본 논문은 전력소모와 면적을 줄인 지연된 피드-포워드 경로를 갖는 3차 SDM 구조를 제안하였다. 제안한 SDM은 기존의 적분기 2개로 구현된 3차 SDM(Sigma-Delta Modulator) 구조를 개선하였다. 제안된 구조에서는 기존 구조의 둘째 단에 지연된 피드-포워드 경로를 삽입함으로써 첫째 단의 계수 값을 2배로 증가시킬 수 있어 기존구조에 비하여 첫째 단 적분기 커패시터($C_I$)를 1/2로 감소시킬 수 있다. 그러므로 첫째 단 적분기의 부하 커패시턴스가 1/2로 작아지기 때문에 첫째 단 연산증폭기의 출력전류는 51%, 첫째 단의 커패시터 면적은 48% 감소되어 제안한 구조는 전력과 면적을 최적화 할 수 있다. 본 논문에서 제안한 구조를 이용하여 설계된 3차 SC SDM은 $0.18{\mu}m$ CMOS 공정에서 공급전압 1.8V, 입력신호 1Vpp/1KHz, 신호대역폭 24KHz, 샘플링 주파수 2.8224MHz 조건으로 시뮬레이션 하였다. 그 결과 SNR(Signal to Noise Ratio) 88.9dB, ENOB(Effective Number of Bits) 14비트이고 SDM의 전체 전력소모는 $180{\mu}W$이다.
Highly proten-conductive elastic composites have been successfully prepared from $H_3PO_4$-doped silica gel and styrene-ethylene-butylene-styrene block elastic copolymer. In addition solid state electric double-layer capacitors have been fabricated using the composite as an electrolyte and activated carbon powders(ACP) hybridized with the composite as a polrizable electrode. The cyclic voltammogram of the electric double-layer capacitor fabricated demonstrated that electric charge was stored in the elecric double-layer at the interface between the polarizable electrode and the electrolyte. The value of capacitance of the capacitor was 10 F/(gram of total ACP), which was comparable to that of the capacitors using conventional liquid electrolytes.
The electrochemical properties of electric double layer capacitor(EDLC) was studied by controlling pore size distribution and specific surface area of the activated carbon fiber(ACF). The mesoporous ACF, which was prepared by the iron exchange method, showed the tendency of increasing average pore size and decreasing total surface area. The mesoporous ACF (surface area = 2225 $m^2$/g, pore size=1.93 nm) showed increased mesopore(pore size=1~3nm) volume from 0.055 cc/g to 0.408 cc/g compared to its raw ACF. The charging capacity of the EDLC which uses the prepared mesoporous ACF also increased from 0.39 F/$cm^2$ to 0.55 F/$cm^2$. From these results, it can be known that the electrochemical properties of EDLC are mainly dependent on the specific surface area, but above the surface area 2200 $m^2$/g, it is the mesopore volume that affects the performance of the capacitor considerably. Because the increased mesopore volume results in a decreased ion mobility resistance, the charge capacitance is enhanced.
This paper proposes a grid-tied photovoltaic (PV) system, consisting of Voltage-fed dual-active-bridge (DAB) dc-dc converter with single phase inverter. The proposed converter allows a small dc-link capacitor, so that system reliability can be improved by replacing electrolytic capacitors with film capacitors. The double line frequency free maximum power point tracking (MPPT) is also realized in the proposed converter by using Ripple Correlation method. First of all, to eliminate the double line frequency ripple which influence the reduction of DC source capacitance, control is developed. Then, a designing of Current control in DQ frame is analyzed and to fulfill the international harmonics standards such as IEEE 519 and P1547, $3^{rd}$ harmonic in the grid is directly compensated by the feedforward terms generated by the PR controller with the grid current in stationary frame to achieve desire Total Harmonic Distortion (THD). 5-kW PV converter and inverter module with a small dc-link film capacitor was built in the laboratory with the proposed control and MPPT algorithm. Experimental results are given to validate the converter performance.
본 논문은 다양한 회로 연결선 모형 중에서 연결선 변수 및 동작 환경에 다라 최적 모형을 쉽게 선택할 수 있는 기준을 제시하고자 한다. 이를 위하여 먼저 연결선의 총 저항, 인덕턴스, 커패시턴스 값 및 신호의 동작주파수를 기반으로 정량적 모형화 오차 분석에 근거하여 인덕턴스의 영향을 고려하여 모형화해야 하는 RLC-class 모형 영역과 그럴 필요가 없는 RC-class모형 영역으로 분할하는 방법을 제시한다. 칩 내부 연결선의 대부분을 차지하는 RC-class 회로 모형은 모형 차수 축소 기법을 통하여 효율적으로 해석될 수 있다. RLC-class 회로 모형은 주어진 허용 모형화 오차 및 전기 변수에 따라 ILC(Iterative Ladder Circuit) 거시 모형, MC(Method of Characteristics)거시 모형 및 상태 기반 컨벌루션(comvolution) 방법 중에서 최적인 모형을 선정하게 된다. 본 논문은 SPICE류의 범용 회로 시뮬레이션 앨고리즘을 가정할 때, 세부 모형들의 시뮬레이션 비용을 감안하고서 최적 모형을 찾는 영역 구성도를 제시한다. 본 논문에서 제시하는 거시모형화 방법은 회로의 수동성을 유지하며, 따라서 무조건적 안정도를 보장할 수 있다.
본 논문에서는 고효율 공진형 비대칭 하프브리지 플라이백컨버터가 제안된다. 컨버터의 1차측 하프브리지 회로는 공진커패시턴스와 변압기 누설인덕턴스를 이용하여 비대칭 펄스폭변조(PWM; Pulse-Width Modulation) 방식에 의한 소프트스위칭 형태로 동작한다. 그리고 컨버터 2차측의 플라이백 회로는 간단한 구동회로에 의해 새로운 전압구동방식으로 동작하는 동기정류기를 이용한다. 제안된 컨버터는 이렇게 하여 컨버터의 전체효율을 향상시킨다. 또한 본 논문에서는 제안된 컨버터의 동작원리를 모드별로 설명하고 컨버터 설계 시의 고려사항과 프로토타입 컨버터의 설계 예를 각각 제시한다. 그리고 본 논문에서 제안하는 전압구동방식으로 동작하는 동기정류기의 간단한 구동기법에 관하여 간략하게 설명한다. 설계된 프로토타입 컨버터는 광범위 입력전압(교류 $V_{in,rms}$=75~265[V])이 가능하며 5[V]의 직류 출력전압과 100[W]의 출력전력을 가진다. 제안된 컨버터의 우수한 성능을 입증하기 위하여 설계된 파라미터로써 프로토타입 컨버터를 제작하여 실험하였으며, 이를 통하여 제안된 컨버터의 우수한 성능을 보인다.
본 연구에서는 화학적으로 활성 흑연나노섬유를 제조하여 그에 따른 전기화학적 거동을 확인하였다. 활성화제로 KOH를 사용하였으며, KOH와 흑연나노섬유의 비를 무게비로 각각 0, 1, 2, 4, 및 5로 처리하여 표면과 기공특성을 연구하였고, 그에 따른 전기화학적 거동을 살펴보았다. 활성화된 흑연나노섬유의 결정구조와 표면특성은 각각 X-선 회절분석법(XRD), 주사전자현미경(SEM) 분석방법을 이용하여 확인하였으며, 기공 특성은 비표면적 장치(BET)를 이용하였으며 질소흡착 등온선에 의해 조사하였다. 전기화학적 특성은 10 mV/s의 주사속도로 순환전류전압(cyclic voltammetry)을 통한 곡선으로 고찰하였으며 정전류법(galvanostatic method)으로 측정된 충방전 곡선을 통해 비축전용량을 계산하였다. 실험 결과로부터, 활성 흑연나노섬유의 전기화학적 거동은 KOH 양이 증가함에 따라 향상되었으며, 4 배 처리된 활성 흑연나노섬유가 최대의 비축전용량을 가진 것으로 나타났다. 이것은 KOH 활성화에 의해 활성 흑연나노섬유의 비표면적과 기공부피가 증가하기 때문인 것으로 사료된다.
본 논문에서는 반도체 집적 회로의 다층 배선 인터커넥트 사이의 기생 캐패시턴스를 수치 해석적으로 계산하여 추출하는 새로운 방법과 그 적용 예를 보고한다. 기생 캐패시턴스를 시뮬레이션을 통해 추출하기 위하여, 복잡한 형태의 3차원 대층배선 구조물을 유한요소법을 이용하여 해석하였다. 캐패시턴스를 추출하기 위한 3차원 다층배선 구조물은 3차원 변환 정보를 가진 2차원 평면 마스크 레이아웃 데이터로부터 생성하였다. 시뮬레이션 결과의 정확도를 검증을 위하여 8.0×8.0×5.0㎛\sup 3\ 크기의 영역에 평행한 두 도전층이 상하로 교차한 구조에 대하여 실험치와 비교하였다. 3차원 다층배선 구조물의 기생 캐패시턴스 추출을 위해서, 유한 요소법 적용을 위한 1,960개의 노드와 8,892개의 사면체 메쉬를 생성하였으며, ULTRA SPARC 1 워크스테이션에 대해서 소요된 CPU 시간은 28초이었으며, 4.4 메가바이트의 메모리를 사용하였다.
In this study, a novel reactive power control scheme is proposed to supply stable reactive power to the distribution line by compensating a ripple voltage of DC link. In a single-phase system, a magnitude of second harmonic is inevitably generated in the DC link voltage, and this phenomenon is further increased when the capacity of DC link capacitor decreases. Reactive power control was performed by controlling the d-axis current in the virtual synchronous reference frame, and the voltage control for maintaining the DC link voltage was implemented through the q-axis current control. The proposed method for compensating the ripple voltage was classified into three parts, which consist of the extraction unit of DC link voltage, high pass filter (HPF), and time delay unit. HPF removes an offset component of DC link voltage extracted from integral, and a time delay unit compensates the phase leading effect due to the HPF. The compensated DC voltage is used as feedback component of voltage control loop to supply stable reactive power. The performance of the proposed algorithm was verified through simulation and experiments. At DC link capacitance of 375 uF, the magnitude of ripple voltage decreased to 8 Vpp from 74 Vpp in the voltage control loop, and the total harmonic distortion of the current was improved.
본 논문에서 제시하는 내용은 수신단의 관문 역할을 담당하는 차동 저 잡음 증폭기를 구현 시, 필연적으로 설계가 필요한 발룬에 대한 분석 내용이다. 발룬은 안테나로부터 입력된 단일 신호를 차동 신호로 변환시켜줌으로써 차동 증폭기의 입력으로 사용될 수 있도록 하는 역할을 담당한다. 이 뿐만 아니라, 안테나를 통해서 들어오는 ESD(Electrostatic Discharge)로부터 회로를 보호하고, 입력 정합에 도움을 준다. 하지만, 일반적으로 사용되는 수동형 발룬의 경우, 두 금속선 사이에 형성되는 전자기적 결합을 통해 교류 신호를 전달하는 방식이므로 이득없이 손실을 가지게 될 뿐 아니라 결론적으로 수신단 전체 잡음 지수 저하에 가장 큰 영향을 미치게 된다. 그러므로, 저 잡음 증폭기에서 발룬의 설계는 매우 중요하며, 선로의 폭, 선로 간격, 권선수, 반경, 그리고 레이아웃의 대칭 구조 등을 고려하여 높은 양호도(quality factor)와 차동 신호의 역위상을 만들어내야만 한다. 본문에서 발룬의 양호도를 높이기 위해 고려해야할 요소들을 정리하고, 설계 요소변경에 따른 발룬의 저항, 인덕턴스, 그리고 캐패시턴스의 변화 경향성을 분석하였다. 분석 결과를 바탕으로 입력 발룬을 설계함으로써 이득 24 dB, 잡음 지수 2.51 dB의 저잡음, 고 이득 차동 증폭기 설계가 가능함을 증명하였다.
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[게시일 2004년 10월 1일]
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