• 한국ITS학회 논문지
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• 제11권5호
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• pp.97-102
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• 2012

본 논문에서는 다양한 초고주파 시스템에서 SIR의 다양한 응용을 위해 반파장 공진기로 등가되는 다단 SIR의 입력 임피던스를 통해 각 단의 전기적 길이 및 고차 하모닉 주파수를 계산하였다. 다단 SIR의 크기 감소율은 단수의 증가에 따라 다소 감소하고 임피던스 비에 의해 지배적으로 영향을 받으며, 하모닉 특성은 단수에 따른 변화가 미미하며 임피던스 비가 작아질수록 기본 공진주파수에서 멀어지게 된다. 또한, 다단 SIR의 등가 임피던스는 가장 낮은 특성 임피던스와 가장 높은 특성 임피던스의 기하평균 값을 가지며 Q 값은 반파장 공진기와 유사한 특성을 보였다.

• 전자공학회논문지SC
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• 제40권6호
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• pp.68-77
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• 2003

생체 임피던스 측정에 사용되는 프론트 엔드의 입력 커패시턴스를 상쇄시키며, 편하고, 작은 이득 여유로도 안정하게 동작하는 제안된 네가티브 커패시턴스 회로를 제안하였다. 기존의 회로를 사용하기 위해서는 적절한 이득-대역폭 적을 갖는 연산 증폭기를 선택해야 하는데 비하여 제안하는 회로는 광대역 연산 증폭기를 사용하므로 연산 증폭기의 선택이 쉽다. 또한 이득 여유가 귀환 커패시터에 직렬로 연결된 귀환 저항에 의하여 조절되므로 이득 여유를 가변 저항기로 튜닝할 수 있다. 제안된 회로의 입력 임피던스는 기존회로의 임피던스보다 2배 크며 네가티브 커패시턴스 회로를 채용하지 않았을 때에 비하여 40배 크다. 나아가서 제안된 회로의 폐루프 위상 응답은 기존의 회로와 네가티브 커패시턴스 회로를 채용하지 않았을 때에 비하여 좋다. 무엇보다도 이득 피킹이 발생하더라도 제안된 회로에서 이득 피킹의 주파수는 루프 이득이 최대로 되는 주파수 보다 높으므로, 이득 여유가 이득 피킹의 영향을 거의 받지 않는다. 따라서 제안된 회로는 매우 작은 이득 여유로도 안정하게 동작할 수 있다.

• Journal of electromagnetic engineering and science
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• 제17권4호
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• pp.191-196
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• 2017

Microwave wireless power transmission (MWPT) is a promising technique for low and medium power applications such as wireless charging for sensor network or for biomedical chips in case with long ranges or in dispersive media such. A key factor of the MWPT technique is its efficiency, which includes the wireless power transmission efficiency and the radio frequency (RF) to direct current (DC) voltage efficiency of RF-DC converter (which transforms RF energy to DC supply voltage). The main problem in designing an RF-DC converter is the nonlinear characteristic of Schottky diodes; this characteristic causes low efficiency, higher harmonics frequency and a change in the input impedance value when the RF input power changes. In this paper, rather than using harmonic termination techniques of class E or class F power amplifiers, which are usually used to improve the efficiency of RF-DC converters, we propose a new method called "optimal input impedance" to enhance the performance of our design. The results of simulations and measurements are presented in this paper along with a discussion of our design concerning its practical applications.

• 센서학회지
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• 제21권1호
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• pp.1-6
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• 2012

Using a current-mode multiple reset, a current-to-voltage(I-V) converter with a wide dynamic range was produced. The converter consists of a trans-impedance amplifier(TIA), an analog-to-digital converter(ADC), and an N-bit counter. The digital output of the I-V converter is composed of higher N bits and lower bits, obtained from the N-bit counter and the ADC, respectively. For an input current that has departed from the linear region of the TIA, the counter increases its digital output, this determines a reset current which is subtracted from the input current of the I-V converter. This current-mode reset is repeated until the input current of the TIA lies in the linear region. This I-V converter is realized using 0.35 ${\mu}m$ LSI technology. It is shown that the proposed I-V converter can increase the maximum input current by a factor of $2^N$ and widen the dynamic range by $6^N$. Additionally, the I-V converter is successfully applied to a photometric sensor.

• 한국항공우주학회지
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• 제43권2호
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• pp.118-124
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• 2015

전파흡수구조(RAS)의 설계는 이산최적화 문제로 확률론적 최적화기법이 적용되며, 효율성을 향상시키기 위해서는 오랜 시간이 소모되는 RCS의 계산량을 감소시켜야 한다. 본 논문에서는 임피던스정합을 이용해 RCS 최소화 단층형 RAS를 설계하기 위한 효과적인 방법을 연구하였다. 연구방법에서는 물리광학법(PO)과 최적화기법의 연동을 통해 전파입사조건에 대해 대상의 RCS가 이상적으로 최소화되는 입력임피던스를 계산하였다. 다음으로 RAS의 복소유전율 및 두께는 이산최적화를 통해 계산된 입력임피던스를 최대한 만족하도록 설계되었다. 연구결과 이러한 방법은 다수의 함수계산이 필요한 확률론적 최적화기법으로 RCS를 직접 최소화한 경우와 동일한 RAS 설계치를 도출하였으며, RCS 해석의 수를 효과적으로 줄임으로써 RAS 설계를 위한 최적화에 소모되는 시간을 크게 감소시켰다.

• 대한전자공학회논문지
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• 제5권1호
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• pp.13-25
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• 1968

고주파용 transistor를 이용한 광대역증폭기를 hybrid-π 등가회로를 이용하여 상세하게 분석하였다. 저주파와 고주파의 경우에 관한 해석을 하였고 이득과 대역폭및 입력 impedance와 출력 impedance를 주는 식을 유도하였다. 직렬궤환증폭기는 전압원으로 구동하여야하며 저저항부하로 동작시켜야 하고 병렬궤환증폭기는 전류원으로 구동하여야 하며 고저항부하로 동작시켜야 하는 것을 표시하였고 이 두가지 증폭단은 완충증폭단이나 변압기결합을 하지않고 결합시킬 수 있음을 표시하였다.

• 한국전자파학회논문지
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• 제25권12호
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• pp.1228-1235
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• 2014

UHF RFID 태그를 설계하기 위해서는 태그 칩의 입력 임피던스 값이 필요하다. 입력 임피던스 산출에는 직접측정 방법이 보편적으로 사용되고 있다. 본 연구에서는 이 방법을 사용할 경우, 칩을 측정장치에 연결하기 위해 도입되는 픽스쳐에서 발생되는 문제점을 분석하고, 그 결과를 확인하였다. 이 문제를 근본적으로 피해갈 수 있는 대안으로 모델링 방법을 제안하고, 실험을 통해 타당성과 정확도를 확인하였다.

• JSTS:Journal of Semiconductor Technology and Science
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• 제13권5호
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• pp.423-429
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• 2013

A 6-Gb/s differential voltage mode driver is presented whose output impedance and pre-emphasis level can be controlled independently. The voltage mode driver consists of five binary-weighted slices each of which has four sub-drivers. The output impedance is controlled by the number of enabled slices while the pre-emphasis level is determined by how many sub-drivers in the enabled slices are driven by post-cursor input. A prototype transmitter with a voltage-mode driver implemented in a 65-nm CMOS logic process consumes 34.8-mW from a 1.2-V power supply and its pre-emphasized output signal shows 165-mVpp,diff and 0.56-UI eye opening at the end of a cable with 10-dB loss at 3-GHz.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2008년도 제39회 하계학술대회
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• pp.1977-1978
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• 2008

In this paper, we compare performance of common-mode rejection between a differential and a non-differential amplifier system with two electrodes. A differential amplifier system is constant for common-mode rejection ratio(CMRR) on the frequency domain. But a non-differential amplifier's CMRR is determined by $Z_{FB}/Z_e$ ($Z_{FB}$ ; feedback impedance, $Z_e$; electrode impedance). There is trade-off between a non-differential amplifier's CMRR and its differential input impedance. And a non-differential amplifier system has some advantages for a bio-potential measurement with two electrodes because a designer can control the impedance between the body and system's common.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2002년도 ITC-CSCC -3
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• pp.1571-1574
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• 2002

This paper describes a circuit and its operations of a programmable digital on-chip terminator designed with CMOS circuits which are used in high speed I/O interface. The on-chip terminator matches external reference resistor with the accuracy of ${\pm}$ 4.1％ over process, voltage and temperature variation. The digital impedance codes are generated in programmable impedance controller (PIC), and the codes are sent to terminator transistor arrays at input pads serially to reduce the number of signal lines. The transistor array is thermometer-coded to reduce impedance glitches during code update and it is segmented to two different blocks of thermometer-coded transistor arrays to reduce the number of transistors. The terminator impedance is periodically updated during hold time to minimize inter-symbol interferences.