In this study, we propose newly designed feedback field-effect transistors that utilize the positive feedback of charge carriers in single-gated silicon channels to achieve steep switching behaviors. The band diagram, I-V characterisitcs, subthreshold swing, and on/off current ratio are analyzed using a commercial device simulator. To demonstrate the changing characteristics of hysteresis, one of the important features of the feedback field effect transistor, we simulated changing the gate insulating material and the gate metal electrode. The fluctuation in the characteristics changed the $V_{TH}$ of the hysteresis and showed a decrease in width of the hysteresis.
Proceedings of the Korean Vacuum Society Conference
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1999.07a
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pp.163-163
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1999
MOSFET, MESFET 그리고 MODFET는 Logic ULSIs, high speed ICs, RF MMICs 등에서 중요한 역할을 하고 있으며, 그것의 gate electrode, contact, interconnect 등의 물질로는 refractory metal을 이용한 CoSi2, MoSi2, TaSi2, PtSi2, TiSi2 등의 효과를 얻어내고 있다. 그중 TiSi2는 비저항이 가장 낮고, 열적 안정도가 좋으며 SAG process가 가능하므로 simpler alignment process, higher transconductance, lower source resistance 등의 장점을 동시에 만족시키고 있다. 최근 소자차원이 scale down 됨에 따라 TiSi2의 silicidation 과정에서 C49 TiSi2 phase(high resistivity, thermally unstable phase, larger grain size, base centered orthorhombic structure)의 출현과 그것을 제거하기 위한 노력이 큰 issue로 떠오르고 있다. 여러 연구 결과에 따르면 PAI(Pre-amorphization zimplantation), HTS(High Temperature Sputtering) process, Mo(Molybedenum) implasntation 등이 C49를 bypass시키고 C54 TiSi2 phase(lowest resistivity, thermally stable phase, smaller grain size, face centered orthorhombic structure)로의 transformation temperature를 줄일 수 있는 가장 효과적인 방법으로 제안되고 있지만, 아직 그 문제가 완전히 해결되지 않은 상태이며 C54 nucleation에 대한 physical mechanism을 밝히진 못하고 있다. 본 연구에서는 증착 시 기판온도의 변화(400~75$0^{\circ}C$)에 따라 silicon 위에 DC/RF magnetron sputtering 방식으로 Ti/Si film을 각각 제작하였다. 제작된 시료는 N2 분위기에서 30~120초 동안 500~85$0^{\circ}C$의 온도변화에 따라 RTA법으로 각각 one step annealing 하였다. 또한 Al을 cosputtering함으로써 Al impurity의 존재에 따른 영향을 동시에 고려해 보았다. 제작된 시료의 분석을 위해 phase transformation을 XRD로, microstructure를 TEM으로, surface topography는 SEM으로, surface microroughness는 AFM으로 측정하였으며 sheet resistance는 4-point probe로 측정하였다. 분석된 결과를 보면, 고온에서 제작된 박막에서의 C54 phase transformation temperature가 감소하는 것이 관측되었으며, Al impuritydmlwhswork 낮은온도에서의 C54 TiSi2 형성을 돕는다는 것을 알 수 있었다. 본 연구에서는 결론적으로, 고온에서 증착된 박막으로부터 열적으로 안정된 phase의 낮은 resistivity를 갖는 C54 TiSi2 형성을 보다 낮은 온도에서 one-step RTA를 통해 얻을 수 있다는 결과와 Al impurity가 존재함으로써 얻어지는 thermal budget의 효과, 그리고 그로부터 기대할 수 있는 여러 장점들을 보고하고자 한다.
Proceedings of the Korean Vacuum Society Conference
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2011.08a
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pp.75-75
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2011
Recently, dye-sensitized solar cell (DSSC) attracts great attention as a promising alternative to conventional silicon solar cells. One of the key components for the DSSC would be the nanocrystalline TiO2 electrode, and the control of interface between TiO2 and TCO is a highly important issue in improving the photovoltaic conversion efficiency. In this work, we applied various interfacial layers, and analyzed their effect in enhancing photovoltaic properties. In overall, introduction of interfacial layers increased both the Voc and Jsc, since the back-reaction of electrons from TCO to electrolyte could be blocked. First, several metal oxides with different band gaps and positions were employed as interfacial layer. SnO2, TiO2, and ZrO2 nanoparticles in the size of 3-5 nm have been synthesized. Among them, the interfacial layer of SnO2, which has lower flat-band potential than that of TiO2, exhibited the best performance in increasing the photovoltaic efficiency of DSSC. Second, long-range ordered cubic mesoporous TiO2 films, prepared by using triblock copolymer-templated sol-gel method via evaporation-induced self-assembly (EISA) process, were utilized as an interfacial layer. Mesoporous TiO2 films seem to be one of the best interfacial layers, due to their additional effect, improving the adhesion to TCO and showing an anti-reflective effect. Third, we handled the issues related to the optimum thickness of interfacial layers. It was also found that in fabricating DSSC at low temperature, the role of interfacial layer turned out to be a lot more important. The self-assembled interfacial layer fabricated at room temperature leads to the efficient transport of photo-injected electrons from TiO2 to TCO, as well as blocking the back-reaction from TCO to I3-. As a result, fill factor (FF) was remarkably increased, as well as increase in Voc and Jsc.
Proceedings of the Korean Vacuum Society Conference
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2012.02a
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pp.161-161
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2012
질화티타늄(Titanium Nitride, TiN)은 화학적 안정성이 우수하고, N/Ti 원소 비율에 따라 열전도성 및 전기전도성이 변화하는 특성을 가지고 있어서 Metal Insulator Silicon (MIS) 나 Metal Insulator Metal (MIM) capacitor의 metal electrode 물질로 적용되고 있다. $TiCl_4$와 $NH_3$ gas를 이용하여 $500^{\circ}C$ 이상의 고온 조건에서 Chemical Vapor Deposition (CVD) 법으로 TiN 박막을 증착하는 방식이 가장 널리 사용되고 있으나, TiN 박막 내의 Chlorine (Cl) 원소가 SiO2 두께와 누설전류 밀도를 증가시키는 요인으로 작용하므로 Cl의 거동 및 함량 제어를 통한 전기적인 특성의 향상 평가가 요구되고 있다[1-3]. 본 실험에서는 $SiO_2$ 위에 TiN을 적층 한 구조에서 magnetic sector type의 Secondary Ion Mass Spectrometry (SIMS)를 이용하여 Cl 원소의 검출도 개선 방법을 연구하였다. 일반적인 $Cs^+$ 이온을 이용하여 $Cl^-$ 이온을 검출할 경우에는 TiN 하부에 $SiO_2$가 존재함에 따른 charging effect와 mass interference가 발생되는 문제점이 관찰되었다. 이를 개선하기 위해 Cl과 Cs 원소가 결합된 $ClCs^+$ cluster ion을 검출하는 방법을 시도하였으나, Cl- 이온 검출 방식에 비해 오히려 낮은 검출도를 나타내었으나 Cl 원소가 속하는 halogen 족 원소의 높은 전자 친화도 특성을 이용한 $ClCs_2^+$ cluster ion을 검출하는 방법[4]을 적용한 경우에는 $ClCs^+$ 방식에 비해 검출도가 3order 개선되는 결과를 확보하였으며, 이 결과를 토대로 Cl dose ($atoms/cm^2$) 와 Rs (ohm/sq) 간의 상관 관계에 대해 고찰하고자 한다.
Transactions on Electrical and Electronic Materials
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v.5
no.5
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pp.169-172
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2004
Deep sub-micron device required to get the superior ultra thin gate oxide characteristics. In this research, I will recommend a novel shallow trench isolation structure(STI) for thin gate oxide and a $N_2$O gate oxide 30 $\AA$ by NO ambient process. The local oxidation of silicon(LOCOS) isolation has been replaced by the shallow trench isolation which has less encroachment into the active device area. Also for $N_2$O gate oxide 30 $\AA$, ultra thin gate oxide 30 $\AA$ was formed by using the $N_2$O gate oxide formation method on STI structure and LOCOS structure. For the metal electrode and junction, TiSi$_2$ process was performed by RTP annealing at 850 $^{\circ}C$ for 29 sec. In the viewpoints of the physical characteristics of MOS capacitor, STI structure was confirmed by SEM. STI structure was expected to minimize the oxide loss at the channel edge. Also, STI structure is considered to decrease the threshold voltage, result in a lower Ti/TiN resistance( Ω /cont.) and higher capacitance-gate voltage(C- V) that made the STI structure more effective. In terms of the TDDB(sec) characteristics, the STI structure showed the stable value of 25 % ~ 90 % more than 55 sec. In brief, analysis of the ultra thin gate oxide 30 $\AA$ proved that STI isolation structure and salicidation process presented in this study. I could achieve improved electrical characteristics and reliability for deep submicron devices with 30 $\AA$$N_2$O gate oxide.
A microstrip gas chamber (MSGC), applied to digital radiography system, was designed and constructed. The microstrip electrodes were fabricated with Chrome(Cr.). by photolithography process on Silicon(Si) wafer and glass substrate. The width of anode and cathode electrodes was $10{\mu}m$, and $290{\mu}m$, respectively. The distance of the electrodes was $100{\mu}m$, and the active area was $50{\times}50mm^2$. And the number of anode was 80. The microstrip electrodes were damaged when discharges occurred over the 600 V of anode voltage. As the result of experiments. It detected the typical output signals of the pulse width, 20 ns, under the condition that the detecting gas was Ar(90%) + $CH_4$(10%), X-ray tube voltage was 42 kV, and tube current was 1 mA.
Trantalum thin films have been prepared by DC sputtering onto As, P, and $BF_2$-implanted ($5{\times}10^15cm^-2$) poly-silicon. The heat treatments by rapid thermal annealing(RTA) have been applied to these samples for the formation of silicides. We have studied the application possibility of Ta-silicide as gate electrode and bit line. The silicide formation and the dopant diffusion after the heat treatment were investigated by various methods, such as four-point probe, X-ray, SEM cross sectional views, ${\alpha}$-step, and SIMS, The tantalum disilicide($TaSi_2$) are formed in the temperature above $800^{\circ}C$, and grown in colummar structure. $TaSi_2$ has a good surface roughness, having range from $80{\AA}\;to\;120{\AA}$, and implanted dopants are incoporated into the $TaSi_2$ layer during the RTA temperature.
본 연구는 요소 센서 제작을 위한 과정으로서, 전기화학적 방법을 이용한 다공질 실리콘 구조 형성과, PDV(Physical Vapor Deposition) 법에 의한 백금 박막 코팅 및 전기화학적 전도성 고분자 코팅과 urease 고정화 단계를 고찰하고 감도 특성을 제시 하였다. 전극 기질로서 B을 도우핑한 p-type 실리콘웨이퍼를 사용하였고, HF:$C_2H_5OH:H_2O$=1:2:1의 부피비를 갖는 에칭 용액에서 5분간 -7 $mA/cm^2$의 일정 전류를 가하여 폭 2 ${\mu}m$, 깊이 10 ${\mu}m$의 다공질 실리콘(PS) 충을 형성하였다. 그 위에 200 ${\AA}$의 Ti 층을 underlayer로서 증착하고, 2000 ${\AA}$의 Pt를 중착하여 PS/Pt 박막 전극을 제작하고, 전도성 고분자로서 polypyrrole (PPy), 또는 poly(3-mehylthiophene) (P3MT)을 전기화학적으로 코팅한 후, urease(EC 3.5.1.5, type III, Jack Bean, Sigma)를 고정화 하였다. 고정화 시 전해질 수용액의 pH는 7.4로 하여 urease표면이 음전하를 갖도록 하고, 전극에 0.6 V (vs. SCE(Saturated Calomel Electrode))의 일정 전압을 가함으로써 urease가 전도성 고분자 표면에 전기적으로 흡착되도록 하였다. 이상의 방법으로 제작한 요소 센서의 감도는 PPy와 P3MT를 전자 전달 매질로 사용한 경우, 각각 8.44 ${\mu}A/mM{\cdot}cm^2$와 1.55 ${\mu}A/mM{\cdot}cm^2$의 감도를 보였다.
Single crystal and polycrystalline Si thin films were doped with phosphorus by a 2-zone diffusion method to develop the low-resistivity polycrystalline Si electrode for a hemispherical grain. Solid phosphorus source was used in order to achieve uniformly and highly doped surface region of polycrystalline Si films having rough surface morphology. In case of 2-zone diffusion method, it is proved that the heavy doping near the surface area can be achieved even at a relatively low temperature. SIMS analysis revealed that phosphorus doping concentration in case of using solid P as a doping source was about 50 times as that of phosphine source at 750$^{\circ}C$. Also, ASR analysis revealed that the carrier concentration was about 50 times as that of phosphine. In order to evaluate the electrical characteristics of doped polycrystalline Si films for semiconductor devices, MOS capacitors were fabricated to measure capacitance of polycrystalline Si films. In ${\pm}$2 V measuring condition, Si films, doped with solid source, have 8% higher $C_{min}$ than that of unadditional doped Si films and 3% higher $C_{min}$ than that of Si films doped with $PH_3$ source. The leakage current of these films was a few fA/${\mu}m^2$. As a result, a 2-zone diffusion method is suggested as an effective method to achieve highly doped polycrystalline Si films even at low temperature.
Woo, Seong Tak;Park, Young Bin;Oh, Da Hee;Ha, Ji-wan
Journal of Sensor Science and Technology
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v.28
no.5
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pp.299-304
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2019
Recently, the development of rehabilitation medical technology has resulted in an increased interest in speech therapy equipment. In particular, research on articulation therapy for communication disorders is being actively conducted. Existing methods for the diagnosis and treatment of speech disorders have many limitations, such as traditional tactile perception tests and methods based on empirical judgment of speech therapists. Moreover, the position and tension of the tongue are key factors of speech disorders with regards to articulation. This is a very important factor in the distinction of Korean characters such as lax, fortis, and aspirated consonants. In this study, we proposed a Korean electropalatography (EPG) system to easily measure and monitor the position and tension of the tongue in articulation treatment and diagnosis. In the proposed EPG system, a sensor was fabricated using an AgCl electrode and biocompatible silicon. Furthermore, the measured signal was analyzed by implementing the bio-signal processing module and monitoring program. In particular, the bio-signal was measured by inserting it into the palatal from an experimental control group. As a result, it was confirmed that it could be applied to clinical treatment in speech therapy.
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[게시일 2004년 10월 1일]
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