Network-on-chip (NoC) is an emerging design paradigm intended to cope with future systems-on-chips (SoCs) containing numerous built-in cores. Since NoCs have some outstanding features regarding design complexity, timing, scalability, power dissipation and so on, widespread interest in this novel paradigm is likely to grow. The test strategy is a significant factor in the practicality and feasibility of NoC-based SoCs. Among the existing test issues for NoC-based SoCs, test access mechanism architecture and test scheduling particularly dominate the overall test performance. In this paper, we propose an efficient NoC-based SoC test scheduling algorithm based on a rectangle packing approach used for current SoC tests. In order to adopt the rectangle packing solution, we designed specific methods and configurations for testing NoC-based SoCs, such as test packet routing, test pattern generation, and absorption. Furthermore, we extended and improved the proposed algorithm using multiple test clocks. Experimental results using some ITC'02 benchmark circuits show that the proposed algorithm can reduce the overall test time by up to 55%, and 20% on average compared with previous works. In addition, the computation time of the algorithm is less than one second in most cases. Consequently, we expect the proposed scheduling algorithm to be a promising and competitive method for testing NoC-based SoCs.
JSTS:Journal of Semiconductor Technology and Science
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제17권4호
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pp.505-513
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2017
As mobile systems are performing various functionality in the IoT (Internet of Things) era, network-on-chip (NoC) plays a pivotal role to support communication between the tens and in the future potentially hundreds of interacting modules in system-on-chips (SoCs). Owing to intensive research efforts more than a decade, NoCs are now widely adopted in various SoC designs. Especially, studies on application-specific NoCs (ASNoCs) that consider the heterogeneous nature of modern SoCs contribute a significant share to use of NoCs in actual SoCs, i.e., ASNoC connects non-uniform processing units, memory, and other intellectual properties (IPs) using flexible router positions and communication paths. Although it is not difficult to find the prior works on ASNoC synthesis and optimization, little research has addressed the issues how to convert different protocols and data widths to make a NoC compatible with various IPs. Thus, in this paper, we address important issues on ASNoC implementation to support and convert multiple interfaces. Based on the in-depth discussions, we finally introduce our FPGA-proven full-custom ASNoC.
사회 기반 시설을 비롯하여 다양한 도메인에서 하나의 시스템이 아닌 다수의 독립 시스템으로 구성된 시스템 오브 시스템즈(System of Systems, 이하 SoS)의 개념이 대두되고 있다. 단일 시스템으로는 만족하기 어려운 복잡한 요구사항을 SoS 수준에서 보다 효과적으로 만족할 수 있을 것으로 기대되기 때문이다. SoS를 구성하는 독립 시스템을 구성 시스템(Constituent System, 이하 CS)이라 부르며, 다수의 CS와 그들의 상호작용을 고려하여 제한된 자원 안에서 SoS 수준의 목표 달성 여부를 검증하는 것이 SoS 공학의 핵심 문제 중 하나이다. 최근 SoS 개발을 위한 기초 연구는 활발하게 이루어졌으나, SoS 모델링 및 검증에 대한 구체적인 사례 기반 연구는 거의 존재하지 않는다. 본 연구는 SoS와 CS가 자신의 목표를 달성하기 위해 독립적으로 의사결정을 수립한다는 특성에 기반을 두어, 개별 행동의 비용과 이익대비 효용을 기준으로 의사결정을 하는 행동-이익-비용(Action-Benefit-Cost) SoS 모델을 제안하고, SoS 예제의 모델링과 정량적 검증 사례 연구를 수행한다.
The structural properties and relaxation processes of $MCsSO_4$ (M = Na, K, or Rb) crystals were investigated by measuring the NMR spectra and spin-lattice relaxation rates $1/T_1$ of their $^{23}Na$, $^{39}K$, $^{87}Rb$, and $^{133}Cs$ nuclei. According to the NMR spectra, the $MCsSO_4$ crystals contain two crystallographically inequivalent sites each for the M and Cs ions. Further, the relaxation rates of all these nuclei do not change significantly over the investigated temperature range, indicating that no phase transitions occur in these crystals in this range. The variations in the $1/T_1$ values of the $^{23}Na$, $^{39}K$, $^{87}Rb$, and $^{133}Cs$ nuclei in these three crystals with increasing temperature are approximately proportional to $T^2$, indicating that Raman processes may be responsible for the relaxation. Therefore, for nuclear quadrupole relaxation of the $^{23}Na$, $^{39}K$, $^{87}Rb$, and $^{133}Cs$ nuclei, Raman processes with n = 2 are more effective than direct processes.
$H_2SO_4$과 Citric acid 은 다른 화학물질보다 토양으로부터 $^{137}Cs$의 추출효율이 높았다. 오래 저장된 방사능오염 토양으로부터 $^{137}Cs$ 제거효율을 높이기 위해 동전기방법에 의한 토양복원 실험 시 $H_2SO_4$과 citric acid를 첨가제로 사용했다. 실험 컬럼으로부터 방출된 방출수의 평균속도는 $2.0{\times}10^{-2}$cm/min이고, 10일 동안 방출된 토양폐액의 부피는 3.6 Pore Volume이다. 10일간 컬럼 내의 $^{137}Cs$의 제거효율이 54%이었다. 한편, 개발된 모델에 의해 계산된 잔류농도 예측 값은 실험으로부터 구한 결과와 거의 일치했다.
10년 이상 된 방사능오염 토양에서 동전기적 방법에 의한 $^{137}$Cs과 $^{60}$Co의 제염효율을 높이기 위해 H$_2$SO$_4$과 시트르산을 첨가제로 사용했다. 동전기 토양복원 컬럼의 방출수 평균속도는 2.0${\times}$$10^{-2}$ cm/min이고, 10일 동안 방출된 토양폐액의 부피는 컬럼의 3.6 공극부피다. 10일간 $^{137}$Cs 의 제거효율이 54%에 불과한 반면에, $^{60}$Co는 97%나 제거되었다. 이것은 $^{137}$Cs의 흡착평형계수가 $^{60}$Co 보다 크기 때문이라고 생각된다. 본 연구에서 제시한 수학적 모델에 의한 컬럼 잔류 오염도는 실험 오차 범위에서 실험결과와 잘 일치하였다.
We have developed the transparent passivation layer for top emission organic light emitting diodes using CsCl thin film by the thermal evaporation method. The CsCl film was deposited on the Ca/Ag semitransparent cathode. The optical transmittance of Ca/ Ag/CsCl triple layer is higher than that of Ca/Ag double layer in the visible range. The device with a structure of glass/Ni/2-TNATA/a-NPD/Alq3:C545T/BCP/Alq3/Ca/Ag/CsCl results in higher efficiency than the device without CsCl passivation layer. The device without CsCl thin film shows a current efficiency of 7 cd/A, whereas the device passivated with CsCl layer shows an efficiency of 10 cd/A. This increase of efficiency isresulted from the increased optical extraction by the CsCl passivation layer.
최근 시스템 온 칩 내 메모리의 고속 동작을 위해 TCM (Tightly Coupled Memory)를 내장한 설계가 크게 증가하고 있다. 본 논문에서는 시스템 온칩 내 eDRAM을 사용한 TCM 메모리를 위한 새로운 병열 메모리 테스트 구조를 제안한다. 제안하는 기법에서 피테스트 메모리가 테스트 모드에서 병렬 구조로 바뀌고 바운더리 스캔 체인과 함께 내장 메모리의 테스트용이도가 크게 향상된다. 병렬테스트 방식의 메모리는 각 메모리 요소들이 특정한 기능을 수행하도록 구조화되어 있으므로 모듈들로 분할하여 테스트 할 수 있으며 입출력 데이터를 기반으로 동적 테스트 평가 가능하다. 시뮬레이션을 통하여 제안한 기법의 타당성을 검증하였다.
본 논문에서는 생체 정보를 이용한 사용자 인증분야에서 가장 널리 사용되는 지문의 특징점 추출기의 SoC(System-on-Chip) 구현을 보인다. 일반적인 지문 특징점 추출 방식은 이진화, 세선화 방법을 사용하는데, 저화질 지문 이미지의 경우 많은 오류가 발생하여 지문인식시스템 전체의 정확도를 떨어뜨리는 문제가 있다. 이러한 문제를 해결하기 위해 지문 이미지에서 융선을 직접 추적하여 특징점을 추출하는 알고리즘이 제안되었으나, 연산량이 많아 스마트카드와 같은 소규모 시스템에서 소프트웨어만으로 수행하기 어렵다는 문제점이 있다. 본 논문에서는 융선추적 알고리즘을 스마트카드용 SoC에서 구현하기 위한 방법을 제안한다. 하드웨어의 효율성을 높이기 위하여 융선추적 알고리즘을 변형하였으며, 알고리즘의 각 기능 블록은 수행할 연산량, 하드웨어 비용과 활용도, 그리고 시스템 효율성 등이 고려되어 하드웨어와 소프트웨어로 분리 구현되었다. 구현된 용선추적을 이용한 지문 추출기는 SoC용 IP로 개발이 되어, 여러가지 스마트카드용 SoC에서 사용될 수 있다.
This study investigated the effect of a coaching system(CS) on the employee's job satisfaction(JS) between the food service industry conducting and not conducting CS. A total of 342 employees were enrolled and the results were as follow. Firstly, relationship and willingness factors directly affected JS. Indirectly, work and relationship factors affected JS through the willingness factors. Secondly, when JS was compared at the service company conducting CS with that not conducting CS, work and relationship factors directly affected JS in the industry conducting CS, but only the relationship factor indirectly affected JS in the company not conducting CS. In addition, at the food service industry conducting CS, work factor affected willingness and competence factors, and therefore JS was affected indirectly, but relationship factor did not affect the willingness and competence factors. However, in the company not conducting CS, willingness only affected JS indirectly. Work factors directly affected JS, but through competence and willingness factors, work factor indirectly affected JS in the industry conducting CS. In the company not conducting CS, the relationship factor between employees affected the JS. In summary, CS increased JS through its direct effect on the work factor and indirect effect on the willingness and competence factors. Studies about CS are insufficient and CS remains in the introductory stage now, so further studies are necessary.
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[게시일 2004년 10월 1일]
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