This study presented facile method of cell patterning using fabricated PDMS patterns on polyelectrolyte coated surface. This basic principle is the fabrication of functional surface presenting two orthogonal surfaces such as cell adhesive and repellent properties. Cell adhesive surface was firstly fabricated with simple coating of polyelectrolyte multilayer. And then, the desired patterns of PDMS for the prevention of nonspecific binding of cells were transferred onto the previously formed thin film of polyelectrolyte multilayer. Thus, we could prepare novel functional surface simultaneously containing PDMS and polyelectrolyte region. As expected, the PDMS regions showed effective prevention of nonspecific binding of cell and the other region, exposed polyelectrolyte area, provided cell adhesive environment. The height of formed PDMS structure was about 100 nm. Based on this method, cell patterning can be successfully obtained with various pattern shapes and sizes. Therefore, we expect that this simple method will be useful platform technology for the development of cell chip, cell based assay system, and biochip.
I. 목적 : Sebaceous gland carcinoma, Squamouse cell ca., basal cell ca., low grade MALToma 등에서 전자선을 이용하여 eyelid 치료시 안구의 선량은 될 수 있는 한 최소선량으로 관리되어야 한다. 그러나 upper나 lower eyelid 전부를 포함하는 조사면은 치료후 백내장등의 심각한 부작용을 만들어 낼 수 있다. 본원에서는 상용되는 Tungsten eyeball shielding block과 기존의 lead block에 의한 차폐시 안구의 선량을 비교하여 Tungsten eyeball shielding block의 유용성에 대해 평가해 보고자한다. 2. 재료 및 방법: 시판되고 있는 BOLX-I 물질을 이용하여 모형안구를 제작하고 안구의 6곳 주요지점을 선정한 후 TLD chip을 이용하여 주로 사용되는 6MeV와 9MeV electron beam의 선량을 측정, Tungsten eyeball shielding block과 lead block의 선량을 비교하였다. 3. 결과 : Tungsten eyeball shielding block의 사용이 안구의 주요 지점인 각막, 망막, 시신경부위의 선량을 lead block사용 때보다 $90\%$에서 $50\%$의 감소효과가 있었다. 4. 결론 : Tungsten eyeball shielding block은 6MeV 전자선 치료시 보다 뛰어난 차폐효과를 보여 임상에서의 유용성이 인정되었다. 그러나 안구에 삽입시 환자의 고통과 불쾌감을 줄일 수 있는 방안이 모색되어야 하는 숙제를 남겼다.
본 논문은 PDMS을 기반으로 한 미세접촉인쇄법을 사용하여 보다 효율적으로 지방세포를 선택적으로 배양접시에 부착시켰으며 패터닝 된 배양접시에서 지방세포가 빠르게 지방분화를 가능하게 하였다. PDMS을 이용한 선택적 표면 처리 방법은 기존의 세포칩 제작과 달리 소량의 유기용매사용, 저가의 장비 사용, 또한 효율적으로 특정 지역 안에서 지방세포를 고정화하고 성장시킬 수 있으며 이를 통해 지방세포의 생리학적 상태를 손쉽게 관찰할 수 있는 분석 기술로 활용된다. 이렇게 구성된 지방세포칩 위에 대표적인 비만 억제제 약물인 Orlistat을 $0.2{\mu}M{\sim}5.0{\mu}M$ 농도로 처리하였을 때 대조군에 비하여 최대 26.5%의 억제 효과가 나타남을 확인하였다. 따라서, 본 논문에서 제안하는 방법을 통하여 다양한 비만 억제제 약물 탐색을 위한 세포칩으로 활용이 가능할 것으로 기대된다.
We have proposed a novel planar lightwave circuit (PLC) optical sensor to monitor the contamination in a flow-cell where water is continuously supplied through a water quality measurement system. We designed a PLC chip with a V-shape waveguide and the simulated its function as a sensor for monitoring contamination in a flow-cell using a numerical the FDTD (finite-difference time-domain) analysis. A novel cross type of waveguide was introduced to make the PLC chip of the V-shaped waveguide. The fabricated PLC was cut into the cross waveguide. A change in the optical propagation loss of the PLC sensor was observed after immersing the PLC sensor into city water. It was determined that the propagation loss of the PLC sensor was 3 dB at a wavelength of $1.55{\mu}m$ in the city water for 15 days.
A surface plasmon resonance (SPR) imaging system was constructed and used to detect the hexahistidine-ubiquitin-tagged human parathyroid hormone fragment (His$\sub$6/-Ub-hPTHF(1-34)) expressed in Escherichia coli. The hexahistidine-specific antibody was immobilized on a thin gold film coated with ProLinker$\^$TM/ B, a novel calixcrown derivative with a bifunctional coupling property that permits efficient immobilizaton of capture proteins on solid matrices. The soluble and insoluble fractions of an E. coli cell lysate were spotted onto the antibody-coated gold chip, which was then washed with buffer (pH 7.4) solution and dried. SPR imaging measurements were carried out to detect the expressed His$\sub$6/-Ub-hPTHF(1-34). There was no discernible protein image in the uninduced cell lysate, indicating that non-specific binding of contaminant proteins did not occur on the gold chip surface. It is expected that the approach used here to detect affinity-tagged recombinant proteins using an SPR imaging technique could be used as a powerful tool for the analyses of a number of proteins in a high-throughput mode.
전자장치의 복잡도 증가와 전원 전압 감소 추세에 따라, 내부 또는 외부에서 발생되는 노이즈에 대한 칩 또는 모듈의 전자기 내성 평가는 필수적이다. 칩 레벨 EMS 표준 시험방법으로 IEC 62132-4의 Direct Power Injection(DPI) 방법이 있지만, 실제 칩 내성은 모듈 상 보드 PDN 구조에 영향 받는다. 이 논문에서는 PLL의 내성을 평가하고 보드의 PDN 구조에 따른 잡음 전달 특성을 비교하였다. 여러 PDN을 만들기 위해 다양한 값의 커패시터들과 LDO 사용 유무 조건이 적용되었다. IC의 전자기 요구사항과 IC 및 보드로 구성된 모듈의 전자기 요구사항 간 불일치를 평가하기 위해, PDN들에 따른 노이즈 전달 특성을 분석하는 것은 강건한 EM 특성을 갖도록 설계하는데 중요한 정보를 줄 수 있음을 보였다. DPI 측정 결과는 LDO 사용에 따라 PLL 저주파 영역의 내성이 크게 개선되었음을 보여주며, DPI에 따른 PLL의 주파수 변화를 TEM cell 스펙트럼 측정으로도 확인 할 수 있었다.
It is important to operate the driving circuit under the optimal condition through precisely sensing the power consumption causing the temperature made mainly by the MOSFET (metal-oxide semiconductor field-effect transistor) when a BLDC (Brushless Direct Current) motor operates. In this letter, a Super-junction (SJ) power TMOSFET (trench metal-oxide semiconductor field-effect transistor) with an ultra-low specific on-resistance of $0.96m{\Omega}{\cdot}cm^2$ under the same break down voltage of 100 V is designed by using of the SILVACO TCAD 2D device simulator, Atlas, while the specific on-resistance of the traditional power MOSFET has tens of $m{\Omega}{\cdot}cm^2$, which makes the higher power consumption. The SPICE simulation for measuring the power distribution of 25 cells for a chip is carried out, in which a unit cell is a SJ Power TMOSFET with resistor arrays. In addition, the power consumption for each unit cell of SJ Power TMOSFET, considering the number, pattern and position of bonding, is computed and the power distribution for an ANSYS model is obtained, and the SJ Power TMOSFET is designed to make the power of the chip distributed uniformly to guarantee it's reliability.
In a lithium-ion battery which is being used in many portable electronic goods, electrolyte is disaggregated and then the gas is happened when electric charging volt is over the 4.5V. So, the pressure on the safety valve is increased and electrolyte is leaked out in the cell. It leads to the risk of explosion. On the other hand, in the case which the battery is discharged excessively, the negative pole is damaged and the performance of the battery is deteriorated. The protection module of a lithium-ion battery is used for preventing such risk and the inspection system is needed to check the performance of such protection module. In this research, a PC-based auto inspection system is developed for the inspection of a battery protection module using Dallas chipset. In the inspection system, AVRl28 chip is used as a controller and the communication protocol is developed for the data communication between the protection module and the AVR128 chip. And GPIB interface is used for the control of measuring devices. Also, MMI environment is developed using LabView for convenient monitoring by the tester.
본 논문에서는 게이트 어레이 방식의 레이아웃 설계를 위한 새로운 배치 알고리듬을 제안한다. 제안된 배치 알고리듬은 서로 크기가 다른 마크로셀을 처리할 수 있으며, I/Q pad의 위치를 고려함으로써 칩의 내부 영역과 I/Q pad간의 배선을 효율적으로 자동화한다. 알고리듬은 초기 분할, 초기 배치 개선의 3단계로 구성된다. 초기 분할 단계에서는 각 I/Q pad의 위치를 고려하여 clustering에 의해 전체 회로를 5그룹으로 분할한다. 초기 배치 단계에서는 각 I/Q pad 및 주변 그룹과의 연결도를 고려한 clustering/min-cut 분할에 의해 각 셀의 위치를 할당한다. 또한, 배치 개선에서는 확률적 배선 밀도 함수를 도입하여 칩내의 배선 밀도를 균일화하기 위한 셀 이동 알고리듬을 제안한다.
In this paper, an IC realization of a cell-network type SC DC-DC converter is reported. To achieve small and low-cost realization, the converter is designed by using a 1.2 $\mu\textrm{m}$ CMOS technology. The CMOS implemented converter will be useful as a building block of various mobile equipments since step-up and step-down voltages can be provided at one time. Concerning the proposed DC-DC converter, SPICE simulatiorls are performed to investigate the characteristics of the circuit. The SPICE simulations show that, the efficiency of the simulated circuit is more than 95 %. From the layout design using a CAD tool, MAGIC, the VLSI chip is fabricated in the chip fabrication program of VLSI Design and Education Center(VDEC), the University of Tokyo with the collaboration by On-Semiconductor. The proposed circuit is integrable by a standard 1.2 $\mu\textrm{m}$ CMOS technology.
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[게시일 2004년 10월 1일]
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