• 제목/요약/키워드: 클럭 오차

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위성 클럭 에러 추정 정확도에 따른 정밀 단독 측위 성능 분석 (The Analysis of Performance of Precise Single Positioning according to estimation accuracy of Satellite Clock Error)

  • 장우;신윤호;신현식
    • 한국전자통신학회논문지
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    • 제7권2호
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    • pp.327-332
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    • 2012
  • 본 논문에서는 관측소 지리적 위치에 의한 대류권 파라미터에 따른 위성 클럭오차 특성을 분석한 것으로 PANDA 소프트웨어를 이용하여 관측소 거리의 간격에 따른 GPS 위성 클럭오차에 따른 정밀단독측위의 성능을 연구하여 결과를 제시하였다. 분석 결과에 의하면 거리의 간격이 200km 이하인 경우에는 대류권 파라미터와 위성 시계 오차 파라미터의 관련성이 크며, 최대 0.8ns의 클럭 오차를 발생하였다. 또한 거리의 간격이 500km이상인 경우에는 위성 클럭 오차와 대류권 파라미터의 관련성이 현저하게 감소됨을 알 수 있었다.

지연된 n-탭 상승 에지 클럭을 이용한 위상 오차 검출기의 설계와 DP-PLL에의 적용 (The design of phase error detector based on delayed n-tap rising edge clock:It's DP-PLL system application)

  • 박군종;구광일;윤정현;윤대희;차일환
    • 한국통신학회논문지
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    • 제23권4호
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    • pp.1100-1112
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    • 1998
  • 본 연구에서 망동기 시스템의 동기 기준 클럭과 시스템 클럭간에 발생하는 위상 오차를 최소화하기 위한 새로운 위상 오차 검출방식이 제안되었고 이 방식을 디지털 처리 위상 동기 루프(digital processing phase locked loop:DP-PLL) 시스템에 적용하였다. 두 클럭간에 발생하는 위상 오차는 지연된 n-탭 상승 에지 클럭으로 구성한 위상 오차 검출기에 의해 위상 오차 변이 (PEV:Phase Error Variation)로 출력된다. 위상 오차 변이는 5ns해상도로 검출되며 검출된 위상 오차 변이는 알고리즘에 의해 최적의 D/A변환기 계수를 추적하면서 위상 동기를 유지한다. 실험결과 위상 검출기는 빠르고 정확한 위상 추적 특성을 갖고 있으며 루프제어 알고리즘은 우수한 지터 억압 특성을 나타내었다.

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위성 멀티미디어 시스템을 위한 랜덤 지연지터에 강인한 기준 클럭 복원 (A Robust Recovery Method of Reference Clock against Random Delay Jitter for Satellite Multimedia System)

  • 김원호
    • 융합신호처리학회논문지
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    • 제6권2호
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    • pp.95-99
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    • 2005
  • 본 논문은 DVB-RCS 규격과 폐루프 버스트 동기 제어 방식을 적용한 양방향 위성 멀티미디어 시스템의 망동기 기준클럭 복원을 위한 정밀한 복원방식을 제안한다. 이러한 시스템의 단말은 TDMA 리턴링크 통신을 위한 기준클럭을 MPEG-2 규격에 정의된 PCR (Program Clock Reference)을 중심국에서 방송하고 단말은 이를 복원하여 사용한다. PCR은 중심국에서 시스템 클럭 (27MHz $\pm$ 30ppm)을 주기적으로 샘플링 하여 각 단말로 방송하는데 단말에서 수신되는 PCR값은 위성을 포함한 전송경로에서 발생되는 가변적인 전달 지연시간 변동으로 인한 오차 때문에 일반적인 디지털 PLL(DPLL) 방식에 의해서는 복원된 기준클럭의 주파수와 중심국의 기준클럭 주파수간의 동기를 주어진 범위 이내로 정확하게 유지하기가 힘들다. 본 논문에서는 수신되는 PCR 패킷의 랜덤한 전달지연시간 번동으로 인해 발생되는 기준클럭의 복원오차를 줄일 수 있는 방식을 제시하고 시뮬레이션을 통하여 성능을 평가하였다. 제안한 방식은 일반적인 DPLL방식에 비해 기준클럭의 복원오차가 1/5로 현저하게 감소되는 성능을 보여 주었다.

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무선 LAN 시스템에서 CCK 변조방식의 클럭 동기 성능 분석 (Performance Analysis on Clock Sychronization of CCK Modulation Scheme in Wireless LAN System)

  • 박정수;강희곡;조성언;조성준
    • 한국정보통신학회:학술대회논문집
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    • 한국해양정보통신학회 2004년도 춘계종합학술대회
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    • pp.583-586
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    • 2004
  • 본 논문에서는 2.4 GHz대역에서 54 MbPs 고속 데이터 전송이 가능한 IEEE 802.11g 무선 LAN 시스템에서 사용되는 변조 방식인 CCK(Complementary Code Keying)의 클럭 동기에 대해서 연구했다. 수신단에서는 잡음 또는 페이딩에 의해 클럭 주파수 오차가 발생한다. 이 주파수 오차는 클럭 타이밍 오프셋을 발생시켜 ISI(InterSymbol Intorference)의 원인이 된다. 그러므로 클럭 타이밍 오프셋을 줄이기 위해서는 트렉킹이 필요하다. 본 논문에서는 클럭 트렉킹을 위해 비동기 방식인 DLL(Delay Lock Loop)방식을 이용하여 시뮬레이션을 수행하였다. AWCN 환경과 실외 다중경로 페이딩 채널환경에 대한 지터 분산과 이에 따른 BER 성능을 비교한다.

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무선 센서 네트워크에서의 개선된 시각 동기화 구현 (Implementation of an Improved Time Synchronization in Wireless Sensor Networks)

  • 방상원;손석원
    • 한국컴퓨터정보학회:학술대회논문집
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    • 한국컴퓨터정보학회 2013년도 제48차 하계학술발표논문집 21권2호
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    • pp.69-72
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    • 2013
  • 본 논문은 TPSN 알고리즘의 시각 동기화 오차를 개선하기 위하여 Imote2 센서 노드의 클럭 드리프트 특성을 적용하는 개선된 TPSN 알고리즘을 제안한다. 클럭 드리프트의 원인은 주로 수정발진기에 기인한다. 본 연구에서는 온도 및 습도 등 환경 조건이 비슷할 경우에 드리프트가 크게 차이나지 않는다는 실험 결과에 따라 드리프트의 평균값을 구하고 이를 TPSN 동기화 오차 보정에 사용한다. 이때 적용되는 드리프트 특성 값은 센서 노드 설치 이전에 미리 측정하여야 한다. 실험을 통하여 본 논문에서 제안한 개선된 TPSN 알고리즘이 동기화 오차 개선에 효과적임을 확인하였다.

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인터넷전화 이용자 체감품질 측정을 위한 측정데이터 간의 시간동기화 (Time Synchronization of the Monitoring Data for the VoIP User Assessment of Voice Quality Measurement)

  • 권태훈;황혜정;이석기;송한춘;원승영
    • 한국콘텐츠학회논문지
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    • 제5권4호
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    • pp.227-236
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    • 2005
  • 인터넷전화 이용자 체감품질을 측정함에 있어 측정시스템 간의 시간동기화가 중요하다. 현재 시스템의 시간동기를 하는 방법에는 NTP 또는 GPS를 이용하여 시간동기화를 하고 있으나 NTP 서버와 시스템간의 거리에 따른 시간적 오차, GPS로부터 수신된 데이터를 처리하는 과정에서의 지연시간, 시스템 클럭의 특성에 따라 발생하는 오차와 같은 문제로 인해 측정시스템 간의 시간동기가 어려운 실정이다. 본 논문에서는 측정데이터의 시간동기를 위해 측정시스템 간의 시간적 오차와 클럭 특성에 의해 발생되는 오차를 보정하여 신뢰성 있는 품질측정 결과를 생성하는 시간동기화 방식을 제안하고 구현하였다.

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위성 DMB용 중계기(Gap Filler)의 TDM-CDM변환부 클럭 생성 방안 연구 (A Clock Generation Scheme for TDM-CDM Converter in Gap Filler for the Satellite DMB Systems)

  • 김종훈
    • 대한전자공학회논문지TC
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    • 제44권1호
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    • pp.93-97
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    • 2007
  • 본 논문에서는 위성 DMB용 Gap Filler의 TDM-CDM변환부를 위한 클럭 생성 방안을 제안하였다. 제안된 방식은 위성으로 부터 수신되는 Ku band(12.2GHz) 대역의 TDM신호에서 복조된 프레임 동기 신호를 기반으로 신호 변환 시스템의 클럭을 공급하는 VCXO(Voltage Controlled Crystal Oscillator)를 제어하여 신호 변환부의 클럭 및 데이터 동기를 제공한다. 기존의 일반적인 클럭 동기 방식과 같은 별도의 PLL을 구성할 필요 없이 Gap Filler의 디지털 신호 변환부에 사용되는 FPGA내부에 간단히 구현될 수 있으며, 주파수 오차범위를 측정 제어할 수 있는 기능을 포함하고 있어 안정도가 높은 OCXO(Oven Controlled Crystal Oscillator)를 사용할 경우 RF부에 필요한 LO( Local Oscillator)를 위한 기준 클럭으로 사용될 수 있다.

PLL을 이용한 고속 마이크로프로세서용 32MHz~1GHz 광대역 클럭발생회로 (A PLL Based 32MHz~1GHz Wide Band Clock Generator Circuit for High Speed Microprocessors)

  • 김상규;이재형;이수형;정강민
    • 한국정보처리학회논문지
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    • 제7권1호
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    • pp.235-244
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    • 2000
  • 본 연구에서 PLL을 이용한 고속 마이크로프로세서용 클럭발생회로를 설계하였다. 이 회로는 32MHz${\sim}$1GHz 클럭을 발생시키며 마이크로프로세서내에 내장될 수 있다. 동적 차동래치를 사용하여 고속 D Flip-Flop을 설게하였고 이에 의거한 새로운 형태의 위상주파수 검출기를 제시하였다. 이 검출기는 위상민감도오차가 매우 적으며 이를 사용한 PLL은 위상오차가 적은 우수한 위상특성을 지닌다. 또한 전압제어발진기 VCO의 선형적 제어를 위하여 전압-전류 변환기가 구동하는 전류제어 발진기로 구성된 새로운 구조의 VCO를 제시하였다. 이러한 PLL에서 제어전압 범위를 1V${\sim}$5V로 넓히고 발생클럭의 주파수를 32 MHz${\sim}$1 GHz로 증가시킬 수 있었다. 클럭발생회로는 $0.65\;{\mu}m$ CMOS 기술을 이용하여 설계하였다. 이 회로는 $1.1\;{\mu}s$의 lock-in 시간과 20mW 이하의 전력소비를 갖는다.

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LCOS 마이크로디스플레이 구동용 보정회로 설계 (Design of Calibration Circuit for LCOS Microdisplay)

  • 이연성;위정욱;한충우;송남철
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2022년도 추계학술대회
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    • pp.469-471
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    • 2022
  • 본 논문에서는 아날로그 구동 방식의 4K UHD LCOS 패널을 구동하기 위해 디지털 픽셀을 아날로그 픽셀로 변환하는 과정에서 발생되는 이득 오차, DC 옵셋, 샘플링 클럭의 위상 오차를 보정하기 위한 보정회로의 구현 방법을 기술한다. 제안된 보정회로는 이득 및 DC 옵셋 보정 회로와 샘플링 클럭 위상 조정 회로로 구성되며, FPGA와 비디오 앰프를 이용하여 구현하였다.

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소프트웨어 기반 의사위성 시각동기 기법 성능평가를 위한 오차 요소 분석 (An Analysis of Error Factors for Software Based Pseudolite Time Synchronization Performance Evaluation)

  • 이주현;이선용;황소영;유동희;박찬식;이상정
    • 한국항행학회논문지
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    • 제18권5호
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    • pp.429-436
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    • 2014
  • 본 논문에서는 의사위성과 GPS 위성 사이의 시각동기를 위한 세가지 동기 방안을 제안하고 시각동기 기법의 성능 분석에 필요한 의사위성 시각동기 오차요소에 대해 분석한다. 제시한 세가지 시각동기 방안으로는 의사위성 시각동기 스테이션 구축 방안, UTC(KRIS)의 시각정보원을 활용한 의사위성 시각동기 방안, GPS 시각용 수신기를 활용한 시각동기 방안이 있다. 또한 제안한 의사위성 시각동기 방안의 성능평가를 위한 시뮬레이션 구성을 위해 의사위성 시각동기 방안의 오차요소를 의사위성 및 기준 클럭의 오차, 전송선로에 의해 발생하는 오차, TIC에 의해 발생하는 오차, 클럭 동기 알고리즘에 의해 발생하는 오차로 구분하고 각 오차 요소를 분석하였다.