• 제목/요약/키워드: 유효 비트

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시간-보간법을 활용한 5-bit FLASH ADC (5-bit FLASH A/D Converter Employing Time-interpolation Technique)

  • 남재원;조영균
    • 융합정보논문지
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    • 제11권9호
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    • pp.124-129
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    • 2021
  • 본 연구는 시간-보간법을 적용한 FLASH analog-to-digital converter (ADC)에 관한 것이다. 시간-보간법은 기존의 FLASH ADC에서 요구되는 전압영역 비교기의 개수를 줄일 수 있으며 이 따른 전력 소모 및 칩 면적의 절약을 기대할 수 있다. 본 연구에서는 5-bit, 즉 31개의 양자화 레벨을 갖는 ADC를 설계 및 구현하였으며, 16개의 양자화 레벨은 기존의 전압영역 비교기 방식을 유지하고, 나머지 15개의 양자화 레벨은 시간영역 비교기를 통하여 처리되도록 구성하여, 기존 5-bit FLASH ADC 대비 전압영역 비교기의 숫자를 48.4% 줄일 수 있었다. 시제품은 14 nm Fin Field-effect transistor (FinFET) 공정으로 제작되었으며 구현면적은 0.0024 mm2, 전력소모는 0.8 V 전원전압에서 0.82 mW로 측정되었으며, 400 MS/s의 변환속도 21 MHz 정현파 입력에 대하여 ADC는 28.03 dB의 신호-대-잡음비 (SNDR), 즉 4.36 유효비트(ENOB)의 성능을 보였다.

ATM-PON의 OLT에서 상향 셀 위상감시를 위한 예측기의 구현 (Implementation of a Predictor for Cell Phase Monitoring at the OLT in the ATM-PON)

  • 문상철;정해;김운하
    • 한국통신학회논문지
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    • 제27권2C호
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    • pp.160-169
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    • 2002
  • ATM PON (Passive Optical Network) 시스템은 OLT (Optical Line Termination)와 다수의 ONU (Optical Network Unit), 그리고 스플리터와 함께 PON을 구성하는 광케이블로 구성된다. 상향 전송에서 셀 충돌을 피하기 위하여, 새로운 ONU가 설치될 때 ranging이라는 정교한 절차를 필요로 한다. 이 절차가 종료된 후에 ONU는 OLT가 제공하는 승인에 따라 상향 셀을 전송할 수 있다. 여러 가지 요인의 변화에 의해 발생할 수 있는 셀 충돌을 예방하기 위하여, OLT는 지속적으로 셀 위상 감시를 수행해야 한다. 이는 OLT가 모든 상향 셀에 대하여 기대되는 도착 시점을 예측하고, 실제 도착하는 시점을 감시하여, 두 시점 간의 오차를 계산하는 것을 의미한다. 따라서, OLT의 TC (Transmission Convergence) 칩에는 현재 제공하는 승인에 대한 셀의 도착할 시점을 계산할 수 있는 예측기가 필요하다. 본 논문에서는 이러한 예측기를 등화왕복지연에 해당하는 길이를 갖는 이동 레지스터를 이용하여 구현한다. 하나의 레지스터는 8 비트로 구성되어, OLT는 어떤 ONU가 어떤 종류의 셀을 보내는지 확인할 수 있다. 또한 TC 칩은 예측기의 기능을 이용하여 ONU의 유효 대역폭을 계산할 수 있다. 타임 시뮬레이션과 구현된 광 보드를 측정하여, 예측기의 동작을 확인한다.

한일상관기의 잔차 지연 보정 알고리즘의 개선 (Improvement of Residual Delay Compensation Algorithm of KJJVC)

  • 오세진;염재환;노덕규;오충식;정진승;정동규
    • 융합신호처리학회논문지
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    • 제14권2호
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    • pp.136-146
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    • 2013
  • 본 논문에서는 FX 형식의 한일상관기(Korea-Japan Joint VLBI Correlator, KJJVC)의 잔차 지연 보정 알고리즘을 제안하였다. KJJVC의 초기 잔차 지연보정 알고리즘에는 연산의 고속화를 위해 정수 연산과 위상보정 계수를 위한 cos/sin table을 도입하였다. 그리고 잔차 지연 알고리즘의 초기설계에서 데이터의 타이밍과 잔차 지연 위상의 불일치와 비트쉬프트와 잔차 지연 위상의 불일치 문제를 해결하였다. VCS의 잔차 지연 알고리즘의 최종 설계에서는 잔차 지연보정된 값을 FFT segment에 적용할 때 잔차 지연 보정 회전 메모리가 초기화 되지 않는 것을 수정하였다. 제안한 잔치 지연 보정 알고리즘을 이용하여, 교차 전력 스펙트럼의 대역폭 모양이 모든 대역폭에 대해서 손실이 없이 평탄한 것을 확인하였다. 제안한 잔차 지연보정 알고리즘의 유효성을 확인하기 위해 시뮬레이터와 KJJVC를 이용하여 실제 관측데이터를 대상으로 상관처리 시험을 수행하였다. 실험결과를 통하여 제안한 잔차 지연 보정 알고리즘이 KJJVC에 잘 적용되고 있으며, 신호대 잡음비가 약 8% 향상되는 것을 확인하였다.

모돈 행동 특성 분석을 위한 마이크로 클러스터링 기술 연구 (A Study on Micro Clustering Technology for Breeding Pig Behavior Analysis)

  • 조진호;오종우;이동훈
    • 한국농업기계학회:학술대회논문집
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    • 한국농업기계학회 2017년도 춘계공동학술대회
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    • pp.165-165
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    • 2017
  • 모돈은 사육 특성상 제한된 파일롯 공간 안에 장시간 머물기 때문에 과중한 몸무게에 의한 지제 이상, 섭식 등의 불량, 수면상태의 불량 등을 지속적으로 관찰해야 하는 대상이다. 측면에 다수의 초음파 센서를 설치하여 기립의 상태 및 운동 시 몸체 궤적의 특성을 분석하여 종합적으로 모돈의 행동 특성을 정량화 하고자 하였다. 이 과정에서 계측 신호의 값을 대수적으로 비교하는 방식에 한계가 있음을 발견하였고, 이를 해결하고자 10 Hz/Ch 내외의 시계열 상대거리 궤적 신호를 주파수 도메인으로 변경하여 분석을 수행하였다. 일정 주파수에 집중되어 있는 주파수 값의 크기 변화(파워 스펙트럼 밀도)를 기준으로 모돈의 움직임의 정상 상태 유무 판별이 가능하였다. 단, 이러한 분석은 계측 데이터를 일괄 처리 방식으로 분석하는 방법으로 도출이 되었으므로, 계측과 정량 분석을 동시에 수행하기 위한 개선이 필요하였다. 계측 시스템에서 사용한 마이크로 프로세서는 Nucleo-446(STMelectronics, CA, USA)로 180 Mhz의 클럭 속도로 작동하나, 총 100 Hz 내외의 16비트 계측 신호에 대해 추가적으로 FFT 등의 주파수 변환 신호 처리를 수행하기에는 연산 능력이 부족하였다. 한편, 주파수 분석의 주기를 1분 단위로 할 경우 처리해야할 정보의 크기는 $100{\times}60{\times}5{\times}2Byte$ 이므로 1분 내에 해당 연산을 종료할 수 있는 추가의 연산 장치가 필요하였다. 계측과 주파수 도메인 변환 연산을 동시에 수행하기 위하여 1 Ghz의 연산능력을 가진 ARM A9 계열의 초소형 멀티코어 AP인 NanoPi Neo Air(Friendlyarm, Guangzhou, China)을 선정하였다. 4개의 코어를 각각 계측, Median 필터링, Smoothing 연산, FFT 분석에 사용하여 1분 단위, 2분 단위, 5분 단위의 주파수 분석을 동시에 수행하였다. 병렬 연산 라이브러리는 오픈 소스인 MPICH(www.mpich.org)를 이용하였다. 상대적으로 여유있는 자원을 보유하고 코어를 실시간으로 결정하여 다수의 모돈 개체 동시 모니터링을 위한 네트워크 연결 역할을 동시에 수행하도록 하였다. 1주일 내외의 요인 실험 수행 결과, 약 70 Mbyte의 데이터가 축적이 되었으며, 1분 단위, 2분 단위, 5분 단위의 주파수 도메인 변환 후 결과를 동시에 취득할 수 있었다. 일부 주파수 도메인 상의 파워 밀도 값이 모돈의 행동 특성에 분석에 유효한 정보를 제공함을 발견하였다. 모돈사 내 현장 보급이 가능한 초소형 AP와 멀티 코어 기반 병렬 처리 기법을 이용한 현장 진단 시스템 개발 연구를 지속적으로 수행할 것이다.

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새로운 디지털 인코딩 기법을 적용한 8비트 1GS/s 프랙셔널 폴딩-인터폴레이션 ADC (A 8b 1GS/s Fractional Folding-Interpolation ADC with a Novel Digital Encoding Technique)

  • 최동귀;김대윤;송민규
    • 전자공학회논문지
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    • 제50권1호
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    • pp.137-147
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    • 2013
  • 본 논문에서는 폴딩 구조에 저항열 인터폴레이션 기법을 적용한 1.2V 8b 1GS/s CMOS folding-interpolation A/D 변환기(ADC)에 대해 논한다. 기존 폴딩 ADC가 갖는 경계조건 비대칭 오차를 최소화하기 위해 홀수개의 폴딩 블록과 프랙셔널 폴딩 비율(fractional folding rate)을 사용하는 구조를 제안한다. 또한, 프랙셔널 폴딩기법을 구현하기 위해 덧셈기를 사용하는 새로운 디지털 인코딩기법도 제안한다. 그리고 iterating offset self-calibration 기법과 디지털 오차 보정 회로를 적용하여 소자 부정합과 외부 요인에 의한 노이즈 발생을 최소화하였다. 제안하는 A/D 변환기는 1.2V 0.13um 1-poly 6-metal CMOS 공정을 사용하여 설계 되었으며 $2.1mm^2$ 유효 칩 면적과(A/D 변환기 core : $1.4mm^2$, calibration engine : $0.7mm^2$), 350mW의 전력 소모를 나타내었다. 측정결과 변환속도 1GS/s에서 SNDR 46.22dB의 특성을 나타내었다. INL 과 DNL 은 자체보정회로를 통해 모두 1LSB 이내로 측정되었다.

흰띠명나방의 온도발육 모형 (Temperature-dependent Development Model of Hawaiian Beet Webworm Spoladea recurvalis Fabricius (Lepidoptera: Pyraustinae))

  • 이상구;김주;정성수;김연국;이상계;황창연
    • 한국응용곤충학회지
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    • 제52권1호
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    • pp.5-12
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    • 2013
  • 비트의 주요 해충인 흰띠명나방을 9개의 다른 온도조건(15.0, 17.5, 20.0, 22.5, 25.0, 27.5, 30.0, 32.5 및 $35.0^{\circ}C$), 상대습도 $65{\pm}5%$, 광조건 16L:8D에서 발육특성을 조사한 결과, 알에서 성충 우화 전까지의 발육기간은 $17.5^{\circ}C$에서 51.0일로 가장 길었고, $35^{\circ}C$에서 14.6일로 가장 짧게 조사되었다. 온도와 발육율의 관계를 직선회귀에 의해 분석한 결과, 결정계수($R^2$) 값이 0.87 이상으로 나타났으며, 온도에 따른 발육은 직선회귀에 부합되었다. 알부터 성충 우화 전까지의 발육영점온도와 유효적산온도는 $10.4^{\circ}C$와 384.7일도를 나타내었다. 각 태별 발육모형은 $R^2$값이 0.97~0.99로 비선형회귀식에 잘 부합되었다. 각 태별 발육누적분포와 발육기간에 대한 평균 발육기간으로 나눈 값을 Weibull 함수에 적용한 결과 $r^2$값이 0.63~0.87이었다.

청각신경신호 검출 장치용 다중채널 아나로그 프론트엔드 (Multi-Channel Analog Front-End for Auditory Nerve Signal Detection)

  • 천지민;임승현;이동명;장은수;한건희
    • 대한전자공학회논문지SD
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    • 제47권1호
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    • pp.60-68
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    • 2010
  • 청신경의 이상으로 발생하는 감각신경성 난청의 경우, 달팽이관이나 청각신경에 전극을 이식하여 전기자극을 가함으로써 청지각을 살릴 수 있다. 이를 위해 우선적으로, 각 청각신경들이 담당하여 인지할 수 있는 소리의 주파수 분포를 표시한 음계소지도를 파악해야 한다. 본 논문에서는 청각신경신호 검출 장치용 다중채널 아나로그 프론트엔드 회로를 제안한다. 제안된 아나로그 프론트엔드의 각 채널은 AC 커플링 회로, 저 전력 4차 Gm-C LPF와 단일 기울기 ADC로 이루어진다. AC 커플링 회로는 청각신호의 불확실한 DC 전압 레벨을 제거하고 AC 신호만 전달한다. Gm-C LPF는 청각신호의 대역폭을 고려하여 설계 되었으며, 플로팅-게이트 기법이 적용된 OTA를 사용하였다. 채널별 ADC를 구현하기 위해서, 최소의 면적으로 구현할 수 있는 단일 기울기 ADC 구조를 사용하였다. 측정 결과, AC 커플링 회로와 4차 Gm-C LPF는 100 Hz - 6.95 kHz의 대역폭을 가지며, 단일 기울기 ADC는 7.7 비트의 유효 해상도를 가진다. 그리고, 채널 당 $12\;{\mu}W$의 전력이 소모 되었다. 전원 전압은 3.0 V가 공급되었고, 코어는 $2.6\;mm\;{\times}\;3.7\;mm$의 실리콘 면적을 차지한다. 제안된 아나로그 프론트엔드는 1-poly 4-metal $0.35-{\mu}m$ CMOS 공정에서 제작 되었다.

백악기 사암과 세일에 대한 포아송비의 변화 (The variation of poisson's ratio for The Cretaceous Sandstones and Shale in the Euiseoung Subbasin.)

  • 정태종
    • 지질공학
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    • 제6권2호
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    • pp.103-110
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    • 1996
  • 본 연구는 의성 소분지에 분포하는 백악기 사암과 셰일을 대상으로 압력에 따른 포아송비의 변화를 구명(究明)한 것이다. 역학적 시험을 실시하기 위하여, 직경 30.0Cm, 길이 6.2Cm인 시료를 사용하여 응력/변형률 시험을 하였다. 시험에 사용된 기기는 분해 능이 $10^{-7}$인 증폭기 및 16비트 A/D변환기,컴퓨터,하중 계측기,시험 운영 프로그램으로 구성되어 있으며, 유효자료 획득 속도는 매 초당 6~100개이다. 일반적으로 포아송비는 지금까지 하나의 물성으로 취급되어 왔으나, 본 시험 결과 금속류와는 달리 포아송비는 압력에 따라 변하는, 압력과 함수 관계에 있음이 확인되었다. 포아송비를 도출함에 있어서 4가지 방법을 사용한 결과, 계산에서는 포아송비가 급격하게 증가하여, 계산방법에 따라 파괴 영역이 확연히 구분되어 진다. 사암과 셰일은 낮은 하중과 높은 하중에서는 서로 다른 거동을 보였으나, 중간 하중 영역즉 탄성 한계 내에서는 ${\nu}_t={\nu}_0+P_{\sigma}$로(${\nu}_0$ : 탄성 영역 내에서의 초기 포아송비. ${\nu}_t$ : 탄성 영역 내에서의 포아송비, P : 포아송 계수, $\sigma$:응력)일차함수적으로 증가하였다. 2가지 암석 시료 모두 탄성 한계 내에서 포아송비는 0.1~0.21의 연속적인 변화 양상을 나타내며,파괴강도 65% 이사에서 급격히 증가하여 0.22~0.45로 나타나므로 이는 탄성 범위밖에 해당된다.

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근적외선 분광법에 의한 사초의 성분추정 (Prediction on the Quality of Forage Crop by Near Infrared Reflectance Spectroscopy)

  • 이효원;김종덕;김원호;이종경
    • 한국초지조사료학회지
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    • 제29권1호
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    • pp.31-36
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    • 2009
  • 본 연구는 청예용 사초의 질을 신속하고 정확하게 측정할 수 있는 대안을 모색하기 위하여수행하였다. 근적외선분광분석법을 이용한 사초의 분석가능성을 타진하기 위해 2002년부터 2007년에 거쳐 생산된 각종 사초 258점을 시료로 사용하였다. 즉 시료는 조단백질, 조섬유, NDF, ADF 그리고 건물소화율을 분석하였으며, 또한 NIR System으로 $400{\sim}2,400nm$ 사이의 파장을 얻었다. 그리고 파장과 습식분석치를 이용하여 중회귀식을 만들고 이것을 사용하여 미지의 시료를 분석할 수 있는가를 검증하였다. 근적외선 분석법의 중요한 지표인 결정계수 $r^2$와 표준오차이며 본 실험의 결과 검증식의 $r^2$는 CP(crude protein), CF(crude fiber), ADF (acid detergent fiber), NDF (neutral detergent fiber) 그리고 IVTD(in vitro true digestibility)에서 각 각 0.70, 0.86, 0.94, 0.94 그리고 0.89였다. 검량식은 그 값이 0.47, 0.39, 0.89, 0.90 그리고 0.61이었다. 본 실험 결과 근적외선분광법에 의한 청예사료 질평가가 가능하며 특히 조섬유, ADF 그리고 진정인비트로 소화율 (IVTD)에서 유효할 것으로 나타났다. 그러나 보다 정확한 결과를 얻기 위해서는 시료는 한국사초의 대표성을 갖는 것을 수집하여 사용해야 할 것이다. 앞으로 더 많은 시료를 추가하면 모든 사초를 분석할 강고한 검량식이 작성될 수 있을 것으로 기대된다.

전력절감용 재구성 연산증폭기를 사용한 4차 델타-시그마 변조기 설계 (Design of 4th Order ΣΔ modulator employing a low power reconfigurable operational amplifier)

  • 이동현;윤광섭
    • 전기전자학회논문지
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    • 제22권4호
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    • pp.1025-1030
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    • 2018
  • 제안하는 4차 델타-시그마 변조기는 1개의 연산증폭기를 시분할 기법을 이용하여 4차 델타시그마 변조기를 구현한 구조를 이용하여 설계하였다. KT/C 잡음의 영향을 줄이기 위하여 첫 번째와 두 번째로 재사용하는 적분기의 적분 커패시터 사이즈를 크게 설계하였으며, 세 번째와 네 번째로 재사용하는 적분기의 적분 커패시터 사이즈는 작게 설계하였다. 다른 커패시터 용량을 한 개의 연산증폭기가 로드하기 때문에 안정도 문제를 해결하기 위하여 연산증폭기 단을 가변 하는 방법을 이용하였다. 전력을 절감하기 위하여, 1단으로 연산증폭기가 동작할 때 사용되고 있지 않는 2단을 구성하고 있는 CS증폭기와, 그 출력단에 붙어있는 연속모드 공통모드피드백회로 의 전류원을 차단하는 방법을 이용함으로써, 아이디어 적용전과 비교하였을 때, 15%의 전력 절감 효과를 얻었다. 제안한 변조기는 TSMC 0.18um CMOS N-well 1 poly 6 metal 공정을 이용하여 제작되었으며, 1.8V의 공급전압에서 305.55uW의 전력을 소모하였다. 256kHz의 샘플링 주파수, OSR 128, 1.024MHz의 클럭주파수, 250Hz 의 입력 싸인 파형을 공급하였을 때, 최대 SNDR은 66.3dB, 유효비트수는 10.6bits, DR은 83dB로 측정되었다. Fom(Walden)은 98.4pJ/step, Fom(Schreier)는 142.8dB 로 측정되었다.