본 논문에서는 전력증폭기의 입력신호의 크기에 따라 CMOS class-E 전력증폭기의 게이트와 드레인의 바이어스 전압을 조절함으로써 낮은 출력전력에서도 80% 이상의 고효율 특성을 갖는 CMOS class-E 전력증폭기를 설계하였다. 입력신호의 포락선을 검파하여 전력증폭기의 바이어스 전압을 조절하는 방법을 이용하였고, 동작주파수는 2.14GHz, 출력전력은 22dBm에서 25dBm, 전력부가효율은 모든 입력전력레벨에서 80.15%에서 82.96%의 특성을 얻을 수 있었다.
수자원을 효율적으로 관리하고 사용하는 것은 확보한 수자원을 확보한 목표에 맞게 시,공간적으로 적절하게 분배 시키는 것이다. 따라서 저수지 운영의 최종 목표는 댐 건설 목적에 따라 확보된 물을 유입량, 저수량, 용수 수요등을 감안하여 댐 운영 목표에 맞게 최적으로 적절한 양의 물을 적절한 시기에 방류하는 것이다.(손덕환, 2004) 현재 댐군의 운영방법은 확정론적인 방법과 추계학적인 방법이 주로 이용되고 있으나 본 연구에서는 최근 연구가 많이 이루어지고 있는 인공신경망을 적용하여 운영방법으로써의 적용성을 검토하고자한다. 연구대상지로는 수력발전소가 포함된 한강의 충주 다목적댐을 선정하였다. 인공신경망은 입력층에서 출력층사이에 은닉층이 존재하는 다중신경망을 활용하였으며 출력층은 방류량으로 설정하여 발전방류와 수문방류를 구분하여 설정하였다. 방류량 결정을 위한 입력층 구성은 선행 연구들을 참고하여 예측 유입량, 현재 수위, 발전량, 용수 수요량 등을 설정하여 입력층으로 구성하였다. 학습기간의 방류량 자료를 학습하고 검정기간을 통해 실제 이루어진 방류량과 모의된 방류량의 차이를 비교, 분석하여 댐 운영방법으로써의 인공신경망의 적용성을 검토하고자하였다.
125 MHz 동작 주파수에서 32개의 다중 위상의 클럭을 출력하는 지연 고정 루프(DLL: delay-locked loop)를 제안한다. 제안된 다중 위상 지연 고정루프는 delay line의 differential non-linearity (DNL)를 개선하기 위해 $4{\times}8$ matrix 구조의 delay line을 사용한다. 또한, $4{\times}8$ matrix delay line 입력 단의 네 지점에 공급되는 클럭의 위상을 보정함으로써 제안하는 지연 고정 루프의 integral non-linearity (INL)을 개선한다. 제안된 지연 고정 루프는 1.2 V의 공급전압을 이용하는 $0.11-{\mu}m$ CMOS 공정에서 제작하였다. 제작된 지연 고정 루프는 40 MHz에서 280 MHz의 동작 주파수 범위를 가지며, 125 MHz 동작 주파수에서 측정된 DNL과 INL은 각각 +0.14/-0.496 LSB, +0.46/-0.404 LSB이다. 입력 클럭의 peak-to-peak jitter가 12.9 ps일 때 출력 클럭의 측정된 peak-to-peak jitter는 30 ps이다. 제작된 고정 지연 루프의 면적과 전력 소모는 각각 $480{\times}550{\mu}m^2$과 9.6 mW이다.
SoC(System-On-Chip) 시스템에서 초 저전력 시스템을 구현하기 위한 dynamic voltage and frequency scaling (DVFS)알고리즘에 사용될 시스템 버스의 다중 코어 전압 레벨을 생성해주는 새로운 다계층(multi-level) 코어 전압용 high-speed level up/down Shifter 회로를 제안한다. 이 회로는 내부 회로군과 외부 회로군 사이에서 서로 다른 전압레벨을 조정 접속하는 I/O용 level up/down shifter interface 회로로도 동시에 사용된다. 제안하는 회로는 인터페이스 접속에서 불가피하게 발생하는 속도감쇄와 Duty Ratio 불안정 문제를 최소화하는 장점을 갖고 있다. 본 회로는 500MHz의 입력 주파수에서 $0.6V\sim1.6V$의 다중 코어 전압을 각 IP들에서 사용되는 전압레벨로, 또는 그 반대의 동작으로 서로 Up/Down 하도록 설계하였다 그리고 제안하는 I/O 용 회로의 level up shifter는 500MHz의 입력 주파수에서 내부 코어 용 level up shifter의 출력전압인 1.6V를 I/O 전압인 1.8V, 2.5V, 3.3V로 전압레벨을 상승 하도록 설계하였으며, level down shifter는 반대의 동작으로 1Ghz의 입력 주파수에서 동작하도록 설계하였다. 시뮬레이션 및 결과는 $0.35{\mu}m$ CMOS Process, $0.13{\mu}m$ IBM CMOS Process 와 65nm CMOS model 변수를 이용한 Hspice를 통하여 검증하였다. 또한, 제안하는 회로의 지연시간 및 파워소모 분석과 동작 주파수에 비례한 출력 전압의 Duty ratio 왜곡에 대한 연구도 하였다.
다중모드 광섬유 테이퍼(taper)를 이용하여 레이저와 광섬유 혹은 두 개의 서로 다른 광섬유 사이의 효과적인 광결합을 위한 모드 크기 변환기를 제안하고 구현하였다. 이 소자의 입력 단은 다중 모드 구조이고 출력단은 단일 모드 구조이다. 소자의 구조 및 광원과 소자사이의 결합 조건이 결합 효율에 미치는 영향을 이론적으로 분석하였다. 이론적 결과는 제안된 소자가 가우시안 빔을 단일모드 광섬유로 거의 손실 없이 결합할 수 있는 것을 보였다. 제안된 소자를 두 개의 마이크로 토치가 부착된 장비를 이용해 제작하였다. 실험 결과 제작된 다중모드광섬유 테이퍼를 통해 $50\;{\mu}m$ 빔 크기를 가지는 가우시안 빔을 단일모드 광섬유로 효과적으로 결합할 수 있는 것을 보였다. 소자의 삽입 손실은 1.3 dB였다.
본 논문에서는 다중입력-다중출력(multiple-input, multiple-output: MIMO) 간섭계(interferometric) 레이다 네트워크 시스템을 기반한 MIMO 간섭계 역합성 개구면 레이다(inverse synthetic aparture radar: InISAR) 영상 형성기법에 관해 연구하였다. MIMO 간섭계 레이다 네트워크 시스템 내에서는 여러 바이스태틱 InISAR 영상들이 형성되며, 이들을 인코히리언트(incoherent)하게 합성함으로써 MIMO InISAR 영상을 형성할 수 있다. 여기서, 바이스태틱 InISAR 영상은 바이스태틱 기하구조 내에서의 표적에 대한 산란분포를 3차원의 형태로 도시한다. 상기 MIMO InISAR 영상에서는 다중 각도에서의 바이스태틱 산란 현상을 3차원의 형태로 도시하기 때문에, 표적의 다양한 산란 정보를 제공함과 더불어, 표적 식별 시 유용한 특징 벡터(feature vector)로써 활용될 수 있다. 시뮬레이션을 통해, 제안된 MIMO InISAR 영상 형성 기법을 이용함으로써 표적에 대한 다중각도에서의 바이스태틱 산란분포가 3차원의 형태로 도시되는 것을 확인할 수 있다.
시간 순서 보전을 만족하는 프레임내 시간 슬롯의 배치 방법에는 임의, 연속, 주기 배치 방식 등이 있다. T-S-T 스위치 구조의 각 입력, 출력, 정터 시간스위치를 256개의 시간슬롯으로, 공간 스위치를 2*2로 구성하고, 시뮬레이션 검색횟수를 32회로 한정하며, 각 경우에 대한 시뮬레이션 시간은 10만 단위로 설정하였다. 시뮬레이션에 적용된 다중호는 기본호, 2배호, 6배호로 한정하였다. 부가된 기본호:2배호:6배호의 구성을 8:1:1, 6:2:2, 4:3:3 로 달리하면서 스위치에 트래픽을 할당하며 트래픽에 따른 호손율을 구하였다. 요약하면, 동일한 트래픽을 부가하였을 때 다중호의 배치 방식은 임의, 연속, 주기 방식의 순서로 호손율이 낮은 결과가 도출되어 다중호의 호손율이 제일 낮은 방식은 주기적 배치방식임을 알 수 있었다.
본 논문에서는 2.4, 3.5, 5.2 GHz의 대역에 맞추어 스위칭 동작을 하는 다중 대역 저잡음 증폭기를 CMOS 0.18 um 공정을 이용하여 설계하였다. 제안된 회로는 스위칭 트랜지스터를 이용하여 입력단에서는 트랜스 컨덕턴스, 게이트-소스 캐패시턴스를 조정하고, 출력단에서는 캐패시턴스를 조정하는 방식으로 다중 대역 입출력 정합을 이루었다. 제안된 저잡음 증폭기는 각 스위칭 트랜지스터의 동작 상태에 따라 2.4, 3.5, 5.2 GHz 대역에서 제안된 회로는 입출력단에서 각각 14.2, 12, 11 dB의 이득과 3, 2.9, 2.8의 잡음 지수 특성을 갖는다. 다중 대역 저잡음 증폭기는 1.8 V의 공급 전압에 대해서 4.2~5.4 mW의 전력을 소비한다.
전기추진선박에서 해결해야 할 중요한 문제점의 하나는 전력변환시에 발생되는 전류 및 전압파형에 포함된 고조파 성분에 의한 손실과 토크리플이다. 이를 제거하기 위해서 많은 방식들이 연구되고 있으며 본 논문에서는 상천이 변압기를 갖는 다중펄스 드라이브를 사용하여 정류된 직류파형을 개선함으로서 전류 및 전압파형에 포함되는 고조파 성분을 감소시키는 방식을 사용하였다. 또한, 그 유효성을 입증하기 위해서 6펄스 및 12펄스 드라이브를 각각 전력변환장치로 사용하였으며 현재 대형 선박에서 사용중인 6000[kW]의 유도전동기를 추진전동기로 채택하여 시뮬레이션을 행하였다. 다중펄스 드라이브에 의한 고조파 저감은 발전기 출력측의 전류파형과 추진전동기 입력측의 전압 파형에 포함된 총고조파 왜형율을 평가하였으며 또한, 고조파에 의한 전동기측의 영향은 추진전동기의 토크리플을 측정하여 비교 분석하였다.
본 논문에서는 다중 스위치를 이용한 전류모드 벅-부스트 컨버터의 벅-부스트 컨버터를 제안하였다. 제안한 컨버터는 넓은 출력 전압 범위와 높은 전류 레벨에서 높은 전력 변환 효율을 갖기 위해 PWM 제어법을 이용하였다. 제안한 컨버터는 최대 출력전류 300mA, 입력 전압 3.3V, 출력 전압 700mV~12V, 1.5MHz의 스위칭 주파수, 최대효율 90% 갖는다. 또한, dc-dc 컨버터의 신뢰성과 성능을 향상시키기 위해 보호회로를 추가하였다. 그리고 Deep-submicron 공정 기술을 이용한 ESD 보호회로를 제안하였다. 제안된 보호회로는 게이트-기판 바이어싱 기술을 이용하여 낮은 트리거 전압을 구현하였다. 시뮬레이션 결과는 일반적인 ggnmos의 트리거 전압(8.2V) 에 비해 고안된 소자의 트리거 전압은 4.1V 으로 더 낮은 트리거 전압 특성을 나타냈다.
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[게시일 2004년 10월 1일]
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