본 논문에서는 고속 데이터 처리용 TCAM(Ternary Content Addressable Memory) 설계를 위하여 6T SRAM cell의 안정성 분석 방법에 대해 기술하였다. TCAM은 고속 데이터 처리를 목적으로 하기 때문에 동작 주파수가 높아질수록 필요 시 되는 CMOS 공정의 단위가 작아지게 된다. 공급 전압의 감소는 TCAM 동작에 불안정한 영향을 줄 수 있으므로 SRAM cell 안정성 분석을 통한 TCAM 설계가 필수적이다. 우리는 6T SRAM의 정적 노이즈 마진(SNM)을 측정하여 분석하였고, TCAM의 모든 시뮬레이션은 $0.18{\mu}m$ CMOS 공정을 사용하여 확인하였다.
최근 자동차가 편리성과 안전성을 추구함에 따라서 자동차 부품도 과거의 기계식 동작 방법에서 전자 제어 장치가 부착된 전자식 동작 방법으로 발전되어 가고 있는 추세입니다. 또한 연비 향상을 위하여 부품의 소형화가 급속히 추진되고 있습니다. 이러한 전자화, 소형화를 실현시키기 위해 자동차 부품에서의 정밀성이 요구되어 지고 있고, 부품 제조 측면에서는 고속화, 정확성이 요구되고 있는 실정입니다. 당사의 경우 CBS (Conventional Brake System)를 생산하다가 전자 제어 장치가 부착된 ABS (Anti-lock Brake System)의 생산을 시작할 때, 부품의 정밀도를 좌우하는 각 치수의 공차 영역이 전체적으로 CBS 대비 약 1/5 수준밖에 되지 않고, 가공 속도는 약 2 배가 빨라야 하기 때문에 생산 준비 단계에서 많은 시행 착오를 겪어야만 했습니다. 여기서 당사가 ABS를 양산하면서 겪은 경험을 토대로 기술토록 하겠습니다. 가공 기술의 경우 고속, 정밀 가공을 실현시키기 위해서 크게 4 가지 측면을 고려해야만 하며, 그 4가지는 설비, Tool Holder, Tool, Chip 측면입니다. 먼저 설비가 고정도가 되기 위해 고강성을 필요로 하는 것은 물론 가동중에 필연적으로 발생하는 열변형에 대한 대책을 수립하지 않으면 안됩니다. 이러한 열변형은 설비 설계 단계에서 대책을 수립할 수 있는 것도 있지만 주위 온도 변화에 의한 열변형처럼 사용 중에 발생되는 것은 설비 사용자가 장시간에 걸친 Data 를 확보하여 대책을 수립하지 않으면 안됩니다. 또한 Tool Holder의 정도도 일반적으로 사용하는 것보다는 고정도의 것이 요구되어지므로 Tool Holder Maker 에 반드시 요구 정도를 명기하여 주문하여야 합니다. Tool도 고속화를 실현시키기 위해 고정도의 다이아몬드 공구가 필요하였고 이를 국내에서 개발하기 위해 많은 시행 착오를 겪어야만 했습니다. 또한 Chip 배출이 고정도의 필수 고려 항목으로서 당사에서는 경우에 따라 여러 가지의 방법을 사용하고 있습니다. 조립 기술의 경우 스테인레스 박판을 열변형을 최소로 하면서 용접을 하기 위해서 레이저 용접을 도입하였고, 부품을 압입하면서 정확하고 정밀한 치수 셋팅을 위하여 서버 모타를 이용한 압입 방법을 사용하였습니다.
다중 반송파방식 무선 LAN에서는 오류정정을 위해 구속장(constraint length : K)이 7인 64-state 길쌈부호를 사용하며, 복호기로 비터비 복호기를 사용한다. 비터비 복호기의 동작속도로는 24 Mbps의 입력 데이터에 대해 12MHz 이상의 처리속도를 가져야한다. 이와 같이 고속의 비터비 부호기를 설계하기 위해서는 일반적으로 32조의 병렬 나비구조 ACS를 갖도록 한다. 병렬 나비구조 ACS를 갖는 비터비 복호기를 설계할 경우 단일 ACS 구조에 비해 상태 메트릭 메모리(state-metric memory), 역추적 메모리(trace back memory)를 관리하는 복잡한 제어회로가 필요하지 않다. 그러나 많은 ACS을 사용함으로 하드웨어의 복잡도가 증가하게 된다. 이에 대해, 본 연구에서는 모든 상태에서 코드워드를 발생시키는 별개의 회로를 단순한 연산으로 대체하며, ACS 기능을 위해 고속 저 전력 시스템에 용이한 새로운 가지값(branch metric)계산방법을 개발하여 적용한다. 그리고 역추적 과정 시 고속 저 전력동작을 위해 one-pointer방법을 채용하여 전체적으로 저 전력 비터비 복호기를 설계한다.
본 논문에서는 영상 신호처리에 적합한 고속 1 line VRAM을 ASIC화 설계하기 위하여 엑세스 시간특성 및 집적도가 우수한 3-TR dual-port 다이나믹 셀을 채용하여 메모리 코어를 설계하였다. 고속 파이프라인 동작을 위하여 서브어레이 1로부터 첫 행을 분리하였고, TM기 비트 라인에 데이터 래치 구조를 채용하여 한 번지의 동시 입.출력이 가능하도록 설계하였다. 주변 회로로 번지 선택기, 1/2V 전압 발생기를 각각 설계하여 개선된 동작특성을 확인한 후 1.5[ m] CMOS 설계규칙을 이용하여 ASIC화 설계하였다.
낮은 전압에서 고속으로 동작이 가능한 고속 비반전 SOI 버퍼 회로를 제안하였다. 제안된 버퍼 회로는 효율적으로 연결된 보조 MOS 트랜지스터를 경유하여 바디 전압이 동적으로 제어된다. 소자 시뮬레이션을 수행하여 바디가 보조 MOS 트랜지스터로 제어되는 MOS 소자의 전류 구동능력을 보이고 기존의 다른 방식과 비교하였다. SPICE를 이용한 회로 시뮬레이션을 통하여 제안된 버퍼 회로의 지연시간 특성을 조사하고 같은 사양을 가진 기존의 SOI CMOS 버퍼 회로와 비교하였다. 같은 면적을 기준으로 하여 제안된 버퍼회로는 기존의 버퍼 회로에 비해 1.2 V의 동작전압과 2 pF의 부하용량에 대하여 약 36% 지연 시간 단축을 보였다.
한국신호처리시스템학회 2001년도 하계 학술대회 논문집(KISPS SUMMER CONFERENCE 2001
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pp.189-192
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2001
본 논문에서는 65MHz의 고속 동작을 요구하고 1344*806의 고해상도를 가지는 HDTV에서의 다양한 색조 변환을 위한 실시간 영상 처리 시스템을 제안한다. 입력 영상의 색조를 변환하기 위해서는 입력 영상의 색 온도를 구하는 것 이 필요하다. 색 온도를 구하기 위해서는 2-D 색도 좌표 계산 알고리즘을 필요로 한다. [1]. 그러나, 2-D 색도 좌표계간 알고리즘을 채택하면 하드웨어 부담이 매우 큰 문제점이 있다. 그러므로 본 논문에서는 2-D 알고리즘의 성능을 유지하면서, 하드웨어 복잡도를 감소시킬 수 있는 1-D 색도 좌표에 의한 계산 방법을 제안한다. 본 논문에서 제안한 방법은 Xilinx Virtex FPGA XCV 2000E-6BG560을 이용하여 검증하였다.
본 논문에서는 고속 저전력 곱셈기에 적합한 CPA(Carry Propagation Adder)로 부분의 ENMODL(Enhanced NORA MODL) 설계방식을 제안한다. ENMODL 설계방식은 반복성이 CLA(Carry -Look-ahead Adder) 가산기와 같은 회뢰에서 면적을 줄 일수 있고 동작 속도를 빠르게 할수 있다. 기존의 NMODL CLA 와 비교하여 6.27%동작속도가 빠르다. 따라서 본 논문에서는 저전 고속 곱셈기에 적합한 CPA 부분을 ENMODL CLA 가산기로 설계했고, 현대 0.6$\mu\textrm{m}$2-ploy 3-metal 공정파라미터를 이용하여 HSPICE로 시뮬레이션 하여 회로의 성능을 확인하였다. 또한 CADENCE tool를 이용하여 16비트 곱셈기에 적합한 ENMODL CLA를 레이아웃 하였다.
본 논문은 자동으로 볼트를 고속 정밀 검사할 수 있는 장치에 대한 시스템 설계 및 제품 개발에 관해 다룬다. 볼트를 연속적으로 고속 검사하기 위해 컨베이어를 이용하고 이를 동작시키기 위한 서보모터와 엔코더를 부착하여 정확한 이송량를 유지하게 된다. 엔코더 신호를 수신한 라인스캔 카메라의 동작에 따라 프레임 그래버로 볼트 영상을 전송하며 한 프레임을 구성한 후 영상 검사 알고리즘에 의해 파라메터를 측정하고 검사하게 된다. 제작된 결과물을 이용하여 실험을 통해 본 장치의 효용성을 입증하고자 한다.
본 논문에서는 HDTV 데이터를 입출력할 수 있는 고속 실시간 데이터 저장 시스템을 제안한다. 이 시스템은 ⅰ) 방대한 크기를 HDTV 데이터를 고속으로 입출력할 수 있어야 한다. ⅱ)데이타를 연속적으로 입출력할 수 있는 것 외에 데이터를 비선형적으로 랜덤하게 억세스 할 수 있어야 한다. ⅲ)실시간으로 데이터를 재생하기 위해 일정하게 주어진 시스템 입출력 속도를 항상 만족할수 있어야 한다. 이러한 조건을 만족시키기 위해서 여러 개의 하드디스크를 병렬로 연결하고 데이터들을 각각의 하드디스크에 나누어 저장하였다. 하드디스크의 입출력 성능은 하드디스크 아암의 탐색 동작에 의해 크게 좌우되므로 탐색 동작을 효과적으로 제어할 수 있는 방법이 설계되었다. 제안된 시스템은 주제어부, 데이터 분배부, 종제어부로 나뉘며 각각의 하드디스크는 독립도니 종제어부에 의해 제어된다. 제안된 시스템이 주어진 요구사항을 만족하는지를 확인하기 위하여, 제안된 시스템을 DEVS 형식론을 이용하여 구현하고 시뮬레이션 하였다. DEVS 형식론은 이산사건 시스템을 계층적이고 모듈화된 형태로 기술한다. 시뮬레이션 과정에서 발생된 사건들을 분석하였다. 그 결과 제안된 시스템이 주어진 요구사항을 잘 만족함을 보았다.
일반적으로 사용되는 전력 스위치 소자에는 IGBT, MOSFET 등이 있다. 그 중 IGBT 소자는 용량 특성이 우수하여 고 용량 인버터에서 사용가능하다는 장점이 있으나 턴 오프 동작 시 손실 특성과 다이오드 역 회복 특성으로 인해 고속 스위칭 동작에는 부적합하다는 단점이 있다. 최근에는 SiC를 사용한 MOSFET의 개발이 진행되어 MOSFET의 대용량화 및 스위칭 손실저감이 이루어졌고 이에 따라, 본 논문에서는 SiC MOSFET을 이용한 고속 스위칭 인버터를 제안하였으며 그 특성을 기존의 IGBT 소자를 이용한 인버터와 비교분석하고 이를 시뮬레이션을 통해 검증하였다.
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[게시일 2004년 10월 1일]
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