• Proceedings of the Korean Vacuum Society Conference
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• 2000.02a
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• pp.78-78
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• 2000

다결정 실리콘-게르마늄 (poly-SiGe)은 태양전지 개발에 있어서 중요한 물질이다. 우리는 소량의 Ge(x=0.05)으로부터 다량의 Ge(x=0.67)을 함유한 수소화된 비정질 실리콘-게르마늄 (a-SiGe:H) 박막의 고상결정화 과정을 ESR (electron spin resonance)방법으로 조사해보았다. 먼저 PECVD 방법으로 Corning 1737 glass 위에 a-Si1-xGex:H 박막을 증착시켰다. 증착가스는 SiH4, GeH4 가스를 썼으며, 기판온도는 20$0^{\circ}C$, r.f. 전력은 3W, 증착시 가스압력은 0.6 Torr 정도이었다. 증착된 a-SiGe:H 박막은 $600^{\circ}C$ N2 분위기에서 다시 가열되어 고상결정화 되었고, 결정화 정도는 XRD (111) peak의 세기로부터 구해졌다. ESR 측정은 상온 x-band 영역에서 수행되었다. 측정된 ESR스팩트럼은 두 개의 Gaussian 함수로써 Si dangling-bond와 Ge dangling-bond 신호로 분리되었다. 가열 초기의 a-SiGe:H 박막 결함들의 스핀밀도의 증가는 수소 이탈에 기인하고, 또 고상결정화 과정에서 결정화된 정도와 Ge-db 스핀밀도의 변화는 서로 깊은 상관관계가 있음을 알 수 있었다. 특히 Ge 함유량이 큰 박막 (x=0.21, 0.67)에서 뿐만 아니라 소량의 Ge이 함유된 박막(x=0.05)에서도 Ge dangling-bond가 Si dangliong-bond 보다 고상결정화 과정에서 더 중요한 역할을 한다는 것을 알수 있었다. 또한 초기 열처리시 Si-H, Ge-H 결합에서 H의 이탈로 인하여 나타나는 Si-dangling bond, Ge-dangling bond 스핀밀도의 최대 증가 시간은 x 값에 의존하였는데 이러한 결과는 x값에 의존하는 Si-H, Ge-H 해리에너리지로 설명되어 질 수 있다. 층의 두께가 500 미만인 커패시터의 경우에 TiN과 Si3N4 의 계면에서 형성되는 슬릿형 공동(slit-like void)에 의해 커패시터의 유전특성이 파괴된다는 사실을 알게 되었으며, 이러한 슬릿형 공동은 제조 공정 중 재료에 따른 열팽창 계수와 탄성 계수 등의 차이에 의해 형성된 잔류응력 상태가 유전막을 기준으로 압축응력에서 인장 응력으로 바뀌는 분포에 기인하였다는 사실을 확인하였다.SiO2 막을 약화시켜 절연막의 두께가 두꺼워졌음에도 기존의 SiO2 절연막의 절연 파괴 전압 및 누설 전류오 비교되는 특성을 가졌다. 이중막을 구성하고 있는 안티퓨즈의 ON-저항이 단일막과 비교해 비슷한 것을 볼 수 잇는데, 그 이유는 TiO2에 포함된 Ti가 필라멘트에 포함되어 있어 필라멘트의 저항을 감소시켰기 때문으로 사료된다. 결국 이중막을 구성시 ON-저항 증가에 의한 속도 저하 요인은 없다고 할 수 있다. 5V의 절연파괴 시간을 측정한느 TDDB 테스트 결과 1.1$\times$103 year로 기대수치인 수십 년보다 높아 제안된 안티퓨즈의 신뢰성을 확보 할 수 있었다. 제안된 안티퓨즈의 이중 절연막의 두께는 250 이고 프로그래밍 전압은 9.0V이고, 약 65$\Omega$의 on 저항을 얻을수 있었다.보았다.다.다양한 기능을 가진 신소재 제조에 있다. 또한 경제적인 측면에서도 고부가 가치의 제품 개발에 따른 새로운 수요 창출과 수익률 향상, 기존의 기능성 안료를 나노(nano)화하여 나노 입자를 제조, 기존의 기능성 안료에 대한 비용 절감 효과등을 유도 할 수 있다. 역시 기술적인 측면에서도 특수소재 개발에 있어 최적의 나노 입자 제어기술 개발 및 나노입자를 기능성 소재로 사용하여 새로운 제품의 제조와 고압 기상 분사기술의 최적화에 의한 기능성 나노 입자 제조 기술을 확립하고 2차 오염 발생원인 유기계 항균제를 무기계 항균제로 대체할 수 있다. 이와 더불

• Korean Chemical Engineering Research
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• v.61 no.3
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• pp.348-355
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• 2023

Magnesium secondary batteries are attracting much attention due to their potential to replace conventionally used lithium ion batteries. Magnesium secondary battery cathode material Mo₆S₈ were synthesized by molten salt synthesis method and PVC as a carbon materials were added to improve electrochemical properties. Crystal structure, size and surface of the synthesized anode materials were measured through XRD and SEM. Charge-discharge profiles and rate capabilities were measured by battery test system. 2.81 wt% PVC coated sample showed the best rate capabilities of 85.8 mAh/g at 0.125 C-rate, 69.2 mAh/g at 0.5 C-rate, and 60.5 mAh/g at 1 C-rate.

• Macromolecular Research
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• v.12 no.3
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• pp.316-321
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• 2004

We have performed copolymerizations of ethylene with 1-hexene using various ansa-metallocene compounds in the presence of the non-coordinative [CPh$_3$][B(C$\_$6/F$\_$5/)$_4$ion pair as a cocatalyst. The metallocenes chosen for this study are isospecific metallocene diamide compounds, rac-(EBI)Zr(NMe$_2$)$_2$ [1, EBI = ethylene-l ,2-bis(1-indenyl)], rac-(EBI)Hf(NMe$_2$)$_2$ (2), rac-(EBI)Zr(NC$_4$H$\_$8/)$_2$ (3), and rac-(CH$_3$)$_3$Si(1-C$\_$5/H$_2$-2-CH$_3$-4-$\^$t/C$_4$H$\_$9/)2 Zr(NMe$_2$)$_2$ (4), and syndiospecific metallocene dimethyl compounds, ethylidene(cyclopentadienyl)(9-fluorenyl) ZrMe$_2$ [5, Et(Flu)(Cp )ZrMe$_2$] and isopropylidence (cyclopentadienyl)(9-fluorenyl)ZrMe$_2$ [6, iPr(Flu)(Cp)ZrMe$_2$]. The copolymerization rate decreased in the order 4 ＞1-3＞2 ＞5＞6. The reactivity of I -hexene decreased in the order 2 ＞6＞1- 3-5＞ 4. We characterized the microstructure of the resulting poly(ethylene-co-l-hexene) by $\^$l3/C NMR spectroscopy and investigated various other properties of the copolymers in detail.

• Proceedings of the Korean Vacuum Society Conference
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• 2011.02a
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• pp.134-134
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• 2011

High-k dielectric materials such as $HfO_2$, $ZrO_2$ and $Al_2O_3$ increase gate capacitance and reduce gate leakage current in MOSFET structures. This behavior suggests that high-k materials will be promise candidates to substitute as a tunnel barrier. Furthermore, stack structure of low-k and high-k tunnel barrier named variable oxide thickness (VARIOT) is more efficient.[1] In this study, we fabricated the $WSi_2$ nanocrystals nonvolatile memory device with $SiO_2/HfO_2/Al_2O_3$ tunnel layer. The $WSi_2$ nano-floating gate capacitors were fabricated on p-type Si (100) wafers. After wafer cleaning, the phosphorus in-situ doped poly-Si layer with a thickness of 100 nm was deposited on isolated active region to confine source and drain. Then, on the gate region defined by using reactive ion etching, the barrier engineered multi-stack tunnel layers of $SiO_2/HfO_2/Al_2O_3$ (2 nm/1 nm/3 nm) were deposited the gate region on Si substrate by using atomic layer deposition. To fabricate $WSi_2$ nanocrystals, the ultrathin $WSi_2$ film with a thickness of 3-4 nm was deposited on the multi-stack tunnel layer by using direct current magnetron sputtering system [2]. Subsequently, the first post annealing process was carried out at $900^{\circ}C$ for 1 min by using rapid thermal annealing system in nitrogen gas ambient. The 15-nm-thick $SiO_2$ control layer was deposited by using ultra-high vacuum magnetron sputtering. For $SiO_2$ layer density, the second post annealing process was carried out at $900^{\circ}C$ for 30 seconds by using rapid thermal annealing system in nitrogen gas ambient. The aluminum gate electrodes of 200-nm thickness were formed by thermal evaporation. The electrical properties of devices were measured by using a HP 4156A precision semiconductor parameter analyzer with HP 41501A pulse generator, an Agillent 81104A 80MHz pulse/pattern generator and an Agillent E5250A low leakage switch mainframe. We will discuss the electrical properties for application next generation non-volatile memory device.

• Proceedings of the KIEE Conference
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• 1998.07d
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• pp.1352-1354
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• 1998

$LiNbO_3$ transistor showed relatively stable characteristic, low interface trap density, and large remanent polarization. This paper reports ferroelectric $LiNbO_3$ thin films grown directly on p-type Si(100) substrates by 13.56 MHz rf magnetron sputtering system for FRAM applications. To take advantage of low temperature requirement for growing films, we deposited $LiNbO_3$ films lower than $300 ^{\circ}C$. RTA(Rapid Thermal Anneal) treatment was performed for as-deposited films in an oxygen atmosphere at $600^{\circ}C$ for 60 sec. We learned from X-ray diffraction that the RTA annealed films were changed from amorphous to poly-crystalline $LiNbO_3$ which exhibited (012), (015), and (022) orientations. The I-V characteristics of $LiNbO_3$ films before and after anneal treatment showed that RTA improved the leakage current of films. The leakage current density of films decreased from $10^{-5}$ to $10^{-7} A/cm^2$ at room temperature measurement. Breakdown electric field of the films exhibited higher than 500 kV/cm. The C-V curves showed the clockwise hysteresis represents ferroelectric switching characteristics. From C-V curves, we calculated dielectric constant of thin film $LiNbO_3$ as 27.5 which is close to that of bulk value.

• Current Photovoltaic Research
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• v.2 no.1
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• pp.1-7
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• 2014

We developed a method of growing thin Si film at $600^{\circ}C$ by hot wire CVD using a very thin large-grained poly-Si seed layer for thin-film Si solar cells. The seed layer was prepared by crystallizing an amorphous Si film by vapor-induced crystallization using $AlCl_3$ vapor. The average grain size of the p-type epitaxial Si layer was about $20{\mu}m$ and crystallographic defects in the epitaxial layer were mainly low-angle grain boundaries and coincident-site lattice boundaries, which are special boundaries with less electrical activity. Moreover, with a decreasing in-situ boron doping time, the mis-orientation angle between grain boundaries and in-grain defects in epitaxial Si decreased. Due to fewer defects, the epitaxial Si film was high quality evidenced from Raman and TEM analysis. The highest mobility of $360cm^2/V{\cdot}s$ was achieved by decreasing the in-situ boron doping time. The performance of our preliminary thin-film solar cells with a single-side HIT structure and $CoSi_2$ back contact was poor. However, the result showed that the epitaxial Si film has considerable potential for improved performance with a reduced boron doping concentration.

• Journal of the Korean Institute of Electrical and Electronic Material Engineers
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• v.12 no.1
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• pp.18-26
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• 1999

In this study, the undoped amorphous layers and phosphorus doped amorphous layers are fabricated using LPCVD at 531$^{\circ}C$ with SiH$_4$ gas or at same temperature with PH$_3$ gas during deposition, respectively. The thickness of deposited amorphous layer from this experiments was 5000 ${\AA}$. In this experiments, undoped amorphous layers are deposited with SiH$_4$and Si$_2$H$\_$6/ gas in a low pressure reactor using LPCVD. These amorphous layers can be doped for poly-silicon by phosphorus ion implantation. The experiments of this study are carried out by phosphorus ion implantation with energy 40 keV into P doped and undoped amorphous silicon layers. The distribution of phosphorus profiles are measured by SIMS(Cameca 6f). Recoiling effects and two dimensional profiles are also explained by comparisions of experimental and simulated data. Finally range moments of SIMS profiles are calculated and compared with simulation results.

• Korean Journal of Materials Research
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• v.28 no.4
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• pp.195-200
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• 2018

This study investigated the effects of the post annealing temperatures on the electrical and interfacial properties of a metal-semiconductor-metal photodetector(MSM-PD) device. The interdigitate type MSM-PD devices had the structure Al(500 nm) / Ti(200 nm) / poly-Si(500 nm). Structural analyses of the MSM-PD devices were performed by employing X-ray diffraction(XRD), scanning electron microscopy(SEM) and transmission electron microscope(TEM). Electrical characteristics of the MSM-PD were also examined using current-voltage(I-V) measurements. The optimal post annealing condition for the Schottky contact of MSM-PD devices are $350^{\circ}C$-30minutes. However, as the annealing temperature and time are increased, electrical characteristics of MSM-PD device are degraded. Especially, for the annealing conditions of $400^{\circ}C$-180minutes and $500^{\circ}C$-30minutes, the I-V measurement itself was impossible. These results are closely related to the solid phase reactions at the interface of MSM-PD device, which result in the formation of intermetallic compounds such as $Al_3Ti$ and $Ti_7Al_5Si_{12}$.

• Proceedings of the KIEE Conference
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• 2007.07a
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• pp.1353-1354
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• 2007

폴리 실리콘 층의 유무에 따른 금속-옥사이드-반도체(MOS) 구조의 소자를 제작하였다. 터널링 산화막과 블로킹 산화막으로는 $Al_{2}O_{3}$ 층을 증착하였으며, 원자층 증착법을 이용하여 제작하였다. 터널링 산화막 층의 두께에 따른 I-V와 C-V 특성을 측정하였다. 전자들이 폴리 실리콘 층에 저장됨에 따라 N-형의 I-V 특성이 관찰되었다. C-V 측정 시에는 반시계 방향의 히스테리시스 특성을 나타내었으며, 전압이 증가할수록 플랫-밴드 전압 이동 폭이 더욱 증가하였다. 이러한 전기적 특성은 전압의 이동에 따른 전자들이 터널링 산화막 층을 통하여 폴리 실리콘 내부에 저장되기 때문이다. 이를 특성들은 폴리 실리콘의 전하 저장 가능성을 보여주는 것이며, 터널링 산화막 층의 두께에 따른 전기적 특성 변화도 관찰하였다.

• Proceedings of the Korean Vacuum Society Conference
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• 2011.02a
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• pp.100-100
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• 2011

2004년 일본의 Hosono 그룹에 의해 처음 발표된 이래로, amorphous gallium-indium-zinc oxide (a-GIZO) thin film transistors (TFTs)는 높은 이동도와 뛰어난 전기적, 광학적 특성에 의해 큰 주목을 받고 있다. 또한 넓은 밴드갭을 가지므로 가시광 영역에서 투명한 특성을 보이고, 플라스틱 기판 위에서 구부러지는 성질에 의해 플랫 패널 디스플레이나 능동 유기 발광 소자(AM-OLED), 투명 디스플레이에 응용될 뿐만 아니라, 일반적인 Poly-Si TFT에 비해 백플레인의 대면적화에 유리하다는 장점이 있다. 최근에는 Y2O3나 ZrO2 등의 high-k 물질을 gate insulator로 이용하여 높은 캐패시턴스를 유지함과 동시에 낮은 구동 전압과 빠른 스위칭 특성을 가지는 a-GIZO TFT의 연구 결과가 보고되었다. 하지만 투명 디스플레이 소자 제작을 위해 플라스틱이나 유리 기판을 사용할 경우, 기판 특성상 공정 온도에 제약이 따르고(약 $300^{\circ}C$ 이하), 이를 극복하기 위한 부가적인 기술이 필수적이다. 본 연구에서는 p-type Si을 back gate로 하는 Inverted-staggered 구조의 a-GIZO TFT소자를 제작 하였다. p-type Si (100) 기판위에 RF magnetron sputtering을 이용하여 Gate insulator를 증착하고, 같은 방법으로 채널층인 a-GIZO를 70 nm 증착하였다. a-GIZO를 증착하기 위한 sputtering 조건으로는 100W의 RF power와 6 mTorr의 working pressure, 30 sccm Ar 분위기에서 증착하였다. 소스/드레인 전극은 e-beam evaporation을 이용하여 Al을 150 nm 증착하였다. 채널 폭은 80 um 이고, 채널 길이는 각각 20 um, 10 um, 5 um, 2 um이다. 마지막으로 Furnace를 이용하여 N2 분위기에서 $500^{\circ}C$로 30분간 후속 열처리를 실시한 후에, 전기적 특성을 분석하였다.