• 제목/요약/키워드: compression packer

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압축패커를 이용한 보은지역의 질산성질소에 의한 오염지하수 수질개선 (Improvement of Water Quality for Contaminated Groundwater by $NO_3-N$ using Compression Packer in Boeun)

  • 이병대;윤욱;윤성택;조희남
    • 지질공학
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    • 제20권1호
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    • pp.25-33
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    • 2010
  • 연구지역의 오염된 대부분의 지하수는 상부의 오염된 천부지하수가 지하수공내로 유입되면서 질산성질소로 오염되었다. 공내 카메라 검층 결과 오염된 공들은 그라우팅 불량과 찢어진 유공관으로 인하여 오염된 천부지하수가 공내로 유입되어 지하수질을 악화시켰다. 오염된 천부지하수는 야외 지질조사시 확인된 동남동-서북서 방향, 북북서 방향, 북서-남동 방향, 남북 방향의 단층 및 절리, 파쇄대를 따라서 공내로 유입되었다. 금번 연구의 목적은 질산성질소로 오염된 지하수 공에 대하여 압축패커 기법을 이용하여 상부 오염물질 유입을 차단함으로써 지하수 수질개선 여부를 평가하는 것이다. 본 연구를 위하여 연구지역내 46개소의 지하수공을 대상으로 질산성질소 분석용 시료를 채취하였다. 질산성질소 함량이 10 mg/L 이상으로 먹는물 수질기준을 초과하거나 먹는물 수질기준에 가까운 공은 9개소로 전체 시료수의 약 20%이다. 압축패커 장치를 설치한 후 모든 공들의 질산성질소 함량이 설치 전에 비하여 26~81% 감소되었다.

안드로이드 덱스클래스로더 실행흐름 변경을 통한 원본 앱 노출 방지 기법 (A Hiding Original App Method by Altering Android DexClassLoader Execution Flow)

  • 조홍래;최준태;하동수;신진섭;오희국
    • 정보보호학회논문지
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    • 제27권6호
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    • pp.1271-1280
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    • 2017
  • 런타임 실행 압축 기술을 이용하는 안드로이드 패커(packer) 서비스는 덱스클래스로더(DexClassLoader)를 이용하여 원본 어플리케이션으로 전환한다. 하지만 덱스클래스로더의 API 인터페이스는 로드할 덱스(Dalvik EXcutable)의 경로와 컴파일 된 파일의 경로를 입력 받으므로 원본이 파일시스템에 드러나는 문제점이 있다. 따라서 해당 API를 패커 서비스에 그대로 사용하는 것은 안전하지 않다. 본 논문에서는 이 문제를 해결하기 위해 덱스클래스로더 API의 컴파일 흐름과 로드 흐름을 변경하여 해결하였다. 이 변경된 실행 흐름으로 인해 컴파일 된 파일을 암호화하여 파일 시스템에 두거나 메모리에만 존재하도록 하고, 이후 로드할 때 복호화 또는 치환을 하여 원본 앱 전환을 가능하게 한다. 제안하는 기법을 통해 원본 파일이 파일시스템에 노출되지 않음으로써 패커의 안정성이 올라갈 것이라 예상한다.

오염지하수 유입방지를 위한 압축패커 그라우팅 장치 개발 (Development of the Compressed Packer Grouting Device for Preventing the Inflow of Polluted Groundwater)

  • 조희남;최상일
    • 지질공학
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    • 제19권4호
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    • pp.433-439
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    • 2009
  • 압축패커장치는 지하수관정의 지표하부오염방지시설의 개선을 위하여 개발한 장치이다. 이 장치는 안전잠금장치의 해제와 케이싱의 압축조작이 단순하여 시공이 간편하고, $4.5\;kg/cm^2$의 내압성을 갖고 있어 지하수 누출이 없도록 수밀성을 갖추고 있으며, 단일케이싱을 설치하며 그라우팅을 위한 확공은 300 mm로 굴착 가능하므로 시공비를 절약할 수 있다. 압축패커의 재질은 실리콘 고무를 사용하여 신장율이 590%이고 Pb, Cd, 페놀 등의 유해성분이 기준치 이하거나 불검출되어 우수한 환경성을 가지고 있다. 또한 시공비가 기존의 그라우팅 공법의 35~62% 이하, 환경신기술 제 47호인 팽창 패커 공법의 87% 이하로 시공이 가능한 경제적인 방법이며, 지하수 수질보전등에 관한 규칙, 제주도 지하수개발 이용시설 설치 및 관리기준, 환경부와 농림수산식품부의 소규모수도시설 운영관리 방안 지침 등 관련 법령규정에 적합한 제품이다.

Pipelined Implementation of JPEG Baseline Encoder IP

  • Kim, Kyung-Hyun;Sonh, Seung-Il
    • Journal of information and communication convergence engineering
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    • 제6권1호
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    • pp.29-33
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    • 2008
  • This paper presents the proposal and hardware design of JPEG baseline encoder. The JPEG encoder system consists of line buffer, 2-D DCT, quantization, entropy encoding, and packer. A fully pipelined scheme for JPEG encoder is adopted to speed-up an image compression. The proposed architecture was described in VHDL and synthesized in Xilinx ISE 7.1i and simulated by modelsim 6.1i. The results showed that the performance of the designed JPEG baseline encoder is higher than that demanded by real-time applications for $1024{\times}768$ image size. The designed JPEG encoder IP can be easily integrated into various application systems, such as scanner, PC camera, color FAX, and network camera, etc.

냉간성형 각형강관 T형 접합부의 항복선해석 전용한계 (Application limit of Yield Line Analysis on Welded T-joints in Cold-Formed SHS Sections)

  • 강창훈;배규웅
    • 한국강구조학회 논문집
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    • 제16권3호통권70호
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    • pp.315-324
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    • 2004
  • 본 논문은 지관에 압축력을 받는 냉간성형 각형강관 T형 용접접합부의항복선 해석에 관한 연구이다. 기존 연구 중 냉간성형 정방형 각형강관 T형 용접 접합부만을 포함하는 실험결과와 Kato, Packer, Zhao, CIDECT 및 본 연구진들의 제안식을 비교하였다. 제안된 항복선 모델의 적용한계치를 제안하기 위하여, 항복선 해석에 기초하여 이전 논문에서 제안된 항복선모델을 재검토하였다. 제안된 항복선 모델은 냉간성형 각형강관 곡률부와 용접크기를 고려한다. 마지막으로, 실험상의 실체 파괴모드와 해석상의 비교결과를 참조하여, 항복선 해석의 적용범위를 ${\beta}^{\prime}{\leq}0.8$로 제안하였다. 여기서, ${\beta}^{\prime}=0.8$, ${\beta}^{\prime}=b_1^{\prime}/b_0^{\prime}$, $b_1{^{\prime}}=b_1+t_0$, $b_0{^{\prime}}=b_0-t_0$.

JPEG이 내장된 ISP를 위한 전력 효율적인 스캔 순서 변환 (Power Efficient Scan Order Conversion for JPEG-Embedded ISP)

  • 박현상
    • 한국산학기술학회논문지
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    • 제10권5호
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    • pp.942-946
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    • 2009
  • ISP와 JPEG 인코더 사이에는 라스터 스캔 순서의 데이터를 $8{\times}8$ 블록 스캔 순서로 변환하는 스캔 순서 변환기가 위치한다. 최근에 단일 라인 메모리를 사용함으로써, 하드웨어 규모를 감축한 스캔 순서 변환기가 제안되었으나 매 사이클마다 기입과 독출 동작을 수행함에 따라서 전체 전력 예산의 대부분을 SRAM이 소모하는 문제점을 야기했다. 본 논문에서는 SRAM에 대한 억세스 빈도를 술이기 위하여 데이터 packer와 unpacker를 스캔 순서 변환 과정에 삽입함으로써, SRAM에 대한 억세스 빈도를 1/8로 줄이는 구조를 제안한다. 실험결과, 제안한 구조를 적용할 경우 SXGA 해 상도에서의 SRAM 전력소모량을 16% 이하로 줄어든다.