• 한국정밀공학회:학술대회논문집
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• 한국정밀공학회 2003년도 춘계학술대회 논문집
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• pp.1018-1021
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• 2003

A scratch tester was developed to evaluate the adhesive strength at interface between thin film and substrate(silicon wafer). Under force control, the scratch tester can measure the normal and the horizontal forces simultaneously as the probe tip of the equipment approaches to the interface between thin film and substrate of wafer. The capacity of each component of force sensor is 0.1 N ∼ 100 N. In addition, the tester can detect the signal of elastic wave from AE sensor(frequency range of 900 kHz) attached to the probe tip and evaluate the bonding strength of interface. Using the developed scratch tester. the feasibility test was performed to evaluate the adhesive strength of semiconductor wafer.

• 한국전기전자재료학회:학술대회논문집
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• 한국전기전자재료학회 2010년도 하계학술대회 논문집
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• pp.177-177
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• 2010

본 연구에서는 반도체용 Si wafer에 마스크 공정 및 slit etching 공정을 적용하여 목표인 30um 이하의 Probe unit을 개발하기 위해 Deep Si Etching(DRIE) 장비를 이용하여 식각 공정에 따른 특성을 평가하였다. 마스크는 Probe block 조립에 적합한 패턴으로 설계 하였으며, slit의 에칭된 지점에 pin이 삽입될 수 있도록 그 폭을 최소한으로 설계하였다. 30um pitch와 20um pitch의 마스크를 각각 설계하여 포토공정에 의해 마스크패턴을 제작하였으며, 식각공정 결과 식각율 5um/min, profile angle $89^{\circ}{\pm}1^{\circ}$로 400um wafer의 양면관통 식각을 확인하였으며, 표면 및 단면 식각특성을 조사하였다.

• 정보저장시스템학회논문집
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• 제2권2호
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• pp.96-99
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• 2006

In this research, a wafer-level transfer method of cantilever away on a conventional CMOS circuit has been developed for high density probe-based data storage. The transferred cantilevers were silicon nitride ($Si_3N_4$) cantilevers integrated with poly silicon heaters and piezoelectric sensors, called thermo-piezoelectric $Si_3N_4$ cantilevers. In this process, we did not use a SOI wafer but a conventional p-type wafer for the fabrication of the thermo-piezoelectric $Si_3N_4$ cantilever arrays. Furthermore, we have developed a very simple transfer process, requiring only one step of cantilever transfer process for the integration of the CMOS wafer and cantilevers. Using this process, we have fabricated a single thermo-piezoelectric $Si_3N_4$ cantilever, and recorded 65nm data bits on a PMMA film and confirmed a charge signal at 5nm of cantilever deflection. And we have successfully applied this method to transfer 34 by 34 thermo-piezoelectric $Si_3N_4$ cantilever arrays on a CMOS wafer. We obtained reading signals from one of the cantilevers.

• 한국정밀공학회:학술대회논문집
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• 한국정밀공학회 2010년도 춘계학술대회 논문집
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• pp.1033-1034
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• 2010

• 한국진공학회:학술대회논문집
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• 한국진공학회 2012년도 제43회 하계 정기 학술대회 초록집
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• pp.316-316
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• 2012

본 연구에서는 Si wafer에 마스크 공정 및 Slit-etching 공정을 적용하여 25 um 피치의 probe unit을 개발하기 위해 Deep Si Etching 장비를 이용하여 식각공정 조건에 따른 특성을 평가하였다. 25 um pitch는 etch 폭의 크기에 따라 3종류로 설계하였으며, 식각공정은 2수준, 4인자 실험계획법에 의해 8회 실험을 수행하였다. 실험계획법에 의해 미니탭을 활용하여 최적조건을 구한 결과 12.5 um etch 폭에서는 가스유량은 200 sccm, 에칭시간 7 sec, 코일 파워 1500W, 에칭 압력은 43.7 mtorr의 조건이 etch 형태 및 profile angle이 목표치에 근접한 결과를 얻었다. 또한 probe pitch를 30~60 um까지 증가시켰을 경우 Etch depth는 증가하였으며, 식각율 또한 증가한 현상을 보였다. 재현성 실험을 위해 위의 최적조건을 이용하여 2회 반복하여 실험한 경우 모든 시편이 목표치에 도달하였다. 이는 미세피치화 되는 프로브 유닛의 기초데이터로 활용될 수 있다.

• 한국진공학회:학술대회논문집
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• 한국진공학회 2012년도 제42회 동계 정기 학술대회 초록집
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• pp.499-499
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• 2012

This study was evaluated on etcher of capacitive coupled plasmas with OES (Optical Emission Spectroscopy) and impedance by VI probe that are widely used for process control and monitoring at semiconductor industry. The experiment was operated at conventional Ar and C4F8 plasma with variable change such as pressure and addition of gas (Atmospheric Leak: N2 and O2), RF, pressure, that are highly possible to impact wafer yield during wafer process, in order to observe OES and VI Probe signals. The sensitivity change on OES and Impedance by Vi probe was analyzed by statistical method to determine healthy of process. The main goal of this study is to understand unwanted tool performance to eventually improve productive capability. It is important for process engineers to actively adjust tool parameter before any serious problem occurs.

• 제어로봇시스템학회논문지
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• 제8권5호
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• pp.419-424
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• 2002

After the patterning and probe process of wafer have been achieved, the dicing processing is necessary to separate chips from a wafer. The dicing process cuts a semiconductor wafer to lengthwise and crosswise directions to make many chips. The existing general dicing method is the mechanical cutting using a narrow circular rotating blade impregnated diamond particles or laser cutting. Inferior goods can be made by the mechanical or laser cutting unless several parameters such as blade, wafer, cutting water and cutting conditions are properly set. Moreover, we can not apply these general dicing method to that of GaN wafer, because the GaN wafer is harder than general semiconductor wafers such as GaAs, GaAsP, AIGaAs and so forth. In order to overcome these problems, this paper describes a new wafer dicing method using fixed diamond scriber and precision servo mechanism.

• 한국윤활학회:학술대회논문집
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• 한국윤활학회 2000년도 제32회 추계학술대회 정기총회
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• pp.18-22
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• 2000

An experimental study was carried out to investigate the effect of nano-contact condition on the nano-adhesion phenomena. SPM(scanning probe microscope) tips with different radius of curvature were fabricated by a series of masking and etching processes. DLC(diamond-like carbon) and W-DLC (tungsten-incorporated diamond-like carbon) were coated on (100) silicon wafer by PACVD(plasma assisted chemical vapor deposition). Pull-off forces of Pure Si-wafer, DLC and W-DLC were measured with SPM(scanning probe microscope). Also, the same series of tests were carried out with the tips with different radius of curvature. Results showed that DLC and W-DLC showed much lower pull-off force than Si-wafer and Pull-off force increased with the tip radius.

• 한국진공학회:학술대회논문집
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• 한국진공학회 2010년도 제39회 하계학술대회 초록집
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• pp.257-257
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• 2010

디스플레이 산업의 발달로 화상 영상폰, 디지털 카메라, MP4, PMP, 네비게이션, LCD TV등의 가전 제품의 수요증가에 따라 이에 장착되는 LCD 패널의 생산력 향상과 원가 절감을 위한 검사 기술이 요구되고 있다. LCD 검사를 위한 Probe unit은 미세전기기계시스템(MEMS) 공정을 이용하여 제작된다. LCD 검사용 Probe unit는 LCD 가장자리 부분에 전기적 신호(영상신호, 등 기신호, 색상신호)가 인가되도록 하는 수 십 내지 수 백개의 접속 단자가 고밀도로 배치되는데, 이러한 LCD는 제품에 장착되기 전에 시험신호를 인가하여 화면의 불량여부를 검사하기 위한 점등용 부품으로 50 um 이하의 Pin간 거리를 유지하면서 정확한 Pin Alignment를 요구하는 초정밀 부품이다. 본 연구에서는 반도체용 Si wafer에 마스크 공정 및 slit etching 공정을 적용하여 목표인 30 um pitch의 Probe unit을 개발하기 위해 Deep Si Etching(DRIE) 장비를 이용하여 식각 공정에 따른 특성을 평가하였다. 마스크 공정은 500 um 두께의 양면 연마된 반도체용 Si wafer를 이용하였으며, thick PR을 사용하여 마스킹하여 식각공정을 수행하였다. Si 깊은 식각은 $SF_6$ 가스와 Passivation용으로 $C_4F_8$ 가스를 교대로 사용하여 수직방향으로 깊은 식각이 이루어지는 원리이다. SEM 측정 결과 30 um pitch의 공정 목표에 도달하였으며, 식각공정 결과 식각율 6.2 um/min, profile angle $89.1^{\circ}$로 측정되었다. 또한 상부 에칭공정과 이면 에칭공정에서 폭과 wall의 간격이 동일하였으며, 완전히 관통된 양면식각이 이루어졌음을 확인하였다. 또한 실제 사용되는 probe unit의 조립에 적합한 slit 공정을 위한 에칭특성을 조사하였다.

• 한국진공학회:학술대회논문집
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• 한국진공학회 2012년도 제43회 하계 정기 학술대회 초록집
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• pp.257-257
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• 2012

Fault detection was carried out in a etcher of capacitive coupled plasma with OES (Optical Emission Spectroscopy) and impedance by VI probe that are widely used for process control and monitoring at semiconductor industry. The experiment was operated at conventional Ar and Fluorocarbon plasma with variable change such as pressure and addition of N2 and O2 to assume atmospheric leak, RF power and pressure that are highly possible to impact wafer yield during wafer process, in order to observe OES and VI Probe signals. The sensitivity change on OES and Impedance by VI probe was analyzed by statistical method including PCA to determine healthy of process. The main goal of this study is to find feasibility and limitation of OES and Impedances for fault detection by shift of plasma characteristics and to enhance capability of fault detection using PCA.