• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2007년도 춘계종합학술대회
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• pp.717-720
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• 2007

본 연구에서는 지향성 안테나 빔의 최적방향을 찾고 유지하는 방법을 제안한다. 제안한 방식은 데이터에 안테나의 정보를 같이 실어 보내고 그 정보를 이용하여 변형된 유전자 알고리즘(MGA)으로 최적의 방향을 찾고 유지 한다. 제안한 방식은 각 스테이션에서 전송하는 데이터에 안테나의 정보를 같이 전송하며 안테나의 RSSI(Received Signal Strength Indication)를 구하고 그 RSSI 값의 곱을 적합도 함수로 이용하여 그 값이 최대가 되는 방향을 찾는 방식이다. 통신 방식은 시분할 이중화(TDD: Time Division Duplex)방식으로 안테나의 제어 정보를 보낸다. 또한 염색체 구성에 있어서 16bit split 방식을 제안하여 탐색에 적용한다. 제안한 방식의 유용성을 확인하기 위하여 1:1, 1:2, 1:5 지향성 안테나의 세 가지 경우에 대한 최적 방향 탐색의 시뮬레이션과 1:1 지향성 안테나의 최적 방향 탐색에 대한 실험을 통하여 성능을 비교 검토하였다. 염색체의 비트 수는 각각 8비트, 16비트, 그리고 16비트 스플릿으로 16비트 스플릿의 경우 8비트만을 사용하여 16비트와 비슷한 성능을 가졌다.

• 한국통신학회논문지
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• 제30권9A호
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• pp.867-875
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• 2005

본 논문은 NRD 가이드를 이용하여 10km이상의 장거리 무선통신이 가능한 밀리미터파 대역용 FM 송신기 및 수신기를 제작하였다. 40GHz 사용주파수의 반파장 크기의 간격을 가지는 상하도체판 사이에 PTEE 유전체선로상에 건발진기, FM변조기 및 안테나로 구성된 FM 송신기를 제작하고, 동일한 간격을 가지는 상하도체판 사이에 국부발진용 건발진기, 밸런스믹서, 3dB 방향성결합기 및 안테나로 구성한 FM 수신기를 각각 제작하였다. 또한 제작된 FM송신기 및 수신기를 이용하여 무선통신 영상전송시험을 실시하였다. 이때 전송거리 10km의 시험거리에서 영상신호를 송신측에서 보낸 후 수신측의 TV 수상기를 통해 선명한 영상을 실시간으로 재생할 수 있었다. 이에 개발된 40GHz 대역 FM 송신기 및 수신기는 CATV의 전송이나 광대역 전송이 필요한 무선통신 시스템으로 사용이 가능하며, 장거리 초고속통신망의 연결 장치로 사용될 수 있을 것이다.

• 대한전자공학회논문지TC
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• 제43권10호
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• pp.69-78
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• 2006

채널환경에 따라 변조방식이 가변되는 적응변조에 의해 높은 대역효율을 얻을 수 있다. 그러므로 시간에 따라 채널이 바뀌는 이동통신 채널에는 특히 적응변조가 적합하다. 이동체의 속도에 따라 적절하게 변조방법을 바꾸기 위해서는 신호대 잡음비의 최적 문턱값을 결정하여야 한다. 따라서 본 논문에서는 특정 이동체의 속도에 대하여 터보부호를 사용할 경우 요구 비트오율 $10^{-6}$을 얻을 수 있는 최적 문턱값을 결정한다. 이를 바탕으로 보간법에 의해서 이동체의 연속적인 속도에 대한 최적 문턱값을 제안한다. 그리고 다양한 이동체의 속도와 채널환경에 대해 그 오류성능 및 대역효율을 분석한다.

• 한국통신학회논문지
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• 제24권8A호
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• pp.1133-1140
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• 1999

저궤도 이동통신 위성을 이용하여 고속 광대역의 멀티미디어 서비스를 제공하기 위해서는 전력 및 대역폭 효율적인 디지털 전송방식의 사용이 요구된다. 본 논문에서는 비선형적으로 증폭된 저궤도 이동위성 통신 채널에서 기존의 QPSK 변복조 방식보다 최소 2배의 정보 전송이 가능한 Trellis 부호화된 16 QAM과 8PSK-2AM의 수신 성능을 비교 분석하였다. 본 논문은 비선형 저궤도 이동 위성통신 채널로서 Fujitsu 사의 GaAs FET 고출력 증폭기가 적용된 Rician 페이딩 채널을 모델링하고 있다. 전산모의 실험결과 8PSK-2AM은 16-AM 보다 위성 채널의 비선형 왜곡에 덜 민감하고 BER 성능이 우수하며 이는 8PSK-2AM의 신호 성상도를 최적화함에 따라 더욱 개선됨을 보였다. 따라서 Trellis 부호화된 8PSK-2AM 전송 방식은 전력 및 대역폭 제한적인 이동위성 통신 채널에서 위성 인터넷, DBS, DAB, ISDB 등의 멀티미디어 서비스를 보다 효율적으로 제공할 수 있을 것이다.

• 대한전자공학회논문지SD
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• 제46권2호
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• pp.1-8
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• 2009

본 논문에서는 일반적인 Folding 구조를 이용한 R-String Folding Block과 Second Folding Block을 제안하여 최대 500Msample/s로 동작하는 ADC를 설계하였다. 제안된 Folding ADC의 R-String Folding Block에서는 상위 4bit를 병렬로 처리하여 디지털 출력을 얻어내며, Second Folding Block에서는 하위 4bit를 새로운 pipeline 방식을 통해 디지털 출력을 얻어낸다. HSPICE 시뮬레이션 과정을 통해 ADC 동작을 확인하였으며 최대 샘플링 주파수인 500Msample/s로 동작할 경우의 평균 전력소모는 1.34mW로 매우 작음을 확인하였다. 램프입력을 인가하면서 디지털 출력이 변할 때의 입력전압을 측정하여 DNL과 INL을 구한 결과 DNL은 $-0.56LSB{\sim}0.49LSB$, INL은 $-0.94LSB{\sim}0.72LSB$의 특성을 나타내었다. 사용된 MOSFET 파라미터는 MOSIS에서 제공하는 $0.35{\mu}m$ 공정 파라미터이다.

• 대한전자공학회논문지SD
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• 제46권2호
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• pp.24-30
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• 2009

본 논문에서는 3GPP(Third Generation Partnership Project) Release 7 eHSPA(High Speed Packet Access for Evolution) UE(User Equipment) FDD(Frequency Division Duplex) 규격을 만족하는 단말 모뎀의 FPGA(Field Programmable Gate Array) 플랫폼 설계 및 이를 기반으로 한 효율적인 검증 방법에 대해 제안한다. 구현된 FPGA 모뎀 플랫폼은 물리 계층 지원을 위한 모뎀 보드, MCU(Micro Controller Unit)와 DSP(Digital Signal Processor) 코어로 구성되어 모뎀 보드를 제어를 위한 제어 보드, 그리고 RF(Radio Frequency) 및 기타 장비 접속을 위한 주변장치(Peripheral) 보드 등으로 구성된다. 그리고 검증 단계는 하드웨어-소프트웨어 연동 상관 정도에 따라 단순 기능 검증, 시나리오 검증 그리고 호 처리 및 시스템 성능 검증 등으로 규정화하여 진행되었고, 실제 구현적인 측면으로 저 전력 SoC(System On a Chip)를 위한 에뮬레이션 검증 기법도 제안한다.

• 대한전자공학회논문지
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• 제26권1호
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• pp.69-77
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• 1989

POS시스템에서 사용되는 바토드 심볼 판독을 위한 홀로곤 스캐너를 개발하였다. 제작된 시스템은 주사 광학부, 광 검출부, 비디오 신호 처리부, 그리고 전치 처리기로 구성되어 있으며, 기존의 다면경을 이용한 바코드 스캐너에 비하여 광학부가 간단하고 바코드 판도면에서 향상된 성능을 얻을 수 있었다. 위치가 변화된 바코드 라벨위에 이루어지는 고밀도 스캔 패턴을 모든 방향에서 판독하기 위하여 실시간으로 디코딩을 수행할 수 있는 새로운 로직을 제안하여 하드웨어와 클락 주파수를 줄임으로써 보다 효율적인 시스템을 구성하였다. 실험 결과, 제작된 시스템은 빠른 처리속도와 기울어진 심볼에 대해서도 좋은 판독율을 나타내었다.

• 전자공학회논문지SC
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• 제39권4호
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• pp.25-35
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• 2002

본 논문에서는 단일 폴리 공정을 기반으로 하여 8b 해상도로 200MHz의 고속 동작을 하기 위해 최적화된 시간 공유 서브레인징 ADC(Analog-to-Digital Converter)를 제안한다. 제안하는 ADC는 높은 정확도를 요구하는 하위 ADC에 이중 채널 구조를 적용하여 높은 샘플링 주파수를 보장하였고, 새로운 기준 전압 인가 방식을 적용하여 기준 전압의 빠른 정착 시간을 얻으면서 동시에 칩 면적을 크게 감소시켰다. 기준 전압을 생성하는 저항열에서는 선형성 및 속도 향상을 위해 기존의 인터메쉬드 구조를 보완한 새로운 저항열을 사용하였다. 8 비트 수준의 정밀도에서 면적 및 전력 소모를 최소화하기 위해 공통 드레인(common- drain) 증폭기 구조를 사용하여 샘플-앤-홀드 증폭기(Sample-and-Hold Amplifier：SHA)를 설계하였으며, 입력단에 스위치와 캐패시터로 구성된 동적 공통 모드 궤환 회로(Dynamic Common Mode Feedback Circuit)를 사용하여 SHA의 동적 동작 범위(dynamic range)를 증가시켰다. 동시에 상위 ADC와 하위 ADC간의 신호 처리를 단순화시키기 위해 상위 ADC에 새로운 인코딩 회로를 제안하였다.

• 전자공학회논문지C
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• 제36C권3호
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• pp.26-34
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• 1999

실리콘 집적회로 인터컨넥트에서 전송선 파라미터를 추출하는 새로운 방법을 제시하고 이를 실험적으로 고찰 한다. 실리콘 기판 위에 있는 전송선에서의 신호는 PCB (printed circuit board)혹은 MCM (multi-chip module)의 인터컨넥트와 같은 마이크로 스트립 구조에서 가정하는 quasi-TEM 모드가 아니라 slow wave mode (SWM)로 대부분의 에너지가 전송되기 때문에 기판의 효과를 고려하여 전송선 파라미터를 추출한다. 실리콘 기판에서 전계 및 자계의 특성을 고려하여 커패시턴스 파라미터의 계산을 실리콘 표면을 그라운드로 설정하고 계산하고 인덕턴스는 단일 전송선 모델로부터 추출한 실효 유전상수를 도입하여 계산한다. 제안한 전송선 파라미터 추출 방법의 타당성을 검증하기 위하여 테스트 패턴을 제작하여 실험적 파리미터 추출 값이 제시한 방법의 결과와 약 10% 이내에서 일치한다는 것을 보여 계산 방법의 타당성을 입증한다. 또한 고속 샘플링 오실로스코프(TDR/TDT 메터) 측정을 통하여 제시한 방법이 크로스톡 노이즈를 정확히 예측 할 수 있는 반면 흔히 사용하고 있는 기판의 효과를 고려하지 않는 RC 모델 혹은 ？ 모델은 약 20∼25% 정도 과소 오차(underestimation error)를 보인다는 것을 보인다.

• 항공우주기술
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• 제3권2호
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• pp.56-64
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• 2004

본 연구에서는 소형위성발사체의 고체모터 가동노즐용 추력벡터제어 구동장치를 제어하기 위한 컴퓨터 하드웨어 설계에 관한 내용을 기술하였다. 구동장치 제어 컴퓨터는 관성항법장치로부터 제어명령을 받아 작동기를 구동하는 장치로, 발사체 내외의 다른 장비들과 통신을 하는 기능도 갖추고 있다. 구동장치 제어 컴퓨터는 고속의 제어 알고리즘 연산에 적합하도록 디지털 시그널 프로세서를 주 프로세서로 채택하여 KSR-III의 아나로그 제어기와 비교할 때 안정성과 신뢰성, 유연성을 더 갖추도록 설계하였다. 설계된 제어 컴퓨터는 여기 프로그램 개발용 타겟 보드 제작을 거쳐 1차 시제품으로 개발되었다. 여기에서는 최상위단계의 설계 요구조건과 하드웨어 구성, 지상지원장비에 대해서도 기술하였다.