TV technology started from black and white TV. Color TV invented and users request more realistic TV technology. The next technology is 3DTV. For 3DTV, 3D display technology, 3D coding technology, digital mux/demux technology in broadcast and 3D video acquisition are needed. Moreover, Almost every contents now exist are 2D contents. It causes necessity to convert from 2D to 3D. This article describes 2D/3D conversion algorithm and H/W platform on FPGA board. Time difference makes 3D effect and convolution filter increased the effect. Distorted image and original image give 3D effect. The algorithm is shown on 3D display. The display device shows 3D effect by parallax barrier method and has FPGA board.
Journal of information and communication convergence engineering
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제1권4호
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pp.177-182
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2003
Conventional multilayer feedforward artificial neural networks are very effective in dealing with spatial problems. To deal with problems with time dependency, some kinds of memory have to be built in the processing algorithm. In this paper we show how the newly proposed Serial Input Neuron (SIN) convolutional decoders can be derived. As an example, we derive the SIN decoder for rate code with constraint length 3. The SIN is tested in Gaussian channel and the results are compared to the results of the optimal Viterbi decoder. A SIN approach to decode convolutional codes is presented. No supervision is required. The decoder lends itself to pleasing implementations in hardware and processing codes with high speed in a time. However, the speed of the current circuits may set limits to the codes used. With increasing speeds of the circuits in the future, the proposed technique may become a tempting choice for decoding convolutional coding with long constraint lengths.
In this paper, we propose a progressive transmission of a video using a 2$\times$2$\times$2 DCT First of all, the video data is transformed into multiresolution represented video data using a 2$\times$2$\times$2 DCT. Then. it is represented by a 3-D EZT(Embedded Zero Tree) coding fur the progressive transmission with a bit-rate scalability. The proposed progressive transmission algorithm needs much less computations and buffer memories than the higher-order convolution based wavelet filter. Also, since the 2$\times$2$\times$2 DCT requires independent local computations, parallel processing can be applied.
오늘날 하드웨어의 발전으로 인해 영상 해상도는 FHD를 넘어 4K UHD 이상의 영상 해상도가 사용화되고 있다. 하지만 Edge Map을 만들기 위해 일반적으로 사용하는 함수들은 Convolution 함수 일종으로서 영상의 해상도가 높을수록 더 많은 Complexity를 요구한다. 또한 현재 주요 영상 압축 기술인 JPEG, H.264/AVC High efficiency video coding(HEVC)같은 기법들은 자연 영상을 중점으로 개발되어 있어 Edge map 압축에 있어 자연 영상만큼의 효율을 보여주지 못하고 있다. 본 논문은 원 영상을 Down Scaling한 뒤 이미지를 다시 원래 사이즈로 Up Scaling하여 두 영상의 차를 이용한 Edge Map을 생성하는 새로운 방법을 소개한다. 생성된 Edge Map의 특성인 Histogram 값의 분포가 0을 중심으로 Gaussian 분포를 가지는 것을 이용한 Zero Based 코덱을 제안한다. 제안된 알고리즘을 이용하여 고 해상도 영상에서도 빠르게 Edge Map을 생성하고 제안한 코덱을 통해 해당 Edge map을 압축한 결과 다른 압축 기술보다 더 뛰어난 성능을 보여주었다.
무선통신은 현재 우리 삶의 일부분을 차지하고 있으며, 유선 통신의 한계인 공간적 제약성을 극복함으로서 일상 또는 산업현장에서 없어서는 안되는 아주 중요한 부분이 되어 있다. 현재 산업현장에서 사용되고 있는 유선과 무선콘트롤러의 성능을 향상시키기 위해 컨볼루션 부호와 CRC부호를 적용한 무선 콘트롤러를 구현하였다. 400Mhz대역의 RF모듈을 사용하여 송수신 프로그램에 컨볼루션 부호를 적용하였을때와 적용하지 않았을때의 각각의 수신율을 테tm트 비교해 보았다. 컨볼루션 부호는 POLYNOMIAL함수를 g1(X) =1 + X + X$^2$, g2(X) =1 + X$^2$로 사용하였고 구속장 K=3, 부호율 1/2인 부호를 사용하였다. CRC부호는 POLYNOMIAI. 함수를 X$^{15}$ + X$^2$+ 1 로 사용하여 총 CRC비트는 16bit가 되게 하였다.
천해 수중 음향 채널의 배경잡음과 다중경로에 의한 비트 오류율(BER)을 경감하기 위해 Quadrature Phase Shift Keying(QPSK)에 전방 오류 정정 코드(FEC)로 부호화 비율 1/2의 길쌈 코딩(CC)을 적용하였다. 전송신호의 대역폭에 대한 채널의 일관성 대역폭의 비를 주파수 선택 지표로 정의하였고 주파수 선택지표에 따른 전송 신호의 BER과 비트 에너지 대 잡음비의 이득을 평가하였다. 실내 수조 실험 결과, 주파수 선택지표가 약 1.0 이하인 경우 BER은 이론적인 결과와 일치하고 비트 에너지 대 잡음비의 이득은 약 5 dB로 이론적인 결과와 일치한다. 주파수 선택 지표가 1.0 이상인 주파수 선택적인 다중경로 채널에서도 BER은 효율적으로 감소하지만 비트 에너지 대 잡음비가 일정크기 이상인 조건에서만 CC의 비트 오류 감소에 효과가 있다. 이러한 결과는 본 연구에서 정의한 주파수 선택 지표가 다중 경로 채널에서 CC의 성능 평가의 지표로 적용될 수 있다. 아울러 등화기를 적용하지 않고 저속 수중 음향 통신시스템에 효과적으로 BER을 줄일 수 있다.
본 논문에서 무선 센서 네트워크에 적용 가능한 시공간 블록 부호(Space-Time Block Coding: STBC)와 ARQ를 이용한 1-2-1 부호화 협력 통신 방식을 제안한다. 부호화 협력 통신은 협력 통신에 채널 부호화를 접목시킨 기술로 본 논문에서는 콘볼루션 부호화기를 사용한다. ARQ 방식은 소스 노드로부터 수신한 신호를 우선적으로 목적지 노드에서 평가하여 만족되어질 경우, ACK 메시지를 소스 노드와 릴레이 노드로 전송하고 수신한 신호를 복구하므로 기존의 협력 통신에 비해 주파수 효율을 높일 수 있다. 중계 노드 1과2는 소스로부터 수신한 신호를 펑처링하석 목적지로 전송하는데, 이때 STBC 기술을 적용하여 프로토콜의 신뢰성을 높인다. 또한, 간단한 비교기를 통하여 우수한 BER 성능을 얻을 수 있다. 마지막으로 제안한 프로토콜을 레일리 페이딩과 AWGN를 고려한 Monte-Carlo 시뮬레이션을 통해 BER 성능을 검증하였다.
이 논문에서는 64-Point FFT Radix-4 알고리즘을 DA(Distributed Arithmetic)연산을 이용하여 효율적으로 나비연산 구조를 설계할 수 있음을 보였다. 기존의 convolution 연산에 사용되어 왔던 DA연산이 FFT 나비연산의 트위들 계산에도 효과적으로 사용될 수 있음을 보였다. 제안된 DA 나비연산 구조를 Verilog HDL 코딩으로 구현한 결과, 기존의 승산기를 사용한 나비연산 구조와 비교하여 $61.02\%$의 cell area 감소 효과를 보였다. 또한 제안된 나비연산 구조를 파이프라인 구조에 적용하여 지연변환기와 함께 사용한 전체 64-point Radix-4 FFT 구조의 Verilog-HDL 코딩을 기존의 승산기를 사용한 구조의 코딩과 비교한 결과, $46.1\%$의 cell area 감소효과를 볼 수 있었다. 따라서 제안된 FFT 구조는 DMB용 OFDM 모뎀과 같은 큰 크기의 FFT에 효율적으로 사용될 수 있는 구조가 될 것이다.
We present an implementation and it's real-sea test of an underwater acoustic communication system, which allows the system to reduce complexity and increase robustness in time variant underwater environments. For easy adaptation to complicated and time-varying environments of the ocean, all-digital transmitter and receiver systems were implemented. For frame synchronization the CAZAC sequence was used, and QPSK modulation/demodulation method with carrier frequency of 25kHz and a bandwidth of 5kHz were applied to generate 10kbps transmission rate including overhead. To improve transmission quality, we used several techniques and algorithms such as adaptive beamforming, adaptive equalizer, and convolution coding/Viterbi decoding. For the verification of the system performance, measurement of BER has been done in a very shallow water with depth of 20m at JangMok, Geoje. During the experiment, image data were successfully transmitted up to about 9.6km.
By minimizing the burst error of data and correcting the error, we can define the convolution coding and interleaving in IEEE 802.11a wireless tan system. Two step block interleaver was decided by coded bits per OFDM symbol and due to this it comes to the delay time in IEEE 802.11a. This is the point of the question which we must consider. We try to decrease the delay time by all 48-clock from interleavings, and we have proposed a way carried out the interleaving outputs per symbol. So in comparison with the existing interleaver, we can decrease the delay time in reading and writing data, as well as reduce the delay time of bit re-ordering per symbol. Also this scheme is apply in all x-QAM cases.
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[게시일 2004년 10월 1일]
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