• 제목/요약/키워드: ADSRC

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모바일 오피스 서비스 지원을 위한 ADSRC 패킷 통신 시스템

  • 이현;안동현;신창섭;임춘식;박세호;조경록
    • 정보와 통신
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    • 제19권9호
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    • pp.77-85
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    • 2002
  • In this paper, we introduce an ADSRC(hdvanced DSRC) OFDM packet communication system which has been developed by ETRI. The ADSRC system is targeted to provide high terminal mobility, high data rate and seamless service in roadside environment for mobile office services. We discuss the requirements of the ADSRC communication system for mobile office services, and the system design specification to meet them with regard to air interface. The ADSRC packet communication systems consist of the MAC processor block, the OFDM packet modem block and the RF block. The MAC processor block handles medium access control and the test. The OFDM packet modem transmits data packets at up to 24Mbps adaptively and recovers the data from RF block. We describe the ADSRC packet communication system architecture and the ADSRC system protocol.

차세대 DSRC 패킷 통신 기술 개발 (Development of Advanced DSRC Packet Communication Technology)

  • 이현;박인성;신창섭;오현서;임춘식;조경록
    • 한국ITS학회 논문지
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    • 제2권1호
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    • pp.93-100
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    • 2003
  • 본 논문에서는 한국전자 통신 연구원에서 연구 개발한 차세대 DSRC 패킷 통신 기술을 소개하였다. 차세대 DSRC 패킷 통신 시스템의 요구 사항, 목표 시스템 규격, 차세대 DSRC 패킷 통신시스템의 구조에 대하여 설명하였다. 차세대 DSRC 시스템은 최대 24 Mbps 데이터를 5.8GHz 대역으로 전송하는 고속 패킷 통신 시스템으로 기존의 ITS 서비스뿐 아니라 모바일 오피스 서비스를 지원한다. 현재 차세대 DSRC 시스템은 각 모듈 별 기능 시험을 실시하였으며 차세대 DSRC RE 모듈의 front end부분에 대한 MMIC(microwave monolithic integrated circuit) 개발하였다. 본 차세대 DSRC 패켓 통신 시스템은 Mobile PC 제조산업, 차량 탑재 무선 인터넷 산업, 차세대 이동통신으로 차량에 탑재되는 고속 무선 인터넷 단말기로서 모바일 인터넷, 게임 등 모바일 오피스 응용 및 텔레매틱스 서비스 차세대 이동통신 산업 발전에 기여할 것으로 기대된다

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OFDM 기반 WAVE 시스템의 시간동기 하드웨어 설계 (Hardware Design for Timing Synchronization of OFDM-Based WAVE Systems)

  • 현트롱안;김진상;조원경
    • 한국통신학회논문지
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    • 제33권4A호
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    • pp.473-478
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    • 2008
  • 5.9 GHz WAVE(Wireless Access for the Vehicular Environment)는 노변-차량, 차량-차량 통신을 통하여 공공안전과 개인통신을 지원하기 위한 중단거리 무선통신 방식이다. WAVE 물리계층의 핵심기술은 시간동기오류에 민감한 OFDM 방식이며 통신링크상의 지연을 최소화하여 고속의 차량통신 환경을 제공하는 것이 매우 중요하다. 본 논문에서는 오류에 강인하고 복잡도가 낮고 지연시간이 적은 WAVE 시스템 응용을 위한 시간동기 알고리즘과 하드웨어 구조를 제안한다. 제안된 알고리즘은 기존의 알고리즘에 비교하여 연산의 복잡도와 지연시간이 감소되며 하드웨어 구조는 파이프라인 구조와 고속 동작에 영향을 줄 수 있는 RAM이 필요하지 않다는 장점이 있다. Matlab과 FPGA를 이용한 하드웨어 구현을 통한 동기화 오차율(SER) 실험결과, 제안된 알고리즘이 고속 이동환경에 대해 강인하고 효율적이라는 확인하였다.