• 화약ㆍ발파
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• 제24권2호
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• pp.33-39
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• 2006

국내에서는 주로 환산거리방식에 의한 발파진동 예측 방법이 주로 사용되고 있다. 환산거리 방식에서 중요한 변수인 지발당 장약량은 인접 단차간에 진동의 영향이 없는 단차로서 통상적으로 8ms을 기준으로 한다. 본 연구에서는 8ms 기준의 기원과 문제점을 문헌고찰을 통해 제시하고 인접단차 간에 진동의 영향이 없는 단차로 각 학자 별로 제시된 8ms, 17ms, 25ms 단차를 Langefors의 2.5T 기준으로 고찰하였다.

• 대한전자공학회논문지SD
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• 제41권10호
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• pp.69-75
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• 2004

본 논문에서는 온도 및 전원전압에 덜 민감한 기준전압을 위해 온-칩 필터를 사용하는 8b 220 MS/s 230 rnW 3단 파이프라인 CMOS A/D 변환기 (ADC) 회로를 제안한다. 제안하는 RC 저대역 필터는 기존의 큰 값을 가진 칩 외부의 바이패스 캐패시터를 사용하지 않고도 고속 동작 시 발생하는 여러 가지 잡음을 효과적으로 감쇄시키고 큰 R, C 부하에서도 기준전압의 정착시간을 줄인다. 시제품 ADC는 0.25 um CMOS 공정을 이용하여 설계 및 제작되었고, 입/출력단의 패드를 제외한 코어 면적은 2.25 ㎟ 이며 측정된 DNL 및 INL은 각각 -0.35～+0.43, LSB, -0.82～+0.71 LSB 수준을 보여준다. 또한, SNDR은 200 MS/s, 220 MS/s 샘플링 주파수에서 입력 주파수가 수 MHz에서 110 MHz까지 증가할 때 각각 43 dB 및 41 dB로 유지되었고, 입력주파수가 500 MHz 까지 증가할 때는 입력주파수가 110 MHz의 경우에 비해 3 dB 정도만 감소되었다.

• 대한전자공학회논문지SD
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• 제45권3호
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• pp.77-85
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• 2008

본 논문에서는 TFT-LCD 디스플레이 및 디지털 TV 시스템 응용과 같이 고속으로 동작하며 고해상도, 저전력 및 소면적을 동시에 요구하는 고화질 영상시스템 응용을 위한 12비트 130MS/s 108mW $1.8mm^2$ 0.18um CMOS ADC를 제안한다. 제안하는 ADC는 3단 파이프라인 구조를 사용하여 고해상도와 높은 신호처리 속도에서 전력 소모 및 면적을 최적화하였다. 입력단 SHA 회로에는 Nyquist 입력에서도 12비트 이상의 정확도로 신호를 샘플링하기 위해 게이트-부트스트래핑 회로를 적용함과 동시에 트랜스컨덕턴스 비율을 적절히 조정한 2단 증폭기를 사용하여 12비트에 필요한 높은 DC 전압 이득과 충분한 위상 여유를 갖도록 하였으며, MDAC의 커패시터 열에는 높은 소자 매칭을 얻기 위하여 각각의 커패시터 주위를 공정에서 제공하는 모든 금속선으로 둘러싸는 3차원 완전 대칭 구조를 갖는 레이아웃 기법을 적용하였다. 한편, 제안하는 ADC에는 전원 전압 및 온도에 덜 민감한 저전력 기준 전류 및 전압 발생기를 온-칩으로 집적하여 잡음을 최소화하면서 시스템 응용에 따라 선택적으로 다른 크기의 기준 전압 값을 외부에서 인가할 수 있도록 하였다. 제안하는 시제품 ADC는 0.18um n-well 1P6M CMOS 공정으로 제작되었으며, 측정된 DNL 및 INL은 12비트 해상도에서 각각 최대 0.69LSB, 2.12LSB의 수준을 보이며, 동적 성능으로는 120MS/s와 130MS/s의 동작 속도에서 각각 최대 53dB, 51dB의 SNDR과 68dB, 66dB의 SFDR을 보여준다. 시제품 ADC의 칩 면적은 $1.8mm^2$이며 전력 소모는 1.8V 전원 전압과 130MS/s에서 108mW이다.

• 한국음향학회지
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• 제17권7호
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• pp.74-78
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• 1998

본 논문에서는 고속의 변환속도를 갖는 파이프라인드 방식과 저전력 특성을 갖는 축차 비교 방식 구조를 혼용하여 고속, 저전력 아날로그-디지털 변환기를 설계하였다. 제안 된 구조는 축차 비교 방식의 변환에서 비교기를 파이프라인드 구조로 연결하여 홀드된 주기 에 비교기의 기준 전위를 전 비교기의 출력값에 의해 변환하도록 하여 고속 동작이 가능하 도록 하였다. 제안된 구조에 의해 8비트 아날로그 디지털 변환기를 0.8㎛ CMOS공정으로 HSPICE를 이용하여 시뮬레이션한 결과, INL/DNL은 각각 ±0.5/±1이었으며, 100kHz 사인 입력 신호를 10MS/s로 샘플링 하여 DFT측정 결과 SNR은 41dB를 얻을 수 있었다. 10MS/s의 변환 속도에서 전력 소모는 4.14mW로 측정되었다.

• 대한화학회지
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• 제63권5호
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• pp.342-345
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• 2019

식품에서 글라이포세이트와 글루포시네이트의 함량 기준은 구체적이며 분류가 잘 되어있다. 그러나 동물 사료나 먹이에서의 함량 기준은 비교적 구체적이지 못하며 분류가 미흡한 편이다. 또한 인간에게 미치는 위험에 대해서는 지속적인 논의는 이루어지고 있는 반면에, 동물에게 미치는 위험성은 충분한 연구가 이루어지지 않았다. 본 연구에서는 동물이 글라이포세이트를 섭취하는 경로로 추정되는 사료에서의 분석법을 확립하였다. 25% 메탄올을 이용한 용매추출, 원심분리 후 고체상추출로 정제한 후, 농축하여 LC-MS/MS를 이용하여 정량 분석하였다. 분석법 검증은 검출한계, 정확도 및 정밀도 시험을 통해 진행하였다. 확립된 시험법의 검출한계는 글루포시네이트 $1.8{\mu}g/kg$, 글라이포세이트 $2.4{\mu}g/kg$ 이었다. 정확도는 94.4~103.4%, 정밀도는 1.5~7.2%의 범위로 나타났다. 동물 사료(n=13)를 분석법을 적용시켜 분석한 결과 글루포시네이트는 한 개의 시료에서 검출되었고($ND{\sim}8.8{\mu}g/kg$), 글라이포세이트는 한 개의 시료를 제외한 모든 시료에서 검출($ND{\sim}337.0{\mu}g/kg$)되었다.

• 터널과지하공간
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• 제16권4호
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• pp.326-333
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• 2006

본 연구에서는 측정된 진동파형을 토대로 다른 발파공들로부터 간섭을 받지 않은 단일공의 진동파형을 분리 하였고 이를 FFT 주파수 분석을 통하여 우세 주파수를 분석하였다. 또한 진동의 지속시간과 발파공수가 PPV에 미치는 영향을 검토하기 위해 분리된 진동파형을 $2{\sim}15$공으로 발파공수를 조절하면서 $1{\sim}80ms$까지 1 ms의 간격으로 지연시차에 변화를 주며 발파진동에 중첩 모델링을 실시하였다. 그 결과 진동의 지속시간이 길어질수록 다른 발파공들로부터 간섭받지 않기 위한 지연시차 또한 길어졌고 동일 지연시차 내에서의 발파공 수에 관한 영향은 크게 나타나지 않았다.

• 한국통신학회논문지
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• 제24권8A호
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• pp.1259-1264
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• 1999

본 논문에서는 파이프라인드 방식의 빠른 변환 속도와 축차 비교 방식의 저전력 구조를 이용하여 고속, 저전력 아날로그 디지털 변환기를 제안하였다. 제안된 구조의 변환 방법은 축차 비교 방식의 변환에서 비교기를 파이프라인드 구조로 연결하여 홀드된 주기에 비교기의 기준 전위를 전 비교기의 출력값에 의해 변환하도록 하여 고속 동작이 가능하도록 하였다. 제안된 구조에 의해 비디오 신호처리가 가능한 10MS/s 아날로그 디지털 변환기를 0.8$\mu\textrm{m}$ CMOS공정으로 HSPICE로써 시뮬레이션하였다. 6비트 아날로그 디지털 변환기는 100kHz 사인 입력 신호를 10MS/s로 샘플링 하여 DFT측정한 결과 37dB의 SNR을 얻을 수 있었으며, 전력 소모는 1.46mW로 측정되었다. 8비트 아날로그 디지털 변환기는 INL/DNL은 각각 $\pm$0.5/$\pm$1이었으며, 100kHz 사인 입력 신호를 10MS/s로 샘플링 하여 DFT 측정하였을 때 SNR은 41dB를 얻을 수 있었고, 전력 소모는 4.14mW로 측정되었다.

• 대한전자공학회논문지SD
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• 제43권11호
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• pp.37-47
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• 2006

본 논문에서는 Digital Video Broadcasting (DVB), Digital Audio Broadcasting (DAB) 및 Digital Multimedia Broadcasting (DMB) 등과 같이 저전압, 저전력 및 소면적을 동시에 요구하는 고성능 무선 통신 시스템을 위한 10b 25MS/s $0.8mm^2$ 4.8mW 0.13um CMOS A/D 변환기 (ADC)를 제안한다. 제안하는 ADC는 요구되는 해상도 및 속도 사양을 만족시키면서 동시에 면적 및 전력 소모를 최소화하기 위해 2단 파이프라인 구조를 사용하였으며, 스위치 기반의 바이어스 전력 최소화 기법(switched-bias power reduction technique)을 적용하여 전체 전력 소모를 최소화하였다. 입력단 샘플-앤-홀드 증폭기는 낮은 문턱전압을 가진 트랜지스터로 구성된 CMOS 샘플링 스위치를 사용하여 10비트 이상의 해상도를 유지하면서, Nyquist rate의 4배 이상인 60MHz의 높은 입력 신호 대역폭을 얻었으며, 전력소모를 최소화하기 위해 1단 증폭기를 사용하였다. 또한, Multiplying D/A 변환기의 커패시터 열에는 소자 부정합에 의한 영향을 최소화하기 위해서 인접신호에 덜 민감한 3차원 완전 대칭 구조의 커패시터 레이아웃 기법을 제안하며, 기준 전류 및 전압 발생기는 온-칩으로 집적하여 잡음을 최소화하면서 필요시 선택적으로 다른 크기의 기준 전압을 외부에서 인가할 수 있도록 설계하였다. 또한, 다운 샘플링 클록 신호를 사용하여 바이어스 전류를 제어함으로써 10비트의 해상도에서 응용 분야에 따라서 25MS/s 뿐만 아니라 10MS/s의 동작 속도에서 더 낮은 전력 사용이 가능하도록 하였다. 제안하는 시제품 ADC는 0.13um 1P8M CMOS 공정으로 제작되었으며 측정된 최대 DNL 및 INL은 각각 0.42LSB 및 0.91LSB 수준을 보인다. 또한, 25MS/s 및 10MS/s의 동작 속도에서 최대 SNDR 및 SFDR이 각각 56dB, 65dB이고, 전력 소모는 1.2V 전원 전압에서 각각 4.8mW, 2.4mW이며 제작된 ADC의 칩 면적은 $0.8mm^2$이다.

• 한국초지조사료학회지
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• 제21권1호
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• pp.31-34
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• 2001

이탈리안 라이그라스 (Lolium multiflorum Lam.) 의 절단한 줄기를 살균처리한 다음, IBA론 첨가한 농도별로 5종의 배지에 처리별로 각각 20개씩 절단한 줄기를 꽃은 후, 4$^{\circ}C$ 암상태에서 40일간 보관하였다가. 실온에 하루동안 둔 다음, 26$^{\circ}C$로 유지되는 생장실에서 배양하며 뿌리가 유도되는 정도를 관찰하였다. 생장실에서 배양한 지 1개월째에 뿌리유도 정도를 조사한 결과, MS-0 처리구에서 0.0%, MS-0.5IBA 처리구에서 8.3%, MS-1.0IBA 처리구에서 37.5%, MS-1.5IBA 처리구에서 16.7%, MS-2.0IBA 처리구에서 12.5%의 뿌리 유도를 확인하였다. MS 배지에 1.0 mg/$\ell$의 IBA를 첨가한 처리구에서 뿌리 유도 정도가 37.5%로서 가장 좋았다. 따라서 이탈리안 라이그라스 줄기로부터 뿌리를 유도할 경우에는 IBA를 첨가해 주는 것이 뿌리 유도 효율을 높일 수 있는 것으로 판단되며, 1.0mg/$\ell$의 IBA를 첨가해 줄 때 뿌리 유도 효율이 가장 좋을 것으로 사료된다.

• 한국식품영양과학회지
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• 제38권12호
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• pp.1779-1784
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• 2009

우리 국민의 주식이 되는 쌀(백미)과 콩류, 감귤류, 열대과 일류, 엽채류, 엽경채류, 근채류, 과채류, 버섯류에 속하는 농산물(989건)에 대해 8종의 EBI계 농약의 잔류 여부를 분석하였다. 그 결과 8건의 검체에서 농약이 검출되었고 농약 수는 5종이 검출되었다. 기준 미설정 농약은 2종이었으며, 곡류 134건 중 4건 검출로 3.0%, 채소류 471건 중 4건 검출로 0.8%의 검출율을 나타내었다. 그 외 콩류(48건), 견과종실류(72건), 과실류(197건), 버섯류(67건)에서는 전혀 검출되지 않았으며 부적합율은 0.1%로 나타났다. 국내 미등록농약인 paclobutrazole이 근대에서 잠정허용기준을 초과하는 것으로 확인되었다. 그리고 EBI계의 검출율은 0.8%로 매우 낮았으며 검출된 농약의 경우도 기준규격 이하로 안전한 수준이었다.