• 제목/요약/키워드: 항복 전압

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Multi RESURF구조를 갖는 LDMOS의 on 저항과 항복전압 (On resistance and breakdown voltage of LDMOS with Multi RESURF structure)

  • 최이권;최연익;정상구
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2002년도 추계학술대회 논문집 전기물성,응용부문
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    • pp.156-158
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    • 2002
  • Reduction of on-resistance($R_{on}$) in high voltage devices is of critical importance for the power consumption of the device. $R_{on}$ decreases with increase of the doping concentration of the drift region. However, breakdown voltage(BV) decreaes also with increase of doping concentration. In this report, a multi-resurf LDMOS[1] strcuture is proposed to reduce the $R_{on}$ which allows no degradation in BV. The on-and off-state characteristics of the proposed structure are simulated using the two-dimensional devices simulator ATLAS and compared with those from the conventional structure.

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양성자 주입법에 의한 PT형 고속전력 다이오드의 제조 (Fabrication of PT type high power diode by proton irradiation)

  • 배영호;김병길;이종헌
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 2005년도 하계학술대회 논문집 Vol.6
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    • pp.97-98
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    • 2005
  • 양성자 조사법에 의하여 고속 전력용 다이오드를 제작하기 위하여 punch-through 다이오드에 다양한 조건으로 양성자를 조사하였다. 동일한 소자에 전자선을 조사한 소자와 속도 향상을 위한 공정이 행하여지지 않은 동일한 소자 각각의 특성을 비교 분석하였다. 양성자 주입은 주입 에너지를 1 MeV 와 1.3 MeV로, 각 에너지 조건에서 도즈를 $1\times10^{12}cm^{-2}$, $1\times10^{13}cm^{-2}$로 변화 시켰다. 분석 결과 양성자 주입된 소자에서 역방향 회복시간은 최소 소자의 약 45%, 전자선이 조사된 소자에 비하여 약 73 %의 값으로 향상시킬 수 있었으며 역방향 항복 전압과 순방향 저항은 처리되지 않은 소자와 전자빔이 조사된 시편들의 값과 비슷한 값을 나타내었다.

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사이리스터의 결함과 항복전압의 관계 분석 (Analysis of the relationship between breakdown voltage and defect of thyristor)

  • 이양재;서길수;김형우;김기현;김상철;김남균;김병철
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 2005년도 하계학술대회 논문집 Vol.6
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    • pp.149-150
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    • 2005
  • Thyristor breakdown voltage variation acceleration aging test was investigated. The breakdown voltage was deceased after 1000 hours acceleration aging test. It temperature rising caused by electric field concentration at the edge beveling region of the thyristor was confirmed using Silvaco device simulation. The local temperature rising is driving force for the defect propagation. Consequently, propagated defects of the beveling region seems to decrease thyristor's breakdown voltage.

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PAMBE를 사용하여 성장된 AlN의 성장온도에 따른 AlN/Si의 구조적 특성 분석

  • 홍성의;한기평;백문철;윤순길;조경익
    • 한국진공학회:학술대회논문집
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    • 한국진공학회 2000년도 제18회 학술발표회 논문개요집
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    • pp.88-88
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    • 2000
  • AlN는 약 6.2eV 정도의 큰 에너지 밴드폭을 가지고 있어서 S, GaAs에 비해 높은 항복전압과 물리적인 강도를 가지고 있어서 고온 고전력 전자소자로 응용이 되어지며, 또한 압전특성이 우수하기 때문에 SAW 소자에 응용이 되어진다. 또한 최근 광소자 재료로 연구가 되어지고 있는 GaN의 Buffer Layer로도 사용이 되어지고 있다. 본 실험은 Plasma Source를 사용한 PaMBE 장비를 사용하여 Si 기판위에 AlN 박막을 성장시키고자 하였다. AlN 박막을 성장 온도를 변화시켜가며 Si(100) 과 Si(111)기판위에 성장을 수행하였으며 성장온도의 변화에 따른 AlN 박막의 결정성을 살펴보았다. AlN/Si(100)은 XRD와 DCD 분석에 의해 AlN 박막이 (0001) 방향으로 우선배향되었음을 알 수 있었고, AlN/Si(111)은 XRD, DCD 그리고 TEM분석에 의해서 단결정 AlN 박막임을 확인 할 수 있었다.

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높은 항복전압을 위한 최적 계단산화막의 쇼트키 다이오드 (The Schottky Diode of Optimal Stepped Oxide Layer for High Breakdown Voltage)

  • 이용재;이문기;김봉렬
    • 대한전자공학회논문지
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    • 제23권4호
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    • pp.484-489
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    • 1986
  • A device with variable stepped oxide layer along the edge region of Schottky junction have been designed and fabricated. The effect of this stepped oxide layer in the edge region improves the breakdown voltage as a result of the by increase of the depletion layer width, and decreases the leakage current as compared to the effect of conventional field oxide layer, when the reverse voltage was applied. Experimental results shown that the Schottky diode with the the reverse voltage was applied. Experimenal results show that the Schottky diode with the optimal stepped oxide layer maintains nearly ideal I-V characteristics and excellent breakdown voltage(170V) by reducing the edge effect inherent in metal-semiconductor contacts. The optimal conditions of stepped oxide layer are 1700\ulcornerin thickness and 10\ulcorner in length.

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부분 채널도핑된 GaAs계 이중이종접합 전력FET의 선형성 증가 (Linearity Enhancement of Partially Doped Channel GaAs-based Double Heterostructure Power FETs)

  • 김우석;김상섭;정윤하
    • 대한전자공학회논문지SD
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    • 제39권1호
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    • pp.83-88
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    • 2002
  • HFET 소자의 선형성과 게이트-트레인 항복특성을 향상시키기 위해 부분채널 도핑된 Al/sub 0.25/Ga/sub 0.75/As/In/sub 0.25/Ga/sub 0.75/As/Al/sub 0.25/Ga/sub 0.75/As 이종접합 구조를 갖는 FET를 제안하였다. 제안된 HFET는 게이트 전극 아래로 도핑되지 않은 AlGaAs 진성공급층을 두어 -2OV 의 높은 항복전압을 얻었다. 또한 소자의 InGaAs 채널에 부분 도핑을 실시하여, 균일 채널 도핑을 실시한 경우보다 향상된 선형성을 유도하였고, 2차원 전산모사 견과와 제작 및 측정결과를 통해 선형성의 향상을 확인하였다. 본 실험에서 제안된 HFET소자는 DC측정 결과와 고주파측정 결과 모두에서 기존의 FET소자들에 비해 향상된 선형성을 나타내었다.

PECVD와 NO 어닐링 공정을 이용하여 제작한 N-based 4H-SiC MOS Capacitor의 SiC/SiO2 계면 특성 (SiC/SiO2 Interface Characteristics in N-based 4H-SiC MOS Capacitor Fabricated with PECVD and NO Annealing Processes)

  • 송관훈;김광수
    • 전기전자학회논문지
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    • 제18권4호
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    • pp.447-455
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    • 2014
  • 본 연구에서는 4H-SiC MOSFET의 주요 문제점인 $SiC/SiO_2$ 계면의 특성을 향상시키기 위해 PECVD (plasma enhanced chemical vapor deposition) 공정을 이용하여 n-based 4H-SiC MOS Capacitor를 제작하였다. 건식 산화 공정의 낮은 성장속도, 높은 계면포획 밀도와 $SiO_2$의 낮은 항복전계 등의 문제를 극복하기 위하여 PECVD와 NO어닐링 공정을 사용하여 MOS Capacitor를 제작하였다. 제작이 끝난 후, MOS Capacitor의 계면특성을 hi-lo C-V 측정, I-V 측정 및 SIMS를 이용해 측정하고 평가하였다. 계면의 특성을 건식 산화의 경우와 비교한 결과 20% 감소한 평탄대 전압 변화, 25% 감소한 $SiO_2$ 유효 전하 밀도, 8MV/cm의 증가한 $SiO_2$ 항복전계 및 1.57eV의 유효 에너지 장벽 높이, 전도대 아래로 0.375~0.495eV만큼 떨어져 있는 에너지 영역에서 69.05% 감소한 계면 포획 농도를 확인함으로써 향상된 계면 및 산화막 특성을 얻을 수 있었다.

고전압 전력반도체 소자 개발을 위한 단위공정에서 식각공정과 이온주입공정의 영향 분석 (Analysis of the Effect of the Etching Process and Ion Injection Process in the Unit Process for the Development of High Voltage Power Semiconductor Devices)

  • 최규철;김경범;김봉환;김종민;장상목
    • 청정기술
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    • 제29권4호
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    • pp.255-261
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    • 2023
  • 파워반도체는 전력의 변환, 변압, 분배 및 전력제어 등을 감당하는데 사용되는 반도체이다. 최근 세계적으로 고전압 파워반도체의 수요는 다양한 산업분야에 걸쳐 증가하고 있는 추세이며 해당 산업에서는 고전압 IGBT 부품의 최적화 연구가 절실한 상황이다. 고전압 IGBT개발을 위해서 wafer의 저항값 설정과 주요 단위공정의 최적화가 완성칩의 전기적특성에 큰 변수가 되며 높은 항복전압(breakdown voltage) 지지를 위한 공정 및 최적화 기술 확보가 중요하다. 식각공정은 포토리소그래피공정에서 마스크회로의 패턴을 wafer에 옮기고, 감광막의 하부에 있는 불필요한부분을 제거하는 공정이고, 이온주입공정은 반도체의 제조공정 중 열확산기술과 더불어 웨이퍼 기판내부로 불순물을 주입하여 일정한 전도성을 갖게 하는 과정이다. 본 연구에서는 IGBT의 3.3 kV 항복전압을 지지하는 ring 구조형성의 중요한 공정인 field ring 식각실험에서 건식식각과 습식식각을 조절해 4가지 조건으로 나누어 분석하고 항복전압확보를 위한 안정적인 바디junction 깊이형성을 최적화하기 위하여 TEG 설계를 기초로 field ring 이온주입공정을 4가지 조건으로 나누어 분석한 결과 식각공정에서 습식 식각 1스텝 방식이 공정 및 작업 효율성 측면에서 유리하며 링패턴 이온주입조건은 도핑농도 9.0E13과 에너지 120 keV로, p-이온주입 조건은 도핑농도 6.5E13과 에너지 80 keV로, p+ 이온주입 조건은 도핑농도 3.0E15와 에너지 160 keV로 최적화할 수 있었다.

비정질실리콘 박막 트랜지스터 (Hydrogenated a-Si TFT Using Ferroelectrics)

  • 허창우
    • 한국정보통신학회논문지
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    • 제9권3호
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    • pp.576-581
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    • 2005
  • 강유전체$(SrTiO_3)$ 박막을 게이트 절연층으로 하여 수소화 된 비정질 실리콘 박막 트랜지스터를 유리 기판 위에 제조하였다. 강유전체는 기존의 $SiO_2,\;SiN$ 등과 같은 게이트 절연체에 비하여 유전특성이 매우 뛰어나 TFT의 ON 전류를 증가시키고 문턱전압을 낮추며 항복특성을 개선하여 준다. PECVD에 의하여 증착된 a-Si:H는 FTIR 측정 결과 $2,000cm^{-1}$$876cm^{-1}$에서 흡수 밴드가 나타났으며, $2,000cm^{-1}$$635cm^{-1}$$SiH_1$의 stretching과 rocking 모드에 기인한 것이며 $876cm^{-1}$의 weak 밴드는 $SiH_2$ vibration 모드에 의한 것이다. a-SiN:H는 optical bandgap이 2.61 eV이고 굴절률은 $1.8\~2.0$, 저항률은 $10^{11}\~10^{15}\Omega-cm$ 정도로 실험 조건에 따라 약간 다르게 나타난다. 강유전체$(SrTiO_3)$ 박막의 유전상수는 $60\~100$ 정도이고 항복전계는 IMV/cm 이상으로 우수한 절연특성을 갖고 있다. 강유전체를 이용한 TFT의 채널 길이는 $8~20{\mu}m$, 채널 넓이는 $80~200{\mu}m$로서 드레인 전류가 게이트 전압 20V에서 $3.4{\mu}A$이고 $I_{on}/I_{off}$ 비는 $10^5\~10^8,\;V_{th}$$4\~5\;volts$이다.

강유전체를 게이트 절연층으로 한 수소화 된 비정질실리콘 박막 트랜지스터 (a-Si:H TFT Using Ferroelectrics as a Gate Insulator)

  • 허창우;윤호군;류광렬
    • 한국정보통신학회:학술대회논문집
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    • 한국해양정보통신학회 2003년도 추계종합학술대회
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    • pp.537-541
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    • 2003
  • 강유전체(SrTiO$_3$) 박막을 게이트 절연층으로 하여 수소화 된 비정질 실리콘 박막 트랜지스터를 유리 기판위에 제조하였다. 강유전체는 기존의 SiO$_2$, SiN 등과 같은 게이트 절연체에 비하여 유전특성이 매우 뛰어나 TFT의 ON 전류를 증가시키고 문턱전압을 낮추며 항복특성을 개선하여 준다. PECVD 에 의하여 증착된 a-Si:H 는 FTIR 측정 결과 2,000 $cm^{-}$1 과 635 $cm^{-}$l 및 876 cm-1 에서 흡수 밴드가 나타났으며, 2,000 $cm^{-1}$ / 과 635 $cm^{-1}$ / 은 SiH$_1$ 의 stretching 과 rocking 모드에 기인 한 것이며 876 $cm^{-1}$ / 의 weak 밴드는 SiH$_2$ vibration 모드에 의한 것이다. a-SiN:H 는 optical bandgap 이 2.61 eV 이고 굴절률은 1.8 - 2.0, 저항률은 $10^{11}$ - $10^{15}$ $\Omega$-cm 정도로 실험 조건에 따라 약간 다르게 나타난다. 강유전체(SrTiO$_3$) 박막의 유전상수는 60 - 100 정도이고 항복전계는 1MV/cm 이상으로 우수한 절연특성을 갖고 있다. 강유전체를 이용한 TFT 의 채널 길이는 8 - 20 $\mu$m, 채널 넓이는 80 - 200 $\mu$m 로서 드레인 전류가 게이트 전압 20V에서 3 $\mu$A 이고 Ion/Ioff 비는 $10^{5}$ - $10^{6}$, Vth 는 4 - 5 volts 이다.

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