• 한국진공학회:학술대회논문집
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• 한국진공학회 2009년도 제38회 동계학술대회 초록집
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• pp.456-456
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• 2010

CMOS 소자가 서브마이크론($0.1\;{\mu}m$) 이하로 스케일다운 되면서 단채널 효과(short channel effect), 게이트 산화막(gate oxide)의 누설전류(leakage current)의 증가와 높은 직렬저항(series resistance) 등의 문제가 발생한다. CMOS 소자의 구동전류(drive current)를 높이고, 단채널 효과를 줄이기 위한 가장 효율적인 방법은 소스 및 드레인의 얕은 접합(shallow junction) 형성과 직렬 저항을 줄이는 것이다. 플라즈마 도핑 방법은 플라즈마 밀도 컨트롤, 주입 바이어스 전압 조절 등을 통해 저 에너지 이온주입법보다 기판 손상 및 표면 결함의 생성을 억제하면서 고농도로 얕은 접합을 형성할 수 있다. 그리고 얕은 접합을 형성하기 위해 주입된 불순물의 활성화와 확산을 위해 후속 열처리 공정은 높은 온도에서 짧은 시간 열처리하여 불순물 물질의 활성화를 높여주면서 열처리로 인한 접합 깊이를 얕게 해야 한다. 그러나 접합의 깊이가 줄어듦에 따라서 소스 및 드레인의 표면 저항(sheet resistance)과 접촉저항(contact resistance)이 급격하게 증가하는 문제점이 있다. 이러한 표면저항과 접촉저항을 줄이기 위한 방안으로 실리사이드 박막(silicide thin film)을 형성하는 방법이 사용되고 있다. 본 논문에서는 (100) p-type 웨이퍼 He(90 %) 가스로 희석된 $PH_3$(10 %) 가스를 사용하여 플라즈마 도핑을 실시하였다. 10 mTorr의 압력에서 200 W RF 파워를 인가하여 플라즈마를 생성하였고 도핑은 바이어스 전압 -1 kV에서 60 초 동안 실시하였다. 얕은 접합을 형성하기 위한 불순물의 활성화는 ArF(193 nm) excimer laser를 통해 $460\;mJ/cm^2$의 에니지로 열처리를 실시하였다. 그리고 낮은 접촉비저항과 표면저항을 얻기 위해 metal sputter를 통해 TiN/Ti를 $800/400\;{\AA}$ 증착하고 metal RTP를 사용하여 실리사이드 형성 온도를 $650{\sim}800^{\circ}C$까지 60 초 동안 열처리를 실시하여 $TiSi_2$ 박막을 형성하였다. 그리고 $TiSi_2$의 두께를 측정하기 위해 TEM(Transmission Electron Microscopy)을 측정하였다. 화학적 결합상태를 분석하기 위해 XPS(X-ray photoelectronic)와 XRD(X-ray diffraction)를 측정하였다. 접촉비저항, 접촉저항과 표면저항을 분석하기 위해 TLM(Transfer Length Method) 패턴을 제작하여 I-V 특성을 측정하였다. TEM 측정결과 $TiSi_2$의 두께는 약 $580{\AA}$ 정도이고 morphology는 안정적이고 실리사이드 집괴 현상은 발견되지 않았다. XPS와 XRD 분석결과 실리사이드 형성 온도가 $700^{\circ}C$에서 C54 형태의 $TiSi_2$ 박막이 형성되었고 가장 낮은 접촉비저항과 접촉저항 값을 가진다.

• 한국산학기술학회논문지
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• 제20권6호
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• pp.80-85
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• 2019

이산화바나듐은 잘 알려진 금속-절연체 상전이 물질이며, 바나듐 레독스 흐름 전지는 대규모 에너지 저장장치로 활용하기 위해서 많은 연구가 이루어져왔다. 본 연구에서는 바나듐 옥사이드 ($VO_x$) 박막을 리튬이온 이차전지의 양극으로 적용하는 연구를 수행하였다. 이를 위해서 $VO_x$ 박막을 실리콘 웨이퍼 위에 열산화공정으로 300 nm 두께의 $SiO_2$ 층이 형성된 Si 기판 및 쿼츠 기판 위에 RF 마그네트론 스퍼터 시스템으로 60분 동안 $500^{\circ}C$에서 다른 RF 파워로 증착하였다. 증착된 $VO_x$ 박막의 표면형상을 전계방출 주사전자현미경으로 조사하였고, 결정학적 특성을 Raman 분광학으로 분석하였다. 투과율 및 흡수율과 같은 광학적 특성은 자외선-가시광선 분광계로 조사하였다. Cu Foil 위에 증착된 $VO_x$ 박막을 리튬이온전지의 양극물질로 적용하여 CR2032 코인셀을 제작하였고, 전기화학적 특성을 조사하였다. 그 결과 증착된 $VO_x$ 박막은 RF 파워가 증가할수록 낟알 크기가 증가하였고, RF 파워 200 W 이상에서 증착된 박막은 $VO_2$상을 나타내었다. 증착된 $VO_x$ 박막의 투과율은 결정상에 따라 다른 값을 나타내었다. $VO_x$ 박막의 이차전지 특성은 높은 표면적을 가질수록, 결정상이 혼재될수록 높은 충방전 특성을 나타내었다.

• 한국정보전자통신기술학회논문지
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• 제12권4호
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• pp.366-372
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• 2019

본 논문에서는 불소가 함유된 상용 폴리이미드를 사용하여 빗살형 전극을 갖는 정전용량형 습도센서를 제작하고 특성 측정 및 분석을 수행하였다. 먼저 상용 폴리이미드의 성분 분석을 위해 실리콘 웨이퍼 상에 패턴닝을 하고 열처리 공정을 수행한 후 EDS 분석을 수행하였다. 분석 결과 탄소(C) 62.48 Wt%, 산소(O) 9.38 Wt% 그리고 불소(F) 성분이 평균 8.44 Wt% 포함되어있는 것을 알 수 있었다. IDT구조에 대한 설계값을 토대로 제작된 습도센서의 면적은 $1.56{\times}1.66mm^2$이며, 전극의 넓이와 전극간 폭은 동일하게 각각 $3{\mu}m$, 센서의 감도를 높이기 위해 전극 수를 166개, 길이를 1.294mm로 제작하였다. 제작된 센서에 대한 기본특성 측정 결과 감도는 24 fF/%RH, 선형 특성 < ${\pm}2.5%RH$ 그리고 히스테리시스는 < ${\pm}4%RH$로 나타났으며, 주파수 특성은 10kHz, 20kHz, 50kHz, 100kHz에서 습도변화에 따른 용량값 변화를 측정한 결과 주파수가 증가할수록 동일 습도에서 용량값은 작아지는 것을 확인할 수 있었으며 10kHz와 100kHz의 습도변화에 따른 용량값 편차는 평균 0.3pF으로 측정되었다.

• 접착 및 계면
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• 제22권2호
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• pp.57-62
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• 2021

원자층 두께의 이차원 전이금속 칼코겐화합물은 그래핀과 비슷한 형태의 이차원 구조로 이루어져 있으며, 전기적 특성을 비롯한 우수한 물리적특성을 보여 차세대 반도체 물질로 각광받고 있다. 그래핀의 대면적 합성의 경우 이미 기술적으로 성숙되어 화학기상 증착법을 이용하여 웨이퍼 수준의 크기만큼 단결정 합성이 가능해졌으나, 이차원 전이금속 칼코겐화합물의 경우 현재 수에서 수백 ㎛ 수준에 머물러 있는 것이 실정이다. 본 논문에서는 최근에 보고된 용융염 기반의 화학기상증착법을 통한 이차원 단층 MoS2₂합성법에서 공정변수가 MoS₂단결정의 크기에 미치는 영향에 대해 조사하였다. 그 결과, 최적화된 조건에서 약 420 ㎛의 고품질 단층 단결정 MoS₂가 합성될 수 있다는 사실을 광학 현미경, 원자력 현미경, 라만 분광, 그리고 광루미네선스 분광 분석을 통하여 밝혀내었다.

• 마이크로전자및패키징학회지
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• 제28권3호
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• pp.9-15
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• 2021

최근 반도체 소자의 소형화는 물리적 한계에 봉착했으며, 이를 극복하기 위한 방법 중 하나로 반도체 소자를 수직으로 쌓는 3D 패키징이 활발하게 개발되었다. 3D 패키징은 TSV, 웨이퍼 연삭, 본딩의 단위공정이 필요하며, 성능향상과 미세피치를 위해서 구리 본딩이 매우 중요하게 대두되고 있다. 본 연구에서는 대기중에서의 구리 표면의 산화방지와 저온 구리 본딩에 티타늄 나노 박막이 미치는 영향을 조사하였다. 상온과 200℃ 사이의 낮은 온도 범위에서 티타늄이 구리로 확산되는 속도가 구리가 티타늄으로 확산되는 속도보다 빠르게 나타났고, 이는 티타늄 나노 박막이 저온 구리 본딩에 효과적임을 보여준다. 12 nm 티타늄 박막은 구리 표면 위에 균일하게 증착되었고, 표면거칠기(R_q)를 4.1 nm에서 3.2 nm로 낮추었다. 티타늄 나노 박막을 이용한 구리 본딩은 200℃에서 1 시간 동안 진행하였고, 이후 동일한 온도와 시간 동안 열처리를 하였다. 본딩 이후 측정된 평균 전단강도는 13.2 MPa이었다.

• 마이크로전자및패키징학회지
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• 제29권1호
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• pp.49-54
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• 2022

반도체 Si 웨이퍼 Cu 배선을 제작하는데 사용하는 submicron 크기의 다마신 패턴의 구리 도금공정을 동일한 조건의 유기첨가제 및 전류밀도 조건을 사용하여 PCB 금속배선에 사용되는 수십 micron 크기의 패턴 도금에 적용하였다. PCB 패턴의 종횡비가 작아 쉽게 채워질 것으로 기대했던 것과는 달리, 이 경우 패턴 내부에 위치별 도금 두께 불균일도가 심화되는 것이 관찰되었다. 이러한 원인을 정량적으로 분석하기 위해 유동 및 전기장을 고려한 전기화학적 해석을 진행하였으며, 이를 통해 패턴 바닥부 코너에서 측벽과 바닥부의 도금에 의한 용액내 Cu²⁺ 이온의 고갈이 상대적으로 패턴 상부보다 빠르게 일어나는 것이 확인되었다. 이는 Cu²⁺ 이온의 확산계수가 2.65×10^-10 m²/s 로 초당 16.3 ㎛정도의 평균 이동거리를 가짐으로, 이 값이 다마신 패턴에서는 충분히 커서 원활하게 패턴 내부까지 이온 공급이 이루어지나, 수십 micron 크기를 갖는 PCB 크기에서는 소진된 구리이온을 보충해 주기 위해 충분한 시간이 필요하기 때문인 것으로 확인되었다. 구리 이온을 충분히 공급해 주기 위해 전류밀도를 낮춰 Cu²⁺ 이온이 확산할 수 있는 충분한 시간을 할애해 줌으로써 두께 균일도가 향상되는 것을 알 수 있었다.

• 전기전자학회논문지
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• 제26권3호
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• pp.422-429
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• 2022

조도센서 칩은 아날로그 회로의 트리밍이나 디지털 레지스터의 초기 값을 셋팅하기 위해 소용량의 eFuse(electrical Fuse) OTP(One-Time Programmable) 메모리 IP(Intellectual Property)를 필요로 한다. 본 논문에서는 1.8V LV(Low-Voltage) 로직 소자를 사용하지 않고 3.3V MV(Medium Voltage) 소자만 사용하여 128비트 eFuse OTP IP를 설계하였다. 3.3V 단일 MOS 소자로 설계한 eFuse OTP IP는 1.8V LV 소자의 gate oxide 마스크, NMOS와 PMOS의 LDD implant 마스크에 해당되는 총 3개의 마스크에 해당되는 공정비용을 줄일 수 있다. 그리고 1.8V voltage regulator 회로가 필요하지 않으므로 조도센서 칩 사이즈를 줄일 수 있다. 또한 조도센서 칩의 패키지 핀 수를 줄이기 위해 프로그램 전압인 VPGM 전압을 웨이퍼 테스트 동안 VPGM 패드를 통해 인가하고 패키징 이후는 PMOS 파워 스위칭 회로를 통해 VDD 전압을 인가하므로 패키지 핀 수를 줄일 수 있다.

• 한국결정성장학회지
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• 제34권1호
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• pp.8-15
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• 2024

다양한 광학 재료에 사용되는 CaF₂ 단결정은 밴드갭(12 eV)이 크고, 넓은 파장영역에서 투과율이 뛰어나며 낮은 굴절률과 분산을 가지는 특징이 있다. 이런 우수한 특성을 바탕으로 최근 리소그래피(Lithography) 공정에서 짧은 파장의 광원에서도 사용가능한 렌즈의 재료로 CaF₂ 단결정이 주목받고 있다. 다만 CaF₂의 경우 157 nm에서 재료 고유의 복굴절이 존재하며, 이로 발생한 수차는 (100)면과 (111)면의 결합을 통해 보상할 수 있기 때문에 면 방향에 따른 특성을 조사하는 것이 필요하다. 이 연구에서는 초크랄스키(Czochralski) 방법으로 성장하여 상용화 된 CaF₂ 단결정 웨이퍼를 이용하여 면 방향에 따른 결정성, 광학적 특성을 분석하였다. 특히 chemical etching을 통해 etch pit의 형태가 면 방향에 따라 다르게 나타나는 것을 확인하였고, 결함 분석을 통해 결정 내 전위의 배열과 결함의 존재가 etch pit 형상에 영향을 주는 것을 확인하였다.

• 한국재료학회지
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• 제6권7호
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• pp.700-708
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• 1996

Flip chip bonding에 무전해도금기술을 적용하여 solder bumper형성의 최적 조건을 규명하였다. 시편은 AI 패턴된 4 inch Si 웨이퍼를 사용하고, 활성화 처리시 zincate 용액을 사용하였으며, 무전해 도금은 Ni-P 도금액고 Au immersion 용액을 사용하였다. 활성화 물질의 AI 침식정도 및 Zn 석출 정도를 알아보기 위하여 EDS측정을 하였고, 각 공전에서의 표면형상을 알아보기 위해 SEM 분석을 하였다. 열처리 후 금도금층의 주 결정성장 방향은 XRD를 이용하여 측정하였다. 산처리에서 질산과 황산 중 질산에 의한 산화막제거 정도가 더 우수하게 나타났다. 활성화 처리시 zincate 용액을 희석시킬수록 입자 크기가 미세해 지고, 활성화 물질은 pH 13-13.5, 상온, 농도 15-25%의조건에서 크기가 작은 Zn 활성화 물질이 균일하게 분포하였다. Ni과 Auan전해도금 속도는 온도와 pH가 증가할수록 증가하였다. Ni 무전해 도금 조건은 pH 4.5, 온도 $90^{\circ}C$, 시간 20분이며, Au 무전해 도금조건은 pH7, 온도 $80^{\circ}C$, 시간 10분이었다. 상온에서 $400^{\circ}C$까지 30분동안 열처리 한 후 금도금막의 결정 방향은 pH 7, 온도 $80^{\circ}C$, 시간 10분이었다. 상온에서 $400^{\circ}C$까지 30분 동안 열처리 한 후 금도금막의 결정 방향은 pH 7에서 (111), pH 9에서는 (200)과 (111)이 주 peak로 나타났으며, 열처리에 의한 결정 방향의 변화는 없었다. 전체 공정에서 최종적인 표면 형상에 영향을 주는 단계는 활성화 처리로서 flip chip의 bonding layer형성에 가장 중요한 요소임을 알 수 있었다.보다 자생지(自生地)에서 높은 함량(含量)을 보였다. 5. 무기성분함양(無機成分含量)의 차이(差異)는 K의 경우(境遇) 자생지(自生地)에서 보다 재배지(栽培地)에서 평균적(平均的)으로 10배이상(倍以上) 정도(程度) 높은 함량(含量)의 차이(差異)를 보였으나 Mn, Zn, Na, Cu 등(等)은 일정(一定)한 경향(傾向)을 보이지 않는 것으로 나타났다. 6. 유리(遊離) 아미노산(酸)의 함량(含量)은 자생지(自生地은)보다 재배지(栽培地)에서 전반적(全般的)으로 높은 함량(含量)을 나타내었고, 특(特)히 Arginine은 다른 성분(成分)들과 비교(比較)해 볼 때 가장 높은 조성(組成)의 차이(差異)를 나타내었다. 7. 야생(野生)더덕과 재배(栽培)더덕의 정유성분수율(精油成分收率)은 자생지재배(自生地栽培)에서는 모두 0.004% 였고 재배지(栽培地)에서는 야생(野生)더덕이 0.005%였다. 8. 더덕의 재배장소(栽培場所)에 따른 향기성분(香氣成分)은 총(總) 21종(種)이었으며 自生地(自生地)에서 야생(野生)더덕은 16종(種), 재배(栽培)더덕은 18종(種)이었고, 재배지(栽培地)에서 야생(野生) 더덕은 14종(種), 재배(栽培)더덕은 20(種)이었다. 9. Trans-2-hexanol은 야생(野生)더덕의 자생지(自生地) 재배(栽培)에서 피이크 면적(面積) 당(當) 50.3%, 재배지(栽培地)에서 피이크 면적(面積) 당(當) 43.3%를 보였으며 amylalcohol, furfuryl acetate, 2-methoxy-4-vinyl phenol(MVP)는 재배(栽培)더덕에서만 확인(確認)되었다.는 KI, BMI와 유의적인 양의 상관관계를 보였고 (p<0.01), HCL-C은 비체중, BMI, LBM, TBM와 유의적인 음의 상관관계를 보였으며, (p<0.01), KI, SBP와도 음의 상관관계를 보였다. (p<0.05), LCL-C는 KI와 유의적이인 양의

• 전자공학회논문지A
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• 제33A권2호
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• pp.96-113
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• 1996

고농도로 붕소가 도핑된 실리콘층 내에 존재하는 부정합 전위는 웨이퍼 가장자리에서 발생됨을 알았으며, 이 층을 도핑되지 않은 영역으로 둘러쌓음으로써 부정합 전위가 억제된 고농도로 붕소가 도핑된 실리콘층을 형성할 수 있었다. 이를 이용하여 부정합 전위가 없는 고농도로 붕소가 도핑된 실리콘 멤브레인을 제작하였으며, 이 멤브레인의 표면 거칠기 및 파괴 강도 그리고 잔류 인장 응력을 각각 20$\AA$ 1.39${\times}10^{10}dyn/cm^{2}$ 그리고 2.7${\times}10^{9}dyn/cm^{2}$로 측정되었다. 반면에 부정합 전위를 포함하는 기존 멤브레인은 각각 500$\AA$ 8.27${\times}10^{9}dyn/cm^{2}$ 그리고 9.3${\times}10^{8}dyn/cm^{2}$로 측정되었으며, 두 멤브레인의 이러한 차이는 부정합 전위에서 기인함을 알았다. 측정된 두 멤브레인의 Young's 모듈러스는 1.45${\times}10^{12}dyn/cm^{2}$로 동일하게 나타났다. 또, 도핑 농도 1.3${\times}10^{12}dyn/cm^{3}$에 대한 고농도로 붕소가 도핑된 실리콘의 유효 격자 상수 및 기존 멤브레인의 평면적 격자 상수 그리고 기존 멤브레인 내의 부정합 전위의 밀도는 각각 5.424$\AA$ 5.426$\AA$ 그리고 2.3${\times}10^{4}$/cm 로 추출되었으며, 붕소가 도핑된 실리콘의 부정합 계수는 1.04${\times}10^{23}$/atom으로 추출되었다. 한편 별도의 추가적인 공정없이 일반적인 에피 성장법을 사용하여 고농도로 붕소가 도핑된 실리콘층 위에 부정합 전위가 없는 에피 실리콘을 성장시켰으며, 이 에피 실리콘의 결정성은 매우 양호한 것으로 밝혀졌다. 또 부정합 전위가 없는 에피 실리콘에 n+/p 게이트 다이오드를 제작하고 그 전압-전류 특성을 측정한 결과 5V의 역 바이어스에서 0.6nA/$cm^{2}$의 작은 누설 전류값을 나타내었다.