본 논문은, IEEE 1149.1 및 IEEE P1500 기반의 보드 및 SoC의 연결선 지연 고장 테스트를 위한 회로 및 테스트 방법을 제안한다. IDFT 모드 시, 출력 셀의 Update와 입력 셀의 Capture가 한 시스템 클럭 간격 내에 이루어지도록 하는 시스템 클럭 상승 모서리 발생기를 구현한다. 이 회로를 이용함으로써, 단일 시스템 클럭 뿐만 아니라 다중 시스템 클럭을 사용하는 보드 및 SoC의 여러 연결선의 지연고장 테스트를 쉽게 할 수 있다. 기존의 방식에 비해 면적 오버헤드가 적고 경계 셀 및 TAP의 수정이 필요 없으며, 테스트 절차도 간단하다는 장점을 가진다.
본 논문에서는 네트워크가 막연히 무작위적이라고 하기에는 사회나 세포, 인터넷 등이 어떤 법칙에 따라 짜연진 것처럼 보인다. 하지만 복잡한 네트워크의 모습이 네트워크의 모델과 실제로 똑같은지를 비교하기는 그리 쉬운 문제가 아니다. 무작위적 네트워크의 경우는 수학적으로 엄밀히 말하자면 쁘아송분포를 따른다. 쁘아송분포에서는 모든 점들이 동일한 확률로 여러 점들에 연결되는 기회를 갖는다. 즉 균일한 분포이다. 따라서 상당히 적거나 반대로 상당히 많은 수의 연결선을 가진 점은 극히 드물다. 이 경우 연결선 분포가 종 모양이 된다. 대부분의 점들이 곡선에 해당하는 연결선 수를 갖게 된다. 본 논문에서 쁘아송분포와 회귀분석을 통하여 하나 또는 둘 이상의 변수들 사이에 어떤 관계를 함수관계로 나타내어 분석하는 방법을 보이고 회귀분석 방법에 의해서 미래를 예측하고자 한다.
농가를 방문하는 가금관련업체의 관계자 및 차량은 HPAI 질병 확산의 매개체가 된다. 농가들의 가금관련업체 이용 정보를 이용하면 농가간의 연결을 확인할 수 있고 HPAI 확산 가중 네트워크를 구성할 수 있다. 네트워크 분석중 중심성 측정은 질병에 취약하거나 타 농가에 영향력이 큰 역할을 하는 농가를 분석하는 방법으로 HPAI 초기 확산을 통제하는 방법으로 이용된다. 단, HPAI 바이러스는 네트워크의 연결선 가중치에 따라서 확산 경로가 달라질 수 있다. 기존의 분석 방법은 확산 경로에 있어 대치되는 연결선의 강도와 연결선의 수 중 하나만을 고려하기 때문에 질병 확산을 정확히 모의하는데 한계가 있다. 그래서 본 연구에서는 2008년 발병한 한국 김제 지역의 39개 농가를 대상으로 가금관련업체 이용자료를 적용한 HPAI 확산 네트워크에 연결선의 가중치에 지수를 적용하는 방법으로 기존의 방법과 결과를 비교했다. 이 자료는 가금 산업 네트워크의 한국 지역 농가 적용성을 평가 할 수 있을뿐만 아니라 추후 잠재적인 질병 발병 차단을 위한 정보 제공에 중요한 역할을 할 것이다.
본 논문은 다양한 회로 연결선 모형 중에서 연결선 변수 및 동작 환경에 다라 최적 모형을 쉽게 선택할 수 있는 기준을 제시하고자 한다. 이를 위하여 먼저 연결선의 총 저항, 인덕턴스, 커패시턴스 값 및 신호의 동작주파수를 기반으로 정량적 모형화 오차 분석에 근거하여 인덕턴스의 영향을 고려하여 모형화해야 하는 RLC-class 모형 영역과 그럴 필요가 없는 RC-class모형 영역으로 분할하는 방법을 제시한다. 칩 내부 연결선의 대부분을 차지하는 RC-class 회로 모형은 모형 차수 축소 기법을 통하여 효율적으로 해석될 수 있다. RLC-class 회로 모형은 주어진 허용 모형화 오차 및 전기 변수에 따라 ILC(Iterative Ladder Circuit) 거시 모형, MC(Method of Characteristics)거시 모형 및 상태 기반 컨벌루션(comvolution) 방법 중에서 최적인 모형을 선정하게 된다. 본 논문은 SPICE류의 범용 회로 시뮬레이션 앨고리즘을 가정할 때, 세부 모형들의 시뮬레이션 비용을 감안하고서 최적 모형을 찾는 영역 구성도를 제시한다. 본 논문에서 제시하는 거시모형화 방법은 회로의 수동성을 유지하며, 따라서 무조건적 안정도를 보장할 수 있다.
고성능의 칩을 설계함에 있어 연결선 사이의 크로스토크 고장은 무시할 수 없는 요인이 되었다. 본 논문에서는 칩 및 보드레벨에서의 연결선 테스트를 위한 효과적인 테스트 패턴 알고리즘을 제시한다. 크로스토크 고장 점검율이 100%인 기존 6n 알고리즘을 분석하고 실질적으로 크로스토크 영향을 주는 net를 고려하여 보다 적은 패턴으로 동일한 고장 점검율을 얻는 새로운 알고리즘을 제안한다.
본 논문은 보드 또는 SoC 상에서 코아와 코아 사이의 연결선 고장 점검을 위한 효과적인 테스트 패턴 알고리즘과 테스트 패턴 생성기를 소개한다. 연결선 고장 모델 분석을 통해 crosstalk과 정적인 고장을 100$\%$ 점검할 수 있는 6n 패턴 알고리즘을 소개한다 보다 적은 4n+1 개의 패턴으로 100\$\%$에 가까운 고장 점검율을 얻으면서 crosstalk 뿐 아니라 정적고장의 검출 및 진단도 가능한 알고리즘을 제안하고, 효과적인 BIST구현 기술에 대하여 소개한다.
현대 반도체의 소형화 및 고성능화로 인해 반도체 테스팅 분야는 다양한 문제점에 봉착하고 있다. 이중 연결선에 대한 signal integrity 문제는 SoC와 같은 고집적 회로에서 반드시 해결해야할 문제이다. 본 논문에서는 연결선의 signal integrity 테스트를 위한 효과적인 테스트 패턴 적용 방안을 제안한다. 제안하는 테스트 패턴은 경계 주사 구조를 통해 적용 가능하며, 상당히 짧은 테스트 시간으로 매우 효과적인 테스트를 수행할 수 있다.
이 논문은 상위 단계 데이터-경로 합성에서 연산 스케쥴링과 자원 할당 및 배정을 동시에 고려한 통합적 접근 방법을 제시한다. 제안한 방법은 스케쥴링 되어있지 않은 데이터-플로우 그래프에 대해서 수행에 필요한 총 clock 스텝 수와 필요한 회로 면적을 동시에 최소화하는 데이터-경로 생성에 특징이 있다. 일반적으로, 연결선의 결정이 합성의 마지막 단계에서 이루어지는 기존의 방법과는 다르게, 우리의 접근 방법은 연산 스케쥴링과 연산의 연산 모듈 배정 그리고 변수의 레지스터 배정 작업을 동시에 수행하여 추가적인 연결선의 수를 매 clock 스텝마다 최적화(optimal) 시킨다. 본 논문은, 이 문제를 최소-비용의 최대-플로우 문제로 변형하여 minimum cost augmentation 방법으로 polynomial time 안에 해결하는 알고리즘을 제안한다.
기존의 평판 디스플레이 비디오 신호 전송 방식은 그래픽 어댑터에 저장된 비디오 데이터를 DA컨버터를 통해 아날로그 신호를 전송한 다음 평판 디스플레이 패널에서 다시 AD 컨버터를 이용해 디지털 신호로 복원한 다음 평판 디스플레이용 컨트롤에 입력되었다. 아날로그 신호를 보내는 것은 AD/DA 컨버터를 이중으로 사용할 뿐 아니라, 연결선을 길게 하는 것이 어렵고 노이즈로 인해 데이터의 수치가 변할 우려가 있다. 패널의 고면적화와 고해상도의 기술 발달로 SXGA급 및 UXGA급 신호에서는 높은 클럭 주파수와 긴 연결선에서도 안정된 신호 전송을 할 수 있는 VESA FPDi 규격에 맞는 인터페이스는 노이즈에 강하고 전자파 발생 억제 및 저전력으로 동작을 한다. 본 논문에서는 인터페이스 신호 전송 방법을 연구하여 신호의 변화를 줄여서 전자파 발생 억제 및 저전력에 도움을 주는 비디오 신호 엔코딩 알고리즘을 제안하였다.
많은 산업 현장에서 서로 다른 표현 미디어간에 칼라의 표현면에서 정확한 칼라 재생을 필요로 하고 있다. 본 논문에서는 확장 cusp 연결선을 이용한 새로운 색역 매핑에 관하여 논한다. 원본 색역내과 재현 색역내의 칼라는 $L^*-C^*$ 공간상에서 색 변환이 이루어지며 각 좌표에 대하여 동시에 변환이 이루어진다. 제안한 알고리즘에 의하여 기존의 색역 매핑 알고리즘보다 높은 채도(Chroma)값을 얻을 수 있었으며 재생이 이루어지는 색역의 이용도 또한 증가함을 실험을 통하여 보여준다. 또한 재현된 영상의 색역 형태가 원본의 색역 형태와 유사정도의 높음으로 인해 appearance 가 더 증가함을 보여준다.
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[게시일 2004년 10월 1일]
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