본 논문에서는 강압응용에 적합한 단일단 단일스위치 PFC를 제안한다. 제안하는 PFC는 스위치가 ZCS턴온하고 작은 전류로 턴오프하며, 다이오드는 ZCS턴오프한다. 또한 CCM에서 동작하므로 스위치 전류스트레스와 EMI가 작을 뿐 아니라 비교적 큰 용량(>500W)에도 적용이 가능하다. 제안하는 PFC의 동작원리를 제시하고 실험을 통하여 타당성을 검증하였다.
최근 클러스터 웹 서버의 로드 벨런싱으로서 L4 스위치가 널리 사용되고 있다. 전형적인 L4 스위치는 연결 요구 발생시 back-end 노드들의 부하를 평가하여 적은 부하를 갖고 있는 노드로 요청을 보내는 기능을 수행한다. 그러나 L4 스위치의 부하 분산은 사용자 연결 횟수를 이용해 분산함으로서 사용자의 다양한 컨텐츠 요청에 적절한 부하분산 스케줄링을 적용하고 있지 않다. 본 논문에서는 서버에 전송되는 컨텐츠 요구를 L4 스위치 계층에서 인식하여 부하배분에 사용하는 부하분산 모델을 제시한다.
본 논문에서는 고승압비를 갖는 단일스위치 ZCS 병렬 공진 컨버터를 제안한다. 제안하는 컨버터는 단일스위치를 사용하여 구조가 간단하며 병렬 공진회로를 이용하여 고승압이 가능하다. 또한, 별도의 클램프 회로 없이 전 부하영역에서 스위치의 ZCS 턴온 및 턴오프와 다이오드의 ZCS 턴오프를 성취한다. 제안하는 컨버터는 250W 시작품을 제작하여 타당성을 검증하였다.
본 논문에서는 HOL 블록킹 현상과 데드락을 줄이기 위해 공유 메모리 스위치를 이용하고 셀에 형태에 따라 유니캐스트 셀과 멀티캐스트 셀을 따로 저장하는 방법을 이용하여 셀의 부하를 줄이는 멀티캐스트 ATM 스위치를 제안한다. 그리고, 트래픽 셀의 손실을 줄이고, 효과적으로 출력하기 위해 제어부에서 출력 포트에 따라 스케줄링하는 기법을 택하였다. 제안한 스위치의 성능을 시뮬레이션을 통해 그 유효성을 보였다.
우수한 성능의 ATM 스위칭 시스템 개발을 위한 주요 목표가 셀 손실, 셀지연 및 처리율의 저하를 최소화하는데 있으며, 이러한 목적에 가장 적합한 ATM스위치 소자가 램덤 액세스 메모리 및 제어 논리에 의해 수행되는 공유 버퍼 메모리 스위치(shared buffer memory switch)이다. 이 스위치는 입력 포트의 수가 증가할 수록 VLSI의 제조가 어렵기 때문에 최근의 소용량 및 대용량의 ATM 스위치는 8$\times$8,600 b/s 또는 16$\times$16,150 Mb/s의 단위 스위치를 사용하여 32$\times$32(4.9 Gb/s), 150Mb/s의 스위치를 구현하는 스위치 모듈 방법을 사용하고 있다. 본 논문에서는 단위 공유 버퍼 메모리 스위치의 버퍼 공유에가 위한 전체 메모리 감소 효과를 만족하는 버퍼 용량을 해석적 으로 평가하고, 트래픽 조건에 따른 셀 손실율을 컴퓨터 시뮬레이션한 결과를 제시 하며 또한, 스위치 모듈 방법을 이용하는 소용량 및 대용량 ATM 스위치 마의 특징을 분석,이 결과를 바탕으로 현재 각국에서 연구중인 32$\times$32, 150Mb/s의 스위치 구조를 제시하며, 궁극적으로 위 주요 목표들을 만족하는 소용량 및 대용량의 ATM 스위칭 시 스템을 위한 고속 스위칭 망 구조를 제시한다.
본 논문은 출력 버퍼를 장착한 크로스바 스위치로 구성된 다양한 네트워크들의 성능 예측 모형을 제안하고, 스위치에 장착된 버퍼의 개수 증가에 따른 성능 향상 추이를 분석하였다. 스위치 내부에 버퍼를 장착하는 기법은 네트워크 내부의 데이타 충돌 문제를 효과적으로 해결하고, 네트워크 성능 및 신뢰도를 높이는 방법으로 널리 알려져 있다. 또한, 크로스바 스위치를 이용하여 네트워크를 구성할 경우 네트워크 내부의 스위치들 간의 연결 형태 그리고, 각 스위치 내부의 데이타 이동 패턴에 따라 네트워크 특성이 결정된다. 본 논문에서는 크로스바 스위치로 구성된 세 가지 서로 다른 형태의 네트워크 : 다단 연결 망(MIN), Fat-tree 망, 그리고 일반 통신망 등의 성능 분석모형을 제안하였다. 제안한 분석 모형은 네트워크 내부 스위치에 장착된 버퍼의 개수와 무관하게 네트워크 성능 평가의 두 가지 주요 요소인 네트워크 정상상태 처리율(Normalized Throughput, NT)과 네트워크 지연시간을 예측한다. 제안한 수학적 성능 분석 연구의 실효성을 검증하기 위하여 병행된 시abf레이션 결과는 상호 미세한 오차 범위 내에서 모형의 예측 데이타와 일치하는 결과를 보여 분석 모형의 타당성을 입증하였다. 또한 분석 결과 네트워크 내부 스위치에 많은 버퍼를 장착 할수록 상대적으로 정상상태 처리율의 증가율은 감소하고, 네트워크 지연시간은 증가하는 것으로 나타났다.
본 논문은 순차적으로 전압 인가된 RF MEMS 스위치를 이용하여 재구성 슬롯 안테나를 설계하였다. MEMS 스위치의 구동전압은 하부 전극과 상부 스위치 사이의 에어캡 높이에 따른 스위치의 특성을 ANSYS 시뮬레이션으로 분석하였다. MEMS 스위치의 구동전압은 하부전극과 상부 스위치 사이의 에어캡 높이와 스위치 형상에 의해 결정된다. 설계된 MEMS 스위치의 길이는 각각 240$\mu\textrm{m}$, 320 $\mu\textrm{m}$, 400 $\mu\textrm{m}$ 이고, 에어캡은 6$\mu\textrm{m}$이었다. 설계된 슬롯 안테나는 전체크기가 10 mm x 10 mm이며, 슬롯의 크기는 길이가 500 $\mu\textrm{m}$, 폭이 200 $\mu\textrm{m}$이었다. 그리고 CPW 급전선은 전체의 길이는 5 mm이며, 입구에서의 CPW는 30-80-30 $\mu\textrm{m}$이괴, 슬롯에서의 CPW는 150-300-150 $\mu\textrm{m}$이다. 세안된 소사의 공진주파수의 튜닝은 RF MEMS 스위치에 DC 바이어스를 인가함으로서 안테나의 전기적인 길이를 변화시켜 이루어진다. 설계된 슬롯 안테나를 시뮬레이션, 제조 및 측정을 하였다.
중개무역의 활성화와 기업의 해외현지법인의 증가로 인한 스위치선하증권의 사용이 빈번해지고 있으며 이와 더불어 이것의 불법적인 발행으로 인한 분쟁도 종종 발생하고 있다. 이러한 분쟁에 대해서는 몇 가지 중요한 판례가 있지만 이에 대한 연구는 전무하다. 따라서 본 연구에서는 스위치선하증권의 불법적 발행관행을 관련 판례를 통하여 조사하고 관련 당사자의 대책을 모색하고자 한다. 스위치선하증권에서는 원선하증권의 선적인, 수하인, 선적항. 하역항, 선적일 등이 변경 또는, 선적인에게 불리한 부기가 제거되거나 선하증권이 분할 또는 통합 발행된다. 여기서 운송인이 원선하증권을 회수하지 않은 상태에서 스위치선하증권을 발행하거나 선적일자, 선적항 또는 하역항을 허위로 기재하거나 불리한 부기가 삭제된 스위치선하증권을 발행하는 것은 불법적인 것으로 볼 수 있다. 스위치선하증권의 불법적 발행은 선적인과 은행 등 무역거래 당사자에게 위험 요인이 된다. 즉 선적인은 대금을 회수하지 못하였음에도 불구하고, 스위치선하증권에 의해서 화물이 제3자에게 인도되면 대금을 회수하지 못하여 손실이 발생한다. 화물의 담보권을 가지고 있는 신용장 개설은행 또는 매입은 행도 스위치선하증권의 불법적인 발행에 따라 그들의 담보권이 침해된다. 대부분의 경우 운송인은 중개무역상과 거래관계에 따라 어쩔 수 없이 원선하증권을 회수하지 않은 상태에서 스위치선하증권을 발행하고 있다. 하나의 화물에 대하여 두 세트 이상의 선하증권이 존재하는 것은 운송인에게 대단히 위험한 것이다.
본 논문에서는, $a{\times}a$ 출력 버퍼 스위치로 구성되며 핫스팟이 발생하는 다단 연결 망 (Multistage Interconnection Network, MIN)의 성능 예측 모형을 제안하고, 스위치에 장착된 버퍼의 개수 증가에 따른 성능 향상 추이를 분석하였다. 제안한 성능 예측 모형은 먼저 네트워크 내부의 임의 스위치 입력 단에 유입되는 데이타 패킷이 스위치 내부에서 전송되는 유형을 확률적으로 분석하여 수립되었다. 성능분석 모형은 스위치에 장착된 버퍼의 개수와 무관하게 버퍼를 장착한 $a{\times}a$ 스위치의 성능, 네트워크 정상상태 처리율(Normalized Throughput, NT)과 네트워크 지연시간(Network Delay)의 예측이 가능하고, 나아가서 이들로 구성된 모든 종류의 다단 연결망 성능 분석에 적용이 용이하다. 제안한 수학적 성능 분석 연구의 실효성 검증을 위하여 병행된 시abf레이션 결과는 상호 미세한 오차 범위 내에서 모형의 예측 데이타와 일치하는 결과를 보여 분석 모형의 타당성을 입증하였다.
복잡한 통신망과 병렬컴퓨터에서는 효율적인 상호 연결을 위해 스위치가 중요한 영향을 미친다. 이 스위치는 라우팅 정보에 따라서 입력포트와 출력포트 사이에 연결을 해주는 역할을 하게 된다. 따라서 스위치에 성능을 향상시키는 것은 중요한 일이다. 본 논문에서 제안한 스위치는 컴퓨터 시뮬레이션 결과 입력버퍼형 보다 최대처리율이 11%이상 향상되었고, 다른 반얀형 스위치들에 비하여 성능과 하드웨어 양을 비교하여 볼 때 좋은 결과를 얻었다. 따라서 이 스위치는 VLSI 칩으로 구현될 경우 초고속 ATM-LAN 과 병렬컴퓨터를 개발하는데 유용하게 활용될 수 있을 것이다. 제안된 반얀형 스위치는 MAX$+^+$PLUSII, VHDL을 이용하여 설계 및 검증을 하고 시뮬레이션을 하였다
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[게시일 2004년 10월 1일]
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