본 연구에서는 실리콘 산화물, 소프트 카본, 카본 블랙을 혼합하여 복합체를 제조하였으며, 이차전지의 음극 특성을 고찰하였다. 이때, 소프트 카본 음극재의 용량 향상을 위하여 첨가된 실리콘 산화물 함량을 0, 6, 8, 10, 20 wt%로 달리하였으며, 카본 블랙은 실리콘 산화물의 부피 팽창 완화를 위한 구조 안정제로 첨가되었다. 제조된 CB/SiOx/C 복합체의 물리적 특성은 XRD, SEM, EDS 및 분체 저항 분석을 통하여 조사되었다. 또한 제조된 복합체의 전기화학적 특성은 리튬 이차전지의 충·방전 사이클, 율속 및 임피던스 분석을 통하여 관찰되었다. CB/SiOx/C 복합체는 카본 블랙 첨가에 의하여 실리콘 산화물의 부피 팽창을 완화시킬 수 있는 내부 공동이 형성되었으며, 카본 블랙과 실리콘 산화물 입자가 고르게 분포되었다 형성된 내부 공동은 실리콘 산화물 함량이 8 wt% 미만에서는 낮은 초기 효율 보이며, 20 wt% 이상에서는 낮은 사이클 안정성을 보였다. 실리콘 산화물이 10 wt% 첨가된 CB/SiOx/C 복합체는 537 mAh/g 초기 방전 용량, 88 %의 용량 유지율과 2C/0.1C에서 79 율속 특성을 보였다. 이는 소프트 카본 음극재의 용량을 향상시키기 위해 실리콘 산화물을 첨가하였고, 실리콘 산화물의 부피 변화를 완충하기 위해 구조 안정제로 카본 블랙을 첨가하였다. CB/SiOx/C 복합체를 고효율의 음극재로 사용하기 위해 최적의 실리콘 산화물 함량 및 구조 안정제로서의 카본 블랙의 메커니즘을 논의하였다.
본 논문은 산소 플라즈마 처리에 따른 반도전성 실리콘 고무의 표면특성 변화를 조사하였다. 실리콘 고무는 각종 초고압 전력기기에서 절연부품으로 많이 사용되어 지고 있다. 하지만, 실리콘 고무가 가지고 있는 고유의 특성 때문에 반도전성 부품과 절연성 부품간의 계면이 접착이 잘 되지 않는 문제점이 나타난다. 이를 위해서 접착제를 사용하거나 표면 거칠기를 변화시키는 개질을 하기도 하지만, 이는 새로운 계면을 형성하거나 약점을 만드는 문제가 있다. 이를 위해 반도전성 실리콘 고무 표면을 산소 플라즈마 개질시켜, 표면을 활성화 시키는 역할과 표면을 균일하게 에칭시켜 기계적 interlocking 메커니즘으로 접착력을 향상시킬 수 있다. 본 실험에서는 산소 플라즈마 처리에 따른 반도전성 실리콘 고무의 표면을 표면에너지. XPS로 기본적인 표면특성을 조사하였다. 실험 결과, 단시간의 산소플라즈마 처리로 표면에 다수의 관능기가 관찰되었다. 이러한 산화층은 실록산 결합쇄가 산화된 실리카 유사층으로 밝혀졌다. 이로써 절연부와 접착 용이성이 기대되었으며, 벌크적인 실리콘 고무의 특성변화 없이 표면개질 만으로 우수한 계면특성을 얻을 수 있다.
본 논문은 단결정 및 다결정 실리콘 기판 상에 아산화질소 플라즈마 처리를 통하여 형성한 초박형 실리콘 옥시나이트라이드 박막의 특성과 이의 어플리케이션에 관한 것이다. 초박형 절연막은 현재 다양한 전자소자의 제작과 특성 향상을 위하여 활용되고 있으나 일반적인 화학 기상 증착 방법으로는 균일도를 확보하기 어려운 문제점을 가지고 있다. 디스플레이의 구동소자로 활용되는 박막 트랜지스터의 특성 향상과 비휘발성 메모리 소자의 터널링 박막에 응용하기 위하여 초박형 실리콘 옥시나이트라이드 박막의 증착과 이의 특성을 분석하였고, 실제 어플리케이션에 적용하였다. 실리콘 산화막과 실리콘 계면상에 존재하는 질소는 터널링 전류와 결함 형성을 감소시키며, 벌크 내에 존재하는 질소는 단일 실리콘 산화막에 비해 더 두꺼운 박막을 커패시턴스의 감소없이 이용할 수 있는 장점이 있다. 아산화질소 플라즈마를 이용하여 활성화된 질소 및 산소 라디칼들이 실리콘 계면을 개질하여 초박형 실리콘 옥시나이트라이드 박막을 형성할 수 있다. 플라즈마 처리 시간과 RF power의 변화에 따라 형성된 실리콘 옥시나이트라이드 박막의 두께 및 광학적, 전기적 특성을 분석하였다. 아산화질소 플라즈마 처리 방법을 사용한 실리콘 옥시나이트라이드 박막을 시간과 박막 두께의 함수로 전환해보면 초기적으로 증착률이 높고 시간이 지남에 따라 두께 증가가 포화상태에 도달함을 확인할 수 있다. 아산화질소 플라즈마 처리 시간의 변화에 따라 형성된 박막의 전기적인 특성의 경우, 플라즈마 처리 시간이 짧은 실리콘 옥시나이트라이드 박막의 경우 전압의 변화에 따라 공핍영역에서의 기울기가 현저히 감소하며 이는 플라즈마에 의한 계면 손상으로 계면결합 전하량이 증가에 기인한 것으로 판단된다. 또한, 전류-전압 곡선을 활용하여 측정한 터널링 메카니즘은 2.3 nm 이하의 두께를 가진 실리콘 옥시나이트라이드 박막은 직접 터널링이 주도하며, 2.7 nm 이상의 두께를 가진 실리콘 옥시나이트라이드 박막은 F-N 터널링이 주도하고 있음을 확인할 수 있다. 결론적으로 실리콘 옥시나이트라이드 박막을 활용하여 전기적으로 안정한 박막트랜지스터를 제작할 수 있었으며, 2.5 nm 두께를 경계로 터널링 메커니즘이 변화하는 특성을 이용하여 전하 주입 및 기억 유지 특성이 효과적인 터널링 박막을 증착하였고, 이를 바탕으로 다결정 실리콘 비휘발성 메모리 소자를 제작하였다.
LPCVD 방법으로 실리콘 산화막 두께 10nm에서 80nm인 MOS를 제작하였다. 그리고 스트레스 전계 산화막 전류의 두께 의존성을 조사하였다. 산화막 전류는 스트레스 전류와 전이전류로 구성되어 있음을 보여 주었다. 스트레스 전류는 스트레스 유기 누설전류와 직류전류로 이루어졌으며 산화막을 통하는 트립 어시스트 터널링으로 행해진다. 전이전류는 계면에서 트랩의 터널링 충전과 방전에 의해 이루어진다. 스트레스 전류는 산화막 전류의 두계 한계를 평가하는데 이용되고 전이전류는 기억소자에서 데이터 유지에 사용된다.
그래핀(graphene)의 가장자리(edge)는 결정구조의 배향성에 따라 지그재그(zigzag)와 안락의자 (armchair) 형태로 구분되는데, 나노미터 크기의 그래핀의 전자적 성질은 이러한 가장자리의 배향성에 의해 크게 영향을 받는다고 알려져 있다. 단일층 그래핀 가장자리 사이에서 일어나는 산화실리콘($SiO_2$)의 carbothermal reduction은 선택적으로 지그재그 형태의 가장자리를 생성한다고 알려져 있다. 본 연구에서는 라만 분광법과 원자 현미경(atomic force microscopy)을 이용하여 기계적 박리법으로 만들어진 이중층 그래핀에서 일어나는 carbothermal reaction을 연구하였다. 고온 산화 방법으로 이중층 그래핀에 원형 식각공(etch pit)을 만들고 Ar 기체 속에서 700도 열처리를 진행한 후, 원형 식각공이 육각형으로 확장된 것을 관찰하였다. 이것은 이중층 그래핀도 산화실리콘의 carbothermal reduction을 유발한다는 사실을 보여준다. 그러나 이중층 그래핀의 반응속도는 단일층보다 느린 것이 확인되었는데, 이는 이중층 그래핀의 탄소 원자와 산화제로 작용하는 산화실리콘 간의 평균 거리가 단일층보다 더 크다는 사실로 설명할 수 있다. 또한 본 연구에서는 반응기 내의 압력이 반응 속도에 미치는 영향과 식각공이 육각형으로 변해가는 과정에 대한 라만 분광 특성을 조사 및 분석하였다.
반도체 세정공정에서 염기성 세정액(SCI, Standard cleaning 1, $NH_{4}$OH + $H_{2}$O_{2}$ + $H_{2}$O)은 공정상 발생되는 여러 오염물 중 파티클의 제거를 위해 널리 사용되고 있는데, SCI 조성중 $NH_{4}$OH양에 따라 세정 중 실리콘의 식각속도를 증가시킨다. 이 연구에서는 SCI 세정이 CZ(Czochralski)와 에피 실리콘 기판 표면에 미치는 영향을 단순세정과 연속적인 산화-HF 식각-SCI 세정공정을 통해 관찰되었다. CZ와 에피 기판을 8$0^{\circ}C$의 1 : 2 : 10과 1 : 1 : 5 SCI 용액에서 60분까지 단순 세정을 했을 때 laser particle scanner와 KLA사의 웨이퍼 검색장치로 측정된 결함의 수는 세정시간에 따라 변화를 보이지 않았다. 그러나 CZ와 에피 기판을 10분간 SCI 세정후 90$0^{\circ}C$에서 산화 HF식각공정을 4번까지 반복하였을 때 에피 기판 표면의 결함수는 감소하는 반면에 CZ기판에서는 직선적으로 증가하였다. 반복적인 산화-HF 식각-XCI 세정공정을 통해 생성된 CZ기판 표면의 결함은 크기가 0.7$\mu$m 이하의 pit과 같은 형상을 보여주었다. 이들 결함은 열처리 중 CZ 기판내와 표면에 산화 석출물들이 형성, 반복적인 HF 식각-SCI 세정공정을 통해 다른 부위에 비해 식각이 빨리 일어나 표면에 생성되는 것으로 여기어 진다.
그래핀(graphene)의 가장자리(edge)는 결정구조의 배향성에 따라 지그재그(zigzag)와 안락의자(armchair) 형태로 구분되는데, 나노미터 크기의 그래핀의 전자적 성질은 이러한 가장자리의 배향성에 의해 크게 영향을 받는다고 알려져 있다. 단일층 그래핀 가장자리 사이에서 일어나는 산화실리콘($SiO_2$)의 carbothermal reduction은 선택적으로 지그재그 형태의 가장자리를 생성한다고 알려져 있다. 본 연구에서는 라만 분광법과 원자 현미경(atomic force microscopy)을 이용하여 기계적 박리법으로 만들어진 이중층 그래핀에서 일어나는 carbothermal reaction을 연구하였다. 고온 산화 방법으로 이중층 그래핀에 원형 식각공(etch pit)을 만들고 Ar 기체 속에서 700도 열처리를 진행한 후, 원형 식각공이 육각형으로 확장된 것을 관찰하였다. 이것은 이중층 그래핀도 산화실리콘의 carbothermal reduction을 유발한다는 사실을 보여준다. 그러나 이중층 그래핀의 반응속도는 단일층보다 5배 정도 느린 것이 확인되었는데, 이는 이중층 그래핀의 탄소원자와 산화제로 작용하는 산화실리콘 간의 평균 거리가 단일층보다 더 크다는 사실로 설명할 수 있다. 또한 단일층과 이중층 그래핀 모두 1 기압 Ar 분위기에서보다 진공상태에서 반응속도가 현저히 작다는 사실이 관찰되었다. 진공도와 온도에 따른 반응속도로부터 반응 메커니즘 및 활성화 에너지에 대해 고찰하고자 한다.
본 논문은 금속 산화물 반도체의 산화막 두께, 채널 폭과 길이에 따른 실리콘 산화막의 신뢰성 특성을 연구하였다. 스트레스전류와 전이전류는 스트레스 전압에 의하여 발생된다. 스트레스 유기 누설전류는 스트레스 전압 인가 동안과 인가 후의 실리콘 산화막에 나타난다. 이때 저레벨 스트레스 전압에 의한 저레벨 누설전류는 저전압 인가 동안과 인가 후의 얇은 실리콘 산화막에서 발생한다. 저레벨 누설전류는 각각 스트레스 바이어스 조건에 따라 스트레스전류와 전이전류를 측정하였다. 스트레스 채널전류는 일정한 게이트 전압이 인가동안 측정하였고 전이 채널전류는 일정한 게이트 전압을 인가한 후에 측정하였다. 본 연구는 소자의 구동 동작 신뢰성을 위하여 저레벨 스트레스 바이어스 전압에 의한 스트레스 전류와 전이전류가 발생되어 이러한 저레벨 누설전류를 조사하였다.
이차원 결정인 그래핀(graphene)은 전하도핑(charge doping)과 기계적 변형에 민감하기 때문에 기판의 물리 및 화학적 구조 및 특성에 따라 그래핀의 물성이 크게 영향을 받는다고 알려져 있다. 특히 널리 사용되고 있는 산화실리콘($SiO_2$/Si) 기판에 존재하는 나노미터 크기의 굴곡과 전하 트랩(charge trap)은 전하 이동도 및 화학적 안정성 등의 면에서 그래핀 고유의 뛰어난 물성을 제한하는 것으로 알려져 있다. 본 연구에서는 비정질 산화실리콘 기판을 대조군으로 삼아 편평도가 높은 결정성 h-BN (hexagonal boron nitride) 기판이 그래핀에 미치는 영향을 관찰하였다. 화학기상증착법(chemical vapor deposition 또는 CVD)으로 성장시킨 그래핀을 각 기판에 전사시킨 후 라만 분광법을 통해 전하 도핑 및 기계적 변형 정도를 측정하였다. h-BN 위에서는 외부 환경에서 기인하는 전하 도핑 정도가 산화실리콘 기판보다 적게 관찰되었다. 또한 h-BN 위에 고착된 그래핀 시료에서는 기판-그래핀 상호작용에서 기인하는 것으로 보이는 새로운 라만 분광 특성이 관찰되었다.
전류밀도, 70mA/cm2와 전류인가시간, 5초, 10초 조건의 양극반응으로 다공성 실리콘을 제작하여 800~110$0^{\circ}C$에서 열산화시킨 후 AI 전극을 증착시켜 만든 MOS(Metal Oxide Semiconductor) 구조의 C-V(Capacilance-Voltage) 특성을 조사하였다. 800, 90$0^{\circ}C$의 저온과 20~30분 이내의 단시간 산화에서는 산화막의 유전상수가 보통의 열산화막보다 크게 나타나고, 산화온도가 110$0^{\circ}C$의 고온과 60분 이상의 장시간 산화의 경우에는 3.9에 근접한 값을 갖는다. 이는 다공성 실리콘 산화막내에 존재하는 산화되지 않은 silicon들에 의한 효과와 표면적 증가에 의한 정전용량의 증가 효과가 복합적으로 작용하는 것이 그 원인이라 생각된다.
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[게시일 2004년 10월 1일]
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