• 한국정보과학회논문지:시스템및이론
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• 제34권2호
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• pp.84-92
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• 2007

본 논문은, IEEE 1149.1 및 IEEE P1500 기반의 보드 및 SoC의 연결선 지연 고장 테스트를 위한 회로 및 테스트 방법을 제안한다. IDFT 모드 시, 출력 셀의 Update와 입력 셀의 Capture가 한 시스템 클럭 간격 내에 이루어지도록 하는 시스템 클럭 상승 모서리 발생기를 구현한다. 이 회로를 이용함으로써, 단일 시스템 클럭 뿐만 아니라 다중 시스템 클럭을 사용하는 보드 및 SoC의 여러 연결선의 지연고장 테스트를 쉽게 할 수 있다. 기존의 방식에 비해 면적 오버헤드가 적고 경계 셀 및 TAP의 수정이 필요 없으며, 테스트 절차도 간단하다는 장점을 가진다.

• 한국통신학회논문지
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• 제28권1A호
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• pp.47-53
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• 2003

본 논문에서는 155 Mb/s급 멀티플렉서-디멀티플렉서를 단일소자로 설계하였다. 이 소자는 초고속 전송망의 전송노드 역할을 하는 2.5 Gb/s SDH 전송시스템에 적용되어 51 Mb/s의 병렬 데이터들을 155 Mb/s의 직렬 데이터로 다중화 하거나 155 Mb/s 직렬 데이터들을 51 Mb/s의 병렬 데이터로 역 다중화 하는 기능을 수행한다 소자의 저속부는 TTL로 접속되고 고속부는 100K ECL로 접속되며 0.7${\mu}m$BiCMOS gate array로 제작되었다 설계 제작된 소자는 180˚의 155 Mb/s 데이터 입력 phase margin을 가지며 출력 데이터 skew는 470ps, 소비전력은 2.0W 이하의 특성을 보인다.

• 융합신호처리학회논문지
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• 제19권2호
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• pp.68-76
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• 2018

본 논문에서는 대전상관기의 다중 편파 관측데이터의 상관처리 방법에 대해 기술한다. VLBI 관측에는 천체의 종류에 따라 단일 또는 다중 편파 관측이 있는데, 천체의 특성을 잘 관찰하기 위해 편파관측을 수행한다. 그리고 천체를 관측하는 동안 관측장치에 포함된 지연값과 천체의 변동원인을 확인하기 위해서도 편파관측을 수행한다. 대전상관기의 편파관측 데이터의 상관처리는 각 안테나 유닛에 입력되는 데이터를 출력하는 동기재생처리장치의 OCTAVIA에서 출력비트 선택 기능을 활용하여 비트를 변환하고, 이때 데이터 스트림(Stream)의 순서가 변경되며, 대전상관기의 입력은 기존의 스트림 번호는 동일하게 설정하여 상관처리를 수행하면 편파상관처리를 할 수 있는 구성을 제안하였다. 편파상관처리를 위해 관측한 시험데이터를 대상으로 상관처리를 수행하였으며, 본 연구에서 제안한 대전상관기의 편파상관처리 방법이 유효하게 동작하고 있음을 실험을 통하여 확인하였다.

• 한국인터넷방송통신학회논문지
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• 제21권4호
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• pp.123-127
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• 2021

밀리미터파 추적 레이더는 다양한 환경조건에서 운용 가능해야하므로 기존의 추적 레이더에 비해 동등 이상의 연산능력 및 소형화를 요구한다. 본 논문에서는 밀리미터파 추적 레이더에 적용하기 위한 소형 전원공급기 설계 및 구현방안에 대해 기술한다. FPGA/DSP 등 디지털회로의 저전압/고전류 및 전압 정밀도 요구사항 충족을 위해 Point of Load (POL) 컨버터를 적용하였으며, 전력밀도를 향상시키고 시스템 효율을 개선할 수 있다. 부하가 크지 않은 출력전압에는 LDO (Low Dropout) 등을 적용하여 최대 출력 375 W, 출력 전원 8종의 단일 입력-다중 출력 전원공급기를 개발하였다. 최대 부하 조건에서 전압정밀도 <±2 %, 잡음레벨 <50 mVpp 특성을 확인하였다.

• 전기전자학회논문지
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• 제8권2호
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• pp.172-180
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• 2004

본 논문에서는 다치 논리회로를 구현하는 방식 중 전압 모드 방식에서 $neuron(\nu)MOS$ Down-literal circuit(DLC)의 다중 문턱전압 성질을 이용하여 유한체 $GF(3^m)$상에서 모든 항의 계수가 존재하는 기약 다항식에 대한 승산 알고리즘(AOTP)을 적용한 병렬 입-출력 모듈 구조의 승산기의 회로를 제안하였다. 3치 입력 신호가 인가되는 승산기는 뉴런모스 DLC를 이용하여 모듈화되고, 모듈에서 변환된 3치 입력 신호를 Pass 게이트를 통해서 선택하는 방식으로 승산 및 가산 게이트를 구현하였다. 설계된 승산기의 회로들은 +3V의 단일 공급 전원에서 $0.35{\mu}m$ N-well double-poly four-metal CMOS 공정의 모델 파라미터를 사용하여 모의실험이 수행되었다. 모의실험 결과를 통하여 승산기는 샘플링 레이트가 3MHz, 소비전력은 $4{\mu}W$, 출력은 ${\pm}0.1V$이내의 전압레벨을 유지하는 것을 알 수 있다.

• 대한기계학회논문집A
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• 제36권11호
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• pp.1371-1379
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• 2012

본 논문에서는 직접분사 가솔린엔진 부품에 의해서 발생하는 진동에 대한 기여도를 분석하는 방법을 제시한다. 본 연구에서는 부분기여도함수를 적용하여 부품 상호간의 관련성에 대한 진동원을 규명 하는데 사용하였다. 직접분사 가솔린 엔진 부품의 진동원을 규명하는데 부분기여도함수 방법을 사용하기 위해서는 시스템의 모델링이 필요하며 본 연구에서는 진동 발생 경로를 2 입력과 단일 출력계로 시스템을 모델링하였다. 이 모델링을 증명 하기 위해서, 직접분사가솔린 엔진의 진동원인 고압펌프, 연료레일, 인젝터, 고압센서에 3 축 가속도계 센서로 각 부품의 진동을 측정했다. 이 모델링을 바탕으로 각각의 진동원에 대한 부분기여도 함수를 구했으며, 직접분사 부품들의 각각의 진동 기여도를 계산하였다. 부분기여도 함수를 바탕으로 한 모델링을 통해 각 부품들에서 발생되는 진동 출력 기여 값을 정량적으로 도출하였다.

• 한국정보기술학회논문지
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• 제17권10호
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• pp.49-55
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• 2019

본 논문은 다중 사용자 다중 입력 단일 출력 (MISO) 간섭 채널에서 복수의 도청자가 존재하는 경우에, 보안 채널 수율을 향상시키기 위한 간단한 프리코딩 벡터 설계 기법을 제안한다. 제안하는 기법에서는 보안 채널 수율을 최적화하는 문제에 대해 다루었으며, 수학식으로 주어지는 분석해를 구하는 것을 목표로 하였다. 이를 위해서 신호대 누수 잡음비 (SLNR) 기반으로 프리코딩 벡터를 설계하는 방법을 제시한다. 구체적으로는, 도청자가 정보 신호를 전혀 검출할 수 없도록 도청 채널 수율을 완전히 제거하면서, 송신단-수신단 링크 간의 채널 수율을 최대화시키도록 프리코딩 벡터를 설계한다. 성능 검증을 위하여 모의실험을 수행하였으며, 송신 안테나 개수, 송신단-수신단 링크 개수, 도청자 수 간에 특별한 조건식을 만족하지 않는 환경에서는, 제안하는 기법이 모든 신호대 잡음비 범위에서 기존 기법보다 더 우수한 보안 채널 수율을 나타낸다는 것을 제시한다.

• 한국방송∙미디어공학회:학술대회논문집
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• 한국방송∙미디어공학회 2016년도 하계학술대회
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• pp.9-11
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• 2016

최근 UHDTV(ultra high definition television) 등의 고해상도 디스플레이가 시장에 등장하면서, 기존의 저해상도 FHD(full high definition) 영상을 고해상도 영상으로 변환할 수 있는 초해상화(super-resolution, SR) 기법들이 각광을 받고 있다. 그 중, 선형 매핑(linear mapping)을 사용하여 저해상도 패치(patch)로부터 고해상도 패치를 복원하는 초해상화 기법은 상대적으로 낮은 복잡도로 좋은 품질의 고해상도 영상을 생성한다. 그러나 이러한 기법은 단순한 선형 매핑을 기반으로 하기 때문에 복잡한 비선형적(nonlinear) 저해상도-고해상도 관계를 예측하기 힘든 단점이 있다. 최근 각광받는 딥러닝(deep learning) 기술은 다층(multi-layer) 네트워크를 쌓아 입력과 출력 간의 복잡한 비선형 관계를 훈련시켜 좋은 성능을 보이는데, 이를 바탕으로 본 논문에서는 다중의 레이어로 구성된 다층 선형 매핑(multi-layer linear mappings, MLLM)을 기반으로 하는 초해상화 기법을 새롭게 제안한다. 제안하는 다층 선형 매핑은 기존 선형 매핑보다 비선형적 관계를 더 잘 예측하여 높은 품질의 고해상도 영상을 생성할 수 있게 한다. 제안된 초해상화 기법은 딥러닝 기반 초해상화 기법과 필적하는 품질의 고해상도 영상을 생성하면서도 더 낮은 복잡도를 지니는 것을 확인하였다.

• 전기전자학회논문지
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• 제7권2호
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• pp.135-143
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• 2003

본 논문에서는 다치논리(Multiple-Valued Logic : MVL)를 위한 데이터 변환기의 설계방법에 대해서 논의한다. 3.3 v의 단일 전원의 4 디지트의 CMOS 아날로그 4치 변환기(Analog to Quaternary Converter : AQC)와 4치 아날로그 변환기(Quaternary to Analog Converter)를 뉴런모스를 사용한 다운리터럴회로(Down-Literal Circuit : DLC)를 사용하여 설계하였다. 뉴런모스 다운리터럴회로는 제안된 AQC와 QAQ가 4개의 전압 레벨값을 출력과 입력으로 사용하게 하며, 소자의 다중 문턱전압 특성을 갖게한다. 제안된 AQC -QAC 회로는 구조면에서 전전력 소모의 특성을 갖는다.

• 한국정보처리학회:학술대회논문집
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• 한국정보처리학회 2018년도 추계학술발표대회
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• pp.573-576
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• 2018

아파치 카프카(Apache Kafka)는 데이터 스트림을 실시간 전달하는 분산 메시지 큐잉 플랫폼이다. 카프카는 대다수의 실시간 처리 응용에 사용되는데, 흔히 데이터 스트림의 발생지와 실시간 처리 시스템 사이(입력) 또는 실시간 처리 시스템과 처리 결과의 목적지 사이(출력)에 배치된다. 분산 기술을 도입한 카프카는 다른 메시지 큐잉 기술에 비해 대용량 데이터 스트림을 더욱 빠르게 전달 할 수 있다는 장점을 갖는다. 하지만, 카프카에 적재되는 데이터 스트림의 양과 실시간 처리 응용의 수가 증가할수록 메시지 지연시간은 매우 높아질 수 밖에 없다. 본 논문은 이러한 카프카의 메시지 지연 문제를 해결하고자 카프카의 로드 쉐딩 엔진을 제안한다. 로드 쉐딩의 세 가지 필수적인 결정에 따라, 제안하는 로드 쉐딩 엔진은 카프카의 프로뷰서에서 지연시간이 기준치를 초과할 경우 일부 메시지 전송을 제한하여 지연시간을 줄인다. 실제 실시간 처리 응용으로 실험한 결과, 단일/다중 데이터 스트리 모두 로드 쉐딩이 바르게 작동하여 지연시간이 지속적으로 증가하지 않고 오르내림이 반복되는 추세를 보였다. 본 연구는 데이터 스트림의 입출력을 카프카로 관리하는 실시간 처리 응용에 로드 쉐딩 기법을 적용한 첫 번째 시도로서, 앞으로 데이터 스트림 처리에 사용될 의미 있는 연구라 사료된다.