고온 급속 열처리시킨 LiNbO₃/AIN/Si(100) 구조를 이용하여 MFIS 소자를 제작하고, 비휘발성 메모리 동작 가능성을 확인하였다. 고유전율 AIN 박막 위에 Pt 전극을 증착시켜 제작한 MIS 구조에서 측정한 1MHz C-V 특성곡선에서는 히스테리시스가 전혀 없고 양호한 계면특성을 보였으며, 축적 영역으로부터 산출한 비유전율 값은 약 8 이었다. Pt/LiNbO₃/AIN/Si(100) 구조에서 측정한 1MHz C-V 특성의 축적영역에서 산출한 LiNbO₃ 박막의 비유전율 값은 약 23 이었으며, ±5 V의 바이어스 범위 내에서의 메모리 윈도우는 약 1.2 V이었다. 이 MFIS 구조에서의 게이트 누설전류밀도는 ±500 kV/cm의 전계 범위 내에서 10/sup -9/ A/㎠ 범위를 유지하였다. 500 kHz의 바이폴러 펄스를 인가하면서 측정한 피로특성은 10/sup 11/ cycle 까지 초기값을 거의 유지하는 우수한 특성을 보였다.
In order to obtain the oxidation layer for SiC MOS, the oxide layers by thermal oxidation process with dry and wet method were deposited and characterized. Deposition temperature for oxidation layer was $1100^{\circ}C$~130$0^{\circ}C$ by $O_2$ and Ar atmosphere. The oxide thickness, surface morphology, and interface characteristic of deposited oxide layers were measurement by ellipsometer, SEM, TEM, AFM, and SIMS. Thickness of oxidation layer was confirmed 50nm and 90nm to with deposition temperature at $1150^{\circ}C$ and $1200{\circ}C$ for dry 4 hours and wet 1 hour, respectively. For the high purity oxidation layer, the necessity of sacrificial oxidation which is etched for the removal of the defeats on the wafer after quickly thermal oxidation was confirmed.
Brazing of Fe-Cr-Al alloy was carried out at $1200^{\circ}C$ in vacuum furnace using nickel-based filler metals : BNi-5 powder(Ni-Cr-Si-Fe base alloy} and MBF-50 foil (Ni-Cr-Si-B). The effect of boron content on the stability of oxide scale on the brazed joint was investigated by means of cyclic oxidation test performed at $1050^{\circ}C$ and $1200^{\circ}C$. Apparently, the joints brazed with MBF-50 containing boron showed relatively stable oxidation rates compared to boron-free BNi-5 at both temperatures. However, it was considered that the slower weight loss of MBF-50 brazed specimen wasn’t resulted from the low oxidation rate but from the spallation of oxide layer. The oxide layer consisted of thick spinel oxide on the surface and $Al_2 O_3$ internal oxide layer along the interface between mother alloy and braze, the mother alloy was also eroded seriously by the formation of spinel oxides such as $FeCr_2 O_4$ and $NiCr_2 O_4$ on the surface, likely to be induced by the change of oxide forming mechanism due to diffusion of boron from the braze. On the contrary, the joint brazed with BNi-5 showed the good oxidation resistance during the cyclic oxidation test. It seems that the oxidation can be retarded by the formation of stable $Al_2 O_3$ layer at the surface.
반도체 미세구리배선 적용을 위하여 구리배선의 습식 표면처리 및 열 사이클에 따른 구리 박막과 실리콘질화막 도포층 사이의 계면접착에너지를 4점굽힘시험을 통해 정량적으로 평가하였다. 구리배선을 화학적 기계적 연마한 후 습식 표면처리를 통하여 구리 박막과 실리콘질화막의 계면접착에너지는 $10.57J/m^2$에서 $14.87J/m^2$로 증가하였다. $-45{\sim}175^{\circ}C$범위에서 250사이클 후, 표면처리를 하지 않은 시편의 계면접착에너지는 $5.64J/m^2$으로, 표면처리를 한 시편은 $7.34J/m^2$으로 감소하였으며, 모든 시편의 박리계면은 구리 박막과 실리콘질화막 계면으로 확인되었다. X-선 광전자 분광법으로 계면 결합 상태를 분석한 결과, 화학적 기계적 연마 공정 후 구리배선의 표면 산화물이 습식표면처리에 의해 효과적으로 제거된 것을 확인하였다. 또한, 열 사이클 처리동안, 구리 박막과 실리콘질화막의 큰 열 팽창 계수 차이로 인한 열응력으로 인하여 구리 박막과 실리콘질화막 계면이 취약해지고, 계면을 통한 산소유입에 따른 구리 산화층이 증가하여 계면접착에너지가 저하된 것으로 판단된다.
JSTS:Journal of Semiconductor Technology and Science
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제9권3호
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pp.166-173
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2009
The reliability of hafnium oxide gate dielectrics incorporating lanthanum (La) is investigated. nMOSFETs with metal/La-doped high-k dielectric stack show lower $V_{th}$ and $I_{gate}$, which is attributed to the dipole formation at the high-k/$SiO_2$ interface. The reliability results well correlate with the dipole model. Due to lower trapping efficiency, the La-doping of the high-k gate stacks can provide better PBTI immunity, as well as lower charge trapping compared to the control HfSiO stacks. While the devices with La show better immunity to positive bias temperature instability (PBTI) under normal operating conditions, the threshold voltage shift (${\Delta}V_{th}$) at high field PBTI is significant. The results of a transconductance shift (${\Delta}G_m$) that traps are easily generated during high field stress because the La weakens atomic bonding in the interface layer.
70 ${\AA}$-thick oxides nitridied at various conditions were reoxidized at pemperatures of 900$^{\circ}C$ in dry-O$_2$ ambients for 5~40 mininutes. The gate oxide interface porperties as well as the oxide substrate interface properties of MOS(Metal Oxide Semiconductor) capacitors with various nitridation conditions, reoxidation conditions and pure oxidation condition were investigated. We stuided I$\sub$g/-V$\sub$g/ characteristics, $\Delta$V$\sub$g/ shift under constant current stress from electrical characteristics point of view and breakdown voltage from leakage current point of view of MOS capacitors with SiO$_2$, NO, RNO dielectrics. Overall, our experimental results show that reoxidized nitrided oxides show inproved charge trapping porperites, I$\sub$g/-V$\sub$g/ characteristics and gate $\Delta$V$\sub$g/ shift. It has also been shown that reoxidized nitridied oxide's leakage currented voltage is better than pure oxide's or nitrided oxide's from leakage current(1${\mu}$A) point of view.
경사형 스페이서와 LDD 영역을 갖는 다결정 실리콘 TFT를 제작하였다. 소자 특성의 신뢰성을 위해 수소($H_2$)와 수소/플라즈마 처리 공정으로 수소 처리된 n-채널 다결정실리콘 TFT 소자를 제작하였다. 소자에 최대 누설전류의 게이트 전압 조건에서 소자에 스트레스를 인가시켰다. 게이트 전압 스트레스 조건에 의해 야기되는 열화 특성인자들인 드레인 전류, 문턱전압($V_{th}$), 부-문턱전압 기울기(S), 최대 전달 컨덕턴스($g_m$), 그리고 파워인자 값을 측정/추출하였으며, 수소처리 공정이 소자 특성의 열화 결과에 미치는 관계를 분석하였다. 특성 파라미터의 분석 결과, 수소화 처리시킨 n-채널 다결정 실리콘 박막 트랜지스터에서 열화특성의 원인들은 다결정실리콘/산화막의 계면과 다결정 실리콘의 그레인 경계에서 실리콘-수소 본드의 해리에 의한 현수 본드의 증가이었다. 따라서 새로 제안한 다결정 TFT의 구조는 제작 공정 단계가 간단하며, 소자 특성에서 누설전류가 드레인 영역 근처 감소된 수평 전계에 의해 감소되었다.
나노 결정질 $ZrO_2$ 박막을 제조하여 박막의 표면에서 인산칼슘을 유도하는 능력을 편가하기 위하여, 지르코늄 나프테네이트를 출발물질로 사용하고 화학적 용액법을 이용하여, $ZrO_2/Si$ 구조를 제작하였다. 코팅용액을 (100)Si 기판 위에 스핀코팅한 후, 500$^{\circ}C$에서 10분간 전열처리와 800$^{\circ}C$에서 30분간 최종열처리를 행하였고, 모든 열처리는 공기분위기에서 실시하였다. X-ray diffraction analysis를 이용하여 열처리된 박막의 결정화도를 조사하였고, 표면의 미세구조와 표면 거칠기를 field emission-scanning electron microscope와 atomic force microscope를 이용하여 관찰하였다. 열처리 후의 박막은 표면에 미세한 $ZrO_2$ 나노 결정이 생성되어 있었으며, 박막의 계면은 매우 균질 하였다. 유사생채용액에 1일 및 5일간 침적된 샘플의 표면위에 형성된 인산칼슘을 energy dispersive X-ray spectrometer를 이용하여 관찰하였고, fourier transform infrared spectroscopy를 이용하여 인산칼슘에 카본이 치환되어 있음을 확인하였다.
The wafer bonding process becomes a flexible approach to material and device integration. The bonding strength in 3-dimensional process is crucial factor in various interface bonding process such as silicon to silicon, silicon to metals such as oxides to adhesive intermediates. A measurement method of bonding strength was proposed by utilizing AFM applied CNT probe tip which indicated the relative simplicity in preparation of sample and to have merit capable to measure regardless type of films. Also, New Tool was utilized to measure of tip radius. The cleaned $SiO_2$-Si bonding strength of SPFM indicated 0.089 $J/m^2$, and the cleaning result by RCA 1($NH_4OH:H_2O:H_2O_2$) measured 0.044 $J/m^2$, indicated negligible tolerance which verified the possibility capable to measure accurate bonding strength. And it could be confirmed the effective bonding is possible through SPFM cleaning.
나노 두께의 NiFe의 자기적 특성을 살펴보기 위해 Si(100)/ $SiO_2$(200 nm)/Ta(5 nm)/N $i_{80}$F $e_{20}$(1~15 nm)의 구조를 ICP형 헬리콘 스퍼터로 제작하였다. 제작된 시편의 자기적 물성은 SQUID를 이용하여 $\pm$50 Oe에서의 4.2K와 300K에서 각각의 M-H loop를 측정하여 자기탄성에너지 변화와 보자력을 확인하였다. 또한 SQUID로 4.2K-300K에서의 M-T curve를 통해 온도에 따른 포화자화를 두께에 따라 살펴보았다. TEM을 사용하여 제작된 시편의 각 계면간의 미세구조를 살펴보았다 나노두께의 NiFe는 3 nm 이하에서는 $B_{bulk}$=0, $B_{surf}$=-3${\times}$$10^{-7}$(J/$m^2$)의 자기 탄성계수를 보였으며, 보자력은 급격히 증가하는 것을 확인하였다. 나노 두께의 퍼말로이는 계면효과에 의해서 벌크특성과 다른 자기탄성계수, 보자력, Ms의 변화가 발생하였다. 따라서 나노급 소자를 제작할 때 이러한 변화를 고려하여 설계하여야 하였다.
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[게시일 2004년 10월 1일]
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