• 한국진공학회:학술대회논문집
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• 한국진공학회 2016년도 제50회 동계 정기학술대회 초록집
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• pp.240-240
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• 2016

반도체 양자점은 불연속적인 에너지준위의 특성 때문에 고전적인 빛과는 다른 단일광자를 방출하여 양자정보 처리과정에 기본 요소로써 사용 될 수 있다. III-Nitride (III-N) 반도체 물질은 III족 원소의 구성비를 조절하였을 때 밴드갭 에너지차이가 크므로 깊은 양자 우물을 만들 수 있으며 최근에는 기존에 연구되던 III-Arsenide 기반의 반도체 양자점과 다르게 상온 (300 K) 동작 가능한 단일광자 방출원이 개발되었다.[1] 또한 약한 split-off 에너지 때문에 양자점 모양에 작은 비대칭성만 존재해도 큰 선형편광도를 가질 수 있다. 하지만 III-N 반도체 양자점의 이러한 특성에도 불구하고 이종기판과의 격자상수 불일치에 따른 많은 threading dislocation, 압전효과에 의한 큰 내부전기장에 의해 발광 효율이 떨어지는 등의 문제가 있다. 이를 해결하기 위해 반도체 양자점을 3차원 구조체와 결합하여 threading dislocation 및 내부전기장을 줄이는 연구들이 진행되고 있다.[2] 본 연구에서는 선택적 영역 성장 방식을 통해 마이크로미터 크기를 가지는 피라미드 형태의 3차원 구조체를 이용, 피라미드의 꼭지점에 형성된 InGaN/GaN 양자점의 광학적 특성에 대해 분석하였다. 저온(9 K)에서 마이크로 photoluminescence 측정을 통해 양자점의 발광파장이 피라미드의 옆면의 파장과는 다름을 확인하였다. 여기광의 세기에 따른 양자점의 발광 세기 측정하여 여기광에 선형 비례함을 보이고, 양자점의 편광도를 측정하여 선형 편광임을 확인하였다. 마지막으로, 광량에 대해 시간에 따른 상관관계를 측정함으로써 양자점이 양자 발광체의 특성을 보이는 지 확인하였다.

• 한국지능시스템학회:학술대회논문집
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• 한국퍼지및지능시스템학회 2003년도 ISIS 2003
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• pp.439-442
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• 2003

In order to solve the difficulties of parameter settings in SA algorithm, an improved practical SA algorithm is proposed by employing the threading techniques, appropriate software structures, and dynamic adjustments of temperature parameters. Threads provide a mechanism to realize a parallel processing under a disperse environment by controlling the flux of internal information of an application. Thread services divide a process by multiple processes leading to parallel processing of information to access common data. Therefore, efficient search is achieved by multiple search processes, different initial conditions, and automatic temperature adjustments. The proposed are methods are evaluated, for three types of Traveling Salesman Problem (TSP) (random-tour, fractal-tour, and TSPLIB test data)are used for the performance evaluation. The experimental results show that the computational time is 5％ decreased comparing to conventional SA algorithm, furthermore there is no need for manual parameter settings. These results also demonstrate that the proposed method is applicable to real-world vehicle routing problems.

• 한국통신학회논문지
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• 제27권5C호
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• pp.512-521
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• 2002

최근에 성능의 한계를 드러내고 있는 수퍼스칼라 RISC를 대체할 새로운 프로세서 구조로서 SMT(Simultaneous Multi-Threading)이 활발히 연구되고 있다. SMT는 하나의 프로세서에 여러 개의 스레드가 하드웨어 자원을 동적으로 공유하며 동시에 수행되는 구조이다. 이러한 환경에서는 프로세서 안에 존재하는 여러 스레드로부터 명령어를 원활하게 공급하여 주는 것이 중요하다. SMT 프로세서는 기존의 프로세서에 비하여 사이클 당 실제 처리되는 명령어 수가 월등히 많기 때문에, 사이클 당 명령어 페치량과 페치된 명령어를 임시 저장하는 페치 큐의 엔트리수가 신중하게 결정되어야 한다. 또한 사이클마다 페치할 스레드와 각 스레드의 페치량을 결정하는 것이 성능에 큰 영향을 미친다. 따라서 본 논문에서는 이러한 요소들이 프로세서 전체의 성능에 미치는 영향을 분석하고 그 결과를 바탕으로 SMT 프로세서에 최적화된 명령어 페치 전략에 대하여 논한다.

• 디지털산업정보학회논문지
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• 제12권1호
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• pp.89-95
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• 2016

Recent growth of hacking threats and development in software and technology put Network security under threat, In addition, intrusion, malware and worm virus have been increased due to the existence of variety of sophisticated hacking methods. The goal of this study is to compare Snort Alpha version with Suricata 2.0.11 version whereas previous study focuses on comparison between snort 2. x version under thread environment and Suricata under multi-threading environment. This thesis' experiment environment is set as followed. Intel (R) Core (TM) i5-4690 3. 50GHz (4threads) of CPU, 16GB of RAM, 3TB of Seagate HDD, Ubuntu 14.04 are used. According to the result, Snort Alpha version is superior to Suricata in performance, but Snort Alpha had some glitches when executing pcap files which created core dump errors. Therefore this experiment seeks to analyze which performs better between Snort Alpha version that supports multi packet processing threads and Suricata that supports multi-threading. Through this experiment, one can expect the better performance of beta and formal version of Snort in the future.

• 한국통신학회논문지
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• 제29권3A호
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• pp.347-357
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• 2004

네트웍 시스템은 빠른 트래픽 처리속도와 다양한 서비스 제공을 위한 유연성이라는 두 가지 측면을 모두 만족시키기 위하여 발전되어 왔고 이러한 결과로 네트웍 프로세서가 출현하게 되었다. 네트웍 프로세서의 성능을 향상시키는 방법으로는 고속의 외부 인터페이스와 전용 연산기 등을 이용하는 방법들이 사용되어왔다. 최근에 이르러 이러한 방법 이외에 아키텍쳐적인 방법을 이용한 SMT(Simultaneous MultiThreading) 네트웍 프로세서의 구조가 제안되었는데 SMT 구조는 설계의 복잡성으로 인하여 상용화에 어려움이 있다. 따라서 SMT 구조의 네트웍 프로세서를 개발하기 위해서는 SMT 구조의 하드웨어 간략화 측면의 연구가 필요하다. 본 논문에서는 SMT 구조의 각 유닛들이 네트웍 알고리즘을 실행하는데 있어서의 영향을 분석하고 그 결과를 바탕으로 최적화된 SMT 네트웍 프로세서의 구조를 제안하였다.

• 한국결정성장학회지
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• 제2권2호
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• pp.53-62
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• 1992

SOI구조 형성을 위항 대용융 재결정(ZMR) 공정에서 타원형의 반사경을 기울여 빔강도분포를 인위적으로 변화시켜 실리콘 박막을 재결정시켰다. 비대칭 선형가열 효과를 해석하기 위하여 전산모사를 행하여 응고계면 근처에서의 온도분포와 열구배 변화를 조사하였다. 상부집속열원의 경사각이 증가할수록 액상의 과냉도와 실리콘 박막내의 결함열 간격은 증가하였다. 주된 결함은 연속적인 아결정립계였고 결함밀도가 낮은 경우는 isolated threading dislocations만이 관찰되었다. 단면 TEM과 박막 XRD 분석결과 실리콘 박막은 (100) 집합조직을 갖는 단결정 박막으로 재결정되었음을 확인할 수 있었다.

• 정보처리학회논문지A
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• 제17A권2호
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• pp.73-80
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• 2010

하드웨어의 성능이 향상됨에 따라 멀티태스킹 방식으로 병행 처리하는 연구가 다양하게 진행되고 있다. 프로그램 개발 단계에서 프로그램을 수정할 경우, 전체 프로그램을 다시 평가하는 대신 수정한 부분과 그 부분에 영향 받는 부분만을 다시 평가하는 방법이 점진 평가인데, 여러 프로세서에서 병렬로 처리하는 대신 자바언어의 멀티쓰레딩 기능을 활용하여 점진 평가의 효율성을 증대시키는 연구가 필요하다. 본 논문에서는 의미 구조에 직접적으로 영향을 주는 변수의 값을 나타내는 속성을 중심으로 종속성을 표시하여 객체 지향언어인 자바 언어에서 병행 점진 평가를 동시에 효율적으로 수행할 수 있는 병행 점진 평가 알고리즘을 제시하고 그 알고리즘의 정확성을 증명한다. 실험을 통해 병행 점진 평가 방법의 효율성을 분석한다.

• 한국안전학회지
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• 제39권1호
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• pp.96-103
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• 2024

The demand for mass calculation of offsite consequence analysis to conduct exhaustive single-unit or multi-unit Level 3 PSA is increasing. In order to perform efficient offsite consequence analyses, the Korea Atomic Energy Research Institute is conducting model optimization studies to minimize the analysis time while maintaining the accuracy of the results. A previous study developed a model optimization method using efficient plume segmentation and verified its effectiveness. In this study, we investigated the possibility of optimizing the model through particle size distribution setting by checking the reduction in analysis time and deviation of the results. Our findings indicate that particle size distribution setting affects the results, but its effect on analysis time is insignificant. Therefore, it is advantageous to set the particle size distribution as fine as possible. Furthermore, we evaluated the effect of multithreading and confirmed its efficiency. Future optimization studies should be conducted on various input factors of offsite consequence analysis, such as spatial grid settings.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2002년도 ITC-CSCC -1
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• pp.293-296
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• 2002

This paper discusses a software reliability model for the distributed s-PCT algorithm fur remote sensing applications. The distributed algorithm is designed based on a Manager-Worker threading concept and goes further to use redundancy to achieve fault tolerance. The paper provides a status report on our progress in developing the reliability concept and applying it to create a model for the distributed s-PCT In particular, we are interested ill the algorithm performance versus reliability.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2003년도 하계종합학술대회 논문집 Ⅲ
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• pp.1387-1390
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• 2003

The superscalar architecture shows limit in performance improvement recently. While, SMT(Simultaneous Multi-Threading) architecture is receiving remark. The purpose of SMT architecture is to improve the performance of superscalar microprocessors by executing multi threads at the same time. In this paper, a load/store unit(LSU) suitable for ARM-compatible SMT microprocessors is presented. This LSU supports load instructions and store instructions of ARM ISA. This LSU keeps away the degradation of SMT by cache miss.