• JSTS:Journal of Semiconductor Technology and Science
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• 제13권2호
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• pp.145-151
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• 2013

In this paper, a low power, small area cyclic time-to-digital converter in All-Digital PLL for DVB-S2 application is presented. Coarse and fine TDC stages in the two-step TDC are shared to reduce the area and the current consumption maintaining the resolution since the area of the TDC is dominant in the ADPLL. It is implemented in a 0.13 ${\mu}m$ CMOS process with a die area of 0.12 $mm^2$. The power consumption is 2.4 mW at a 1.2 V supply voltage. Furthermore, the resolution and input frequency of the TDC are 5 ps and 25 MHz, respectively.

• 한국항행학회논문지
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• 제2권2호
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• pp.116-125
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• 1998

최근의 이동 통신 시스템용 전력 증폭기는 고전력, 고효율 특성을 가지며 또한 저왜곡 특성을 갖도록 요구되고 있다. 디지털 통신 시스템의 전력 증폭기는 상호 변조와 스펙트럼 재성장에 의한 인접 채널 간섭이 생기게 되며, 특히 광대역 디지털 통신 시스템에서는 인접채널 전력비 특성이 중요하게 이용되고 있다. 전력 증폭기의 통신 시스템에 대한 영향을 분석하기 위해 22Mcps로 대역 확산된 광대역 디지털 변조 신호원을 구현하고, ISM 밴드를 이용한 전력 증폭기를 설계하여 RZ, NRZ등 코딩방법에 따른 전력 증폭기의 비선형 특성인 인접채널 전력비 특성을 비교 시뮬레이션 및 측정하였다.

• 정보학연구
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• 제6권4호
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• pp.1-9
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• 2003

본 연구는 저압 전력선 망을 통한 전력선 통신(PLC: Power Line Communication)에 관한 내용이다. 전력선 통신이 가지는 주요 잇점은 기존의 인프라구조의 사용이다. 전력선 통신 채널은 전형적으로 전력선의 길이와 주파수가 증가함에 의해 신호 감쇠를 나타내는 주파수 선택적 페이딩(Frequency-Selective Fading)을 가지는 다중경로 반사 전파로 모델링 할 수 있다. OFDM(Orthogonal Frequency Division Multiplexing)은 다수개의 낮은 데이터 율의 반송파들이 높은 전송율을 이루는 형태로 송신기에서 조합되는 변조 기법이다. 모델링한 다중 경로 반사 전력선 채널에 음향 신호를 입력하여 체계의 성능을 모의 실험을 통해 분석, 검증하였다.

• 한국시뮬레이션학회:학술대회논문집
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• 한국시뮬레이션학회 2005년도 춘계학술대회 논문집
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• pp.10-14
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• 2005

IEEE 802.15.4 low-rate Wireless Personal Area Networks(WPAN) are expected to provide ubiquitous networking between small personal/home devices and sensors with low power consumption and low cost features. The technology employs special CSMA/CA (Carrier Sense Multiple Access/collision Avoidance) to save power consumption for small or portable WPAN-enabled devices. In this paper, we simulation the slotted CSMA/CA of IEEE 802.15.4 MAC and evaluate its performance limit in order to grasp the characteristics of Medium Access Control (MAC) of IEEE 802.15.4 WPAN.

• 대한전자공학회논문지SD
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• 제48권10호
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• pp.33-38
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• 2011

본 논문에서는 로컬에서의 동기화를 위한 새로운 저 전력 동기화 기술을 제안하였다. 본 논문에서 제안하고 있는 저 전력 동기화 기술은 현재 널리 이용되고 있는 소스 동기화 방법과 비교하여 클록을 전송하는 대신 인에이블 신호를 전송하여 동기화를 함으로써 소스 동기화 방법의 장점과 데이터 전송속도는 그대로 유지하면서 동기화를 위한 회로와 배선에서 소모되는 전력을 50%이상 감소시킨다.

• Journal of Magnetics
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• 제8권1호
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• pp.74-78
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• 2003

The largest advantage of magnetic micromachine is wireless operation. This advantage makes it suitable for medical micromachine working inside the human body. In the medical field, low invasion treatment is very important From this point of view, very small machines working in the body without power supply cables meet the needs of the medical field. In this paper, we report about magnetic wireless actuators for medical applications.

• 제어로봇시스템학회:학술대회논문집
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• 제어로봇시스템학회 2003년도 ICCAS
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• pp.1982-1985
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• 2003

Future cellular networks will mainly be driven by, high quality channels, high band with utilization, low power consumption and efficient network management. For a given channel allocation, the capacity and quality of communication of cellular radio systems using CDMA(Code Division Multiple Access) can be increased by using a transmitter power control scheme to combat the near-far problem. Centralized power control schemes or distributed ones to maximize the minimum signal-to-interference in each user of CDMA wireless network have been investigated. This paper has proposed a distributed power control algorithm, which employs an adaptive search scheme, in order to solve quickly the linear systems of equations for power update in CDMA cellular radio systems. The simulation results show that the proposed scheme has faster convergence rate than the typical bang-bang type of distributed power control algorithm, which has been much used as a reference algorithm in IS-95A and W-CDMA communication network.

• 한국전자통신학회논문지
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• 제17권4호
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• pp.671-678
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• 2022

근사 컴퓨팅은 정확한 결과 대신에 허용 가능한 정도의 부정확한 결과를 도출하는 연산 기법이다. 근사 곱셈은 고성능, 저전력 컴퓨팅을 위한 근사 컴퓨팅 방식 중 하나이다. 본 논문에서는 근사 4-2 compressor와 향상된 전가산기를 사용하여 고집적·저전력·고속 근사 곱셈기를 제안하였다. 근사 4-2 compressor를 사용한 근사 곱셈기는 정확, 근사, 상수 수정 영역의 3개 영역으로 구성되어 있으며, 효율적인 부분 곱 감소 방식을 적용하여 각 영역의 크기를 조절하면서 성능을 비교하였다. 제안한 근사 곱셈기는 Verilog HDL로 설계하였고, 25nm CMOS 공정에서 Synopsys Design Compiler(DC)를 이용하여 면적, 전력, 지연시간을 분석하였으며, 기존의 근사 곱셈기에 비해 면적을 10.47%, 전력을 26.11%, 지연시간을 13% 줄였다.

• JSTS:Journal of Semiconductor Technology and Science
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• 제16권4호
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• pp.463-469
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• 2016

This paper presents a compression-friendly low power test scheme in EDT environment. The proposed approach exploits scan slices reusing to reduce the switching activity during shifting for test scheme based on linear decompressor. To avoid the impact on encoding efficiency from resulting control data, a counter is utilized to generate control signals. Experimental results obtained for some larger ISCAS'89 and ITC'99 benchmark circuits illustrate that the proposed test application scheme can improve significantly the encoding efficiency of linear decompressor.

• 전자공학회논문지
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• 제50권12호
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• pp.71-79
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• 2013

본 논문에서는 이퀄라이저 적응기(adaptation)를 포함하는 12.5 Gb/s 저전력 수신단 설계에 대해서 기술한다. 샘플러와 직렬 변환기를 사용한 저전력 아날로그 이퀄라이저 적응기를 구현함으로써 채널과 칩 공정 변화에 능동적으로 적응할 수 있으며 그 적응 원리에 대해서 설명한다. 또한 저전력을 위한 전압 모드 송신기의 접지 기반 차동 신호를 수신하는 기술에 대해서 설명하였다. 17.6 dB의 피킹 이득을 갖는 CTLE(Continuous Time Linear Equalizer)는 6.25 GHz에서 -21 dB 손실을 갖는 채널의 길게 늘어지는 ISI(Inter Symbol Interference)를 제거한다. 45 nm CMOS 공정을 이용하여 eye diagram에서 200 mV의 전압 마진과 0.75 UI의 시간 마진을 갖고 0.87 mW/Gb/s의 낮은 전력 소모를 유지한다.