• 제목/요약/키워드: high-speed signaling

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안전분석 기법과 SysML 기반의 아키텍처 산출물의 연계성 확보를 통한 BCT 시스템의 안전 무결성 확보에 관한 연구 (On Ensuring the Safety Integrity of the BCT System through Linkage Safety Analysis Techniques and SysML-based Architecture Artifact)

  • 김주욱;오세찬;심상현;김영민
    • 한국산학기술학회논문지
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    • 제17권8호
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    • pp.352-362
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    • 2016
  • 오늘날 산업 기술의 발달에 따른 고도화로 인해, 최근 우리 사회에 고속열차에 이어 무인운영 도시철도에 이르기까지 다양한 열차 시스템들이 개발 및 운용되고 있는 추세에 있다. 특히, 본 연구에서 대상으로 다룬, 도시철도 도메인에서는 기존 철도차량에 대해서 신호 제어 시스템을 운용하는 환경에서 보다 복잡화된 운용개념을 지원하기 위한 신규 신호 시스템 체계의 도입이 필요로 하고 있다. 또한, 기존의 존재하지 않은 컨셉을 바탕으로 개발되는 신호 시스템은 철도를 이용하는 승객들의 인적 피해를 최소화하기 위한 노력이 필요로 하고 있다. 본 연구에서는 신규 시스템 개발에 참여하는 다양한 도메인 엔지니어로 하여금 동일한 시각 제공과 통합된 방법론을 바탕으로 효율적인 신호시스템 설계 및 안전 활동을 위한 방법론을 제시 하고자 한다. 따라서, 서로 상이한 도메인 영역의 연계성 확보를 통해 향후 신규 시스템 설계시 보다 안전성 확보를 통한 설계적 무결성을 확보할 수 있는 방법론이 될 수 있을 것이다.

메모리 인터페이스를 위한 적응형 프리엠퍼시스를 가지는 8-Gb/s/채널 비균형 4-레벨 펄스진폭변조 입출력회로 (An 8-Gb/s/channel Asymmetric 4-PAM Transceiver with an Adaptive Pre-emphasis for Memory Interface)

  • 장영찬;전영현
    • 대한전자공학회논문지SD
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    • 제46권8호
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    • pp.71-78
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    • 2009
  • 고속 메모리의 인터페이스를 위한 8 ${\times}$ 8-Gb/s/채널 4-레벨 펄스진폭변조 입출력회로를 1.35V의 공급전압을 가지는 70nm DRAM 공정을 이용하여 설계하였다. 4-레벨 펄스진폭변조를 위한 3 가지의 eye opening에서 상위와 하위 eye의 전압과 시간의 마진을 증가시키기 위해 비균형 4-레벨 펄스진폭변조의 신호전송 기법을 제안한다. 제안한 기법은 수신 단에서의 기준 전압 노이즈 영향을 33% 감소시키며, 이를 통계적인 수식을 통해 분석한다 일반적인 직렬 인터페이스 대비 신호 손실이 적은 DRAM 채널의 ISI(신호간의 간섭)를 줄이기 위해 수신 단에서 단일 비트 펄스의 테스트 신호를 적분함으로 ISI를 측정하는 적응형 프리앰퍼시스 기법을 구현한다. 또한, 이를 위해 정해진 테스트 패턴에 의해 최적의 ISI를 측정하기 위한 적분 클럭의 시간 보정기법을 제안한다.

ns-2 네트워크 시뮬레이터 기반의 MPλS 시뮬레이터의 설계 및 구현 (Design and Implementation of MPλS Simulator based on ns-2 Network Simulator)

  • 서선영;이봉환;황선태;윤찬현
    • 대한전자공학회논문지TC
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    • 제40권10호
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    • pp.119-128
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    • 2003
  • 인터넷 사용자의 급증, 서비스의 다양화, 전송속도의 고속화, 이용 분야의 확대 등으로 인해 인터넷 트래픽이 매년 급속하게 증가하고 있다. 이러한 수요를 충족시키기 위하여 대용량의 대역폭을 제공하는 WDM 기술과 IP 망을 효율적으로 통합한 MPLS를 기반으로 하는 MPλS 프로토콜이 제안되었다. 본 논문에서는 ns-2 네트워크 시뮬레이터의 기능을 확장하여 MPλS 네트워크 시뮬레이터를 설계하고 구현하였다. 구현한 시뮬레이터는 OXC(Optical Crossconnect) 모듈, 효율적인 파장 할당을 위한 RWA(Routing and Wavelength Assignment) 모듈, 다중 파장 링크 모듈, MPλS 시그널링 및 제어 모듈 등으로 구성된다. 구현한 시뮬레이터 상에서 처리율 및 블로킹 확률 등의 파라미터를 이용하여 MPλS의 성능을 검증하였으며 구현한 시뮬레이터는 시스템 개발 이전 단계에서 제안된 프로토콜의 기능을 검증하는데 유용하게 사용 될 수 있을 것으로 사료된다.

CMOS공정 기반의 고속-저 전압 BiCMOS LVDS 구동기 설계 (The Design of CMOS-based High Speed-Low Power BiCMOS LVDS Transmitter)

  • 구용서;이재현
    • 전기전자학회논문지
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    • 제11권1호통권20호
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    • pp.69-76
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    • 2007
  • 본 논문에서는 CMOS 공정기반의 BiCMOS LVDS 구동기를 설계하여 고속 I/O 인터페이스에 적용하고자 한다. 칩 면적을 줄이고 LVDS 구동기의 감내성을 향상시키기 위해 lateral 바이폴라 트랜지스터를 설계하여 LVDS 구동기의 바이폴라 스위칭으로 대체하였다. 설계된 바이폴라 트랜지스터는 20가량의 전류이득을 지니며, 설계된 LVDS 드라이버 셀 면적은 $0.01mm^2$로 설계되었다. 설계된 LVDS 드라이버는 1.8V의 전원 전압에서 최대 2.8Gb/s의 데이터 전송속도를 가진다. 추가적으로 ESD 현상을 보호하기 위해 새로운 구조의 ESD 보호 소자를 설계하였다. 이는 SCR구조에서 PMOS, NMOS의 턴-온 특성을 이용 낮은 트리거링 전압과 래치 업 현상을 최소화 시킬 수 있다. 시뮬레이션 결과 2.2V의 트리거링 전압과 1.1V의 홀딩 전압을 확인할 수 있었다.

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파워 분배망을 고려한 디지털 회로 시스템의 설계와 분석 (Design and Analysis of Digital Circuit System Considering Power Distribution Networks)

  • 이상민;문규;위재경
    • 대한전자공학회논문지SD
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    • 제41권4호
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    • pp.15-22
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    • 2004
  • 이 논문은 PCB의 PDN(Power Distribution Network) 시스템을 고려한 채널 분석을 나타내었다. 설계자가 원하는 PDN 시스템을 설계하기 위하여, 전체 주파수 범위의 PDN이 요구하는 임피던스를 얻는 유용한 설계방법을 제안하였다. 제안된 방법은 주파수 영역과 관계된 계층적 배치 접관방식과 보트와 decoupling 커패시터 사이의 current 흐름의 간섭을 고려한 path-based equivalent 회로를 기본으로 하였다. 비록 빠르고 쉬운 계산을 위한 lumped model일지라도, 실험 결과는 제안된 모델이 numerical 분석처럼 거의 정확함을 보였다. PDN 시스텐의 분석은 패키지 인덕턴스가 파워 노이즈, 데이터 채널을 통한 신호 이동에 영향을 받는다는 것을 보여주고 있으나, 보드 PDN 또한 정확한 채널 신호를 위해 무시할 수 없다는 것을 보여준다. 따라서 설계자는 반드시 초고속 디지털 시스템의 첫 스팩 설계로부터 보드, 패키지, 칩 등을 동시에 디자인을 해야 한다.

계층 구조에서 F-SNOOP을 적용한 선택적 버퍼링 매크로 핸드오버 (Slective Buffering Macro Handover Which Applies The F-SNOOP in Hierarchical structure)

  • 안치현;김동현;김형철;유황빈;이대영;전계석
    • 한국통신학회논문지
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    • 제31권5B호
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    • pp.413-420
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    • 2006
  • HMIPv6는 MAP(Mobility Anchor Point)라고 불리는 프로토콜 요소를 도입하여 로컬 핸드오버 시 MN(Mobile Node)에 대한 전송 지연과 외부 네트워크로의 시그널링 로드를 줄이는데 그 의미를 가지고 있다. 하지만 로컬지역의 핸드오버가 아닌 메크로 핸드오버의 경우 기존의 MIPv6의 핸드오버를 그대로 이용하고 있기 때문에 패킷손실과 전송 지연에 대한 문제점이 발생한다. 본 논문에서는 계층적인 구조에서 매크로 핸드오버 발생 시 CN와 MN 사이의 거리, NAR(New Access Router)와 MN 사이의 거리를 계산하여 기준값을 생성하고 그에 맞는 버퍼링 핸드오버를 선택하는 메커니즘을 제안한다. 또한 그러한 핸드오버에 알맞은 무선망에서의 성능개선을 위해 F-SNOOP을 도입한다. 무선망은 패스로스, 페이딩, 잡음, 간섭 등의 이유로 높은 에러율의 특성을 갖고 있어 혼잡과 무관하게 많은 패킷 손실이 발생하고 있다. TCP는 이를 혼잡으로 여겨 혼잡제어를 하여 패킷 전송율이 낮아지는데 F-SNOOP은 SNOOP 프로토콜을 기반으로 핸드오프 시 혼잡제어지연 기법인 Freeze-TCP의 ZWA(Zero Window Advertisement) 메시지를 이용하여 무선망의 TCP의 성능을 향상시킨다.

Time-Lapse Live-Cell Imaging Reveals Dual Function of Oseg4, Drosophila WDR35, in Ciliary Protein Trafficking

  • Lee, Nayoung;Park, Jina;Bae, Yong Chul;Lee, Jung Ho;Kim, Chul Hoon;Moon, Seok Jun
    • Molecules and Cells
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    • 제41권7호
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    • pp.676-683
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    • 2018
  • Cilia are highly specialized antennae-like organelles that extend from the cell surface and act as cell signaling hubs. Intraflagellar transport (IFT) is a specialized form of intracellular protein trafficking that is required for the assembly and maintenance of cilia. Because cilia are so important, mutations in several IFT components lead to human disease. Thus, clarifying the molecular functions of the IFT proteins is a high priority in cilia biology. Live imaging in various species and cellular preparations has proven to be an important technique in both the discovery of IFT and the mechanisms by which it functions. Live imaging of Drosophila cilia, however, has not yet been reported. Here, we have visualized the movement of IFT in Drosophila cilia using time-lapse live imaging for the first time. We found that NOMPB-GFP (IFT88) moves according to distinct parameters depending on the ciliary segment. NOMPB-GFP moves at a similar speed in proximal and distal cilia toward the tip (${\sim}0.45{\mu}m/s$). As it returns to the ciliary base, however, NOMPB-GFP moves at ${\sim}0.12{\mu}m/s$ in distal cilia, accelerating to ${\sim}0.70{\mu}m/s$ in proximal cilia. Furthermore, while live imaging NOMPB-GFP, we observed one of the IFT proteins required for retrograde movement, Oseg4 (WDR35), is also required for anterograde movement in distal cilia. We anticipate our time-lapse live imaging analysis technique in Drosophila cilia will be a good starting point for a more sophisticated analysis of IFT and its molecular mechanisms.

부분 응답 채널을 위한 채널 등화기들의 성능 분석에 관한 연구 (Performance Analysis of the Channel Equalizers for Partial Response Channels)

  • 이상경;이재천
    • 한국통신학회논문지
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    • 제27권8A호
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    • pp.739-752
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    • 2002
  • 부분 응답 신호 기법은 데이터 전송 및 저장 채널에서 신호간 간섭을 효율적으로 제어함으로써 주파수 대역폭 감축의 목적을 달성할 수 있어 많이 채택하고 있는 기법이다. 본 논문에서는 부분 응답 채널 시스템에서의 채널 등화의 문제를 연구하였다. 부분 응답 모델의 대상으로 자기 기록 채널을 고려하였는데 적응 등화기 설계를 위한 기준 신호의 서로 다른 선택이 등화기 성능에 미치는 영향을 연구하였다. 먼저 각각의 등화기에 대해서 기존의 등화기 설계에서 사용하고 있는 등화기 출력 단에서의 평균제곱오차를 이론적으로 분석하였다. 한편 등화기 출력 단에서의 평균제곱오차는 등화기 자체 분석에 있어서는 유용하지만 서로 다른 등화기법의 비료에는 미흡하기 때문에 이를 보완하기 위한 성능 평가 요소로서 최종 데이터 검출 직전에서의 데이터 평균제곱오차를 이론적으로 유도하였다. 이 결과를 통해 부분 응답 시스템에서 서로 다른 신호 배치를 갖는 적응 등화 기법들의 성능 비교가 가능하다. 또한 이러한 성능 평가 기준에 적합한 등화기 설계 방법도 고려하였다. 마지막으로 컴퓨터 시뮬레이션 결과를 통해 이론적으로 분석된 연구 결과의 타당성을 입증하였다.

부분 응답 채널에서의 블라인드 적응 등화 기술에 관한 연구 (Blind Adaptive Equalization of Partial Response Channels)

  • 이상경;이재천
    • 한국통신학회논문지
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    • 제26권11A호
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    • pp.1827-1840
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    • 2001
  • 고속 데이터 전송 모뎀 및 고밀도 기록/재생 장치에서 채널에 의해 초래된 신호간 간섭 등의 왜곡을 감축시키는 적응 등화기는 구동초기에 수신부/재생부에서도 알고 있는 데이터 신호(훈련신호)의 전송을 필요로 하고 이것은 결과적으로 실제 정보 데이터의 전송시간 감축 또는 기록미디어의 사용 효율 저하를 초래 한다. 또한 burst-mode 데이터 전송 등의 경우에서와 같이 훈련신호를 보내기가 곤란한 경우도 있다. 따라서 훈련신호 없이 동작하는 블라인드 적응 등화기술에 대한 연구에 최근까지도 많은 노력이 집중되고 있지만 관련 기술 및 성능 평가에서 기본적으로 nonlinear processing 및 분석기법을 필요로 하기 때문에 아직까지도 규명해야 될 요소들이 많이 남아 있다. 특히 효율적인 주파수대역 활용을 추구하는 부분응답 신호 방식의 경우에 해당 채널의 전달함수 영점들(zeros)이 단위원 위에 있어 등화기가 신호간 간섭을 감축시키기 위해 채널 특성을 보상하는 과정에서 등화기 입력에 들어오는 채널 첨가잡음의 증폭도 초래하기 때문에 성능이 저하된다. 이에 대응하여 본 논문에서는 기존 기법들의 성능상의 문제점을 연구한 후에, 성능 개선을 이룰 수 있는 새로운 블라인드 적응 등화 기법을 제시한다. 연구 결과는 고속 데이터 전공 모뎀 등 부분 응답 신호 방식을 사용하는 채널 등화 방식에 모두 적용 가능하지만 특히 HDD, digital VCR등의 고밀도 magnetic 기록/재생 채널을 대상으로 한 평가 결과에서 유용성을 보여 준다.

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혁신형 중소기업의 재무적 제약과 배당스무딩간의 관계 (The Relations between Financial Constraints and Dividend Smoothing of Innovative Small and Medium Sized Enterprises)

  • 신민식;김수은
    • 중소기업연구
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    • 제31권4호
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    • pp.67-93
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    • 2009
  • 본 연구는 1999년 1월 1일부터 2007년 12월 31일까지 한국거래소의 유가증권시장과 코스닥시장에 상장된 혁신형 중소기업을 대상으로 재무적 제약과 배당스무딩간의 관계를 실증분석 하였으며, 주요한 분석결과는 다음과 같다. 기업들은 목표 배당성향을 가지고 있으며, 실제 배당성향이 목표 배당성향에서 이탈하면 다시 배당지급을 부분적으로 조정한다. 배당조정속도는 Lintner(1956)의 배당조정모형의 핵심변수인 전기 주당배당과 당기 주당이익을 사용하여 거의 대부분 측정할 수 있으며, 잔여배당이론과 그 이후에 등장한 배당신호이론, 대리인이론, 케이터링 이론 및 거래비용이론에 관한 대용변수들은 배당조정속도에 부분적으로 영향을 미친다. 그리고 전기 주당배당은 당기 주당이익보다 배당조정속도에 더 큰 영향을 미치는데, 이는 기업들이 특별한 이유가 없는 한 전기 주당배당 수준을 장기적으로 유지하는 안정적인 배당정책을 선호한다는 증거가 된다. 혁신형 중소기업은 비혁신형 중소기업보다 배당조정속도가 더 빠르다. 혁신형 중소기업은 R&D 투자에 따른 미래의 성장성과 수익성을 담보로 하여 장기적으로 안정적인 배당정책을 유지할 수 있다. 다시 말해, 혁신형 중소기업은 배당지급이 목표 배당성향에서 이탈하더라도, R&D 투자에 따른 미래의 성장성과 수익성을 담보로 하여 목표 배당성향을 향하여 배당지급을 신속하게 조정하여 배당스무딩을 효과적으로 달성할 수 있다. 그리고 혁신형 중소기업 중에서도 재무적 비제약 기업은 재무적 제약 기업보다 배당조정속도가 더 빠르다. 이는 재무적 비제약 기업일수록 자본시장을 통한 외부 자금조달이 용이하기 때문에 주당배당을 신속하게 조정한다는 증거가 된다. 따라서 자본시장 접근성이 용이하여 재무적 제약을 적게 받는 기업일수록 외부 자금조달이 용이하기 때문에 배당지급을 더 신속하게 조정함으로써 배당스무딩을 더 효과적으로 달성할 수 있다. 그리고 중소기업청이 정책적 목적으로 분류한 혁신형 중소기업(벤처기업, 이노비즈기업, 경영혁신형기업)은 비혁신형 중소기업보다 배당조정속도가 더 빠르다. 중소기업청에서 정책적 목적으로 분류한 혁신형 중소기업은 신용보증지원, 정책자금지원, 조세혜택, 공공입찰 우선권 부여 등과 같은 다양한 정책적 혜택으로 인해 재무적 제약을 적게 받기 때문에 배당지급을 더 신속하게 조정할 수 있다. 결론적으로, 한국거래소의 유가증권시장과 코스닥시장에 상장된 혁신형 중소기업은 비혁신형 중소기업보다 배당조정속도가 더 빠르고, 혁신형 중소기업 중에서도 재무적 비제약 기업은 재무적 제약 기업보다 배당조정 속도가 더 빠르다. 다시 말해, 중소기업 중에서도 R&D 집중도가 높은 혁신형 중소기업은 R&D 투자에 따른 미래의 성장성과 수익성을 담보로 하여 배당스무딩을 신속하게 할 수 있고, 혁신형 중소기업 중에서도 자본시장 접근성이 좋은 기업은 재무적 제약을 적게 받기 때문에 배당스무딩을 더 신속하게 할 수 있다. 따라서 중소기업 경영자는 R&D 집중도를 증가시키고 자본시장 접근성을 높여 재무적 제약을 회피함으로써 신속한 배당스무딩을 통해 장기적으로 안정적인 배당정책을 유지할 수 있다고 생각한다. 그리고 중소기업청이 정책적 목적으로 분류한 혁신형 중소기업(벤처기업, 이노비즈기업, 경영혁신형기업)의 경우에도 배당조정속도가 비혁신형 중소기업보다 더 빠르게 나왔다. 이러한 결과는 배당정책의 측면에서 중소기업청의 혁신형 중소기업 정책을 지지하는 실증적인 증거가 된다.