ZnTe films have been grown on (100) GaAs substrate with two representative problems. The one is lattice mismatch, the other is thermal expansion coefficients mismatch of ZnTe /GaAs. It claims here, the relationship of film thickness and defects distribution with (100) ZnTe/GaAs using hot wall epitaxy (HWE) growth was investigated by transmission electron microscopy (TEM). It analyzed on the two-sort side using TEM with cross-sectional transmission electron microscopy (XTEM) and high-resolution electron microscopy (HREM). Investigation into the nature and behavior of dislocations with dependence-thickness in (100) ZnTe/ (100) GaAs hetero-structures grown by transmission electron microscopy (TEM). This defects range from interface to 0.7 $\mu\textrm{m}$ was high density, due to the large lattice mismatch and thermal expansion coefficients. The defects of low density was range 0.7$\mu\textrm{m}$~1.8$\mu\textrm{m}$. In the thicker range than 1.8$\mu\textrm{m}$ was measured hardly defects.
p형 실리콘 기판위에 100.angs.의 초기 산화막을 성장시킨 후 붕소(B)와 인(P)을 1MeV 이온주입 에너지로 4.dec. tilting하여 붕소의 도즈량은 1*10/녀ㅔ 13/[cm/sup -2/]까지, 인은 1*10/sup 13/[cm/sup -2]로부터 1*10/sup 14/[cm/sup -2/] 까지 변화시키며 이온 주입하였다. 이온주입 후 RTA 로서 열처리 하였으며, 열처리 시간은 10초에서 40초까지,열처리 온도를 1000.deg.C에서 1100.deg.C까지 변화하였다. 이후 기파낸의 불순물의 프로파일 및 미세 결함의 분포를 분석하기 위하여, SIMS, SRP, XTEM 분석을 실시하였고, 이를 monte-carlo 모ㅓ델로서 시뮬레이션하여 비교하였다. SIMS 분석 결과 열처리 온도와 시간이 증가할수록 접합깊이가 증가하였고, 프로파일이 넓어짐을 볼수 있다. SRP 측정에서 붕소는 주해거리 (Rp)값은 1.8.mu.m~1.9.mu.m, 인의 경우는 1.1.mu.m~1.2.mu.m의 주행거리 (Rp) 값이 나타났다. XTEM 분석결과 붕소의 경우 열처리에 전후에도 결함을 볼수 없었고, 인의 경우 열처리 이후에 실리콘 결정내부에 있던 산소(O)와 인(P)우너자의 pinning효과에 의해 전위다이폴을 형성하여 표면근처로 성장함을 볼수 있었다.
Ar ions were implanted at 1 MeV into (100)Cz Si wafers with dose of 1 * 10$^{15}$ ions/cm$^{2}$. Damage induced by high energy implantation and its annealing behavior during rapid thermal annealing for 10sec at temperatures from 550 to 1100${\circ}C$ were investigated by crosssection transmission electron microscopy study. It can be clearly seen from the observation that the SPE(Solid Phase Epitaxy) regrowth of the buried amorphous layer induced by ion implantation proceeds from both upper and lower amorphous/crystalline (a/c) interfaces, and the activation energy for SPE from interfaces were both 1.43eV. Misfit dislocation where two interfaces met was formed and it coalesced into the hair pin dislocation in the upper regrown region. At the higher temperature after annealing out of the misfit dislocation, hair pin dislocations showed considerable drop in its bandwidth. However, they were not disappeared even at the temperature 1100${\circ}C$ with the end of range dislocation loops which were formed at the original lower a/c interface.
한국세라믹학회 1986년도 Priceedings Of The Third Korea-Japan Seminar On New Ceramics
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pp.287-304
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1986
High quality monocrystalline $\beta$-SiC thin films were grown via two-step process of conversion of the Si(100) surface by reaction with $C_2H_4$ and the subsequent chemical vapor deposition (CVD) at $1360^{\circ}C$ and 1 atm total pressure. Four dopants, B and Al and p-type, and N and P for n-type, were also incorporated into monocrystalline $\beta$-SiC thin films during the CVD growth process. IR and Raman spectroscopies were used to evaluate the quality of the undoped $\beta$-SiC thin films and to investigate the effects of dopants on the structure of the doped $\beta$-SiC thin films. The changes in the shape of IR and Raman spectra of the doped thin films due to dopants were observed. But the XTEM micrographs except for the B-doped and annealed films showed the same density and distribution of stacking faults and dislocations as was seen in the undoped samples, The IR and Raman spectra of the B-doped and annealed films showed the broad and weak bands and one extra peak at the 850 $cm^{-1}$ respectively. The SAD pattern and XTEM micrograph of the B-doped and annealed film provided the evidence for twinning.
Kim, K.J.;Kim, K.S.;Jang, Y.C.;Lee, N.-E.;Choi, J.;Jung, D.
한국표면공학회지
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제34권5호
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pp.475-480
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2001
Diffusion of Cu into the low-k para-xylene based plasma polymer (pXPP) thin films deposited by plasma-enhanced chemical vapor deposition using the para-xylene precursor was comparatively measured using various methods. Cu layer was deposited on the surfaces of pXPPs treated by $N_2$ plasma generated in a magnetically enhanced inductively coupled plasma reactor. Diffusion characteristics of Cu into pXPPs were measured using Rutherford backscattering spectroscopy (RBS), secondary ion mass spectroscopy (SIMS), cross-sectional transmission electron microscopy (XTEM), and current-voltage (I-V) measurements for the vacuum-annealed Cu/pXPPs for 1 hour at $450^{\circ}C$ and were compared. The results showed a correlation between the I-V measurement and SIMS data are correlated and have a sensitivity enough to evaluate the dielectric properties but the RBS or XTEM measurements are not sufficient to conclude the electrical properties of low-k dielectrics with Cu in the film bulk. The additional results indicate that the pXPP layers are quite resistant to Cu diffusion at the annealing temperature of $450^{\circ}C$ compared to the other previously reported organic low-k materials.
인(Phosphorus)을 1MeV로 이온 주입한 후 RTA를 실시하여 미세결함의 특성을 조사하고, 면저항, SRP, SIMS, XTEM 분석과 CMOS 구조에서 래치업 특성을 모의 실험하였다. 도즈량이 증가할수록 면저항은 낮아지고, Rp값은 도즈량이 $1{\times}10^{13}/cm^2,\;5{\times}10^{13}/cm^2,\;1{\times}10^{14}/cm^2$일때 각각 $1.15{\mu}m,\;1.15{\mu},\;1.10{\mu}m$로 나타났다. SIMS 측정결과는 열처리 시간이 길수록 농도의 최대치가 표면으로부터 깊어지고, 농도 또한 낮아짐을 확인하였다. XTEM 분석 결과는 열처리 전에는 결함측정이 불가능했으나, 측정되지 많은 미세결함이 열처리 후 이차결함으로 성장한 것으로 조사되었다. 모의 실험은 buried layer와 connecting layer 구조를 사용하였으며, buried layer보다 connecting layer가 래치업 특성이 우수함을 확인하였다. Connecting layer의 도즈량이 $1{\times}10^{14}/cm^2$이고 이온주입 에너지가 500KeV일 때 trigger current는 $0.6mA/{\mu}m$이상이었고, trigger voltage는 약 6V로 나타났다. Connecting layer의 이온주입 에너지가 낮을수록 래치업 저감효과가 더욱 우수함을 알 수 있었다.
Tungsten silicide films were deposited on the highly phosphorus-doped poly Si/SiO2/Si substrates by Low Pressure Chemical Vapor Deposition. They were heat treated in different conditions. XTEM, SIMS and high frequency C-V analysis were conducted for characterization. It can be concluded that outdiffusion of phosphours impurity throught the silicide films lead to its depletion in the poly-Si gate region near the gate oxide, resulting in loss of capacitance and increase of effective gate oxide thickness.
N-도핑된 3C-SiC (N-SiC(3C))을 화학기상증착(CVD)으로 $1250^{\circ}C$에서 Si(111) 기판 위에 tetramethylsilane(TMS)를 열분해하여 성장하였다. 수송가스는 $H_{2}$이었고, N-SiC(3C) 에피층은 CVD로 성장되는 동안 $NH_{3}$에 의하여 n-형으로 도핑되었다. N-SiC(3C)의 물리적 특성은 적외선 분광(FTIR), X-선 회절(XRD), 라만 스펙트럼(Raman spectrum), 단면 투과전자영상(XTEM), Hall 측정 및 p/n 다이오드의 전압-진압(I-V) 특성에 의하여 조사되었다. N-도핑된 SiC(3C) 에피층의 전도형은 n-형이었고, 전도형은 $NH_{3}$를 사용한 N-dopant에 의하여 저온에서 잘 조절될 수 있다.
Gate oxide 의 두께 감소는 gate의 캐패시턴스를 증가시켜 트랜지스터의 속도를 빠르게 하며, 동시에 저전압 동작을 가능하게 하기 때문에 gate oxide 두께는 MOS 공정 세대가 진행되어감에 따라 계속 감소할 것이다. 이러한 얇은 산화막은 device design에 명시된 두께의 특성을 나타내야 한다. Gate oxide의 두께가 작아질수록 gate oxide와 crystalline silicon간의 계면효과가 박막의 두께의 결정에 심각한 영향을 주기 때문에 정확한 두께 계측이 어렵다. 이러한 영향과 계측방법에 따라서 두께 계측의 차이가 나타난다. XTEM은 사용한 parameter에, Ellipsometer는 refractive index에, MEIS(Medium) Energy Ion Scattering)은 에너지 분해능에, Capacitor-Voltage 측정은 depletion effect에 의해 영향을 받는다. 우리는 계면의 원자분해능 분석에 통상 사용되어온 High Resolution TEM을 이용하여 약 30~70$\AA$ SiO2층의 두께와 계면 구조에 대한 분석을 하여 이를 MEIS와 0.015nm의 고감도를 가진 SE(Spectroscopy Ellipsometer), C-V 측정 결과와 비교하여 가장 좋은 두께 계측 방법을 찾고자 한다.
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[게시일 2004년 10월 1일]
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