• 전력전자학회:학술대회논문집
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• 전력전자학회 2010년도 하계학술대회 논문집
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• pp.349-350
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• 2010

본 논문에서는 부스트 컨버터와 플라이백 컨버터가 통합된 단일(Single Stage) 역률 보상 회로의 2차측에 Voltage Doubler를 적용한 새로운 역률 보상회로를 제안한다. 제안하는 회로는 불연속 모드(DCM-DCM)로 동작하며, 스위치 전압 및 전류 스트레스를 저감하고 2차측 다이오드의 전압 스트레스를 저감시키는 특징이 있다. 120 V LED 구동 드라이버 사양의 실험을 통해 제안한 회로의 동작을 검증한다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2010년도 하계학술대회 논문집
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• pp.142-143
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• 2010

An active-clamped current-fed half-bridge converter for the high step-up application is proposed in this paper. The proposed converter is composed of active clamping snubber circuits and a voltage doubler rectifier. The operational principle, theoretical analysis, and design considerations are presented. To confirm the operation, features, and validity of the proposed circuit, the experimental result for a 200W, 24V input and 400V output prototype are presented.

• Journal of Electrical Engineering and Technology
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• 제2권1호
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• pp.81-88
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• 2007

This paper proposes a coupled inductor-based rectifier of a Three-Level (TL) DC/DC converter and compares the rectification methods of a TL converter. The CICDR- TL (Coupled Inductor Current Doubler Rectifier Three-Level) converter achieves ZVS (Zero Voltage Switching) for the switches in a wide load range. CDR (Current Doubler Rectifier) and CICDR Three-Level converter have low voltage and current ripple. Advantages and disadvantages of topology compared to the rectifier of bridge, center-tap, CDR, and CICDR are discussed. Experimental estimation results are obtained on a 27V, 60A DC/DC TL converter prototype for the 1.8kW, 40kHz IGBT based experimental circuit.

• 전력전자학회논문지
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• 제11권1호
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• pp.14-21
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• 2006

본 논문에서는 출력 전압의 리플을 이용하여 지상 레그(lagging leg)의 스위치들의 영전류 스위칭(ZCS)을 수행하는 두 개의 트랜스포머를 가지는 위상천이 풀-브릿지 컨버터를 제안하다. 제안된 컨버터는 진상 레그(leading leg)의 스위치들은 영전압 스위칭(ZVS)을 수행하고, 지상 레그의 스위치들은 출력 전압-더블러(Voltage-Doubler)의 전압 리플차를 이용해 출력 다이오드의 전류 전환(commutation)이 빠르게 이루어지도록 하여서 중부하에는 영전류 스위칭을, 경부하에서는 영전압 스위칭을 가능하게 한다. 또한 출력측의 전압 리플차를 이용하기 때문의 기존의 1차측 부스트 캐패시터를 이용하는 컨버터에 비해 턴비를 이용하여 보다 빠른 전류 전환을 수행할 수 있는 장점을 가진다. 따라서 별도의 추가적인 소자없이 모든 스위치의 소프트스위칭이 가능하도록 하고, 지상 레그의 영전류 스위칭을 통해서 환류구간의 순환전류도 없애줌으로써 높은 효율을 얻을 수 있다. 모드 해석과 실험을 통하여 제안 컨버터의 성능을 검증한다.

• 한국전자파학회논문지
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• 제19권7호
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• pp.771-777
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• 2008

본 논문에서는 변형된 시간 지연 기법을 이용한 마이크로파 2차 주파수 체배기가 제안되었다. 제안된 주파수 체배기에서는 입력 신호와 지연된 신호 사이에 발생하는 군지연 시간 부정합을 전압 제어 지연 선로(VCDL)를 이용하여 보상하였다. 가변 슈미트 트리거를 이용한 군지연 시간 정합과 신호 파형의 성형(waveform shaping)으로 인해 원하지 않는 기본 주파수($f_0$)와 3, 4차 고조파 성분들이 충분히 제거할 수 있었다. 결과적으로 출력 단자에서는 오직 2 체배된 주파수 성분($2f_0$)만이 우세하게 나타난다 제안된 주파수 체배기는 1.15 GHz의 기본 주파수에서 설계되었고 TSMC 0.18 $\mu m$ 공정을 이용하여 제작되었다. 입력 신호 전력을 0 dBm 인가하였을 때, 2차 체배된 출력 주파수 성분의 측정된 전력은 2.57 dBm이었다. 2차 체배된 주파수 성분에 대해 $f_0,\;3f_0$, 그리고 $4f_0$ 성분의 제거율은 각각 43.65, 38.65, 그리고 35.59 dB이다.

• 대한전자공학회논문지TC
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• 제41권10호
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• pp.109-117
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• 2004

본 논문에서는 VCDRO, GaAs MESFET, 반사기 등을 이용하여 주파수 체배기 형테로 구성한 K-대역 국부발진기를 설계하고 제작하여 특성을 실험하였다. VCDRO은 위상잡음특성을 개선하기 위하여 저잡음 특성을 가지며 플리커 잡음이 적은 MESFET를 선택하였으며 Q값이 큰 유전체 공진기를 사용하여 선택도를 높였다. 특히, 제안된 주파수 체배기는 반사기와 대역저지필터를 사용함으로써, 일반적인 체배기에 비해 회로의 크기를 줄이고, 고조파 억압특성을 개선했을 뿐만 아니라 더 좋은 변환이득을 얻었다. 제작된 VCDRO의 특성을 측정한 결과, 중심 주파수 12.05 Uh에서 5.8 dRm의 출력 전력과 -37.98 dBc의 고조파 억압, 100 Khz offest 주파수에서 -114 dBc의 위상잡음 특성을 얻을 수 있었으며, 주파수 체배기의 특성을 측정한 결과, 5.8 dBm의 입력신호에 대해 출력 주파수인 24.10 GHz에서 출력 전력은 1.755 dBm이고, 변환이득은 1.482 dB, 고조파 억압은 -33.09 dBc, 100 kHz offset 주파수에서 -98.23dBc의 위상잡음 특성을 얻었다. 주파수 체배 기법을 이용하여 제작된 발진기는 K-대역에서 국부발진기로 이용될 수 있음을 확인하였다.

• Journal of Power Electronics
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• 제19권5호
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• pp.1099-1107
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• 2019

A soft switching converter with wide voltage range operation is investigated in this paper. A series resonant converter is implemented to achieve a high circuit efficiency with soft switching characteristics on power switches and rectifier diodes. To improve the weakness of the narrow voltage range in LLC converters, an alternating current (ac) power switch is used on the primary side to select a half-bridge or full-bridge resonant circuit to implement 4:1 voltage range operation. On the secondary-side, another ac power switch is adopted to select a full-wave rectifier or voltage-doubler rectifier to achiever an additional 2:1 output voltage range. Therefore, the proposed resonant converter has the capacity for 8:1 (320V~40V) wide output voltage operation. A single-stage hybrid resonant converter is employed in the study circuit instead of a two-stage dc converter to achiever wide voltage range operation. As a result, the study converter has better converter efficiency. The theoretical analysis and circuit characteristics are verified by experiments with a prototype circuit.

• Journal of Electrical Engineering and Technology
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• 제11권5호
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• pp.1229-1234
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• 2016

• 대한전기학회논문지:전기기기및에너지변환시스템부문B
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• 제51권10호
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• pp.581-586
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• 2002

To improve the current waveform of diode rectifiers, we propose a new operating principle for the voltage-doubler diode rectifiers. In the conventional voltage-doubler rectifier circuit, relatively large capacitors are used to boost the output voltage, while the proposed circuit uses smaller ones and a small reactor not to boost the output voltage but improve the input current waveform. A circuit design method is shown by experimentation and confirmed simulation. The experimental results of the proposed diode rectifier satisfies the harmonic guide lines. A high input power factor of 97(%) and an efficiency of 98[%] are also obtained. The new rectifier with no controlled switches meet the harmonic guide lines, resulting in a simple, reliable and low-cost at-to dc converters in comparison with the boost-type current-improving circuits. This paper proposes a nonlinear impedance circuit composed by diodes and inductors or capacitors. This circuit needs no control circuits and switches, and the impedance value is changed by the polarity of current or voltage. And this paper presents one of these applications to improve the input current of capacitor input diode rectifiers. The rectifier using the nonlinear impedance circuit is constructed with four diodes and four capacitors in addition to the conventional rectifiers, that is, it has eight diodes and five capacitors, including a DC link capacitor. It makes harmonic components of the input current reduction and the power factor improvement. Half pulse-width modulated (HPWM) inverter was explained compared with conventional pulse width modulated(PWM) inverter. Proposed HPWM inverter eliminated dead-time by lowering switching loss and holding over-shooting.

• Journal of Power Electronics
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• 제18권1호
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• pp.34-44
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• 2018

This paper presents a pulse-width adjustment (PWA) strategy for a novel bidirectional DC-DC boost converter to improve the performance of the dynamic inductor current response. This novel converter consists of three main components: a full-bridge converter (FBC), a high-frequency isolated transformer with large leakage inductance, and a three-level voltage-doubler rectifier (VDR). A number of scholars have analyzed the principles, such as the soft-switching performance and high-efficiency characteristic, of this converter based on pulse-width modulation plus phase-shift (PPS) control. It turns out that this converter is suitable for energy storage applications and exhibits good performance. However, the dynamic inductor current response processes of control variable adjustment is not analyzed in this converter. In fact, dc component may occur in the inductor current during its dynamic response process, which can influence the stability and reliability of the converter system. The dynamic responses under different operating modes of a conventional feedforward control are discussed in this paper. And a PWA strategy is proposed to enhance the dynamic inductor current response performance of the converter. This paper gives a detailed design and implementation of the PWA strategy. The proposed strategy is verified through a series of simulation and experimental results.