Communications for Statistical Applications and Methods
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제21권2호
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pp.115-124
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2014
In this paper we derive a Berry-Esseen type bound for the kernel density estimator of a random left truncated model, in which each datum (Y) is randomly left truncated and is sampled if $Y{\geq}T$, where T is the truncation random variable with an unknown distribution. This unknown distribution is estimated with the Lynden-Bell estimator. In particular the normal approximation rate, by choice of the bandwidth, is shown to be close to $n^{-1/6}$ modulo logarithmic term. We have also investigated this normal approximation rate via a simulation study.
2007년8월 v2.0을 출간하면서 표준화가 완료된 Ultra Mobile Broadband(UMB) 기술은 진보된 안테나 기술과 함께, CDMA, TDM, Layer-superposed OFDM(LS-OFDM), OFDM, OFDMA의 장점들을 하나의 Air Interface로 통합하였으며, 효율적인 자원 관리 기법을 통해 더 많은 VoIP 사용자들을 수용할 수 있게 해준다. 4x4 안테나를 사용시 20MHz의 주파수 대역에 순방향 288 Mbps, 역방향 75 Mbps의 최대 전송률을 제공하며, 양방향에 대한 평균 Network 지연시간은 약 16.8 ms을 지원하고, 10 MHz 주파수 대역에 1000명 이상의 VoIP 사용자를 지원할 수 있다. 본 고에서는 UMB의 표준화 과정 및 현황 그리고 물리 계층과 MAC 계층의 요소 기술들에 대해 고찰한다.
We generalize bi-orthogonal (non-orthogona) MRA to frame MRA in which the family of integer translates of a scaling func-tion forms a frame for the initial ladder space V0. We investigate the internal structure of frame MRA and establish the existence of a dual scaling function, and show that, unlike bi-orthogonal MRA, there ex-ists a frame MRA that has no (frame) 'wavelet'. Then we prove the existence of a dual wavelet under the assumption of the existence of a wavelet and present easy sufficient conditions for the existence of a wavelet. Finally we give a new proof of an equivalent condition for the translates of a function in L2(R) to be a frame of its closed linear span.
The purpose of this paper is to improve certain results proved in a recent paper of Soliman et al. [20]. These results are the outcome of utilizing the idea of absorbing pairs due to Gopal et al. [6] as opposed to two conditions namely: weak compatibility and the peculiar condition initiated by Pant [15] to ascertain the common fixed points of Lipschitzian mappings. Some illustrative examples are also furnished to highlight the realized improvements.
본 논문에서는 단거리 무선 통신의 새로운 국제 표준으로 부상하고 있는 2.4 GHz ZigBee 응용을 위한 저전력 CMOS LNA(Low Noise Amplifier)를 설계하였다. 제안한 구조는 전류 재사용 기법을 이용한 2단 cascade구조이며 회로의 설계에서 TSMC $0.18{\mu}m$ CMOS 공정을 사용하였다. 전류 재사용단은 두 단의 증폭기 전류를 공유함으로써 LNA의 전력 소모를 적게 하는 효과를 얻을 수 있다. 본 논문에서는 LNA설계 과정을 소개하고 ADS(Advanced Design System)를 이용한 모의실험 결과를 제시하여 검증하였다. 모의실험 결과, 1.0V의 전압이 인가될 때 1.38mW의 매우 낮은 전력 소모를 확인하였으며 이는 지금까지 발표된 LNA 중 가장 낮은 값이다. 또한 13.83dB의 최대 이득, -20.37dB의 입력 반사 손실, -22.48dB의 출력 반사 손실 그리 고 1.13dB의 최소 잡음 지수를 보였다.
현재 Wi-Fi Alliance에서 발표한 Wi-Fi Direct 표준 기술(Wi-Fi Peer-to-Peer Technical Specifications v1.2, 2010)은 둘 이상의 장치로부터 Wi-Fi 직접 통신을 허용하기 위하여 정의된 기술로서, 최근 출시되는 스마트폰과 TV 등의 여러 장치에서 이 기술을 제공하고 있다. 본 기술에서 Coordinator 역할을 수행하는 GO(Group Owner)는 제 3의 장치로 부터 접속을 허용할 수 있기 때문에 상대적으로 높은 에너지 자원과 연산 능력이 요구되지만, 현재 표준 기술에서는 GO 역할 결정에 대한 환경적 요소를 고려하지 않으며, 따라서 각 장치 간 에너지 분산 측면의 효율성이 제한적이다. 본 고는 Wi-Fi Direct를 구성하는 각 장치의 물리적 파라미터와 사용자 환경에 의존적인 역할 기반의 파라미터를 도출하고 이를 통하여 GO 역할을 효율적으로 결정할 수 있도록 DIVA 방식을 새롭게 제안하며 실험을 통하여 효과를 나타내었다.
본 논문에서는 무선통신시스템의 수신단에 적용될 수 있는 6비트 100MHz 플래쉬 A/D 변환기를 설계하였다. 제안하는 플래쉬 A/D 변환기는 해상도가 1비트씩 증가함에 따라 2배수로 증가하는 S-R 래치 회로를 단순화하여 집적화 하였다. 기존 NAND 기반의 S-R 래치 회로에 사용되던 8개의 MOS 트랜지스터 숫자를 6개로 줄였으며, 비교단의 동적 소비전력을 최대 12.5%까지 감소되도록 설계하였다. 설계된 A/D 변환기는 $0.18{\mu}m$ CMOS n-well 1-poly 6-metal 공정을 사용하여 제작되었고, 전원 전압 1.8V, 샘플링 주파수 100MHz에서의 전력소모는 282mW이다. 입력 주파수 1.6MHz, 30MHz에서의 SFDR은 각각 35.027dBc, 31.253dBc이며, 4.8비트, 4.2비트의 ENOB를 나타내었다.
본 논문에서는 포락선추적 기능을 갖는 WCDMA 기지국에 사용될 수 있는 GaN FET를 이용한 전력증폭기 모듈을 설계하고, 제작 및 측정결과를 제시하였다. 개발된 전력증폭기 모듈은 소신호 RF 신호를 입력받아 고이득 MMIC 증폭기, 구동 증폭기 및 전력 증폭기 등을 거쳐 10W 이상의 출력을 생성할 수 있다. 또한, Envelope Tracking 응용을 위해서 최종 전력증폭기의 Drain 전압이 가변되어도 전체 모듈이 안정적으로 동작할 수 있도록 발진방지회로, Isolator, 음전압 우선인가 바이어스 회로가 설계되었다. 모든 바이어스 회로와 RF회로를 $17.8{\times}9.8{\times}2.0\;cm3$ 크기의 하우징 안에 집적화하여 소형화시켰다. 측정결과 바이어스 전압이 4V에서 28V까지 가변할 경우 30dBm에서 40dBm까지 출력이 가변되면서도 35%이상의 일정한 효율 특성을 나타내어 포락선 추적 기능을 수행할 수 있음을 확인하였다.
본 논문에서는 RSA 암호화 알고리즘을 지원하기 위한 암호화 프로세서의 구조를 제안한다. 본 논문의 RSA 암호화 프로세서는 빅 몽고메리 알고리즘(FIOS)을 기반으로 제안되였으며, 다양한 비트 길이(128∼2048 비트)를 지원한다. RSA 암호화 프로세서의 구조는 RSA 제어 신호 발생기, 빅 몽고메리 프로세서(가산기, 승산기)의 모듈로 구성된다. 빅 몽고메리 프로세서의 가산기와 승산기는 다양한 알고리즘을 이용하여 구현하였다. 내장형 시스템에 적합하게 설계하기 위하여 여러 가지 연산기를 합성한 결과 중에서 ARM 코프로세서와 연동할 수 있는 동작주파수를 갖는 연산기 중에서 가장 작은 연산기를 선택하였다. RSA 암호화 프로세서는 Verilog-HDL을 이용하여 하향식 설계 방법으로 구현되었으며, C언어와 Cadence의 Verilog-XL을 이용하여 검증하였다. 검증된 모델은 하이닉스 0.25$\mu\textrm{m}$ CMOS standard cell 라이브러리를 이용하여 합성되었으며, 2.3V, 10$0^{\circ}C$ 최악 조건에서 동작한다. 본 논문에서 제안한 RSA 암호화 프로세서는 약 51MHz의 주파수에서 동작하며, 게이트 수는 nand2 게이트 기준으로 36,639 gates의 면적을 가진다.
염료감응형 태양전지는 기존 실리콘 태양전지에 비하여 가격 경쟁력이 우수하고 안정성이 뛰어나다는 장점으로 인하여 다양한 연구가 진행되고 있으며, 특히 국내/외 여러 그룹에서 백금 대체 전극에 대한 연구가 많이 수행되고 있다. 따라서 본 연구에서는 저가형 고효율 염료감응형 태양전지의 구현을 위하여 상대전극의 대표적 물질인 백금을 대체하는 물질로서 그래핀을 선정하여 저가형 상대 전극 소재 개발하고 특성을 개량코자 하였다. 그래핀 전극의 특성을 평가하기 위하여 FTO 기판상에 그래핀 전극과 백금 전극을 각각 제작하여 AFM 및 J-V 특성을 평가하였다. 그래핀 0.1 wt%의 경우 전류밀도 11.68 mA/cm2, 최대효율 4.34% 등 백금 상대전극에 유사한 특성을 나타냄으로서 합성조건 등을 개선하는 경우, 백금 상대전극에 우수한 특성을 나타낼 수 있는 가능성을 확인하였다.
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[게시일 2004년 10월 1일]
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