A scratch tester was developed to evaluate the adhesive strength at interface between thin film and substrate(silicon wafer). Under force control, the scratch tester can measure the normal and the horizontal forces simultaneously as the probe tip of the equipment approaches to the interface between thin film and substrate of wafer. The capacity of each component of force sensor is 0.1 N ∼ 100 N. In addition, the tester can detect the signal of elastic wave from AE sensor(frequency range of 900 kHz) attached to the probe tip and evaluate the bonding strength of interface. Using the developed scratch tester. the feasibility test was performed to evaluate the adhesive strength of semiconductor wafer.
Nano adhesion and friction between a Sj$_3$N$_4$ AFM tip and thin silver films were experimentally studied. Tests were performed to measure the nano adhesion and friction in both AFM(atomic force microscope) and LFM(lateral force microscope) modes in various ranges of normal load. Thin silver films deposited by IBAD (ion beam assisted deposition) on Si-wafer (100) and Si-wafer of different surface roughness were used. Results showed that nano adhesion and friction decreased as the surface roughness increased. When the Si surfaces were coated by pure silver, the adhesion and friction decreased. But the adhesion and friction were not affected by the thickness of IBAD silver coating. As the normal force increased, the adhesion forces of bare Si-wafer and IBAD silver coating film remained constant, but the friction forces increased linearly. Test results suggested that the friction was mainly governed by the adhesion as long as the normal load was low.
We studied the dielectric characteristics of low-k SiOCH thin films by Ellipsometry. The SiOCH thin films were prepared by deposition of BTMSM precursors on p-Si wafer by CCP-PECVD method. The nano-porous structural organic/inorganic hybrid-type of SiOCH thin films correlated directly to the formation of low dielectrics close to pore(k=1). The structural groups including highly dense pores in SiOCH thin films originated the anisotropic geometry type of network structure directing to complex refractive characteristics of SiOCH single layer on the p-Si wafer. The linearly polarized beam of Xe-ramp in the range from 190 nm to 2100 nm introduced to the surface of SiOCH thin film, and the reflected beam was Elliptically polarized by complex refractive coefficients of SiOCH dipole groups. The amplitude variation $\Psi$ and phase variation $\Delta$ of the relative reflective coefficients between perpendicular and parallel components to the incident plane were measured by Ellipsometry. The complex optical constants n and k as well as the dielectric constant and thickness of SiOCH thin films were driven by the measured value of $\Psi$ and $\Delta$.
Recently, the minimum line width shows a tendency to decrease and the multi-level increase in semiconductor. Therefore, a planarization technique is needed and chemical mechanical polishing(CMP) is considered as one of the most suitable process. CMP accomplishes a high polishing performance and a global planarization of high quality. But there are several defects in CMP such as micro-scratches, abrasive contaminations, and non-uniformity of polished wafer edges. Wet etching include of Spin-etching can improve he defects of CMP. It uses abrasive-free chemical solution instead of slurry. On this study, ILD(INterlayer-Dielectric) was removed by CMP and wet-etching methods in order to investigate the superiority of wet etching mechanism. In the thin film wafer, the results were evaluated at a viewpoint of material removal rate(MRR) and within wafer non-uniformity(WIWNU). And pattern step height was also compared for planarization characteristics of the patterned wafer.
Transactions on Electrical and Electronic Materials
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제15권4호
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pp.207-212
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2014
Aluminum-doped zinc oxide (AZO) films were deposited on SiOC/Si wafer by an RF-magnetron sputtering system, by varying the deposition parameters of radio frequency power from 50 to 200 W. To assess the correlation of the optical properties between the substrate and AZO thin film, photoluminescence was measured, and the origin of deep level emission of AZO thin films grown on SiOC/Si wafer was studied. AZO formed on SiOC/Si substrates exhibited ultraviolet emission due to exciton recombination, and the visible emission was associated with intrinsic and extrinsic defects. For the AZO thin film deposited on SiOC at low RF-power, the deep level emission near the UV region is attributed to an increase of the variations of defects related to the AZO and SiOC layers. The applied RF-power influenced an energy gap of localized trap state produced from the defects, and the gap increased at low RF power due to the formation of new defects across the AZO layer caused by lattice mismatch of the AZO and SiOC films. The optical properties of AZO films on amorphous SiOC compared with those of AZO film on Si were considerably improved by reducing the roughness of the surface with low surface ionization energy, and by solving the problem of structural mismatch with the AZO film and Si wafer.
Multi-wafer planetary type chemical vapor deposition reactors are widely used in thin film growth and suitable for large scale production because of the high degree of growth rate uniformity and process reproducibility. In this study, a two-dimensional model for estimating the effect of the gap between satellite and wafer on the wafer surface temperature distribution is developed and analyzed using computational fluid dynamics technique. The simulation results are compared with the results obtained from an analytical method. The simulation results show that a drop in the temperature is noticed in the center of the wafer, the temperature difference between the center and wafer edges is about $5{\sim}7^{\circ}C$ for all different ranges of the gap, and the temperature of the wafer surface decreases when the size of the gap increases. The simulation results show a good agreement with the analytical ones which is based on one-dimensional heat conduction model.
초음파분무를 이용한 MOCVD법으로 강유전체 $PbTiO_3$박막을 Si(100) wafer와 ITO-coated glass위에 제조하였다 Si 기판 위에 증착된 박막으로부터, 출발원료의 농도비(Ti/Pb)가 1.2일 때, 단일 perovskite 상을 얻을 수 있었다. ITO-coated glass 위에 증착된 박막은 Si기판 위에 제조된 박막보다 박막의 성장속도가 더 빠르며, 기판온도를 $530^{\circ}C$부터 $570^{\circ}C$까지 증가시켰을 때, 결절성과 입자 크기의 증가에 의해 유전상수는 증가하였다. $570^{\circ}C$에서의 유전상수 및 유전손실 값은 각각 205, 0.016을 나타내었다. 기판온도가 $600^{\circ}C$ 이상인 경우, 유전상수가 감소되는 경향을 보였다.
Many studies in crystalline silicon solar cell fabrication have been focused on high efficiency and low cost. In this paper, we carried out the doping procedure by varying the silicon wafer thicknesses and sheet resistance. The silicon wafers with various thicknesses were obtained by shiny etching and texturing. The thicknesses of wafers were 100, 120, 150, and $180{\mu}m$. The emitter layer formed by $POCl_3$ doping process had sheet resistance with 40 and $80{\Omega}/sq$ for selective emitter application. This experiment indicated wafer thickness did not influence sheet resistance but lifetime was strongly effected.
n-type crystalline silicon wafers were passivated with intrinsic a-Si:H thin films on both sides using HWCVD. Minority carrier lifetime measurement was used to verify interface passivation properties between a-Si:H thin film and crystalline Si wafer. Thin film interface characteristics were investigated depending on $H_2/SiH_4$ ratio and hot wire deposition temperature. Vacuum annealing were processed after deposition a-Si:H thin films on both sides to investigate thermal effects from post process steps. We noticed the effect of interface passivation properties according to $H_2/SiH_4$ ratio and hot wire deposition temperature, and we had maximum point of minority carrier lifetime at H2/SiH4 10 ratio and $1600^{\circ}C$ wire temperature.
Ferroelectric BaTiO3 thin film was produced using BaTi-ethoxide sol. This sol was prepared from BaTi-ethoxide by a partial hydrolysis with ammonia as a basic catalyst and ethylene glycol as a chelating agent. BaTiO3 thin film was prepared from three continuous spin-coating layers of the sol on bare Si(100) wafer at 2500 rpm followed by pyrolysis at $700^{\circ}C$ for 30 min. After the heat treatment, the film was 0.200$\pm$0.010 ${\mu}{\textrm}{m}$ thick and its grain size was 0.059 ${\mu}{\textrm}{m}$. On the other hand, electrical properties were measured for BaTiO3 thin film separately prepared on Au-deposited silicon wafer. The dielectric constant and loss of the BaTiO3 thin film at room temperature was 150~160 and 0.04 respectively, which was measured at 10 kHz and oscillation level of 0.1 V. In the measurements of the dielectric properties at high temperatures, it was observed that the capacitance of the thin film increases steeply, while the dielectric loss reaches maximum around 1$25^{\circ}C$, which corresponds a phase transition from tetragonal to cubic BaTiO3.
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[게시일 2004년 10월 1일]
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