This letter reports the fabrication of polycrystalline silicon thin-film transistors (poly-Si TFT) on flexible plastic substrates using amorphous silicon (a-Si) precursor films by sputter deposition. The a-Si films were deposited with mixture gas of argon and helium to minimize the argon incorporation into the film. The precursor films were then laser crystallized using XeCl excimer laser irradiation and a four-mask-processed poly-Si TFTs were fabricated with fully self-aligned top gate structure.
AThe effect of localized surface plasmon on silicon substrates was studied using silver nanoparticles. The nanoparticles were formed by self-arrangement through the surface energy using rapid thermal annealing (RTA) technique after the thin nanolayer of silver was deposited by thermal evaporation. By the theoretical calculation based on Mie scattering and dielectric function of air, indium tin oxide (ITO), and silver, the strong peak of scattering cross section of silver nanoparticles was found at 358 nm for air, and 460 nm for ITO, respectively. Accordingly, the strong suppression of reflectance under the condition of induced light of $30^{\circ}$ occurred at the specific wavelength which is almost in accordance with peak of scattering cross section. When the external quantum efficiency was measured using silicon solar cells with silver nanoparticles, there was small enhancement peak near the 460 nm wavelength in which the light was resonated between silver nanoparticles and ITO.
Amorphous silicon thin-film transistors (a-Si TFTs) were incorporated into Mo-tip-based triode-type field emitters and diode-type ones of carbon nanotubes for an active-matrix cathode (AMC) plate of field emission displays. Also, we developed a novel surface-treatment process for the Mo-tip fabrication, which gleatly enhanced in the stability of field emission. The field emission currents of AMC plates on glass substrate were well controlled by the gate bias of a-Si TFTs. Active-matrix field emission displays (AMFEDs) with these AMC plates were demonstrated in a vacuum chamber, showing low-voltage matrix addressing, good stability and reliability of field emission, and highly uniform light emissions from the anode plate with phosphors. The optimum design of AMFEDs including a-Si TFTs and a new light shield/focusing grid is discussed.
Thickness optimization of heavily doped p-type seeding layer was studied to improve performance of thin film silicon solar cell. We used liquid phase epitaxy (LPE) to grow active layer of $25{\mu}m$ thickness on $p^+$ seeding layer. The cells with $p^+$ seeding layer of $10{\mu}m\;to\;50{\mu}m$ thickness were fabricated. The highest efficiency of a cell is 12.95%, with $V_{oc}=633mV,\;J_{sc}=26.5mA/cm^2$, FF = 77.15%. The $p^+$ seeding layer of the cell is $20{\mu}m$ thick. As thicker seeding layer than $20{\mu}m$, the performance of the cell was degraded. The results demonstrate that the part of the recombination current is due to the heavily doped seeding layer. Thickness of heavily doped p-type seeding layer was optimized to $20{\mu}m$. The performance of solar cell is expected to improve with the incorporation of light trapping as texturing and AR coating.
Graphite has excellent mechanical and physical properties. It is known to advanced materials and is used to materials for molds, thermal treatment of furnace, sinter of diamond and cemented carbide tool etc. SiC materials are coated on the surface and holes of graphite to protect particles emitted from porous graphite with 5%~20% porosity and make graphite hard surface. SiC materials have high durability and thermal stability. Thermal CVD method is widely used to manufacture SiC thin films but high cost of machine investment and production are required. SiC thin films manufactured by Si reaction liquid and vapore with carbon are effective because of low cost of machine and production. SiC thin films made by vapor silicon infiltration into porous graphite can be obtained for shorter time than liquid silicon. Si materials are evaporated to the graphite surface in about $10^{-2}$ torr and high temperature. Si materials are melted in $1410^{\circ}C$. Si vapor is infiltrated into the surface hole of porous graphite and $Si_xC_y$ compound is made. $Si_x$ component is proportional to the Si vapor concentration. Si diffusion coefficient is estimated from quadratic equation obtained by Fick's second law. The steady stae is assumed. Si concentration variation for the depth from graphite surface is fitted to quadratic equation. Diffusion coefficient of Si vapor is estimated at about $10^{-8}cm^2s^{-1}$.
Thickness optimization of heavily doped p-type seeding layer was studied to improve performance of thin film silicon solar cell. We used liquid phase epitaxy (LPE) to grow active layer of $25{\MU}m$ thickness on p+ seeding layer. The cells with p+ seeding layer of $10{\mu}m\;to\;50{\mu}m$ thickness were fabricated. The highest efficiency of a cell is $12.95\%$, with Voc=633mV, $Jsc=26.5mA/cm^2,\;FF=77.15\%$. The $P^+$ seeding layer of the cell is $20{\mu}m$, thick. As thicker seeding layer than $20{\mu}m$, the performance of the cell was degraded. The results demonstrate that the part of the recombination current is due to the heavily doped seeding layer. Thickness of heavily doped p-type seeding layer was optimized to $20{\mu}m$. The performance of solar cell is expected to improve with the incorporation of light trapping as texturing and AR coating.
Electrical properties of multi-channel metal-induced unilaterally precrystallized polycrystalline silicon thin-film transistor (MIUP poly-Si TFT) devices and circuits were investigated. Although their structure was integrated into small area, reducing annealing process time for fuller crystallization than that of conventional crystal filtered MIUP poly-Si TFTs, the multi-channel MIUP poly-Si TFTs showed the effect of crystal filtering. The multi-channel MIUP poly-Si TFTs showed a higher carrier mobility of more than 1.5 times that of the conventional MIUP poly-Si TFTs. Moreover, PMOS inverters consisting of the multi-channel MIUP poly-Si TFTs showed high dynamic performance compared with inverters consisting of the conventional MIUP poly-Si TFTs.
Modern thin film deposition processes require high deposition rates, low costs, and high-quality films. Atmospheric pressure plasma-enhanced chemical vapor deposition (AP-PECVD) meets these requirements. AP-PECVD causes little damage on thin film deposition surfaces compared to conventional PECVD. Moreover, a higher deposition rate is expected due to the surface heating effect of atomic hydrogens in AP-PECVD. In this study, polycrystalline silicon thin film was deposited at a low temperature of 100℃ and then AP-PECVD experiments were performed with various plasma powers and hydrogen gas flow rates. A deposition rate of 15.2 nm/s was obtained at the VHF power of 400 W. In addition, a metal foam showerhead was employed for uniform gas supply, which provided a significant improvement in the thickness uniformity.
스테인레스 스틸 유연기판 위에 플라즈마 화학기상 증착법 (plasma enhanced chemical vapor deposition)을 이용하여 nip 구조의 미세결정질 실리콘 박막 태양전지 (microcrystalline silicon thin film solar cell)를 제조하고 i ${\mu}c$-Si:H광 흡수층과 p ${\mu}c$-Si:H 사이에 i a-Si:H 버퍼 층을 삽입하여 i/p 계면특성을 개선하고 이에 따른 태양전지 성능특성 변화를 조사하였다. ${\mu}c$-Si:H 박막으로 이루어진 i/p 계면에서의 구조적, 전기적 결함은 태양전지 내에서 생성된 캐리어의 재결합과 shunt resistance 감소를 초래하여 개방전압 (open circuit voltage) 및 곡선 인자 (fill factor)를 감소시키는 것으로 알려졌다. 제조된 미세결정질 실리콘 박막 태양전지는 SUS/Ag/ZnO:Al/n ${\mu}c$-Si:H/i ${\mu}c$-Si:H/p ${\mu}c$-Si:H 구조로 제작되었으며 i/p 계면 사이의 i a-Si;H 버퍼층 두께를 변화시키고 이에 따른 태양전지의 특성을 조사하였다. 태양전지의 구조적, 전기적 특성 변화는 Scanning Electron Microscope (SEM), UV-visible-nIR spectrometry, Photo IV와 Dark IV를 통하여 조사하였다.
We have investigated the hysteresis phenomenon of a hydrogenated amorphous silicon thin film transistor (a-Si:H TFT) and analyzed the effect of hysteresis phenomenon when a-Si:H TFT is a pixel element of active matrix organic light emitting diode (AMOLED). When a-Si:H TFT is addressed to different starting gate voltages, such as 10V and 5V, the measured transfer characteristics with 1uA at $V_{DS}$ = 10V shows that the gate voltage shift of 0.15V is occurred due to the different quantities of trapped charge. When the step gate-voltage in the transfer curve is decreased from 0.5V to 0.05V, the gate-voltage shift is decreased from 0.78V to 0.39V due to the change of charge do-trapping rate. The measured OLED current in the widely used 2-TFT pixel show that a gate-voltage of TFT in the previous frame can influence OLED current in the present frame by 35% due to the change of interface trap density induced by different starting gate voltages.
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[게시일 2004년 10월 1일]
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