• 한국통신학회:학술대회논문집
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• 한국통신학회 1996년도 하계종합학술발표회 논문집(상)
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• pp.28-31
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• 1996

• 콘크리트학회지
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• 제10권5호
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• pp.27-35
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• 1998

• 한국산학기술학회:학술대회논문집
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• 한국산학기술학회 2002년도 춘계학술발표논문집
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• pp.160-162
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• 2002

본 논문은 LCD구동 IC 패키지 제조 분야에서 사용되는 TAB IC블랭킹 금형에 대해 신속하고 합리적인 설계를 수행하기 위하여 금형설계와 관련된 다년간 축적된 경험적지식과 설계지식을 전산정보화하여 지식베이스를 구축하였고, 설계에 필요한 TAP IC 패키지의 형상정보를 제공받기 위하여 표준적인 특징형상 입력모듈을 제안하였다. 또한 지식베이스를 통해 산출된 설계 결과를 3차원 모델러와 연계하여 3차원 형상생성 및 가공도면의 자동화를 실현하여, 기존의 TAB If 블랭킹 금형설계자 뿐만 아니라 신입설계자도 바로 실무에 적용할 수 있는 시스템으로 발전시키고자 한다.

• 한국추진공학회:학술대회논문집
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• 한국추진공학회 2009년도 제33회 추계학술대회논문집
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• pp.19-22
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• 2009

발사체 상단의 자세제어를 목적으로 하는 과산화수소 단일추진제 추력기 설계 및 성능평가를 수행하였다. 상용 발사체급에 요구되는 수준인 100, 250 N 급 추력기를 목표로 하였으며 검증 모델에서 성능시험을 통해 형상을 확정한 후, 최종 비행 모델을 밸브와 통합하여 개발하였다. 설계된 추력기는 특성속도, 추력, 비추력 및 펄스 응답성 측정을 통해 설계의 적절성을 검증하였다.

• 대한전자공학회논문지SD
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• 제41권3호
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• pp.8-8
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• 2004

본 논문에서는 새로운 interpolation-2 방식의 비교기 구조를 제안하여 칩 면적과 전력 소모를 줄이며 오류정정 회로를 내장하는 6-비트 70㎒ ADC를 설계하였다. Interpolation 비교기를 적용하지 않은 flash ADC의 경우 2n개의 저항과 2n -1개의 비교기가 사용되며 이는 저항의 수와 비교기의 수에 비례하여 많은 전력과 큰 면적을 필요로 하고 있다. 또한, interpolation-4 비교기를 적용한 flash ADC는 면적은 작으나 단조도, SNR, INL, DNL 특성이 떨어진다는 단점이 있었다. 본 논문에서 설계한 interpolation-2 방식의 ADC는 저항, 비교기, 앰프, 래치, 오류정정 회로, 온도계코드 디텍터와 인코더로 구성되며, 32개의 저항과 31개의 비교기를 사용하였다. 제안된 회로는 0.18㎛ CMOS 공정으로 제작되어 3.3V에서 40mW의 전력소모로 interpolation 비교기를 적용하지 않은 flash ADC에 비해 50% 개선되었으며, 칩 면적도 20% 감소되었다. 또한 노이즈에 강한 오류정정 회로가 사용되어 interpolation-4 비교기를 적용한 flash ADC 에 비해 SNR이 75% 개선된 결과를 얻었다.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2018년도 추계학술대회
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• pp.193-194
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• 2018

본 논문은 $6kW/L(98W/in^3)$의 전력밀도를 갖는 xEV LDC를 위한 절연형 DC-DC컨버터의 설계 방법을 제안한다. 부피를 가장 많이 차지하는 수동소자의 부피를 줄이기 위해 GaN소자를 적용하여 스위칭 주파수를 700kHz를 적용하였다. 또한 자속 상쇄 개념이 적용된 매트릭스 평면 변압기를 적용하여 변압기의 부피를 크게 줄일 수 있었다. 본 논문에서는 후보 토폴로지들의 비교를 통해 고 전력 밀도에 가장 적합한 토폴로지를 선정하였으며, 자속상쇄 개념 기반의 매트릭스 평면 변압기를 설계방법을 제안하였다.

• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2008년도 춘계종합학술대회 A
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• pp.809-812
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• 2008

통신 시스템에 대한 관심은 인터넷의 급격한 발전에 의해 가상공간의 출현과 유비쿼터스 컴퓨팅 환경 구축에 대한 요구가 증대됨에 따라 관련 이론 및 기술의 발전을 주도해 왔다. 이와 관련하여 가장 근간이 되는 문제들 중 하나는 최적 정보 통신 스패닝 트리 (OCST: Optimal Communication Spanning Tree) 설계 문제이다. 본 논문에서는 이러한 OCST 설계 문제를 네트워크 신뢰도를 고려하여 해결하기 위해 유전 알고리즘 (GA)를 이용한다. 본 논문에서는 유전 알고리즘을 이용함에 있어서 n개의 노드들로 구성된 네트워크 문제에서 n-2개의 숫자열로 표현 가능한 유전자 표현법을 이용하고 신뢰성 있는 OCST 설계 문제 해결을 위한 해법으로서 유전 알고리즘을 제안한다. 임의로 생성된 예제에 대한 수치 실험을 통해 통신시스템의 기본 문제 중 하나인 OCST 설계 문제의 해법으로서의 제안 알고리즘의 유용성과 효율성을 확인한다.

• 한국정보통신학회논문지
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• 제9권3호
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• pp.633-637
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• 2005

본 연구에서 제안한 유한체 나눗셈기는 기존에 존재하는 알고리즘을 개선하여 병렬 처리가 가능하도록 개선하였고, 이를 위하여 n bit look-up table 참조 방식을 도입하여 division당 2m/n cycle의 연산 처리량을 가질 때, n의 증가에 따른 회로 면적의 증가, 동작 주파수의 감소가 적어지게 된다. 이에 따라, 높은 연산 처리량과 적은 회로 면적이라는 두 가지 목표를 모두 달성할 수 있는 나눗셈기의 구현이 가능해졌다. 이를 바탕으로, Reed-Solomon Code와 ECC (Elliptic Curve Cryptography) 암호화 알고리즘 등, 통신의 오류 정정 부호 분야와 암호화 분야에서 자주 응용되는 Galois Field에서의 나눗셈 연산을 수행하는 $GF(2^m)$ 나눗셈기를 VHDL을 이용하여 설계하고 FPGA에 구현하여 기능을 검증하였다. 제안된 나눗셈기는 m=4, n=2의 경우에 대해 설계, 검증을 수행하였다. 회로의 구현은 Altera의 10만 게이트 급 FPGA EP20K30ETC144-1 Chip을 이용하여 77Mhz의 최대 동작 주파수상에서의 동작을 검증하였다.

• 한국통신학회논문지
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• 제31권9A호
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• pp.906-912
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• 2006

본 논문에서는 $5.15{\sim}5.35GHz$ 대역의 무선 LAN용 N-슬롯 마이크로스트립 안테나를 설계 제작하였다. 사각형 패치에 사이즈 감소를 위해 N-슬롯 미앤더 주름구조를 갖도록 하였으며, 접지면과 기판사이에 공기층을 삽입하여 VSWR<2.0에서 적절한 대역을 얻고자 하였다. 설계시 주요 파라미터는 N-슬롯의 길이, 폭, 위치와 공기층의 두께 및 급전위치였으며 최적화된 파라미터를 가지고 실제 제작 및 측정하였다. 제작된 안테나의 측정결과는 다음과 같다. 공진 주파수는 5.25GHz이고, VSWR<2.0에서 약 300MHz의 대역폭과 $1.3{\sim}2.64dBi$의 이득을 얻었다. H-평명과 E-평면에서 각각 $80.21^{\circ}$와 $103.38^{\circ}$로 나타났다.

• 한국항해항만학회지
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• 제34권5호
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• pp.337-342
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• 2010

오늘날과 같이 해상 교통량이 많은 상황에서는 선박의 안전운항을 위해 항로표지의 역할이 더욱 중요해지고 있다. 국제항로표지협회에서는 항로표지 통신시스템의 체계화된 기능 및 서비스기반에 관한 국제표준화를 추진하고 있다. 본 논문에서는 e-NAV에 대비한 항로표지 통합 관리 및 관련정보의 서비스를 위해 항로표지 정보 서비스 통신망을 설계하고 실험한다. AIS 기반의 항로표지 통신망은 외부 정보 수집과 실험을 위해 AIS AtoN과 합성(Synthetic) 및 가상(Virtual)을 포함하여 설계했다. 시스템 내부적으로는 AIS와 WCDMA 등의 무선망을 연동하는 복합구조의 통신망을 구성했다. 육상의 통신을 연계한 항로표지 정보 서비스 통신망을 통해 국제표준에 부합되는 AIS 기반 항로표지 정보를 제공할 수 있다.