MANET은 이동 노드들로만 구성되어 신속하게 네트워크를 구축할 수 있으며, 그 활용 범위가 다양하여 현재까지 많은 인기를 끌고 있다. 하지만 노드들의 잦은 이동으로 인한 동적인 토폴로지와 각 노드들의 제한된 자원 그리고 무선통신이 갖는 보안의 취약성이 MANET이 해결해야 할 큰 문제이다. 본 논문에서는 오버헤드를 줄이면서 정확한 침입탐지를 수행할 수 있는 영역 기반 분산협력 침입탐지 기법을 제안하였다. 제안한 침입탐지 기법에서는 네트워크를 일정한 크기로 분할 한 후 로컬 탐지와 전역 탐지가 수행된다. 로컬 탐지는 노드들의 비정상 행위를 탐지하기 위해 모든 노드에서 수행되고, 전역 탐지는 게이트웨이 노드에서 시그너처 기반 공격 탐지가 이루어지게 된다. 게이트웨이 노드에서 관리되는 시그너처 DB는 이웃 게이트웨이 노드와 허니넷을 구성하여 주기적인 업데이트가 이루어지고, 신뢰 관리 모듈에 의해 영역내의 노드들에 대한 신뢰도를 유지하였다. 제안한 기법의 침입탐지 성능을 확인하기 위하여 다중 계층 클러스터 기법과 비교 실험을 통해 우수한 성능을 확인할 수 있었다.
In contrast to a conventional transformer, the flat transformer is made using a number of small ferrite cores. Two cores for transformer and one core for inductor, which composed one module. Many modules can be connected together to form a flat matrix transformer. This structural arrangement eliminates the single hot spot problem in conventional transformers and permits high current density pertains at high frequency. In this study, the ferrite magnetic cores of Mn-Zn system for the Flat transformer were manufactured and the electrical and magnetic characteristics of its tested. The power loss of sample FO2(Mn-Zn ferrite) sintered at $1350^{\circ}C$ was $350kW/m^3$ in test conditions of 250kHz, 200mT and $100^{\circ}C$, which showed the good power loss property in high frequency. The power loss of FO2 samples has been studied as a function of magnetic flux density and frequency. Steinmetz exponent was 2.82 at 250kHz and 2.73 at 500kHz. These results illustrated the switching of power loss mechanism in ferrite core from hysteresis losses to eddy current losses or others.
본 논문은 $0.18{\mu}m$ 실리콘 CMOS 기술을 이용한 IEEE802.15.4g SUN 체계의 센서노드 무선통신부에 적용할 수 있는 RF 주파수 합성기의 구현에 대하여 기술하였다. 제안한 주파수 합성기는 고속 저잡음 특성을 얻기 위하여 VCO, 프리스케일러, 1/N 분주기, ${\Delta}-{\Sigma}$ 모듈레이터 그리고 PLL 공통 회로 등의 설계 최적화가 이루어졌으며, 특히 VCO는 NP 코어 구조와 13단 캡 뱅크를 각각 적용하여 고속, 저잡음 및 광대역 튜닝 범위를 확보하였다. 제안된 주파수 합성기를 칩으로 제작하여 측정한 결과 출력 주파수 범위는 1483MHz~2017MHz, 위상잡음은 100KHz 오프셋에서는 -98.63dBc/Hz, 1MHz 오프셋에서는 -122.05dBc/Hz로 양호한 특성을 얻을 수 있었다.
로봇은 조립, 도장, 용접 등 단순 반복 작업이나 위험한 지역의 탐사 및 산업현장에서 벗어나 좀더 다양한 분야로 발전되어지고 있다. 최근 로봇의 형태는 인간의 명령을 이행하고 스스로 학습하며, 감정을 지닐 수 있는 인공지능을 내장한 로봇이다. 활용의 예 중에는 '가족 도우미'의 역할을 수행하는 로봇으로 가사, 방범, 오락, 교육 그리고 인공비서 등의 기능을 담당하는 형태로 향후 가정의 필수품으로 자리 잡을 전망이다. 이러한 가정용 로봇의 구현을 위해서 인공지능의 요소를 활용하는 것은 당연하다. 일차적으로 로봇이 여러 가지의 기능을 수행하기 위해서는 환경 정보를 받아들이는 센서의 역할이 크며 이런 센서를 사용조건에 맞게 활용하는 것도 중요하다. 본 논문에서는 로봇에 부착된 여러 개의 센서를 응합하고 융합된 여러 종류의 센서값을 이용하여 로봇이 주변환경에 맞게 행동을 할 수 있도록 소프트 컴퓨팅 기법을 이용하였다. 또한 로봇의 행동모듈을 구성하여 인간에게 시각$.$청각적인 효과를 줄 수 있도록 인간 친화형 지능 로봇을 구현하고자 한다.
초고속 환경에서 대용량 데이터에 대한 안정적 기록 및 효율적인 데이터 접근의 필요성은 갈수록 높아지고 있다. 이와 관련된 기초과학의 한 분야로 방대한 천체 관측 데이터를 생산하는 VLBI(: Very Long Baseline Interferometer)가 있는데 고분해능, 고감도 관측 연구를 수행하기 위해서는 고성능의 데이터 저장 시스템이 요구된다. 하지만 시장에 출시된 대다수 클라우드 기반 스토리지는 일반 IT, 금융, 행정 서비스 지원을 위한 저용량, 복수 스트림의 비정형 데이터에 최적화되어 있기 때문에 빅 스트림 데이터 기록을 위한 최적의 대안이 될 수 없다. 본 논문에서는 이를 극복하기 위한 방안으로 데이터 입출력 처리에 있어 고성능, 동시성에 최적화된 데이터 저장 시스템을 설계하고자 한다. 이를 위해 멀티 코어 CPU 환경에서 libpcap, pf_ring 등의 API 호출을 통해 패킷 입출력 모듈을 구현하였고 외부로부터 유입되는 데이터를 효율적으로 처리할 수 있도록 소프트웨어 RAID(: Redundant Array of Inexpensive Disks) 기반의 확장성 있는 스토리지를 구축하였다.
TPMS(Tire pressure monitoring system)의 의무장착에 대한 법률개정에 따른 개발의 활성화를 토대로, WSN(Wireless Sensor Network)의 '설치하고 잊어버린다'는 기본 명제 하에, 차량수명과 동일한 성능의 배터리 대체용 에너지 하베스터에 대한 연구가 활발히 진행되고 있다. 본 논문은 자동차의 메커니즘적인 측면에서 가장 유용한 회전운동 성분을 이용하여 회전하는 휠과 고정된 브레이크 디스크 사이의 상대운동을 통한 전자기 유도방식 발전을 채택하였다. 휠 측에 구성된 코일과 브레이크 디스크에 매립된 자석의 다양한 배열과 코일 권선수 등을 설계변수로 잡고 직교배열표를 이용하여 최적의 조합을 찾아낸 후 실험을 통해 실제 축전되는 전기 에너지의 양을 측정하여 도출된 특성함수를 바탕으로 본 모듈의 타당성을 검증하였다.
탁주발효의 자동화를 위하여 발효 중 발생하는 기체를 측정할 수 있는 bubble counter와 제어장치를 개발하였다. 동 장치를 활용하여 pilot 규모의 탁주발효에 적용하였다. 탁주발효중 발생하는 기체를 계측하는 bubble counter는 photo-interruptor와 acryl관으로 구성하였으며, 계측되는 기체용적은 기포당 0.018ml였다. 그리고 탁주발효의 제어장치는 single chip microcomputer(MC68705R3)로 제작하였으며, 발효액의 온도를 측정, 제어하기 위하여 온도계측회로를 제작하였고, 냉각수 순환을 결정하는 solenoid valve의 작동으로 온도제어를 하였다. 동 장치를 운영하기 위하여 software를 작성하여 ROM에 구조화하였다. 동 장치로 $CO_2$ 발생량과 속도를 자동적으로 추정한 결과 알코올 농도곡선과 형태가 서로 유사함을 보여주었으며, $30^{\circ}C$ 발효조건에서 24시간때에 최대 발생량을 보였다. 알코올농도와 $CO_2$ 발생량은 뛰어난 상관관계를 보였으며, 이로부터 제어알고리듬을 작성할 수 있었다.
본 논문에서는 W-CDMA 이용한 10 [MHz]의 채널 대역폭을 갖는 다중채널 무선가입자망 단말기용 RF-모듈을 설계 제작하였다. RF-모듈은 송수신전단, 주파수합성기, 변복조기 및 전력제어회로로 구성하였다. 제작한 RF-모듈에 대한 시험결과 송신전력은 250 [mW], 통과대역내의 진폭과 위상왜곡을 측정한 전력의 평탄도는 ${\pm}1.5[dB]$를 얻었다. 또한 송신시 확산신호의 Chip Rate는 8.312 [Mcps]를 얻었고, 주파수합성기에 대한 측정결과는 RF 대역과 변복조를 위한 국부발진신호 주파수는 설계규격을 만족하였다. 수신전계강도특성과 AGC의 동작범위는 모두 60 [dB]로 만족하였고, RF-모듈과 기저대역과의 연동여부를 확인하기 위해 페이저도와 눈패턴을 측정한 결과 좋은 결과를 얻었다.
This paper reviews the current development of an ultra-slim SiP for Radio Frequency (RF) application, in which three flip chips, additional passive components and Surface Acoustic Wave (SAW) filters are integrated side-by-side. A systematic investigation is carried out for the design optimization, process and reliability improvement of the package, which comprises several aspects: a design study based on the 3D thermo-mechanical finite element analysis of the packaging, the determination of stress, warpage distribution, critical failure zones, and the figuration of the effects of material properties, process conditions on the reliability of package. The optimized material sets for manufacturing process were determined which can reduce the number of testing samples from 75 to 2. In addition the molded underfilling (MUF) process is proposed which not only saves one manufacturing process, but also improves the thermo-mechanical performance of the package compared with conventional epoxy underfilling process. In the end, JEDEC's moisture sensitivity test, thermal cycle test and pressure cooker tests have also been carried out for reliability evaluation. The test results show that the optimized ultra-slim SiP has a good reliability performance.
비동기 설계 기법은 시스템 클럭을 사용하지 않고, 동작이 필요한 모듈만 활성화시켜 전력 및 성능면에서 동기식 설계 기법에 비해 높은 성능을 갖는다. 본 논문은 임베디드 컨트롤러인 Intel 80csl과 완전한 명령어 호환성을 갖고, 비동기식 파이프라인 구조로 최적화된 A8051 아키텍쳐를 제안한다. 다양한 어드레싱 모드와 명령어를 제공하는 CISC 명령어 수행 스킴은 동기식 파이프라인 구조에 적합하지 않고 많은 오버헤드를 유발한다. 본 논문에서는 명령어 실행 사이클을 비동기식 파이프라인 수행에 적합하도록 명령어별로 그룹화하고, 동기화 및 다중 실행 사이클로 인한 오버헤드로 발생된 버블을 제거함으로서 최적화하였다. 또한 적합한 분기 처리 기법 및 가변적인 명령어 길이의 처리 방법을 제시함으로서 명령어 수행시 필요한 상태 수를 최소화하고, 명령어 수행의 병렬성을 증가시켰다. 제안된 A8051 아키텍쳐는 Verilog HDL로 설계하여 0.,35㎛ CMOS 공정 표준 셀 라이브러리로 합성하였다. 실험 결과로 A8051은 36㎒ 클럭을 사용하는 인텔 80C51과 다른 비동기 80C51에 비해 약 24배의 성능 향상을 얻었다.
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[게시일 2004년 10월 1일]
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