• 제목/요약/키워드: Layout problem

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실시간 정보 제공을 위한 웹 트랜스코딩 (Web Transcoding for Real-Time Information Providing)

  • 우찬일;신인철
    • 전자공학회논문지CI
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    • 제39권2호
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    • pp.54-63
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    • 2002
  • 최근 들어 인터넷 접속을 위하여 웹 접근이 가능한 개인 장치들이 점점 더 이용 가능해 짐에 따라 PDA나 셀룰러 폰과 같은 휴대 장치로부터 인터넷에 접속하는 사용자들이 증가하고 있다. 그러나 웹 상의 대부분의 페이지들은 적어도 640×480의 해상도를 가지는 컬러 모니터의 데스크탑 컴퓨터에 디스플레이하기 위해 제작되어, 충분한 표현 능력을 가지고 있지 않은 휴대 장치들에 동일한 내용의 웹 컨텐츠를 다르게 표현해야 할 필요가 요구되고 있다. 따라서 웹 컨텐츠와 휴대 장치들간의 이러한 문제를 해결하기 위하여 다양한 웹 트랜스코딩 기술이 제안되고 있다. 본 논문에서는 semi-automatic 웹 트랜스코딩 방법을 사용하여 실시간 정보를 위한 웹 트랜스코딩 시스템(웹 프리즘)을 제안한다. 본 논문에서 사용한 semi-automatic 트랜스코딩 방법은 모바일 사용자들이 웹 페이지의 레이아웃이 빈번하게 바뀌지 않는 제한된 범위의 웹 페이지에 접근하기 위한 좋은 방법으로 제공되며, 또한 웹 프리즘을 데스크탑 PC에서 구현하여 실험한 결과 PDA에서 좋은 품질의 문서를 생성하였다.

화상정보처리를 위한 엔트로피 부호화기 설계 (Design of Entropy Encoder for Image Data Processing)

  • 임순자;김환용
    • 전자공학회논문지C
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    • 제36C권1호
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    • pp.59-65
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    • 1999
  • MPEG-II 기반의 HDTV/DTV Encoder 구성부중 하나인 엔트로피 부호화기(entropy encoder)를 설계하였다. 설계된 엔트로피 부호화기는 생성된 비트스트림이 버퍼에 저장될 경우 버퍼의 고갈을 막기위해 제로 스터핑 블록을 첨가함으로써 9Mbps의 비트율로 출력된다. 또한, AC 계수와 DC 계수 table로 PROM이 아닌 조합회로를 사용하여 회로내부에 Critical path가 발생하지 않도록 하였다. 패커부의 경우 배럴 쉬프트 하나를 사용하여 24비트 단위로 패킹을 하도록 하였으며, 헤더정보 부호화부, 입력정보지연부, 부호화부 그리고 버퍼 제어부로 구성된다. 설계된 회로는 VHDL function 시뮬레이션을 통하여 검증하였고, 설계공정 파라미터로는 $0.8{\mu}m$ Gate Array 설계방식을 적용하여 Gate compiler로 P&R을 수행한 결과 전체 Layout의 핀 수와 Gate수는 각각 235개와 120,000개로 측정되었다.

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루브 골드버그 기계의 합성을위한 예제 기반 접근방법 (An Example-Based Approach to the Synthesis of Rube Goldberg Machines)

  • 이강훈
    • 한국컴퓨터그래픽스학회논문지
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    • 제20권2호
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    • pp.25-32
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    • 2014
  • 본 논문은 물리 시뮬레이션 환경에서 일련의 강체요소가 인과사슬에 따라 연쇄적으로 구동되는 가상의 루브 골드버그 기계를 합성하기 위한 예제 기반 접근방법을 제안한다. 일련의 요소 집합이 주어졌을 때, 본 논문의 목표는 사용자가 명시한 이동의 시작 및 종료위치, 그리고 경계 영역 조건을 만족하는 범위에서 이들 요소로만 구성된 루브 골드버그 기계를 자동으로 구축하는 것이다. 이를 위하여, 먼저 적은 개수의 요소로 구성된 소규모 컴포넌트들을 무작위로 추출한 후 모든 컴포넌트 쌍에 대한 결합 가능성을 하나의 그래프 구조로 표현한다. 이 그래프 위에서의 경로 탐색을 통하여 공간 상에 펼쳤을 때 사용자가 지정한 요구 조건을 만족시키는 경로를 찾고, 해당 경로에 따라 순차적으로 컴포넌트를 조립함으로써 기계를 구축한다. 완성된 기계가 물리 시뮬레이션 환경에서 정확히 동작함을 보장하기 위하여, 끝으로 간단한 그리디 알고리즘을 적용하여 조립된 컴포넌트들의 위치를 정교하게 조절한다. 다섯 종류의 요소만을 이용하여 만든 다양한 구조의 루브 골드버그 기계를 보임으로써 본 논문에서 제안한 방법의 유용성을 보인다.

Optimum design and vibration control of a space structure with the hybrid semi-active control devices

  • Zhan, Meng;Wang, Sheliang;Yang, Tao;Liu, Yang;Yu, Binshan
    • Smart Structures and Systems
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    • 제19권4호
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    • pp.341-350
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    • 2017
  • Based on the super elastic properties of the shape memory alloy (SMA) and the inverse piezoelectric effect of piezoelectric (PZT) ceramics, a kind of hybrid semi-active control device was designed and made, its mechanical properties test was done under different frequency and different voltage. The local search ability of genetic algorithm is poor, which would fall into the defect of prematurity easily. A kind of adaptive immune memory cloning algorithm(AIMCA) was proposed based on the simulation of clone selection and immune memory process. It can adjust the mutation probability and clone scale adaptively through the way of introducing memory cell and antibody incentive degrees. And performance indicator based on the modal controllable degree was taken as antigen-antibody affinity function, the optimization analysis of damper layout in a space truss structure was done. The structural seismic response was analyzed by applying the neural network prediction model and T-S fuzzy logic. Results show that SMA and PZT friction composite damper has a good energy dissipation capacity and stable performance, the bigger voltage, the better energy dissipation ability. Compared with genetic algorithm, the adaptive immune memory clone algorithm overcomes the problem of prematurity effectively. Besides, it has stronger global searching ability, better population diversity and faster convergence speed, makes the damper has a better arrangement position in structural dampers optimization leading to the better damping effect.

자동변속기 유성기어 소음을 고려한 시스템 분석용 프로그램 개발 및 적용에 관한 연구 (Development of a Design and Analysis Program for Automatic Transmission Applications to Consider the Planetary Gear Noise and Its Adaptation)

  • 이현구;이상화;김무석;홍사만;김시웅;유동규;권현식;아멧칼만
    • 한국소음진동공학회논문집
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    • 제25권7호
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    • pp.487-495
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    • 2015
  • A generalized special program called planetary transmission analysis(here in after PTA) is developed to improve planetary gear noise in automatic transmission. PTA is capable of analyzing any typical one-degree-of-freedom automatic transmission gear train containing any number of simple, compound or complex-compound planetary gear sets. The kinematics module in PTA can compute the rotational speeds of gears and carriers and calculate the order frequencies to predict the planetary noise components. The power flow analysis module performs a complete static force analysis providing forces, moments, or torques of gears, bearings, clutches and connections. Based on the given type and number of planetary gear sets, the search algorithm determines all possible kinematic configurations and gear tooth combinations in a required set of gear ratios, while eliminating whole kinematic redundancies and unfavorable clutching sequences. By using PTA program, planetary internal speeds of new developed automatic transmission are early obtained; therefore, possibility of the noise problem could be predicted in early design stage. As implementing PTA in planetary gear NVH development procedure, planetary gear noise was successfully reduced by 10 dBA.

GSIS를 이용한 호수의 수리학적 특성 추출에 관한 연구 (A Study on the Hydraulic Characteristic Extraction of Lake using GSIS)

  • 성동권;전형섭;박성규;정영동;조기성
    • 한국측량학회지
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    • 제18권1호
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    • pp.67-73
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    • 2000
  • 공업화, 도시화가 지속되어 내륙 수계의 수질은 날로 오염되고 있으며, 이와 함께 호수의 수질 또한 악화되어 호수 수질오염 문제는 새로운 수질관리 방안을 필요로 하게 되었다. 본 연구는 GSIS(Geo-Spatial Information System)을 이용한 호수의 수질 관리를 위한 방안의 초기단계로서 GSIS 환경에서 호수의 각종 수리학적 특성 정보를 자동 추출할 수 있는 방안에 대하여 연구하였으며 또한, 추출된 호수의 수리학적 특성정보의 활용의 일례로서 유한차분법을 이용한 호수 수체 흐름의 특성분석을 수행하였다. 수체 흐름의 특성분석에 필요한 각종 수리학적 특성 정보 추출을 GSIS를 이용하여 자동화하므로서 분석작업을 효율적으로 수행할 수 있었으며, 특히 호수단면 정보의 추출을 출력물의 형태가 아닌 다른 정보와 결합하여 분석 가능한 형태로 추출하므로서 호수의 성층현상분석과 같은 호수의 단면정보가 필수적인 각종 분석을 GSIS 환경에서 가능하도록 하였다.

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PMIC용 32bit eFuse OTP 설계 (Design of a 32-Bit eFuse OTP Memory for PMICs)

  • 김민성;윤건수;장지혜;김려연;하판봉;김영희
    • 한국정보통신학회논문지
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    • 제15권10호
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    • pp.2209-2216
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    • 2011
  • 본 논문에서는 Magnachip $0.18{\mu}m$ 공정을 이용하여 PMIC용 32bit eFuse OTP IP를 설계하였다. eFuse 링크 아래에 N-Well을 두어 프로그램시 eFuse 링크와 p-기판의 VSS가 단락되는 문제점을 해결하였다. 그리고 디코딩된 WERP (WL Enable for Read or Program) 신호가 eFuse OTP 메모리로 바로 입력되는 경우 듀얼 포트 eFuse OTP 메모리 셀의 RWL (Read Word-Line)과 WWL (Write Word-Line)을 선택적으로 활성화해 주는 WL 구동회로를 제안하였다. 또한 BL 프리차징 회로에서 delay chain을 제거하여 제어회로의 레이아웃 면적을 줄였다. 메모리 테스트 장비를 이용하여 제작된 94개의 샘플 die를 측정한 결과 5.5V의 프로그램 전압에서 100%의 수율을 얻었다.

MPEG-7 기반 비디오/이미지 검색 시스템(VIRS) (MPEG-7 based Video/Image Retrieval System (VIRS))

  • 이재호;김형준;김회율
    • 정보처리학회논문지B
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    • 제10B권5호
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    • pp.543-552
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    • 2003
  • 멀티미디어데이터의 급격한 양적 팽창은 원하는 데이터를 빠르고 정확하게 검색해야 한다는 새로운 과제를 안겨주었다. 이러한 효율적 검색을 위해서 가장 중요한 기반이 되는 것이 바로 데이터의 적절한 표현이다. 2001년 국제 표준으로 제정된 MPEG-7은 바로 이러한 이유로 멀티미디어 데이터의 표현에 대한 표준화를 다루고 있다. 그러나 MPEG-7의 내용은 표준의 특성상 포함하는 범위가 방대하고 실제 검색시스템을 구축하려는 이들에게 다루기 힘든 것이 사실이다. 이에 본 논문에서는 MPEG-7에 제시되어 있는 표준 중 비주얼 기술자들만을 이용하여 간단한 검색시스템을 구축하는 방법에 대하여 제시하고 그 검색 결과를 도시하였다. 또한 개발된 시스템인 MPEG-7 VIRS(Video/Image Retrieval System)의 검색 결과를 통하여 각 비주얼 기술자를 이용한 검색과 다중 기술자들의 조합을 이용한 검색간의 결과를 분석하였으며 앞으로 MPEG-7을 이용한 검색 시스템이 나아갈 방향에 대한 간단한 제시를 하고 있다.

PMOS 트랜지스터의 ESD 손상 분석 (ESD Failure Analysis of PMOS Transistors)

  • 이경수;정고은;권기원;전정훈
    • 대한전자공학회논문지SD
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    • 제47권2호
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    • pp.40-50
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    • 2010
  • 본 논문은 미세 CMOS 공정의 PMOS 트랜지스터에 높은 전류가 인가될 때 발생하는 기생 PNP 바이폴라 트랜지스터의 스냅백과 breakdown 동작에 초점을 맞춘다. $0.13\;{\mu}m$ CMOS 공정을 이용해 제작한 다양한 I/O 구조를 분석함으로써 PMOSFET의 ESD 손상 현상의 원인을 규명하였다. 즉, 인접한 다이오드로부터 PMOSFET의 바디로 전하가 주입됨으로써 PMOSFET의 기생 PNP 트랜지스터가 부분적으로 turn-on되는 현상이 발생하여 ESD에 대한 저항성을 저하시킨다. 2차원 소자 시뮬레이션을 통해 레이아웃의 기하학적 변수의 영향을 분석하였다. 이를 기반으로 새로운 PMOSFET ESD 손상을 방지하는 설계 방법을 제안한다.

백플레인용 10Gbps 아날로그 어댑티브 이퀄라이저 (A 10Gb/s Analog Adaptive Equalizer for Backplanes)

  • 유귀성;한건희;박성민
    • 대한전자공학회논문지SD
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    • 제44권9호
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    • pp.34-39
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    • 2007
  • 백플레인 채널 시리얼 링크는 심각한 신호왜곡 현상을 겪는다. 특히, 채널 자체의 특성에 의해 발생하는 이득손실, 주파수에 따른 손실, 반사파 등의 불완전성으로 더욱 심해진다. 이 중 주파수에 따른 손실의 경우 신호파형에 ISI를 일으키므로, 이를 줄이기 위해 어댑티브 이퀄라이저 회로를 사용한다. 본 논문에서는 0.18um CMOS공정을 이용하여 구현한 아날로그 형태의 10Gb/s 어댑티브 이퀄라이저 회로를 소개한다. 제안한 이퀄라이저 회로는 34인치의 긴 백플레인 채널(혹은 트랜스미션 라인)의 불완전성에도 불구하고, 매우 높은 동작속도(10Gb/s)를 유지한다. 포스트 레이아웃 시뮬레이션 결과, 제안한 회로는 10mW의 전력소모와 $8ps_{p-p}$의 지터 특성을 가지며, $0.56mm^2$의 칩 사이즈를 갖는다.