심층 처분 방식은 고준위폐기물을 처분하기 위한 가장 적합한 대안으로 고려되어지고 있다. 고준위폐기물은 공학적방벽시스템에 의해 지하 500~1,000m 깊이의 암반층에 처분된다. 공학적방벽시스템의 구성 요소로는 처분용기, 완충재, 뒷채움재 및 갭채움재가 있다. 이 중 벤토나이트 완충재는 지하수 유입으로부터 처분용기를 보호하고, 방사성 핵종 유출을 저지하는 역할을 하기에 심층 처분시스템에 있어 매우 중요하다고 할 수 있다. 초기에는 처분용기로부터 발생하는 고온의 열량으로 인해 완충재의 포화도는 감소하지만, 그 후 주변 암반으로부터 유입되는 지하수로 인해 완충재의 포화도는 증가한다. 이렇듯 완충재의 불포화 거동 특성은 공학적방벽의 전체 안전성을 좌우할 수 있는 중요한 입력자료이다. 국내의 경우 경주에서 생산되는 벤토나이트가 완충재의 주요 후보물질로 고려될 수 있는데 국내 벤토나이트 완충재의 온도를 고려한 불포화 거동 특성에 대한 연구는 매우 미진한 상황이다. 따라서 본 연구에서는 국내 압축 벤토나이트 완충재의 온도 증가에 따라 함수비가 일정한 조건에서의 함수특성곡선을 도출하였으며, 시험 값과 온도가 고려된 수정 van-Genuchten 모델 값과의 상대오차는 약 2%를 나타냈다.
We build a queueing model for buffered leaky bucket system. First, we set up system equations and them calculate the steady-state probabilities at an arbitrary time epoch by recursive method. We derive the mean waiting time and the mean number of cells in the input buffer, and evaluate the performance of the buffered leaky bucket system to find the optimal queue capacity and token generation rate that meet the quality of service(QoS).
This paper describes the improvement of frequency characteristic of crystal oscillator I.C using Ti-Salicide. The characteristics of transistor(drive current) using Ti-Salicide process are better than Poly-Si process, because the mobility. To know frequency characteristic of oscillator I.C, the simulation is performed using inverter buffer chain of Fan-out 10 TTL. Its result shows at once the generation of normal clock pulse in input signal and the improvement of rising and falling time.
In this paper, we analyze the performance of ATM switch with output buffer which has a space priority control mechanism. As we assumed that the input traffic consists of loss tolerable voice and loss sensitive data, we modeled it with MMPP(Markov Modulated Poisson Process). We confirmed that the loss probability of loss sensitive traffic decreases when we use the space priority control mechanism.
An ATM switch is the basic component of an ATM network, and its functioning is to switch incoming cells arriving at an input port to the output port associated with an appropriate virtual path. In case of an ATM switch with buffer sharing scheme, the performance analysis is very difficult due to the interactions between the address queues. In this paper, the influences of the degree of traffic burstiness and some traffic routing properties are investigated by using the simulation. Also, some cell access strategies including priority access and cell dropping are compared in terms of cell loss probability.
In the input buffer switch system, VOQ(Virtual Output Queue) archives 100% throughput. The VOQ with the systolic architecture maintains an uniform performance regardless of a number of Packet class and output port, so that it doesn't have a limitation of scalability. In spite of these advantages, the systolic architecture VOQ is difficult to change sorting order In this paper, we Proposed a systolic architecture VOQ which support weighted round robin(WRR) algorithm to provide with flow control service.
이 논문에서는 자원을 공유하는 여러 개의 QoS(Quality of Service) 큐(queue)를 서비스하기 위한 새로운 서비스 규칙 - 선형 서비스 규칙을 제안하고, 그 특징을 분석하였다. 제안하는 선형 서버는 각각의 큐에 대한 출력 트래픽(traffic) 및 고객 수 과정을 입력 트래픽의 선형 함수로 만든다 특히 입력 트래픽이 가우스 분포를 갖는 경우에는 큐 길이의 분포와 출력 트래픽 분포가 모두 가우스 분포를 갖게 하며, 그 분포의 평균과 분산이 입력 트래픽의 평균과 전력 스펙트럼(power Spectrum)의 함수로 나타나게 한다. 중요한 QoS 척도인 버퍼 넘침 확률 및 지연 분포 역시 입력 트래픽의 평균과 전력 스펙트럼의 함수로 나타나게 된다. 이 연구는 네트워크의 각 노드를 하나의 선형 필터로 볼 수 있게 하므로, 선형 시스템 이론에 기초한 네트워크 전반에 걸친 트래픽 관리 기술의 새로운 방향을 제시하였다.
Seo, Hyo-Gi;Seo, Seung-Woo;Yun, Jong-Won;Rieh, Jae-Sung
JSTS:Journal of Semiconductor Technology and Science
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제11권3호
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pp.190-197
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2011
This paper presents a 144 GHz divide-by-2 injection locked frequency divider (ILFD) with inductive feedback developed in a commercial 90-nm Si RFCMOS technology. It was demonstrated that division-by-2 operation is achieved with input power down to -12 dBm, with measured locking range of 0.96 GHz (144.18 - 145.14 GHz) at input power of -3 dBm. To the authors' best knowledge, this is the highest operation frequency for ILFD based on a 90-nm CMOS technology. From supply voltage of 1.8 V, the circuit draws 5.7 mA including both core and buffer. The fabricated chip occupies 0.54 mm ${\times}$ 0.69 mm including the DC and RF pads.
We present a closed form approximate analytical model to estimate the expected waiting times for the storage and retrieval requests of an automated storage/retrieval (AS/R) system, assuming that the storage/retrieval (S/R) machine idles either at the rack or at the input/output point. The expected waiting times (and the associated mean queue lengths) can play an important role to decide whether the performance of a stable AS/R system is actually acceptable, to determine buffer size (or length) of the input conveyor, and to compute the number of the rack openings which is required to hold the loads which are requested by processing machines but waiting in the rack to be retrieved by the SIR machine. This model can be effectively used in the early design stage of an AS/R system.
This paper presents adjustment of input order to improve clustering performance of ART1. We propose new method for On-line clustering which adjusts initial input data using buffer. We demonstrate the clustering performance of the proposed algorithm by testing it on Zoo data set from UCI and created artificial data set for simulation. Experimental results show that preposed method increases 7.8% of clustering performance than ART1 model on the average.
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[게시일 2004년 10월 1일]
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