Journal of the Korean Institute of Electrical and Electronic Material Engineers
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v.27
no.11
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pp.679-685
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2014
For the measurements of surface shape milled using FIB (focused ion beam), the silicon bulk, $Si_3N_4/Si$, and Al/Si samples are used and observed the shapes milled from different sputtering rates, incident angles of $Ga^+$ ions bombardment, beam current, and target material. These conditions also can be influenced the sputtering rate, raster image, and milled shape. The fundamental ion-solid interactions of FIB milling are discussed and explained using TRIM programs (SRIM, TC, and T-dyn). The damaged layers caused by bombarding of $Ga^+$ ions were observed on the surface of target materials. The simulated results were shown a little bit deviation with the experimental data due to relatively small sputtering rate on the sample surface. The simulation results showed about 10.6% tolerance from the measured data at 200 pA. On the other hand, the improved analytical model of damaged layer was matched well with experimental XTEM (cross-sectional transmission electron microscopy) data.
Proceedings of the Korean Institute of Electrical and Electronic Material Engineers Conference
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2004.11a
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pp.3-6
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2004
Power semiconductor devices are being compact, high performance and intelligent thanks to recent remarkable developments of silicon design, process and related packaging technologies. Developments of MOS-gate transistors such as MOSFET and IGBT are dominant thanks to their advantages on high speed operation. In conjunction with package technology, silicon technologies such as trench, charge balance and NPT will support future power semiconductors. In addition, wide band gap material such as SiC and GaN are being studies for next generation power semiconductor devices.
The TEM samples prepared by ion milling have the advantage that thin area can be obtained from almost any materials. However, it has the disadvantage that the amount of thin area can often be quite limited. For the cross-sectioned samples and grossly heterogeneous materials, the thickness of less than $0.1{\mu}m$ can be achieved by mechanical grinding and polishing (tripod polisher) and then the TEM samples may be ion-milled for final thinning or cleaning. These approaches were described in this paper. Examples of TEM observations were taken from cross-section samples of thin films on silicon and sapphire, from diffusion layers between $Mo_5Si_3\;and\;Mo_2B$, and from rapidly solidified 304 stainless steel powders embedded in electroplated copper.
A method for fabrication of nano-scale GaN structure by inductively coupled plasma etching is proposed, exploiting a thermal dewetting of Pt thin film as an etch mask. The nano-scale Pt metal islands were formed by the dewetting of 2-dimensional film on $SiO_2$ dielectric materials during rapid thermal annealing process. For the case of 30 nm thick Pt films, pattern formation and dewetting was initiated at temperatures greater $600^{\circ}C$. Controlling the annealing temperature and time as well as the thickness of the Pt metal film affected the size and density of Pt islands. The activation energy for the formation of Pt metal island was calculated to be 23.2 KJ/mole. The islands show good resistance to dry etching by a $CF_4$ based plasma for dielectric etching indicating that the metal islands produced by dewetting are suitable for use as an etch mask in the fabrication of nano-scale structures.
Proceedings of the Korean Institute of Electrical and Electronic Material Engineers Conference
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1999.11a
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pp.468-470
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1999
One of the most critical problem in etching of platinum was generally known that the etch slope was gradual. therefore, the addition of $N_2$ gas into the Ar/C1$_2$ gas mixture, which has been proposed the optimized etching gas combination for etching of platinum in our previous article, was performed. The selectivity of platinum film to oxide film as an etch mask increased with the addition of N2 gas, and the steeper etch slope over 75 $^{\circ}$ could be obtained. These phenomena were interpreted the results the results of a blocking layer such as Si-N or Si-O-N on the oxide mask. Compostional analysis was carried out by X-ray photoelectron spectroscopy (XPS) and secondary ion mass spectrometry (SIMS). Moreover, it could be obtained the higher etch rate of Pt film and steeper profile without residues such as p.-Cl and Pt-Pt ant the addition N\ulcorner of 20 % gas in Ar(90)/Cl$_2$(10) Plasma. The Plasma characteristic was extracted from optical emissionspectroscopy (OES).
Proceedings of the Korean Vacuum Society Conference
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2010.08a
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pp.166-166
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2010
Recently, TFTs based on amorphous oxide semiconductors (AOSs) such as ZnO, InZnO, ZnSnO, GaZnO, TiOx, InGaZnO(IGZO), SnGaZnO, etc. have been attracting a grate deal of attention as potential alternatives to existing TFT technology to meet emerging technological demands where Si-based or organic electronics cannot provide a solution. Since, in 2003, Masuda et al. and Nomura et al. have reported on transparent TFTs using ZnO and IGZO as active layers, respectively, much efforts have been devoted to develop oxide TFTs using aforementioned amorphous oxide semiconductors as their active layers. In this thesis, I report on the performance of thin-film transistors using amorphous indium gallium zinc oxides for an active channel layer at room temperature. $SiO_2$ was employed as the gate dielectric oxide. The amorphous indium gallium zinc oxides were deposited by RF magnetron sputtering. The carrier concentration of amorphous indium gallium zinc oxide was controlled by oxygen pressure in the sputtering ambient. Devices are realized that display a threshold voltage of 1.5V and an on/off ration of > $10^9$ operated as an n-type enhancement mode with saturation mobility with $9.06\;cm^2/V{\cdot}s$. The devices show optical transmittance above 80% in the visible range. In conclusion, the fabrication and characterization of thin-film transistors using amorphous indium gallium zinc oxides for an active channel layer were reported. The operation of the devices was an n-type enhancement mode with good saturation characteristics.
This research was worked about $Ga_2O_3$ Epi wafer that was one of the mose wide band gap semiconductors to be used power semiconductor industry. This wafer was grown $5.3{\mu}m$ thickness on Sn doped $Ga_2O_3$ Substrate by HVPE(Hydride Vapor Phase Epitaxy). Generally, we can fabricate 600V class power semiconductor devices when the thickness of compoound power semiconductor is $5{\mu}m$. but in case of $Ga_2O_3$ Epi wafer, we can obtain over 1000V class. As a result of J-V measurment of the grown $Ga_2O_3$ Epi wafer, we obtain $2.9-7.7m{\Omega}{\cdot}cm^2$ on resistance. Specially, in case of reverse, we comfirmed a little leakage current when the reverse voltage is over 200V.
Journal of the Korean Crystal Growth and Crystal Technology
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v.34
no.4
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pp.109-116
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2024
β-Ga2O3 is a representative ultra-wide bandgap (UWBG) semiconductor that has attracted much attention for power device applications due to its wide-bandgap of 4.9 eV and high-breakdown voltage of 8 MV/cm. In addition, because solution growth is possible, it has advantages such as fast growth rate and lower production cost compared to SiC and GaN [1-2]. In this study, we have successfully grown Si-doped 10 mm thick Si-doped β-Ga2O3 single crystals by the EFG (Edge-defined Film-fed Growth) method. The growth direction and growth principal plane were set to [010] / (010), respectively, and the growth speed was 7~20 mm/h. The as-grown β-Ga2O3 single crystal was cut into various crystal planes (001, 100, ${\bar{2}}01$) and off-angles (1o, 3o, 4o), and then surface processed. After processed, the homoepitaxial layer was grown on the epi-ready substrate using the HVPE (Halide vapor phase epitaxy) method. The processed samples and the epi-layer grown samples were analyzed by XRD, AFM, OM, and Etching to compare the surface properties according to the crystal plane and off-angle.
This paper is for enhancing the breakdown voltage of MHEMTs with an InP-etchstop layer. Gate-recess structures has been simulated and analyzed for the breakdown of the devices with the InP-etchstop layer. The fully removed recess structure in the drain side of MHEMT shows that the breakdown voltage enhances from 2V to almost 4V and that the saturation current at gate voltage of 0V is reduced from 90mA to 60mA at drain voltage of 2V. This is because the electron-captured negatively fixed charges at the drain-side interface between the InAlAs barrier layer and the $Si_3N_4$ passivation layer deplete the InGaAs channel layer more and thus decreases the electron current passing the channel layer. In the paper, the fully-recessed asymmetric gate-recess structure at the drain side shows the on-breakdown voltage enhancement from 2V to 4V in the MHEMTs.
Journal of the Korean Crystal Growth and Crystal Technology
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v.33
no.2
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pp.83-90
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2023
The β-Ga2O3 has the most thermodynamically stable phase, a wide band gap of 4.8~4.9 eV and a high dielectric breakdown voltage of 8MV/cm. Due to such excellent electrical characteristics, this material as a power device material has been attracted much attention. Furthermore, the β-Ga2O3 has easy liquid phase growth method unlike materials such as SiC and GaN. However, since the grown pure β-Ga2O3 single crystal requires the intentionally controlled doping due to a low conductivity to be applied to a power device, the research on doping in β-Ga2O3 single crystal is definitely important. In this study, various source powders of un-doped, Sn 0.05 mol%, Sn 0.1 mol%, Sn 1.5 mol%, Sn 2 mol%, Sn 3 mol%-doped Ga2O3 were prepared by adding different mole ratios of SnO2 powder to Ga2O3 powder, and β-Ga2O3 single crystals were grown by using an edge-defined Film-fed Growth (EFG) method. The crystal direction, crystal quality, optical, and electrical properties of the grown β-Ga2O3 single crystal were analyzed according to the Sn dopant content, and the property variation of β-Ga2O3 single crystal according to the Sn doping were extensively investigated.
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[게시일 2004년 10월 1일]
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