• 제목/요약/키워드: Cascade structure

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Virtual Queue Based QoS Layered Vertical Mapping in Wireless Networks

  • Fang, Shu-Guang;Tang, Ri-Zhao;Dong, Yu-Ning;Zhang, Hui
    • KSII Transactions on Internet and Information Systems (TIIS)
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    • 제8권6호
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    • pp.1869-1880
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    • 2014
  • Wireless communication is one of most active areas in modern communication researches, QoS (Quality of Service) assurance is very important for wireless communication systems design, especially for applications such as streaming video etc., which requires strict QoS assurance. The modern wireless networks multi-layer protocol stack structure results in QoS metrics layered and acting in cascade and QoS metrics vertical mapping between protocol layers. Based on virtual buffer between protocol layers and queuing technology, a unified layered QoS mapping framework is proposed in this paper, in which we first propose virtual queue concept, give a novelty united neighboring protocol layers QoS metric mapping framework, and analysis method based on dicerete-time Markov chain, and numerical results show that our proposed framework represents a significant improvement over previous model.

A Cascaded Modular Multilevel Inverter Topology Using Novel Series Basic Units with a Reduced Number of Power Electronic Elements

  • Barzegarkhoo, Reza;Vosoughi, Naser;Zamiri, Elyas;Kojabadi, Hossein Madadi;Chang, Liuchen
    • Journal of Power Electronics
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    • 제16권6호
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    • pp.2139-2149
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    • 2016
  • In this study, a new type of cascaded modular multilevel inverters (CMMLIs) is presented which is able to produce a considerable number of output voltage levels with a reasonable number of components. Accordingly, each series stage of the proposed CMMLI is comprised of two same basic units that are connected with each other through two unidirectional power switches without aiming any of the full H-bridge cells. In addition, since the potentiality for generating a higher number of output voltage levels in CMMLIs hinges on the magnitude of the dc voltage sources used in each series unit, in the rest of this paper, four different algorithms for determining an appropriate value for the dc sources' magnitude are also presented. In the following, a comprehensive topological analysis between some CMMLI structures reported in the literature and proposed structure along with several simulation and experimental results will be also given to validate the lucrative benefits and viability of the proposed topology.

뉴로 네트워크에서 코사인 모듈화 된 가우스함수의 다항식과 계단함수의 근사 (Approximation of Polynomials and Step function for cosine modulated Gaussian Function in Neural Network Architecture)

  • 이상화
    • 전자공학회논문지CI
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    • 제49권2호
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    • pp.115-122
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    • 2012
  • 본 논문에서는 CosGauss라고 하는 코사인함수로 모듈화 된 가우시안 활성화함수가 뉴로 네트워크에서 다항식과 계단함수의 근사에 사용될 수 있음을 증명한다. CosGauss 함수는 시그모이드, 하이퍼볼릭 탄젠트, 가우시안 활성화 함수보다 더 많은 범프(bump)를 구성 할 수 있다. 이 함수를 캐스케이드 코릴레이션 뉴로 네트워크 학습에 사용하여 벤치마크 문제인 Tic-Tac-Toe 게임과 아이리스(iris) 식물 문제와 실험하고 여기에서 얻어진 결과를 다른 활성화 함수를 사용한 결과와 비교 분석한다.

A 256-Radix Crossbar Switch Using Mux-Matrix-Mux Folded-Clos Topology

  • Lee, Sung-Joon;Kim, Jaeha
    • JSTS:Journal of Semiconductor Technology and Science
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    • 제14권6호
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    • pp.760-767
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    • 2014
  • This paper describes a high-radix crossbar switch design with low latency and power dissipation for Network-on-Chip (NoC) applications. The reduction in latency and power is achieved by employing a folded-clos topology, implementing the switch organized as three stages of low-radix switches connected in cascade. In addition, to facilitate the uniform placement of wires among the sub-switch stages, this paper proposes a Mux-Matrix-Mux structure, which implements the first and third switch stages as multiplexer-based crossbars and the second stage as a matrix-type crossbar. The proposed 256-radix, 8-bit crossbar switch designed in a 65nm CMOS has the simulated power dissipation of 1.92-W and worst-case propagation delay of 0.991-ns while operating at 1.2-V supply and 500-MHz frequency. Compared with the state-of-the-art designs in literature, the proposed crossbar switch achieves the best energy-delay-area efficiency of $0.73-fJ/cycle{\cdot}ns{\cdot}{\lambda}^2$.

Dual Gate Emitter Switched Thyristor의 전기적 특성 (Electrical Characteristics of the Dual Gate Emitter Switched Thyristor)

  • 김남수;이응래;최지원;김영석;김경원;주변권
    • 한국전기전자재료학회논문지
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    • 제18권5호
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    • pp.401-406
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    • 2005
  • Two dimensional MEDICI simulator is used to study the electrical characteristics of Dual Gate Emitter Switched Thyristor. The simulation is done in terms of the current-voltage characteristics with the variations of p-base impurity concentrations and current flow. Compared with the other power devices such as MOS Controlled Cascade Thyristor(MCCT), Conventional Emitter Switched Thyristor(C-EST) and Dual Channel Emitter Switched Thyristor(DC-EST), Dual Gate Emitter Switched Thyristor(DG-EST) shows to have tile better electrical characteristics, which is the high latch-up current density and low forward voltage-drop. The proposed DG-EST which has a non-planer u-base structure under the floating N+ emitter indicates to have the better characteristics of latch-up current and breakover voltage in spite of the same turn-off characteristics.

LCL 입력 필터를 갖는 PWM 컨버터의 궤환 선형화 제어 (Feedback Linearization Control of PWM Converters with LCL Input Filters)

  • 김동억;이동춘;김흥근
    • 전력전자학회논문지
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    • 제13권1호
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    • pp.55-62
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    • 2008
  • 본 논문에서는 댐핑저항을 사용하지 않고 LCL필터를 사용한 AC/DC PWM 컨버터를 제어하기 위해 다중 루프구조를 갖는 궤환선형화 제어기법을 제안한다. 궤환선형화 기법은 시스템의 비선형성을 제거하여 선형적으로 제어기를 설계할 수 있는 방법으로 우수한 동특성을 얻을 수 있다. 궤환선형화와 더불어 다중루프를 적용하여 컨버터입력전류를 제한함으로써 컨버터의 과전류를 방지할 수 있다. 사용되는 센서의 개수를 줄이기 위해 전원전압과 전원전류가 추정된다. 제시된 제어 알고리즘은 시뮬레이션 및 실험을 통해 그 타당성이 검증된다.

손실이 있는 Left-Handed 전송선로를 이용한 감쇠기와 벡터 변조기 응용 (Attenuator using Lossy Left-Handed Transmission Line and Vector Modulator Application)

  • 김승환;김일규;김영;윤영철
    • 한국항행학회논문지
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    • 제13권3호
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    • pp.399-405
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    • 2009
  • 본 논문은 메타 재질 구조를 바탕으로 한 가변 감쇠기와 그 응용에 대하여 기술 하였다. 손실이 존재하는 전송선로를 이용한 감쇠기 단위 셀은 CRLH(Composite Right/Left Handed) 전송선로와 다이오드 바이어스 전압에 따라서 내부 저항값의 변화에 따라서 손실을 제어할 수 있는 PIN다이오드로 구성되어 있다. 또한, 내부의 초기 삽입 손실을 줄이기 위해서 두 개의 PIN 다이오드를 병렬로 연결하였다. 이 감쇠기는 감쇠기 단위 셀 숫자를 증가시킴으로서 감쇠량을 증가시킬 수 있는 주기적 구조로 설계되었다. 단위 셀의 전기적 특성은 주파수 1.5 GHz ~ 2.5 GHz에서 10dB의 감쇠량과 최대 15o의 위상변화를 확인하였다. 이러한 특성의 감쇠기를 직렬로 연결하여 벡터 변조기에 응용하였다.

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3-N-(2,2디에토오키시에칠) -2벤즈 이미다즈오리논의 결정 및 분자구조 (THE CRYSTAL AND MOLECULAR STRUCTURE OF 3-N-(2,2-DIETHOXY-ETHYL)-2-BENZIMIDAZOLINONE)

  • 안중태;이숙자
    • 한국결정학회지
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    • 제2권2호
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    • pp.7-12
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    • 1991
  • C13H18N2O3(Mr=250.29)는 단사정계의 P211a의 공간군을 갖고 있으며 a=8.765(4), b=17.679 (3), c=9.238(4)A, p=105.6(3)A, z=4, V= 1378.53A3, A(Mo Ka)=0.71069A, 1:0. 81cm-1, F(000)=536, T=298 이며 1.0 σ(I)보다 큰 강도를 가진 1783개의 회절반점에 대하여 최종 R값은 0.080이다. 직접법에 의하여 구조를 풀었으며 C-H 결합길이와 메칠기는 길이를 고정시켜 이 상적인 기하학적 구조에 맞추어 계단식 대각최소자 승법에 의하여 정밀화하였다 두 에토오키시기중의 하나는 다른 기에 비해 100°나 더 기울어져있다. 결정격자내에 한개의 N-H‥‥0(2.798A) 수소결합이 있어 두 분자를 연결하면서 b-축에 따라 쌓여져 있다.

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NCV-|v1 >라이브러리의 새로운 쌍대 구조와 응용 (For new Duality Structure and its Application in the NCV-|v1 > Library)

  • 박동영;정연만
    • 한국전자통신학회논문지
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    • 제11권2호
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    • pp.165-170
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    • 2016
  • 본 논문은 $NCV-{\mid}v_1$ > 라이브러리의 새로운 쌍대 구조의 특성과 그 응용에 대한 연구이다. 상태벡터가 고유벡터인 임의 n개 qudit 상의 모든 유니터리 연산은 1개와 2개의 $NCV-{\mid}v_1$ > 라이브러리 들의 합성으로 표현할 수 있다. 본 연구는 입력 상태벡터가 PP로 제한적인 Barenco의 n비트 U(2n) 연산자를 전역 극성의 입력 상태벡터로 확장 실현하는 것이다. 이와 같이 보강된 확장 실현은 유니터리 연산자의 제어게이트 합성 시에 $NCV-{\mid}v_1$ > 과 이의 쌍대인 $NCV^{\dag}-{\mid}v_1$ > 라이브러리 모두를 사용할 경우에 이들이 대칭적 쌍대 성질을 갖고 있어 모든 극성의 상태벡터 입력에 대해 AND 지배적 종속 합성이 가능하기 때문이다.

Backstepping 기법을 이용한 유기적 비행 어레이의 제어시스템 설계 (Design of Control System for Organic Flight Array based on Back-stepping Controller)

  • 오복영;정준호;김승균;석진영
    • 한국항공우주학회지
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    • 제45권9호
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    • pp.711-723
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    • 2017
  • 본 연구에서는 재형상 특성을 지닌 유기적 비행 어레이의 비행 제어 시스템 설계에 대한 내용을 제안하였다. 단일 덕티드팬의 결합과 분리를 기반으로 구성되는 유기적 비행어레이는 주어진 임무나 주변 상황에 대해 유기적으로 어레이 형상을 변화시킬 수 있는 장점을 가진다. 이와 더불어 덕티드팬 비행체 기반이기 때문에 호버링이 가능하여 실내 정찰, 통신 중계, 레이더 재밍과 같은 미션에 유용하게 사용 된다. 비행 어레이의 동역학모델링은 단일 덕티드팬 비행체의 동역학 모델을 기반으로 구성되며, 비선형 제어기법을 적용하기 위해 어파인 형태의 동역학 식에 대한 유도를 수행한다. 비행체 자세 제어를 위해 Backstepping 제어기법을 적용하였으며 PID 제어기법을 통해 위치 제어 루프를 구현한다. 또한 수치 시뮬레이션을 통해 제안 된 제어기가 주어진 상황에서 충분한 성능을 보이는지를 검증하였다.