A power amplifier(PA) has been designed for 900 MHz-band applications. The PA consists of a single-ended CMOS amplifier which has $0.18{\mu}m{\times}64{\times}6$ gate width. The PA has been designed using $0.18{\mu}m$ CMOS process. At 900 MHz, the PA exhibit an output power of 20.8 dBm and a power-added efficiency(PAE) of 58.4 % with 22.2 dB power gain.
A 900MHz CMOS RF power amplifier with digitally controllable output power has been proposed and designed with 0.6${\mu}{\textrm}{m}$ standard CMOS technology. The designed power amplifier was composed of digitally controllable switch mode pre-amplifiers with an integrated 4nH spiral inductor load and class-C output stage. Especially, to compensate the 1ow Q of integrated spiral inductor, cascode amplifier with a Q-enhancement circuit is used. It has been shown that the proposed power control technique allows the output power to change from almost 3dBm to 13.5dBm. And it has a maximum PAE(Power Added Efficiency) of almost 55% at 900MHz operating frequency and 3V power supply voltage.
본 논문에서는 LTE/WWAN 이동 통신 단말기 응용을 위해 커플드 급전된 모노폴 안테나를 제안하였다. 이 안테나는 모노폴, 커플링 스트립, 급전 패드, 스터브, 단락 스트립으로 구성되어 있다. 모노폴의 기본 공진과 급전 패드와 커플링 스트립 사이에서 발생하는 커플링에 의한 공진이 결합하여 LTE700(698~787 MHz), GSM-850(824~894 MHz), GSM900(890~960 MHz) 대역을 포함한다. 스터브의 공진은 모노폴의 고조파 성분과 결합하여 GSM1800(1,710~1,880 MHz), GSM1900(1,850~1,990 MHz), UMTS(1,920~2,170 MHz) 대역을 포함한다. 그러므로 제안된 안테나는 LTE700, GSM850, GSM900, GSM1800, GSM1900, UMTS 대역을 포함하는 육중 대역 이동 통신 단말기를 위한 안테나로써 적용이 가능하다. 동작 대역 내에서 방사 패턴은 안정적이고 전방향성이며, 안테나 이득은 적당하다.
본 논문은 전하펌프와 클록트리거 회로를 사용하는 프리스케일러가 포함된 UHF RFID 응용을 위한 900MHz Integer-N 방식의 주파수 합성기를 소개한다. 쿼드러처 출력이 가능한 전압제어발진기와 프리스케일러, 위상주파수검출기와 전하펌프 및 아날로그 고정 검출기는 0.35-${\mu}m$ CMOS 공정으로 설계되었다. 주파수 분주기는 verilog-HDL 모듈을 통해 설계되었으며 mixed-mode 시뮬레이션을 통해 디자인을 검증하였다. 전압제어발진기의 동작 주파수영역은 828MHz에서 960MHz이고 위상이 90도 차이나는 쿼드러처 신호를 출력한다. 시뮬레이션 결과로 위상잡음은 100KHz offset 주파수에서 -102dBc/Hz 이었으며, 고착시간은 896MHz에서 928MHz까지 32MHz step을 천이할 때 4us이다.
Journal of Advanced Marine Engineering and Technology
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제35권4호
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pp.506-511
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2011
본 논문은 900MHz대 무선전력전송을 위한 렉테나를 제안한다. 렉테나는 무선 RF 전력을 수신하여 DC 전력으로 변환하는 소자로서 안테나와 정류회로 및 충전부 회로로 구성이 된다. 본 논문에서는900MHz 전력을 수신하기 위해 슬롯 안테나, 0dBm에서 40%의 정류효율을 갖는 정류회로 및 미약한 전력을 충전 후 부하에 일정한 전압을 공급하는 충전부 회로를 설계하였다. 1W의 전력을 송신하는 RFID 리더기를 송신기로 사용하는 실험에서, 제안하는 렉테나는 0dBm의 입사 전력 환경 하에서 50$k{\Omega}$의 부하저항에3.3V의 일정한 전압을 280초 정도 공급하는 것을 확인할 수 있었다.
본 논문에서는 900MHz대역의 대각선 슬롯형 마이크로스트립 패치 안테나를 설계하였다. 제안한 마이크로스트립 패치안테나는 안테나 크기, 절단 길이, 급전위치, 공기층의 높이 등과 같은 중요 파라미터를 고려하여 설계하였다. 설계한 마이크로스트립 패치안테나는 915MHz에서 최소의 반사손실을 가지며, 반사손실을 -16dB 이하에서 정재파비가 1.2이하일 경우, 약 26MHz의 대역폭을 확보함을 알 수 있다. 또한, 설계한 대각선 슬롯형 마이크로스트립 패치 안테나는 915MHz 중심주파수 대역에서 이득이 6dB이고, 축비가 2.8dB 되어 우수한 특성을 갖는다.
본 논문의 핵심인 'RFID(900MHz)를 활용한 GATE 무정차 시스템'은 차량(트레일러)이 터미널에서 컨테이너를 반입/반출하기 위하여 GATE 통과 시 RFID를 연계하여 무정차로 차량의 정보를 인식하고, 터미널에서 제공하는 컨테이너 정보를 차량에 설치되어 있는 RFLDU 단말기에 자동으로 관련 정보를 제공하는 시스템을 말한다. 이를 설계 및 구현을 위해 RFID 기술 부문에서는 UHF대역(900MHz)의 RFID 태그(Tag) 및 리더(Reader)기를 사용하였으며, 원활한 데이터를 수집 및 처리(운영)를 위해 RFID 미들웨어 및 응용 프로그램을 구현하였다. 또한 본 논문에서 구현된 시스템을 실제 항만 부두에서 실험 및 운영을 통해 본 시스템의 안정성을 검증하였으며, 검증된 결과를 통해 차량(트레일러) 및 터미널의 생산성을 극대화 및 물류비용을 절감이 발생할 것으로 사료된다.
본 논문에서는 핀 다이오드를 사용하여 4중 대역(GSM900/GSM1800/GSM1900/UMTS)을 포함하는 휴대폰 용 재구성 안테나를 제안하였다. 제안한 안테나의 크기는 $45{\times}11{\times}6mm^3$이다. 안테나 패턴 위에 위치한 두 개의 핀 다이오드를 독립적으로 조절하여 다이오드가 on/off 됨에 따라 각각 Planar Inverted-F Antenna(PIFA) mode와 loop mode로써 동작하게 하였다. 재구성 안테나의 설계를 검증하기 위해 핀 다이오드 대신 conducting tape을 사용하여 prototype을 설계, 제작, 실험하였다. 제작한 재구성 안테나에서 PIFA 모드로 동작할 때의 측정 결과는 7 dB 대역폭이 8.62 %(880~960 MHz)이며, GSM900(880~960 MHz) 대역을 포함한다. Loop 모드로 동작할 때의 측정결과는 7 dB 대역폭이 26.36 %(1,696~2,240 MHz)로 GSM1800(1,710~1,880 MHz)/GSM1900(1,850~1,990 MHz)/UMTS(1,920~2,170 MHz)대역을 포함한다.
본 논문에서는 $0.11{\mu}m$ CMOS 공정을 이용한 900 MHz 대역의 RFID 통신 수신단을 제안한다. 본 RFID 수신단은 포락선 검출기와 저역 통과 필터, 비교기와 D-플립플롭, 그리고 디지털 블록의 클록을 공급하기 위한 발진기가 집적된 형태이며, 저전력으로 구동하도록 설계하여 수동 RFID 통신용 태그에 적합하게 하였다. 본 수신단은 종래의 아날로그 데이터 슬라이서가 아닌 디지털 데이터 슬라이서를 사용함으로써 전력 소모를 줄였다. 클록의 주파수는 1.68 MHz이고, 소비전력은 $5{\mu}W$이며, 제작된 회로의 크기는 측정 패드를 제외하고 $325{\mu}m{\times}290{\mu}m$이다.
본 논문에서는 50%의 duty cycle 출력을 가지며, 디지털 방식으로 분주수를 제어할 수 있는 새로운 분주기 구조를 제안하였다. 그리고 0.25$\mu\textrm{m}$ 2-poly, 5-metal CMOS 공정 파라미터를 이용한 HSPICE 모의실험을 통해서 제안한 주파수 분주기를 이용한 900MHz 주파수 합성기를 설계하였다. 제안한 주파수 분주기의 동작은 0.65$\mu\textrm{m}$ 2-poly, 2-metal CMOS 공정을 사용하여 제작한 칩을 측정하여 확인하였다. 설계한 전압제어발진기(VCO)는 2.5V 전원전압 하에서 900MHz의 중간주파수, $\pm$10%의 동작 범위, 154MHz/V의 이득을 가진다. 또한 모의실험 결과 주파수 합성기의 settling time은 약 $1.5\mu\textrm{s}$이고, 짝수와 홀수 분주시 50%의 duty cycle과 820MHz~1GHz의 동작 주파수 범위를 갖으며, 전력소모는 대략 70mW임을 확인하였다.
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[게시일 2004년 10월 1일]
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