본 논문은 루프필터 전압 감지기와 주파수 전압 변환기를 이용하여 잡음 특성을 개선한 위상고정루프의 구조를 제안한다. 루프 필터 전압 변화는 저항과 커패시턴스로 구성된 회로에 의해서 출력이 결정된다. 시정수 값이 작은 회로를 지나는 신호는 루프 필터의 평균 출력 전압과 거의 같은 값을 가진다. 시정수 값이 큰 회로를 지나는 신호는 루프 필터 평균 출력 값을 가지며, 추가된 루프필터 전압 감지기에서 기준 신호가 된다. 루프필터 전압 감지기 출력은 보조 전하펌프의 전류 크기를 제어한다. 루프 필터 출력 전압이 상승하면 루프필터 전압 감지기는 루프 필터 출력 전압을 하강하게 하고, 또는 루프 필터 출력 전압이 하강하면 루프필터 전압 감지기는 루프 필터 출력 전압을 상승하게 한다. 또한 주파수 전압 변환기도 필터 출력 전압 변동 폭을 줄여주어 제안된 위상고정루프의 잡음 특성을 개선해준다. 제안된 위상고정루프는 1.8V 0.18㎛ CMOS 공정을 이용하여 설계한다. 시뮬레이션 결과는 0.854ps 지터와 30㎲ 위상 고정 시간을 보여준다.
본 논문에서는 출력단에 외란이 존재하는 수위 제어 시스템을 안정화하는 제어기를 제안하였다. 출력단의 외란의 효과를 감소시키기 위하여 여러 기법들이 제안되었지만 시스템에 존재하는 시간지연으로 인해 기대한 만큼 제어성능이 나오지 않고, 시간지연을 해석하기도 쉽지 않다. 이런 문제를 해결해보고자 PI 제어기에 필터를 도입해서 외란의 영향을 감소시키고, 외란관측기(Disturbance Observer)를 추가로 적용하여 출력단 외란의 영향이 감소되는 것을 검증하였다. 제안된 제어기는 MATLAB 시뮬레이션을 이용하여 성능을 검증하였다.
PMOS집적기술을 이용하여 512-Bit mask programmable ROM을 설계하고 제작하였다. ROM의 내용은 제작공정에서 gate pattern으로 기억시켰으며 chip의 출력을 512(32×16)개의 점의 행렬로써 오실로스코프에 나타내어 확인하였다. 제작된 chip은 -6V와 - l2V의 범위에서 정상적으로 동작하였다 소모전력과 전달지연시간은 -6V에서 각각 3mW와 13μsec였다. -12V에서는 소모전력이 27mW로 증가하였으며 전달지연시간은 3μsec로 감소하였다. Chip의 출력은 TTL gate의 인력을 직접 구동시킬 수 있었으며 chip select에 의하여 출력을 disable 시켰을 때는 높은 임피던스 상태를 유지하였다.
파장가변형 광섬유레이저로 광섬유격자 센서어레이를 복조하는 방법을 제안하였다. 레이저의 출력파장을 시간지연 샘플링으로 분석하고 이를 이용하여 기존 시스템의 비선형적 동작특성을 개선하였다. 계산된 파장값은 센서어레이 출력파평의 각 피크에 할당되어 파장가변필터의 비선형성에 영향받지 않고 가해진 물리량에 대하여 항상 선형적인 출력을 얻게 하였다. 실험을 통하여 약 20 pm의 분해능을 얻었으며 이는 고속의 위상변조를 사용할 경우 크게 개선될 수 있음을 보였다.
본 논문에서는 유한 차분 시간 영역(FDTD, Finite Differential Time Domain)법과 완전 정합층(PML, Perfectly Matched Layer) 방법을 이용하여 반도체 다층 배선이 평행하게 인접하거나, 교차하면서 인접하는 구조뿐 아니라. 평행하게 인접하면서 다른 평면상에 두 배선이 존재하는 3차원 다층 배선 구조에 대한 컴퓨터 수치 분석 방법을 보고한다. 평행한 인접 배선 구조에서는 수평 거리를 변화시키면서 출력 결과를 비교하였으며, 교차한 인접 배선 구조에서는 수직 거리를 변수로 하여 시간 영역과 주파수 영역에서의 출력 결과를 정량적으로 비교하였다. 또한, 평행하게 인접하면서 다른 평면상에 두 배선이 존재하는 3차원 다층 배선 구조에 대해서는 수평 거리와 수직 거리를 각각 변화시켜 가면서 출력되는 누화 특성을 측정하고 비교하였다.
Many processing times for fabricating complex shaped parts by near net shape process such as thixoforming or semi-solid forming, are required due to the time for die design, induction heating and forming process. Therefore, for the thixoforming process, multi-capacity induction heating process is very important due to the reduction of the processing time and cost. It is indispensable to adopt a power-time heating pattern which manages to conciliate complete eutectic melting at the core with limited overheating at the periphery. The total reheating time is thus dependent on billet diameter; in inches$(pm20%)$. Typically, high frequency is used for the rapid reheating of the billet to the eutectic temperature range and low frequency for the remelting of the desired fraction of liquid and for the radial homogeneization of the liquid fraction. So in this study, the multi-capacity induction heating conditions of ALTHIX 86s alloy to reduce the processing time and cost would be proposed. The suitability of multi-capacity induction heating conditions would be verified through the comparison to Garat's data.
태양광 시스템의 발전량의 증가로 인하여 높은 전위차에 의한 새로운 형태의 태양전지 모듈의 열화 및 출력 감소가 보고되고 있다. Potential induced degradation (PID) 이라고 불리는 이 현상은 고 전위차가 모듈을 구성하는 태양전지와 프레임 사이에 인가되며 발생하는 열화 현상이다. PID의 발생은 태양전지와 프레임 사이의 누설 전류의 크기를 통하여 간접적으로 설명이 되고 있다. 그리고 PID의 해결 방법으로 이 누설 전류를 줄이기 위하여 모듈의 구성 재료를 변화시키는 연구가 보고되고 있다. 하지만 아직 누설 전류와 출력 감소의 연관성에 대한 설명이 부족하고 정확한 발생 원인은 밝혀지지 못한 상황이다. PID가 발생된 이후 태양전지에 발생된 변화를 관찰하기 위하여 항온, 항습 챔버와 고전압 발생 장치에서 PID 시험을 하였다. 서로 다른 두 종류의 태양전지를 사용하여 시간에 따른 PID 현상의 차이점을 살펴보았고 출력 변화를 light IV로 관찰하였다. 또한 시간에 따른 모듈의 전기적 특성의 변화는 dark IV와 electroluminescence (EL)를 이용하여 측정하였다.
한정된 무선자원에서 CDMA 방식의 초고속 이동멀티미디어 통신서비스를 제공하기 위해서는 대역사용효율을 높힐 수 있는 방안이 필요하다. 본 논문에서는 실수 이진 데이터가 입력되는 Binary input Multi Carrier-CDMA전송구조의 IFFT처리부에서 출력 심볼 파형이 대칭성을 갖는 점을 이용하여 중복된 출력 심볼파형의 1/2만을 본래 출력 심볼파형의 시간폭에 맞게 시간 확장을 하므로서 기존 전송대역폭의 1/2대역폭으로 신호전송이 가능한 구조를 제시하였다. 본 방식은 동일 대역폭 사용조건하에서 DS-CDMA방식에 비해 처리이득이 4배 높아지며 그에 따른 성능이 제시되었다.
본 논문은 임의의 입력지연을 갖는 Takagi-Sugeno (T-S) 퍼지 시스템의 관측기 기반 출력궤환 제어 시스템을 논의한다. 설계된 연속시간 T-S 퍼지 관측기 시스템을 영차의 샘플/홀드 함수를 이용하여 이산시간 관측기를 설계한다. 이때 플랜트와 관측기의 출력에러가 제어기를 통하여 궤환되기 때문에 이산화 과정에서 발생한 에러를 보정할 수 있다. 여기에서 시스템의 제어 입력은 임의로 변화하는 유한개의 상태를 갖는 마코프 확률과정으로 표현한다. 생성된 시스템의 확률적 안정 가능성 조건은 선형 행렬 부등식의 형태로 표현한다. 이러한 결과를 2자유도 헬리콥터의 모델에 대한 모의실험을 통하여 효용성을 확인한다.
항공전자 시스템은 유지비용 감소 및 운용성능 향상을 위하여 기능을 모듈화, 통합화 설계를 적용한 모듈 통합형 항공 전자 시스템으로 개발 되어지고 있으며, 다양한 임무 제어 수행을 위해서 가상화 기술을 적용한 파티셔닝 운용체제를 적용 하고 있다. 가상화 기술을 적용 할 경우 CPU 처리 부하 분배는 중요한 고려 대상이며, 특히 입출력 처리 시간에 대한 불확실성은 안정성 있는 항공전자 시스템 설계에 있어 위험 요소 중 하나이다. 본 논문에서는 유즈케이스를 통해 입/출력 처리 방식에 따르는 CPU 처리 부하량을 비교 분석하여 공간적/시간적 파티셔닝 예시에 적용함으로써 입/출력 처리 방식의 영향성을 검토하고자 한다.
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[게시일 2004년 10월 1일]
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