This paper proposes a modified converter topology from the existing loaded resonant converter and describe the development of 10kW(50~500V, 0~ 50A) DC/DC Converter using the proposed topology. The suggested converter, which revised the topology of the converter operating on the CCM(Continuous Conduction Mode) (above resonance), has the advantage of enhancing the efficiency of rated load operation by rapidly increasing the primary side resonant current and by improving the resonance current in a trapezoid shape. The proposed topology is described with analysis of operating mode and designed using PSpice simulation and the points on design to consider when implementing the topology are described. It is verified that the advantages of the proposed topology centered on rated load are effectively highlighted. Experimental results carried out at different condition and its results shows 98.5% efficiency at full load condition.
최근 고유가 시대에 따른 대체 에너지기술 분야에 대한 관심과 함께 저전력 소비형 전자기기의 동력원으로서 열전발전기술이 주목받고 있다. 열전발전 기술을 이용하여 산업폐열원 등에서 전력을 생산하기 위해서는 폐열원의 열적 분포특성이 우선적으로 검토, 평가되어야 한다. 그 이유는 일반적 산업폐열원의 경우 발전소자가 설치될 열원에서의 열 분포가 실험실 조건에서와 같이 일정면적에서의 균일 열량조건을 만족시키기는 어렵고 국부적 불균일 열 분포를 나타낼 가능성이 매우 높기 때문으로, 이같은 불균일 열원특성은 열전모듈의 직렬연결을 기본으로 하고 있는 열전 발전시스템의 발전능에 직접적 영향을 미치게 되기 때문이다. 따라서 불균일 열원특성에 따른 열전 발전능의 평가는 열전발전기 전체의 발전능을 평가하는 매우 중요한 인자이다. 본 연구에서는 Bi-Te계 열전발전모듈을 이용하여 열편차 조건에서의 열분포 특성 및 열전달 특성변화를 조사하고 이것에 따른 단위발전소자의 발전특성 변화를 규명 하고자 하였다.
This paper describes a transformerless static synchronous campensator (STATCOM) system based on cascade H-bridge multilevel inverter with star configuration. It is designed not only for the dynamic and continuous compensation of the reactive power but also for the improvement of power quality of existing wind power plant. Especially, when the induction generator of wind turbine is directly connected to the grid, reactive power are occurred by exiting current. so a reactive power compensation system based on the cascade H-bridge multilevel STATCOM is proposed because the output power quality and controllability of reactive power are required by grid code in many different countries. Using various The proposed reactive power control strategy using a STATCOM is compared with the conventional scheme using fixed-size of capacitor bank through various simulation results.
The charge redistribution digital-to-analog converter(CR-DAC) is often used for successive approximation register analog-to-digital converter(SAR ADC) that requiring low power consumption and small circuit area. However, CR-DAC is required 2 to the power of N unit capacitors to generate reference voltage for successive approximation of the N-bit SAR ADC, and many unit capacitors occupy large circuit area and consume more power. In order to improve this problem, this paper proposes SAR ADC using series capacitor DAC. The series capacitor DAC is required 2(1+N) unit capacitors to generate reference voltage for successive approximation and charges only two capacitors of the reference generation block. Because of these structural characteristics, the SAR ADC using series capacitor DAC can reduce the power consumption and circuit area. Proposed SAR ADC was designed in CMOS 180nm process, and at 1.8V supply voltage and 500kS/s sampling rate, proposed 6-bit SAR ADC have signal-to-noise and distortion ratio(SNDR) of 36.49dB, effective number of bits(ENOB) of 5.77-bit, power consumption of 294uW.
본 논문은 복수개의 스위칭모드 전원장치를 병렬 결선을 통하여 부하에 보다 큰 전력을 공급가능하게 하는 시스템 설계에 관한 것이다. 이를 위해 정전압조정기의 출력단에 션트저항을 직렬로 배치하고 아두이노를 이용하여 출력단 전압을 감지하고 제어하도록 하였다. 본 논문에서는 실험을 위해 두 개의 정전압조정기를 이용하였으나 그 이상의 보드에 대해서도 일반화가 가능할 것이다. 이와 같은 방식으로 제어되는 시스템을 통해 두 개의 시스템이 부하에 전달되는 전류의 합이 각각의 보드에서 나온 전류의 96%가 부하에 전달되는 것을 확인하였다. 효율의 경우 단위 보드에서의 효율은 92.4% 정도가 나왔으며 병렬결선 시에는 90% 정도가 나왔다.
This study proposes a design methodology for bidirectional, series-resonant, dual-active bridge (SRDAB) converters. The circuit parameters of the SRDAB converters are designed by considering the output power and efficiency of the converter. The proposed method can be used to design a high-power, high-efficiency SRDAB converter. A voltage controller is employed to manipulate the output voltage of the converter, and the controller gains are selected using the transfer function and frequency response of the controller. Simulation results show that the output power of the designed SRDAB converter is 2 kW per converter module as designed. In addition, the performance of the voltage controller is evaluated using the simulation and experimental results. The output voltage follows the reference voltage within 10 ms under the step change of the reference command. The output voltage also follows the reference voltage under the step load change. The efficiency of the designed SRDAB converter is 95.6%.
마이크로스트?에 의하여 매직티를 평면상에 구성할 수 있는 방법을 제시한다. H-아암은 병렬회로로 구성되므로 직접 병렬구성을 하였으며, E-아암의 직각결합은 이 마이크로스트릴 회로 마운트에 공간을 형성하고 이 회로의 접지면에 겝을 이용하여 등지적으로 직렬결합이 되게 한다. 특히 E-아암의 겝에서 최대의 결합이 이루어지도록 개방 및 단락 스터브를 마이크로스트립으로 만들어 주었으며, 이때 E와 H-아암에 2:1이 되는 입퍼던스 정합기를 Chewshev 이계변환기로한 결과 S-Band에서는 각 아암에서 1.25보다 작은 VSWR을 얻었으며 분잡도는 -40dB 이하로써 이론치와 잘 일치하는 결과를 얻었다.
SiC 기반의 전력용 반도체 소자들은 스위칭 속도가 빠르고 높은 차단 전압을 가져 dv/dt가 크다. 중전압 이상에서 게이트 드라이버에 절연된 전원 공급을 하기 위해 소형 변압기가 사용된다. 하지만 변압기의 1, 2 차 권선 사이에 수십 pF 이상의 기생 커패시턴스가 존재하며, 높은 전압을 고속으로 스위칭 하게 될 경우 기생 커패시턴스를 통해 제어부로 공통 모드 전류가 흘러 오작동을 야기할 수 있다. 본 연구에서는 변압기를 대체하여 무선전력전송 코일을 이용한 게이트 드라이버용 절연된 전원공급 장치를 제안한다. 무선전력전송 코일 사이의 거리를 수 mm 이상 이격시켜 코일 사이의 기생 커패시턴스를 1 pF 이하로 줄이고 높은 절연 특성을 가질 수 있다. 무선전력 전송의 공진 토폴로지는 직렬-병렬을 선택했고, 2 MHz에서 높은 효율을 갖도록 I-core 코일을 2.2cm × 1.5cm × 1.7cm으로 제작해 검증했다.
본 논문에서는 위상 고정 루프 PLL(Phase Locked Loop)의 궤환 성질을 이용한 Ku-band(10.95-11.70GHz)용 위상고정 유전체 공진 발진기를 설계 및 제작하였다. 직렬 궤환형의 유전체 공진 발진기를 제작한 후, 발진기의 주파수를 전압 제어하기 위해 전압 가변 캐패시터로 작용하는 바랙터 다이오드를 사용하여 전압제어 유전체 공진 발진기를 구현하였다. 이와 같이 제작된 전압제어 유전체 공진 발진기에 샘플링 위상비교기를이용하여 위상고정 유전체 공진 발진기를 제작하였다. 위상고정 유전체 공진 발진기는 X-band 주파수 대역의 전압제어 유전체 공진 발진기 신호를 샘플링 위상 비교기를 이용하여 VHF 대역의 기준 신호에 위상고정시켜 높은 주파수 안정도를 얻는 것으로 유럽형 FSS(Fixed Satellite Service)를 위한 10.00 GHz를 구현하였다. 측정 결과 본 논문의 위상고정 유전체 공진 발진기는 전압제어 유전체 공진 발진기보다 높은 주파수 안정도를 보였으며, 10.00 GHz에서 출력전력 10 dBm 이상이었고 carrier로 부터 10 KHz 벗어난 점에서 -80dBc/Hz의 위상 잡음을 얻었다.
고속 메모리의 인터페이스를 위한 8 ${\times}$ 8-Gb/s/채널 4-레벨 펄스진폭변조 입출력회로를 1.35V의 공급전압을 가지는 70nm DRAM 공정을 이용하여 설계하였다. 4-레벨 펄스진폭변조를 위한 3 가지의 eye opening에서 상위와 하위 eye의 전압과 시간의 마진을 증가시키기 위해 비균형 4-레벨 펄스진폭변조의 신호전송 기법을 제안한다. 제안한 기법은 수신 단에서의 기준 전압 노이즈 영향을 33% 감소시키며, 이를 통계적인 수식을 통해 분석한다 일반적인 직렬 인터페이스 대비 신호 손실이 적은 DRAM 채널의 ISI(신호간의 간섭)를 줄이기 위해 수신 단에서 단일 비트 펄스의 테스트 신호를 적분함으로 ISI를 측정하는 적응형 프리앰퍼시스 기법을 구현한다. 또한, 이를 위해 정해진 테스트 패턴에 의해 최적의 ISI를 측정하기 위한 적분 클럭의 시간 보정기법을 제안한다.
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[게시일 2004년 10월 1일]
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