• 한국식품저장유통학회지
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• 제19권5호
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• pp.639-644
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• 2012

본 실험은 형광분광법을 이용하여 분말화된 대두의 산패도를 유지의 추출과정 없이 직접 측정하는 방법을 확립하기 위해 실시하였다. FST와, TBA test, 산가 측정법을 이용하여 $25^{\circ}C$와 $90^{\circ}C$에서 20일 동안 저장하면서 산패도에 따라 값을 비교하였다. $25^{\circ}C$에서 저장 기간 중의 산패도는 변화가 없음을 알 수 있었다. 모든 측정치들은 초기값에 비해 20일 후의 값이 크게 차이 없이 일정한 것을 알 수 있었다. 반면 $90^{\circ}C$에서는 FST의 경우 8일에서 11일 사이에 FI값이 크게 증가하는 경향을 보인 후 일정하게 값이 증가하는 경향을 볼 수 있었는데 TBA test에서는 0일에서 꾸준하게 증가하던 값이 다시 감소하는 것을 보였으며 이는 oleic acid와 linoleic acid의 함량이 높은 대두의 특징이라 할 수 있다. 본 연구에서 실험한 시료의 경우 산가는 FST와 같은 경향을 보여주었다. 본 연구의 중요한 결과는 FST를 이용하여 대두의 산패를 분말상에서 직접 측정하는 법을 확립한 것이며 이는 일반적으로 사용되는 TBA test와 산가를 이용한 직접측정법에 비해 측정시간이 빠르며 추출과정에 의한 오차를 최소화 할 수 있음을 보여주었다.

• 한국수자원학회논문집
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• 제38권4호
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• pp.271-280
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• 2005

본 연구의 목적은 기존 수위-유량곡선식에 내재되어 있던 발산과 처리 불능문제를 해결하기 위한 새로운 형태의 관계식($Q=p(h-e)^{\beta}-{\gamma}$)을 제안하고 그러한 수위-유량곡선식 산정모형을 개발하였다. 발산 문제는 영유량 수위 매개변수 e를 찾고 추정된 식의 총오차 값을 최소화하는 동안 승수 매개변수 ${\beta}$가 비정상적으로 커지는 것이다. 불능 문제는 e값이 계측 최소수위 이상의 값일 때 (h - e)값이 음수가 되어 로그값을 취하는 것이 불가능하다는 것이다. 이상의 두 가지 문제는 제어변수 ${\gamma}$를 도입함으로서, ${\beta}$를 감소시키는 효과와 "0" 이상으로 (h - e)를 제어할 수 있게 되었다. 본 연구에서는 물리적 분석과 민감도 분석을 통하여 수위-유량곡선식에서 매개변수 ${\gamma}$의 영향이 e 의 영향과 거의 같음을 보였다. 또한 개발된 WinCARD 시스템은 모든 수위국의 수문분석에 사용되는 기존 수위-유랑곡선식의 적합도를 평가하고, 하천유량 산정을 위한 신규 수위-유량곡선식을 작성하는데 활용될 수 있다.

• 한국건설관리학회논문집
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• 제14권5호
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• pp.35-43
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• 2013

최근 상당기간과 공사비를 최소화할 수 있는 비정형 건축물의 설계와 시공이 새로운 기술로 구현되고 있다. 이는 비정형 건축물의 최적화 설계와 부재화를 통한 공장 생산 시스템과 현장 조립 및 설치 기술로 가능하다. 비정형 건축물의 구현을 위한 연구가 진행되어 왔으나 여전히 비정형 건축물 시공은 설계오류와 시공자의 도면이해 부족, 시공경험 및 공법의 부재 등으로 인하여 시공 품질과 공기, 공사비 증가 등의 잠재적 리스크를 포함하고 있다. 비정형 건축물의 시공품질 향상과 공기단축 및 시공비 상승의 문제점을 해결하기 위한 3D 디지털 설계와 제작 기술을 적용하는 것이 중요하다. 이에 본 연구는 비정형 구조물의 시공성을 고려한 3차원 디지털 설계 최적화 프로세스를 제안한다. 궁극적으로 본 연구는 비정형 구조물의 구조검토, CNC(Computerized Numerical Control) 가공에 의한 부재의 정밀제작, 설치, 시공의 오차관리로 최적 시공의 근간이 되는 비정형 건축물 외피 시스템 구현을 위한 최적화 설계 프로세스를 제시한다.본 연구는 비정형 건축물을 구현한 사례를 살펴보고 디지털 설계 프로세스와 적용 프로그램을 살펴본다. 비정형 건축물의 설계도의 3D 디지털 데이터 구축과 디지털 최적화 구현 사례로 4대강 대표 물문화관(The ARC)을 중심으로 설계단계에서 적용된 최적화 기법을 순차적으로 분석하여 비정형 건축물의 3차원 좌표제어에 대한 방법론을 제시한다.

• 대한공간정보학회지
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• 제24권3호
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• pp.11-18
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• 2016

도심환경이나 좁은 골목길의 경우 건물 등의 장애물에 의해 GNSS 신호가 차폐되어 충분한 개수의 가시위성 확보가 어려운 난수신환경이기 때문에 측위가 불가능하거나 측위정확도가 저하되는 문제가 발생한다. 이 연구에서는 골목길 환경에서의 위치정확도 향상 기술을 개발하고 그 성능을 검증하였다. 먼저 관측자료를 선별하고 이상점을 제거하는 알고리즘을 적용하였으며, GPS/GLONASS 복합측위를 구현하였다. 또한 위성신호의 신호강도를 나타내는 SNR을 기반으로 다중경로 신호의 영향을 최소화하는 다중경로오차 저감 기술을 적용하였다. 개발 기술의 성능검증을 위하여 인하대학교 후문에 위치한 도로폭 10m 이내의 좁은 골목길을 테스트베드로 선정하였으며, 테스트베드 내의 4개 측점들을 대상으로 정지측위 및 이동측위를 실시하고 측위 정확도를 분석하였다. 그 결과 정지측위의 경우 개활지에서는 저가 장비인 u-blox를 사용하는 경우보다 3차원 RMSE가 평균 45% 향상되는 것을 확인하였으며, 골목길에서는 3차원 정확도가 평균 37% 향상되었다. 특히 이동측위의 경우 개발 기술을 통해 편의 없이 안정적으로 위치결정이 가능함을 확인하였다.

• 한국콘텐츠학회논문지
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• 제19권12호
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• pp.517-526
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• 2019

본 연구는 자동노출제어장치 사용 시 파라미터 조합에 따른 영상 화질과 방사선 출력을 분석하여 임상에 적용할 수 있는 최적의 방법을 모색하고자 하였다. 실험방법은 관전압 70, 81 kVp와 자동노출제어장치(Automatic Exposure Control, AEC)의 감도 S200, S400, S800, S1000을 조합해서 복부와 골반부의 입사표면선량, 관전류량, 신호 대 잡음비(Signal to Noise Ratio, SNR), 대조도 대 잡음비(Contrast to Noise Ratio, CNR), 시간-방사선량 곡선을 구하였다. 그 후 영상 화질과 출력의 안정성을 평가하였다. 그 결과 입사표면선량, 관전류량, 신호 대 잡음비, 대조도 대 잡음비는 관전압과 감도가 높게 설정될수록 감소하였다. 또한 관전압과 감도가 높게 설정될수록 시간-방사선량 곡선은 출력의 안정성이 줄어드는 양상을 보였다. 결론적으로 복부와 골반부 검사 시 관전압과 감도를 높게 조합할수록 검출기는 영상 화질과 방사선 출력을 정상적으로 재현해내지 못하였다. 따라서 비교적 낮은 관전압과 감도를 조합하여 검출기가 파라미터의 조합을 인식할 때 발생하는 오차 범위를 최소화해야 영상 화질과 방사선 출력의 안정성을 최적화할 수 있다는 것을 알 수 있었다.

• 한국인터넷방송통신학회논문지
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• 제15권3호
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• pp.99-105
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• 2015

본 논문에서는 nonconstant modulus 신호를 대상으로 채널의 찌그러짐에 의한 부호간 간섭을 보상하기 위한 MMA (Multiple Modulus Algorithm) 적응 등화기를 가변 적응 스텝 크기를 적용하지 않고 2단의 직렬 연결 형태로 구현하여 수렴 속도를 개선할 수 있는 mMMA (modified MMA)에 대하여 다룬다. 적응 등화기는 유한 차수의 탭 지연선에 의한 단일 디지털 필터로 구현되므로, 논문에서는 이를 2단의 직렬 연결 필터로 구현한 후 각 단에서는 MMA와 동일한 알고리즘으로 오차 신호를 얻은 후 필터 계수를 갱신하게 된다. 따라서 첫단에는 빠른 수렴 속도를 결정하며, 두 번째단에서는 첫단의 출력에 포함되어 있는 잔류 isi양을 최소화시키도록 탭 계수를 갱신한다. 이때 1단 시스템과 2단 시스템은 동일한 차수의 필터가 되도록 조정하면서 적응 등화 성능을 비교하였으며, 성능 비교를 위한 지수로는 등화기 출력 신호 성상도, 수렴 특성을 나타내는 잔류 isi, 최대 찌그러짐과 MSE, 채널의 신호대 잡음비에 따른 SER을 사용하였다. 시뮬레이션 결과 2단의 FIR 구조를 갖는 mMMA가 1단의 기존 MMA보다 등화 잡음에 의한 성상도를 제외한 모든 성능 지수에서 우월하며, 수렴 속도는 1.5~1.8배 정도 개선됨을 확인하였다.

• 대한전자공학회논문지SD
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• 제43권5호
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• pp.1-10
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• 2006

본 논문에서는, 1.8V 8-bit 500MSPS CMOS A/D 변환기를 제안한다. 8-bit 해상도, 고속의 샘플링과 입력 주파수, 그리고 저 전력을 구현하기 위하여 Cascaded-Folding Cascaded-Interpolation type으로 설계되었다. 또한 본 연구에서는 고속 동작의 문제점들을 해결하기 위하여 새로운 구조의 Digital Encoder, Reference Fluctuation을 보정하기 위한 회로, 비교기 자체의 Offset과 Feedthrough에 의한 오차를 최소화하기 위한 Averaging Resistor, SNR을 향상시키기 위한 Distributed Track & Hold를 설계하여 최종적으로 500MSPS의 A/D 변환기 출력 결과를 얻을 수가 있다. 본 연구에서는 1.8V의 공급전압을 가지는 $0.18{\mu}m$ 1-poly 5-metal N-well CMOS 공정을 사용하였고, 소비전력은 146mW로 Full Flash 변환기에 비해 낮음을 확인할 수 있었다. 실제 제작된 칩은 측정결과 500MSPS에서 SNDR은 약 43.72dB로 측정되었고, Static상태에서 INL과 DNL은 각각 ${\pm}1LSB$ 로 나타났다. 유효 칩 면적은 $1050um{\times}820um$의 면적을 갖는다.

• 대한전자공학회논문지SD
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• 제45권1호
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• pp.7-13
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• 2008

본 논문에서는 PMOLED(passive matrix organic light emitting diodes) 데이터 구동회로의 전류 편차를 보상하는 새로운 구조의 회로를 제안한다. 일반적인 PMOLED 데이터 구동 회로의 경우 MOS(metal oxide semiconductor) 공정 변화에 의해서 발생하는 데이터 구동 회로 출력단의 전류 편차는 보상 할 수 없으나, 제안된 데이터 구동회로는 출력단의 전류 편차를 보상하여 균일한 값의 전류를 OLED 패널(panel)에 인가 할 수 있다. 제안하는 회로는 종래의 데이터 출력 회로에 스위칭 트랜지스터를 추가하여 데이터 출력 전류용 회로를 공통 연결선에 연결함으로써 공정 변화에 의한 출력 전류의 편차를 최소화 할 수 있다. 제안한 회로는 $128(RGB){\times}128$의 해상도를 지원하는 PMOLED 패널을 기준으로 설계 하였고, 구동 회로 개발에 이용된 공정은 0.35um이다. 실험 결과 제안한 데이터 구동회로의 출력 전류는 1%대의 오차를 갖는 반면, 종래의 데이터 구동회로의 경우 출력 전류는 9% 대로 심한 변화를 나타내었다. 본 논문에서 제안한 PMOLED 데이터 구동회로를 이용할 경우 고화질의 OLED 디스플레이 구현이 가능하여 고 품위의 디스플레이 특성을 요구하는 휴대용 디스플레이 기기에 적용 할 수 있다.

• 한국전자파학회논문지
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• 제9권4호
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• pp.515-525
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• 1998

본 논문에서는 위성통신에서 단일 안테나로 송수신하기 위하여 12.5 GHz와 14.25 GHz 대역에서 각각 동작하 는 이중공진 안테나를 껄계 제작하고 특성을 살며보았으며, 이중 급천구조를 이용함으로써 기폰의 단일 급전 방 식 이중공진 안테나의 문제점인 송수신 신호의 분리 및 단일 편파 특성율 보완하였다. 이중급전 안테나의 방사소 자 경우 방사체의 폭과 길이는 각각의 단일 공진 안테나의 길이가 되고, 급전선의 청합의 경우에는 상대 급천선 에 의한 임피던스의 변화를 최소화시켰다. 또한 이를 배열 안테나로 확장시 공간상의 문제를 해결하기 위해서 마 이크로스트립선로와 동축선로를 혼합한 급전방식을 사용하여 이차원 $2\times2$ 배열 안테나를 껄계 제작하고 방사때 턴 및 주파수 특성 동을 측정하여 두 공진 주파수로 각각 사용 가능함올 확인하였다. 측정된 결과를 살펴보면 공진주파수는 셜계치에서 1.44 % 이하의 오차를 보였으며, 반사손실의 경우 -21 dB 이하의 값올 나타냈으며, 두 포트간 격리도는 또한 -21 dB 이하의 값올 나타냈다. 측정된 방사때턴으로부터 계 산된 directivity는 12.23 dBi를 나타냈으며, 사이드로브 레벨은 elevation 명면은 -12 dB 이하, azimuth 명면 은 -15 dB를 이하의 값을 나타냈다. 또한 교차 편파특성의 경우 elevation 명면과 azimuth 평면 모두 -17 dB 이하의 값을나타냈다.

• 정보처리학회논문지A
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• 제11A권2호
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• pp.195-202
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• 2004

본 연구에서 매우 정밀한 샘플링을 필요로 하는 고해상도 비디오 응용면을 위하여 병렬 파이프라인 아날로그 디지털 변환기(ADC)를 설계하였다. 본 ADC의 구조는 4 채널의 10-비트 파이프라인 ADC를 병력 time-interleave로 구성한 구조로서 이 구조에서 채널 당 샘플링 속도의 4배인 200MS/s의 샘플링 속도를 얻을 수 있었다. 변환기에서 핵심이 되는 구성요소는 Sample and Hold 증폭기(SHA), 비교기와 연산증폭기이며 먼저 SHA를 전단에 설치하여 시스템 타이밍 요구를 완화시키고 고속변환과 고속 입력신호의 처리론 가능하게 하였다. ADC 내부 단들의 1-비트 DAC, 비교기 및 2-이득 증폭기는 한 개의 switched 캐패시터 회로로 통합하여 고속동작은 물론 저 전력소비가 가능한 특성을 갖도록 하였다. 본 연구의 연산증폭기는 2단 차동구조에 부저항소자를 사용하여 높은 DC 이득을 갖도록 보강하였다. 본 설계에서 각 단에 D-플립플롭(D-FF)을 사용한 지연회로를 구성하여 변환시 각 비트신호를 정렬시켜 타이밍 오차를 최소화하였다. 된 변환기는 3.3V 공급전압에서 280㎽의 전력소비를 갖고 DNL과 INL은 각각 +0.7/-0.6LSB, +0.9/-0.3LSB이다.