The study was to investigate the effects of stimulus velocity and passer's skill level on anticipation timing performance. Fourteen subjects(seven novices and seven experts) were required to make a total 12 passes in coincidence with an experimentally manipulated moving light signal in randomly presented three different conditions(4m/s, $3m/s{\rightarrow}5m/s$, $5m/s{\rightarrow}3m/s$). Results of analyses showed that absolute error(AE) and constant error(CE) were greater in constant acceleration of the moving stimulus. In addition, experts were more accuracy and consistency than novices on absolute, constant and variable error(VE). These findings indicated that stimulus velocity served as the major determination of anticipation timing performance of passing.
This study was performed to investigate the effects of receiver's moving speed and pass types on anticipation timing response. Ten subjects were required to make a total of 24 passes in coincidence with an experimentally manipulated moving light signal in randomly three different conditions by performing chest and bound pass. Results of analyses revealed AE, CE, and VE increased as moving velocity became constant-acceleration condition. In addition, chest pass was more accuracy and consistency than bound pass on AE and CE. These findings indicated that moving velocity and pass type served as the major determination of coincident timing response on passing in basketball.
KIPS Transactions on Computer and Communication Systems
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v.8
no.3
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pp.57-64
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2019
In this paper, an efficient prediction-based parallel simulation method using spatially partial simulation strategy is proposed for improving both the performance of the event-driven gate-level timing simulation and the debugging efficiency. The proposed method quickly generates the prediction data on-the-fly, but still accurately for the input values and output values of parallel event-driven local simulations by applying the strategy to the simulation at the higher abstraction level. For those six designs which had used for the performance evaluation of the proposed strategy, our method had shown about 3.7x improvement over the most general sequential event-driven gate-level timing simulation, 9.7x improvement over the commercial multi-core based parallel event-driven gate-level timing simulation, and 2.7x improvement over the best of previous prediction-based parallel simulation results, on average.
주식 시장을 예측하는 문제는 금융 분야에서 중요한 관심이 되어왔다. 주식 시세는 시장 환경의 변화에 따라 급격한 변화를 갖는다. 따라서 주식 투자로부터 이윤을 창출하기 위해서 주식을 사고 파는 시점을 결정하는 문제는 중요하다. 본 연구에서는 주시 매매 타이밍을 예측하기 위해서 캔들스틱 차트(Candlesticks chart)분석을 이용한 전문가 시스템(Expert System)으로서 '차트 해석기 (Chart Interpreter)'를 설계, 개발하였다. 주식 가격의 변동을 예고하는 패턴들을 정의하고 그 패턴들의 의미에 따라 매미결정을 첨가한 규칙을 생성하였다. 정의된 패턴들은 의미에 따라 크게 하락형, 상승형, 중립형, 추세지속형, 추세 전환형으로 분류된다. 정의된 패턴과 지식베이스의 유용성을 검증하기 위해서 수행된 1992년부터 1997년에 걸친 과거 한국 주식 시장 실거래 투자 데이터에 대한 실험결과는 평균 투자 성공률이 약 72%로서 주식시장에서 투자자들의 투자를 돕는데 우수한 지표로서 사용될 수 있음을 보였다. 또한, 개발된 지식베이스는 특정 연도나 특정 분야에 따라 예측력이 크게 변하지 않은 시간 독립적이고 분야 독립적인 특성을 가짐으로 분야나 시간에 구애받지 않고 사용할 수 있다는 장점을 갖는다.
KIPS Transactions on Computer and Communication Systems
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v.5
no.12
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pp.439-446
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2016
In this paper, an efficient prediction accuracy enhancement strategy is proposed for improving the performance of the prediction-based parallel event-driven gate-level timing simulation. The proposed new strategy adopts the static double prediction and the dynamic prediction for input and output values of local simulations. The double prediction utilizes another static prediction data for the secondary prediction once the first prediction fails, and the dynamic prediction tries to use the on-going simulation result accumulated dynamically during the actual parallel simulation execution as prediction data. Therefore, the communication overhead and synchronization overhead, which are the main bottleneck of parallel simulation, are maximally reduced. Throughout the proposed two prediction enhancement techniques, we have observed about 5x simulation performance improvement over the commercial parallel multi-core simulation for six test designs.
Proceedings of the Korean Information Science Society Conference
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2003.10a
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pp.202-204
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2003
EISC ISA를 기반으로 한 64 비트 고성능 내장형 마이크로프로세서 AE64000의 효과적인 성능 향상을 위해서 비용 대비 성능 향상이 우수한 분기 예측 기법을 도입하여 AE64000 파이프라인에 적합한 분기 예측기를 추가로 설계하고 SPEClnt 벤치마크 및 타 내장형 벤치마크의 성능 분석 시뮬레이션을 통해 최적의 분기 예측기의 구조를 결정하였다. AE64000에서 LERI 명령 처리를 위해 AE64000 파이프라인에 추가된 독특한 IFU에 의하여 복잡성을 갖지만, IF 단계의 PC 대신에 IFU 단계의 PrePC를 이용하여 분기 명령을 명령어 prefetch 단계에서 예측함으로써, 올바른 분기 예측시 분기로 인한 손실을 제거할 수 있다. 결과적으로 최종 선정된 최적의 분기 예측기는 Verilog로 구현하여 AE64000 프로세서 코어 모델과 통합 합성하였고 아울러 추가되는 면적과 최종 목표 클럭에 동작하기 위한 타이밍 분석을 통해 최종 생산에 적합하도록 설계된 분기 예측기의 기능 및 타이밍 검증을 수행하였다. 최종 구현된 분기 예측기는 프로세서 칩 전체의 1% 미만의 비용으로 최고 12%의 성능 향상을 달성하여 성능 대비 면적의 효율성에서 높은 결과를 보였다.
The Journal of Korean Institute of Communications and Information Sciences
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v.32
no.4C
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pp.355-361
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2007
In this paper, the hop-timing estimator, which NED and ELF are adopted to, has been proposed. The estimation performance of the proposed scheme and the conventional scheme is compared through computer simulations. The simulation results show that the new system has less hop-timing error than the conventional system in partial band noise jamming channel. The lover Eb/Nj and ratio of jamming bandwidth(rho) we, the bigger performance enhancement of the proposed system is.
Journal of the Korean Institute of Telematics and Electronics C
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v.36C
no.8
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pp.1-9
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1999
Timing-level circuit analyses are used to obtain fast and accurate results, and the analysis of gate and interconnect delay is necessary to validate the correctness of circuit design. This paper proposes an efficient algorithm which simultaneously calculates the gate delay and the transition time of linearized voltage source for subsequent interconnect delay calculation. The notion of effective capacitance is used to calculate the gate delay and the transition time of linearized voltage source which considers the on-resistance of driving gate. The procedure for obtaining the gate delay and the transition time of linearized voltage source has been developed through an iterative operation using the precharacterized data of gates. While previous methods require extra information for the transition time calculation of linearized voltage sources, our method uses the derived data during the gate delay calculation process, which does not require any change in the precharacterization process.
Journal of the Korean Society for Aeronautical & Space Sciences
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v.38
no.10
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pp.979-984
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2010
The users who use a combined GPS/Galileo receiver will benefit from an improved availability of the combined system and a reduced dependence on one particular positioning system. However, these users must solve the problem of an offset between the time scales of GPS and Galileo (GGTO). GGTO must be analyzed for not only a navigation system but also a timing system requesting precise time service. This paper analyzes the interoperability problem in a combined GPS/Galileo timing receiver and estimates the timing performance under various assumptions. The GPS real measurements were collected by using the commercial timing receiver from Ashtech Ltd. and the Galileo measurements were generated by a simulation software. A suitable test scenario set-up and the performance in a point of timing stability was evaluated.
Journal of the Korea Institute of Information and Communication Engineering
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v.15
no.8
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pp.1727-1734
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2011
In this paper, a position control scheme of the ink droplet is presented for the high image quality and print speed ink jet printer. The proposed scheme estimates the impact position and compensates it by control of the jet strobe time based on the dynamic equations describing the moving trajectory of the ejected ink droplet. Compared to the conventional jet strobe control which is based on the simple synchronization with the position signal of the ink jet nozzle, the proposed control scheme provides more accurate impact position control while the carrier is moving with accelerated or decelerated speed as well as steady state speed with fluctuations. The availability of printing during the acceleration and deceleration states of the carrier moving enables the print speed up and the frame size down which means the cost down.
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[게시일 2004년 10월 1일]
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