본 논문은 결정 궤환(Decision Feedback) 기반 차동 위상 검출 방식인 DF-DPD와 DPD-RGPR의 성능이 차동 복호(Differential Decoding)를 갖는 동기 검출 (Coherent Detection) 방식의 성능에 근접한다는 것을 수치적으로 증명한다. M-ary DPSK에 대한 기존 차장 위삼 검출 빙식은 수신기 구조를 간단하게 만들지만, 참조 위상으로 활용되는 이전 심볼에서의 잡음 성분으로 인해 열화된 수신 성능을 갖는다. 기존 차동 검출 방식의 수신 성능을 향상시키기 위해 DF-DPD, DPD-RGPR 등을 포함하는 다중 심볼 차동 검출 방식들이 제시되었다. 하지만, 이러한 방식들의 검출 성능에 대한 분석 및 비교에 대한 연구는 거의 진행되지 않았다. 그러므로, 본 논문에서는 DF-DPD와 DPD-RGPR 등의 결정 궤환 기반 차동 위상 검출 방식들의 성능을 수치적으로 분석한다. 수치적 분석 결파, 결정 궤환을 갖는 차동 위상 검출 방식들은 차동 복호를 갖는 동기 검출의 성능에 근접할 수 있으며 향상된 성능을 갖는 비동기 검출 (Noncoherent Detection)에 활용될 수 있음을 볼 수 있었다. 하드웨어 복잡도를 고려하면, 검출 길이가 증가함에 따라 복잡도가 증가하는 구조에 기반한 DF-DPD 방식보다 반복적으로 갱신되는 참조 위상을 사용하는 검출 방식에 기반한 DPD-RGPR 방식이 구현에 더욱 효과적임을 알 수 있었다.
본 논문에서는 cdma2000 규격을 채용한 역방향 링크 동기식 DS-CDMA 시스템을 시뮬레이션 하여 시스템의 성능을 분석하였고, 파일롯 채널과 정보 채널 즉, 기존의 트래픽 채널간의 최적 전력비를 구하였다. cdma2000 시스템은 기존의 IS-95와는 달리 파일롯 채널을 이용하여 페이딩 채널을 추정하고 이를 이용하여 채널 환경에 의한 수신신호의 위상변화를 보강해 준다. 채널 추정길이 31pcg 심볼에서 파일롯 채널과 트래픽 채널의 최적 전력비를 구하였다. 또한 시스템에 전력 제어를 적용하여 목표 FER을 만족시키기 위한 required Eb/No를 구하였고, 다중의 사용자가 고속의 데이터를 동시에 전송할 때의 성능을 분석하였다.
본 논문에서는 OFDM 시스템의 시간 오차와 주파수 오차를 추정하는 방안을 제시하고 있다. 제안한 동기 알고리즘은 수신 신호의 순환상괸(cyclic correlation)을 이용하며, 이 순환상관에는 시간과 주파수 오차 정보가 모두 나타나게 된다. 따라서 제안하는 추정 알고리즘은 여분의 학습심볼(training symbol)를 필요로 하지 않으며, 채널의 정보를 사용하지 않는다. 제안한 추정 방법은 평균자승오차(mean square error) 성능에서 잡음이나 채널의 특성에 상관없이 거의 일정한 성능을 가지며, 실험 결과는 이러한 특징을 뒷받침 해주고 있다. 좀 더 정확한 추정을 위해서, 순환 상관을 평균을 취하는 방법이 적용되었다. 이 경우, 평균을 취하는 방법은 평균을 취하지 않는 방법보다 훨씬 더 정확한 추정을 가능하게 한다.
본 논문은 대역폭에 제약을 받지 않는 우주 통신용에 사용할 목적으로 도플러에 강인한 저 전력 비동기 FSK 수신기를 FPGA로 구현한 논문이다. 사용한 비동기 FSK 수신기는 심볼 검출을 하기 위해 16점 FFT를 이용하며 데이터의 주 속도는 10kbps이고 도플러에 강인하고 전력 효율과 신뢰성을 얻기 위해 디지털 회로로 설계된다. 또한 CORDIC 알고리듬을 이용하여 FFT 연산 시 사용되는 복소 승산을 가산기 및 천이기로 대체하여 저전력화 하였다. 설계 시스템의 검증을 하기 위해 먼저 Simulink로 시뮬레이션 하여 성능을 확인하고Xilinx사의 System Generator를 이용하여 FPGA 구현하여 성능을 비교 검증하였다. 결과적으로 Simulink 결과와 FPGA 구현 결과가 표6과 표7에 의해 잘 일치함을 확인하였다.
DVB-S2 (Digital Video Broadcasting - Satellite Version 2)와 같은 위성 통신 시스템은 낮은 신호 대 잡음 비 (SNR; Signal-to-Noise Ratio) 및 큰 주파수 오차에서의 동작이 요구되므로 인해 초기 프레임 동기 과정에서 강건한 프레임 동기 획득을 위한 상관 방식이 필요하다. 초기 프레임 동기 획득을 위해서는 기존의 다양한 상관 방식이 존재하며 채널 환경에 따라 이들 상관 방식은 각각 다른 특성 및 성능을 갖는다. 본 논문에서는 낮은 신호 대 잡음 비 영역 및 큰 주파수 오차 존재 하에서도 우수한 성능을 보이는 상관기 구조를 제시하고 그 성능을 분석 및 검증한다. 제안하는 상관 방식은 동기 수열 내에서 확장된 동기 심볼 거리에 대한 차등 상관의 크기 합과 벡터 합을 각각 이용하며, 계산된 상관값과 수신신호의 Euclidean 거리를 활용하므로써 수신 신호와 동기 수열의 상관도를 극대화하는 효과를 갖는다. 크기 합 상관 방식의 경우 4 dB 이하의 신호 대잡음 비에서 주파수 오차의 존재 유무에 관계없이 최대 우도 (ML; Maximum likelihood) 방식의 근사화를 통해 유도된 방식을 포함한 기존의 알려진 모든 상관 방식보다 향상된 오율을 가지며, 벡터 합 상관 방식은 주파수 오차 감소함에 따라 크기 합 상관 방식보다도 더욱 우수한 성능을 가진다.
본 논문에서는 3GPP(3rd Generation Partnership Project) LTE(Long Term Evolution) FDD(Frequency Division Duplexing) / TDD(Time Division Duplexing) 듀얼 모드 하향 링크 수신기를 위한 주파수 동기 알고리즘을 제안한다. 일반적으로 3GPP LTE OFDMA(Orthogonal Frequency Division Multiple Access) 시스템에서의 대략적 주파수 동기는 PSS(Primary Synchronization Signal)를 이용한 상관 방식이 적용되며, 미세 주파수 동기는 OFDMA 심볼의 보호 구간(CP: Cyclic Prefix) 상관 방식이 적용된다. 그러나 기존의 대략적 주파수 동기 알고리즘들은 페이딩 환경에서 상관 패턴의 열화와 잡음의 제곱으로 인한 SNR(Signal to Noise Ratio) 손실로 충분한 성능 이득을 얻지 못한다. 또한 주파수 분할을 통하여 양방향 송수신되는 FDD 모드와 달리 TDD 모드에서는 상향링크 구간과 하향링크 구간이 시분할로 전송되기 때문에 TDD 모드에서 기존 미세 주파수 동기 알고리즘은 상향링크와 하향링크의 신호 전력의 차이로 인해 안정적인 동작을 수행할 수 없다. 따라서 본 논문에서는 기존 방식의 문제점을 분석하고, 이를 기반으로 3GPP LTE FDD 모드뿐 아니라, TDD 모드에서도 안정적인 동작이 가능한 주파수 동기 알고리즘을 제안하였다. 다양한 환경에서의 컴퓨터 모의실험을 통해 제안된 주파수 동기 알고리즘은 기존 방식들에 비해 우수한 성능을 보이며, 3GPP LTE FDD/TDD 듀얼 모드 하향 링크 수신기에서 안정적인 동작이 가능함을 입증하였다.
OFDM시스템의 대안으로, SC-FDE시스템은 주파수 선택적 페이딩 환경에서 구현상의 복잡도가 크지 않으면서 낮은 PAPR로 다중 경로 지연에 의한 영향을 완화시키기 위한 기술로 연구되어 왔다. SC-FDE시스템에서 보호 구간으로 PN신호를 훈련 심볼(Training Sequence)로 둠으로써 CP에 비해 빠른 동기화와 채널 추정에 사용될 수 있는 장점이 있으며, 채널 추정을 위해 Correlation과 LMS기법을 동시에 적용함으로써 에러가 최소가 되기까지 수렴 시간을 줄일 수 있다. 본 논문에서는 PN시퀀스를 기반으로 추정한 채널 값으로, ISI를 효과적으로 제거할 수 있는 MMSE-FDE 등화 기법을 제안한다. SFN 채널 환경과 같이 스펙트럼 널이 강한 다중 경로 페이딩환경에서 ISI를 선 제거 하는 ISI cancellation 기법을 통해 정확한 SNR추정을 할 수 있고, 이를 통해 MMSE-FDE 등화 성능을 향상 시킬 수 있다.
This paper deals with a design of a symbol timing recovery circuit of QAM using the interpolation in AWGN channel. To reduce timing jitter and the amount of processing data, we employ MGA (Modified Gardner Algorithm) as a symbol timing error detector which is called NDA(Nondecision Directed Algorithm). We show the characteristics (S-curve and the variance) of timing error detector with the roll-off factor of a shaping filter, which are compared with GA. Also, we compare the BER curve of interpolation method with that of ideal case. The performance of the STR is shown to be close to that of ideal case. This result shows that this method can be useful to implement symbol timing recovery circuit for multi-level modulation.
In this paper, we propose a new architecture of the fast symbol timing synchronization system which has some shared hardware blocks in order to reduce the hardware complexity. The proposed system consists of received power detector, correlation power detector using shared complex moving adders, and 2-step peak detector. Our system has detected FFT starting point within three Symbols using first two reference symbols of the frame in wireless ATM system. The new architecture was designed and simulated using VHDL. Our proposed architecture also detects a correct symbol timing synchronization within three symbols under a multi-path fading channel.
ATSC 방식을 사용하는 DTV 수신기는 심볼 타이밍 동기를 맞추기 위해 77.3㎲마다 존재하는 세그먼트 싱크를 이용한 방법 또는 가드너 알고리즘을 사용한다. 이 중 가드너 알고리즘을 사용하는 방법은 다중 경로 채널 환경으로 인해 타이밍 옵셋이 발생한다. DTV 수신 채널 환경이 많은 수의 다중 경로 신호를 포함하고 있기 때문에 가드너 알고리즘을 사용한 DTV 수신기는 타이밍 옵셋이 발생한다. 이 타이밍 옵셋은 샘플링 순간을 잘못된 시점으로 옮기기 때문에 등화기의 성능이 열화된다. 다중 경로 채널 환경에서 등화기의 성능을 최적화하는 샘플링 순간은 주 경로 신호의 크기가 최대가 되는 점이다. 본 논문에서는 타이밍 옵셋 보상기를 사용하여 샘플링 순간을 주 경로 신호의 최대점으로 옮겨 타이밍 옵셋을 보상하고 등화기로 입력되도록 하여 DTV 수신 성능을 개선하였다. 타이밍 옵셋 보상기는 채널 상관기, 최대점 탐색기, 타이밍 보상용 보간 필터로 구성되어 있다. 타이밍 옵셋 보상기와 등화기를 연계 실험하여 성능 향상을 분석하였다.
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[게시일 2004년 10월 1일]
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