• The Journal of the Korea institute of electronic communication sciences
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• v.2 no.3
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• pp.163-167
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• 2007

In this paper, to design 8 bit RISC Microprocessor, a method of Clock Gating to reduce electric power consumption is proposed. In order to examine the priority, the comparison results of between a 8 bit Microprocessor which is not considered Low Power consumption and which is considered Low Power consumption using a methods of Clock Gating are represented. Within the a few periods, the results of comparing with a Microprocessor not considered the utilization of Clock Gating shows that the reduction of dynamic dissipation is minimized up to 21.56%.

• Proceedings of the Korea Information Processing Society Conference
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• 2016.10a
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• pp.158-161
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• 2016

모바일 기기의 발전과 함께 다양한 어플리케이션의 기능이 제공되면서 전력에 대해 효율적인 관리가 필요해졌다. 효율적인 관리를 위하여 모바일 디바이스에서의 전력 소모 원인을 분석해야만 한다. 그러나 기존 연구에서 사용되었던 안드로이드 프레임워크의 수정을 통한 전력 분석 방법은 개발에 대한 용이성이 낮은 단점이 존재하고, 프로파일링을 통한 전력 분석 방법은 각 디바이스 모델에 의존적인 단점이 존재한다. 따라서 본 논문에서는 기존 연구들의 문제점을 개선하기 위해서 안드로이드 프레임워크를 수정하지 않고 획득할 수 있는 프로세스와 서비스의 목록 정보를 통해 어플리케이션이 소모하는 전력에 대한 분석을 제안한다. 본 논문에서 제안하는 방법을 GPS를 사용하는 어플리케이션을 분석하기 위해서 적용해보았다. 이를 통해 사용자는 측정된 전력과 함께 해당 전력을 사용하고 있는 프로세스 및 서비스 목록을 확인 할 수 있다.

• Journal of Broadcast Engineering
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• v.10 no.2
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• pp.174-181
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• 2005

In this paper, we proposed new fast scattered pilot synchronization techniques to reduce the burst synchronization time for the DVB-H receiving system with robustness. DVB-H terminals employ a TDM system called 'Time-Slicing' to reduce power consumption. In order to fully exploit the potential power reduction, the synchronization time for the DVB-H receiver must be very short. A typical DVB-T system uses the TPS Synchronization to determine the position of scattered pilots which are used for channel estimation, and it takes 68 OFDM symbol time. In this paper, several new fast scattered pilot synchronization techniques are proposed.

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.45 no.11
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• pp.56-62
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• 2008

Modern microprocessors must deliver high application performance, while the design process should not subordinate power. In terms of performance and power tradeoff, the instructions window is particularly important. This is because a large instruction window leads to achieve high performance. However, naive scaling conventional instruction window can severely affect the complexity and power consumption. This paper explores an architecture level approach to reduce power dissipation. We propose a low power issue logic with an efficient tag translation. The direct lookup table (DTL) issue logic eliminates the associative wake-up of conventional instruction window. The tag translation scheme deals with data dependencies and resource conflicts by using bit-vector based structure. Experimental results show that, for SPEC2000 benchmarks, the proposed design reduces power consumption by 24.45% on average over conventional approach.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.34 no.2B
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• pp.151-161
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• 2009

The PULSE protocol can greatly reduce power consumption using a node's sleep state. But this protocol does not consider movement of a sink node in a sensor network. In the mobile sensor network a routing protocol must recover path error by movement of a sink node as quickly as possible. Therefore we have to achieve fast path recovery and power saving to support movement of a sink node in a sensor network. This paper proposes the Mobile PULSE protocol which is a improved routing protocol for a mobile sink node. And we evaluate Mobile PULSE and show that the Mobile PULSE reduces the recovery time about 40% compared with original PULSE protocol. Mobile PULSE increases energy consumption than PULSE as a maximum of 0.8%, which means Mobile PULSE is similar to PULSE in energy consumption. This paper shows mobile PULSE's capability in the mobile sensor network through evaluation of path recovery time and power consumption.

• The Journal of the Institute of Internet, Broadcasting and Communication
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• v.23 no.4
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• pp.23-28
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• 2023

In a wireless smart utility network communication system, an asynchronous low power MAC is standardized and used according to IEEE 802.15.4e. An asynchronous MAC called RIT (Receiver Initiated Transmission) has a characteristic in which delay time and power consumption are greatly affected by a check-in interval (RIT period). By waking up from sleep every check-in interval and checking whether there is data to be received, power consumption in the receiving end can be drastically reduced, but power consumption in the transmitting end occurs due to an excessive wakeup sequence. If an excessive wake-up sequence is reduced by shortening the check interval, power consumption of the receiving end increases due to too frequent wake-up. In the RIT asynchronous MAC technique, power consumption performance according to traffic load and operation of check-in interval is analyzed and applied to Wi-SUN construction.

• Proceedings of the Korean Information Science Society Conference
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• 2002.10c
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• pp.721-723
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• 2002

본 논문에서는 최근 수요가 급격히 증가하고 있는 FPGA의 전력 소모 특성을 분석하기 위해서 개발한 측성 시스템(SECF : Seoul National University Energy Characterizer FPGAs)의 구성 및 동작 방법을 설명하고 있다. 또한 이 시스템을 이용하여 몇 가지의 간단한 실험을 통해 FPGA 전력 소모 경향을 살펴보는 것을 그 목적으로 한다.

• Proceedings of the Korean Information Science Society Conference
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• 2004.04a
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• pp.937-939
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• 2004

최근 들어 개발 및 보급이 확산되고 있는 포터블 임베디드 시스템에서는 전력이 중요한 성능 지표로 작용한다. 특히 메모리 시스템의 전력 소모량은 전체 전력 중 매우 큰 비중을 차지하므로, 정확한 전력분석에 기초하여 전력 소모를 줄일 수 있는 구조에 관한 연구가 수행되고 있다. 본 논문에서는 포터블 임베디드 시스템의 주요 처리 대상인 멀티미디어 응용 프로그램의 낮은 데이터 재사용성을 극복하기 위하여 참조 예측기를 포함하는 메모리 시스템의 전력 분석 모델을 제안한다.

• Proceedings of the KIEE Conference
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• 2011.07a
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• pp.650-651
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• 2011

공용 컴퓨팅 자원은 전력 자원 소모가 지속적으로 발생하는 컴퓨팅 자원 중 하나이다. 하지만, 공용 컴퓨팅 자원은 그 활용 특성상 소유 의식 및 비용 문제로부터 사용자의 책임성이 떨어지므로 전력자원의 지속적 낭비가 이루어지는 대표적인 전력 소모처이다. 따라서 본 연구에서는 공용 컴퓨팅 시설에서 운용되는 컴퓨터 시스템에 대한 다양한 상태에서의 전력 사용량을 측정 분석하였으며, 이를 통해 시스템 차원에서 제공하는 전력 절약 기능에서도 유휴 상태와 유사한 전력 소모가 있음을 밝히고 있다. 이에 본 논문에서는 공용 컴퓨팅 자원 (컴퓨터 시스템) 및 사용자의 활용성 측정에 기반을 둔 공용 컴퓨팅 자원 제어 시스템을 제안한다.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.34 no.6B
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• pp.641-647
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• 2009

This paper proposes an improved predictive dynamic power management (DPM) scheme and a task scheduling algorithm to reduce unnecessary power consumption in embedded systems. The proposed algorithm performs pre-scheduling to minimize unnecessary power consumption. The proposed predictive DPM utilizes a scheduling library provided by the system to reduce computation overhead. Experimental results show that the proposed algorithm can reduce power consumption by 22.3% on the average comparing with the LLF algorithm for DPM-enable system scheduling.