• Title/Summary/Keyword: 비동기 회로

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A Protocol of TTP/C(timed token protocol with concession) for Real-Time Messages in Distributed Computing Environment (분산 컴퓨팅 환경에서 실시간 메시지 통신을 위한 TTP/C 프로토콜)

  • Oh, Sung-Heun;Choi, Joong-Sup;Yang, Seung-Min
    • Journal of KIISE:Computer Systems and Theory
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    • v.27 no.5
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    • pp.518-528
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    • 2000

  • Messages in distributed real-time systems are categorized into two groups: synchronous messages and asynchronous messages. Synchronous messages, such as sampled audio and image data,are generated periodically with delivery time constraints. Protocols should guarantee the end-to-enddeadlines for such messages. Asynchronous messages are non-periodic and may arrive in a randomway with no strict time constraints.In this paper, we propose TTP/C(timed token protocol with concession), an extension of TTPprotocol, to achieve higher timeliness guarantee for synchronous messages in distributed real-timesystems. In TTP/C, a node concedes the allocated bandwidth to other nodes with urgent synchronousmessages to be sent provided that the node has no urgent messages, TTP/C works very well evenif the synchronous messages are generated with some jittering by nodes. The simulation results showthe improved performance of TTP/C protocol for guaranteeing synchronous messages deadlinescomeared to the existing TTP protocols.

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Jitter Tolerances in Digital Transmission Equipment (디지틀 전송 장치의 지터 허용치)

  • Ko, Jeong-Hoon;Lee, Man-Seop;Park, Moon-Soo
    • Journal of the Korean Institute of Telematics and Electronics
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    • v.26 no.3
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    • pp.14-21
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    • 1989

  • In the digital transmission equipment, the input jitter tolerance is a function of input timing recovery circuit characteristics. Especially, in the asynchronous multiplexers, it is also a function of the frame format, the buffer sizes in the synchronizer and desynchronizer, the PLL transfer function, and operating range of VCO in PLL In this paper, a new algorithm for calculating the jitter tolerance of the saynchronous digital transmission equipment is presented. With the new algorithm, we analyzed how the above factors limit the jitter tolerance in the equipment. We also measured the input jitter tolerance for a 45M-140M multiplexing equipment, whose results show the same trend with calculated tolerance.

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The design of the matched filter for CDMA rapid initial PN code synchronization acquisition using HW reuse scheme (CDMA 고속초기동기획득을 위한 HW 재사용에 의한 정합필터의 설계)

  • Lim, Myoung-Seob
    • Journal of the Korean Institute of Telematics and Electronics S
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    • v.35S no.11
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    • pp.28-36
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    • 1998

  • In the CDMA mobile communication system with asynchronous mode among base stations, the initial PN code acquisition method using a matched filter can be considered for the rapid PN code synchronization acquisition in the handoff region. In the model of the noncoherent QPSK/DS-SS under the Rayleigh fading channel, the mean acquisttion time of the matched filter is analyzed to have a shortened time in proportion to the length of matched filter to be compared with the serial correlation method. In this paper to improve the HW complexity of the conventional matched device which enables the repeated correlation process, is designed and its function is verified through the FPGAsimulation using Altera MaxPlus Ⅱ.

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Development of the synchronized current sampling device for current difference relay using GPS (GPS를 이용한, 전류차동계전기의 전류 샘플링 동기장치 개발.)

  • Lee, Young-I.;Choi, Bong-Kyu;Lee, Gi-Won;Jung, Bum-Jin
    • Proceedings of the KIEE Conference
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    • 1997.07c
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    • pp.1048-1051
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    • 1997

  • 본 논문에서는 GPS 수신기를 이용하여 송전선 양단에 설치되어 있는 전류차동계전기들의 전류샘플링을 동기시키는 방법을 제안하고, 이를 이용한 전류샘플링 동기장치의 개발에 대해 설명 한다. 송전선 양단의 GPS 수신기들에서 만들어지는 서로 동기된 IPPS신호들을 이용해 샘플링 동기신호를 만들어 주고, 이를 이용해서 서로 동기된 전류샘플링이 적당한 계수값 지정과 함께 이루어지도록 A/D변환기와 메모리 그리고 프로그램형 논리 소자를 사용한다. 샘플링 동기신호를 만들어주기 위해서 GPS수신기와 10MHz발진기를 이용한 디지털 위상잠금회로(DPLL, Digital Phase- Locked Loop)를 구성 한다. 본 논문에서 제안하는 전류샘플링 동기방식은 통신을 이용한 기존의 방식에 비해 계전기의 계산부담을 덜어주고 보다 정확한 샘플링 동기를 얻을 수 있게 한다.

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Reduced State Graph Generation for Efficient Synthesis of Asynchronous Circuits with Timing Constraints (시간제약조건을 가진 비동기 회로의 효율적 합성을 위한 축소상태그래프의 생성)

  • 고기웅;김의석;이동익;서범수
    • Proceedings of the Korean Information Science Society Conference
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    • 2001.10a
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    • pp.610-612
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    • 2001

  • 시간 제약 조건을 가진 타임드 페트리넷으로부터 최적화된 비동기식 제어회로를 생성하기 위해서는 시간 분석을 통하여 도달 가능한 상태만으로 구성된 축소 상태 그래프를 생성하는 작업이 매우 중요하다. 본 논문에서는 기존의 방법들이 적용 가능한 타임드 페트리넷의 범주에 제약을 가하거나 혹은 회로의 합성과는 직접적인 상관없이 시간 분석을 위하여 대규모의 시간 상태 그래프를 부가적으로 생성하는 문제를 해결하기 위하여 타임드 페트리넷으로부터 축소된 시간 상태 그래프를 직접적으로 생성하는 방법을 제안 한다 실험 결과는 제안된 방법이 모든 범주의 타임드 페트리넷으로부터 빠른 시간 내에 합성에 충분한 축소된 상태그래프를 생성함을 보여준다.

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A Survey on Oscillatory Neural Networks (발진 신경망의 연구현황 분석)

  • Lim, C.D.;Shin, J.H.;Jang, J.S.
    • Electronics and Telecommunications Trends
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    • v.8 no.2
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    • pp.60-68
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    • 1993

  • 지금까지 뇌에는 컴퓨터와 같은 클럭(clock) 신호가 없고 신경들 간의 활동은 비동기적이라고 알려져 왔다. 그러나, 1989년 Singer 연구 그룹에서 시각 피질에 있는 많은 신경들이 발진하며 이들 간에는 시각 영상에 따라 동기현상을 보인다고 발표한 후, 많은 실험과 모델링이 행해지고 있다. 이 분야의 응용으로는 여러 분야가 있으며, 특히 동기 발진 모델을 이용하였을 경우에 패턴 분리와 인식에 응용될 수 있다. 본 고에서는 신경회로망의 새로운 기류인 생물학적 발진 신경망의 실험과 모델링에 대한 동향을 분석하고자 한다.

  • https://doi.org/10.22648/ETRI.1993.J.080206 인용 PDF