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Ir-RE 코팅 대비 자장여과필터방식을 이용한 비구면 유리 렌즈용 초경합금(WC)표면의 ta-C 박막 코팅 성능 개선 연구 (A Study on the Performance Improvement of ta-C Thin Films Coating on Tungsten Carbide(WC) Surface for Aspherical Glass Lens by FCVA Method Compared with Ir-Re coating)

  • 정경서;김승희
    • 한국산학기술학회논문지
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    • 제20권12호
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    • pp.27-36
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    • 2019
  • 작은 굴절률 및 높은 굴절률을 갖는 저 분산 렌즈에 대한 요구가 증가함에 따라, 높은 내열성 및 내마모성을 갖는 이형성 보호 필름에 대한 필요성이 증가하고 있다. 그러나 광학 산업은 비구면 유리 렌즈 성형에 사용되는 이형보호 필름의 제조 공정 및 품질 표준에 대한 명확한 표준을 아직 확립하지 못했다. 이 기술은 광학 렌즈를 제조하는 각 회사의 노하우로 취급된다. 본 연구에서는 FCVA (Filtered Cathode Vacuum Arc) 기반 ta-C 박막 코팅의 이온에칭, 각 소스 및 필터부의 마그네트론 및 아크 전류, 바이어스 전압의 최적화에 관한 실험을 수행하였다. 그 결과, 코팅성능 측면에서, 이리듐- 레늄 합금 박막 스퍼터링 제품 대비 필름 두께가 약 50% 얇고, 경도는 약 20%, 박막의 접착강도는 약 40 % 개선된 것으로 측정되었다. 본 연구의 박막 코팅 공정 결과는 금형 이형 박막층의 최소 기계적 특성 및 품질 확립을 위한 유리 렌즈의 개발 및 활용에 크게 기여할 것으로 사료된다.

산물벼 함수율 측정을 위한 $2{\times}2$ 마이크로스트립 패치 안테나 개발 (A $2{\times}2$ Microstrip Patch Antenna Array for Moisture Content Measurement of Paddy Rice)

  • 김기복;김종헌;노상하
    • Journal of Biosystems Engineering
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    • 제25권2호
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    • pp.97-106
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    • 2000
  • To develop the grain moisture meter using microwave free space transmission technique, a 10.5GHz microwave signal with the power of 11mW generated by an oscillar with a dielectric resonator is transmitted to an isolator and radiated from a transmitting $2{\times}2$ microstrip patch array antenna into the sample holder filled with the 12 to 26%w.b. of Korean Hwawung paddy rice. the microwave signal, attenuated through the grain with moisture, is collected by a receiving $2{\times}2$ microstrip patch array antenna and detected using a Shottky diode with excellent high frequency characteristic. A pair of light and simple microstrip patch array antenna for measurement of grain moisture content is designed and implemented on atenflon substrate with trleative dielectric constant of 2.6 and thickness of 0.54 by using Ensemble ver. 4.02 software. The aperture of microstrip patch arrays is 41 mm width and 24mm high. The characteristics of microstrip patch antenna such as grain. return loss, and bandwidth are 11.35dBi, -38dB and 0.35GHz($50^{\circ}$ at far-field pattern of E and H plane. The width of the sample holder is large enough to cover the signal between the antennas temperature and bulk density respectively. The calibration model for measurement of grain moisture content is proposed to reduce the effects of fluectuations in bulk density and temperature which give serious errors for the measurements . From the results of regression analysis using the statistically analysis method, the moisture content of grain samples (MC(%)) is expressed in terms of the output voltage(v), temperature (t), and bulk density of samples(${\rho}b$)as follows ;$$MC(%)\;=\;(-3.9838{\times}10^{-8}{\times}v^{3}+8.023{\times}10^{-6}{\times}v^{2}-0.0011{\times}v-0.0004{\times}t+0.1706){\frac{1}{{\rho}b}}{\times}100$ Its determination coefficient, standard error of prediction(SEP) and bias were found to be 0.9855, 0.479%w.b. and -0.0.369 %w.b. respectively between measured and predicted moisture contents of the grain samples.

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A-site Ca 및 B-site Zr 첨가에 의한 BaTiO3-CaTiO3복합체의 유전특성 및 미세구조에 미치는 영향 (Effects of A-site Ca and B-site Zr Substitution on the Dielectric Characteristics and Microstructure of BaTiO3-CaTiO3 Composite)

  • 윤만순;박영민
    • 한국세라믹학회지
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    • 제40권1호
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    • pp.37-45
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    • 2003
  • $BaTiO_3$의 Ba 자리에 Ca, Ti 자리에 Zr을 첨가한 $(B a_{1-x}Ca_x)(Ti_{0.96-y}Zr_{y}Sn_{0.04})O_3$ $(0.15 {\leq} x{\leq}0.20,\; 0.09{\leq}y{\leq}$0.14) 조성에 2차상 형성을 유도하여 복합체를 만든 후 유전 및 소결 특성을 조사하였다. Ca량이 15mol% 이상 첨가됨에 따라 $CaTiO_3$를 주성분으로 하는 2차상이 석출하여 복합체가 형성되었으며, Ca량의 증가에 따라 2차상 분율이 증가하였다. Ca량의 증가는 큐리 온도를 mol%당 $1.7^{\circ}C$ 감소시키며, 저유전율 2차상의 영향으로 Ca량 증가에 따라 최대 유전율은 mol%당 200 감소하였다. Zr 첨가는 큐리온도를 mol%당 $10^{\circ}C$ 감소시키며, 확산형 상전이 현상을 증가시켜 최대 유전율을 217 감소시켰다. 2차상의 증가에 의하여 비정상 입성장이 억제되어 소결밀도, 내전압 특성이 향상되었으며, Zr 첨가에 의하여 커패시턴스의 온도 안정성을 제어하여 EIA 규격을 만족하는 고압, 고유전율 Y5U 콘덴서 조성을 개발하였다.

전류모드 CMOS에 의한 다치 가산기 및 승산기의 구현 (Implementation of Multiple-Valued Adder and Multiplier Using Current-Mode CMOS)

  • 성현경
    • 정보처리학회논문지A
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    • 제11A권2호
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    • pp.115-122
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    • 2004
  • 본 논문에서는 전류모드 CMOS를 사용하여 다치 가산기 및 다치 승산기를 구현하였으며, 먼저 효과적인 집적회로 설계 이용성을 갖는 전류모드 CMOS를 사용하여 3치 T-게이트와 4치 T-게이트를 구현하였다. 구현된 다치 T-게이트를 조합하여 유한체 $GF(3^2)$의 2변수 3치 가산표와 승산표를 실현하는 회로를 구현하였으며, 이들 다치 T-게이트를 사용하여 유한체 $GF(4^2)$의 2변수 4치 가산표와 승산표를 실현하는 회로를 구현하였다. 또한, Spice 시뮬레이션을 통하여 이 회로들에 대한 동자특성을 보였다. 다치 가산기 및 승산기들은 $1.5\mutextrm{m}$ CMOS 표준 기술의 MOSFET 모델 LEVEL 3을 사용하였고, 단위전류는 $15\mutextrm{A}$로 하였으며, 전원전압은 3.3V를 사용하였다. 본 논문에서 구현한 전류모드 CMOS의 3치 가산기와 승산기, 4치 가산기와 승산기는 일정한 회선경로 선택의 규칙성, 간단성, 셀 배열에 의한 모듈성의 이점을 가지며 특히 차수 m이 증가하는 유한체의 두 다항식의 가산 및 승산에서 확장성을 가지므로 VLSI화 실현에 적합한 것으로 생각된다.

GNSS Software Receivers: Sampling and jitter considerations for multiple signals

  • Amin, Bilal;Dempster, Andrew G.
    • 한국항해항만학회:학술대회논문집
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    • 한국항해항만학회 2006년도 International Symposium on GPS/GNSS Vol.2
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    • pp.385-390
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    • 2006
  • This paper examines the sampling and jitter specifications and considerations for Global Navigation Satellite Systems (GNSS) software receivers. Software radio (SWR) technologies are being used in the implementation of communication receivers in general and GNSS receivers in particular. With the advent of new GPS signals, and a range of new Galileo and GLONASS signals soon becoming available, GNSS is an application where SWR and software-defined radio (SDR) are likely to have an impact. The sampling process is critical for SWR receivers, where it occurs as close to the antenna as possible. One way to achieve this is by BandPass Sampling (BPS), which is an undersampling technique that exploits aliasing to perform downconversion. BPS enables removal of the IF stage in the radio receiver. The sampling frequency is a very important factor since it influences both receiver performance and implementation efficiency. However, the design of BPS can result in degradation of Signal-to-Noise Ratio (SNR) due to the out-of-band noise being aliased. Important to the specification of both the ADC and its clocking Phase- Locked Loop (PLL) is jitter. Contributing to the system jitter are the aperture jitter of the sample-and-hold switch at the input of ADC and the sampling-clock jitter. Aperture jitter effects have usually been modeled as additive noise, based on a sinusoidal input signal, and limits the achievable Signal-to-Noise Ratio (SNR). Jitter in the sampled signal has several sources: phase noise in the Voltage-Controlled Oscillator (VCO) within the sampling PLL, jitter introduced by variations in the period of the frequency divider used in the sampling PLL and cross-talk from the lock line running parallel to signal lines. Jitter in the sampling process directly acts to degrade the noise floor and selectivity of receiver. Choosing an appropriate VCO for a SWR system is not as simple as finding one with right oscillator frequency. Similarly, it is important to specify the right jitter performance for the ADC. In this paper, the allowable sampling frequencies are calculated and analyzed for the multiple frequency BPS software radio GNSS receivers. The SNR degradation due to jitter in a BPSK system is calculated and required jitter standard deviation allowable for each GNSS band of interest is evaluated. Furthermore, in this paper we have investigated the sources of jitter and a basic jitter budget is calculated that could assist in the design of multiple frequency SWR GNSS receivers. We examine different ADCs and PLLs available in the market and compare known performance with the calculated budget. The results obtained are therefore directly applicable to SWR GNSS receiver design.

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UHD 영상을 위한 고성능 HEVC 디블록킹 필터 설계 (Hardware Design of High Performance HEVC Deblocking Filter for UHD Videos)

  • 박재하;류광기
    • 한국정보통신학회논문지
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    • 제19권1호
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    • pp.178-184
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    • 2015
  • 본 논문에서는 UHD(Ultra High Definition) 영상을 위한 고성능 HEVC(High Efficiency Video Coding) 디블록킹 필터 하드웨어 구조를 제안한다. 제안하는 하드웨어 구조는 필터링 수행시간 단축을 위해 두 개의 필터로 구성된 4단 파이프라인 구조를 가지며 경계강도 모듈을 병렬 구조로 설계하였다. 또한 저전력 하드웨어 구조를 위해 파이프라인의 단계를 클록 게이팅으로 설계하였고, 파이프라인 과정에서 단일 포트 SRAM에 접근할 때 발생하는 해저드 문제를 해결하기 위해 분할된 메모리 구조로 설계하였다. 전처리 단계에서 단일 포트 SRAM에 데이터를 저장할 때 발생하는 지연시간을 감소하기 위해 새로운 필터링 순서를 제안하였다. 본 논문에서 제안하는 디블록킹 필터 하드웨어 구조는 Verilog HDL로 설계 하였으며, TSMC 0.18um CMOS 표준 셀 라이브러리를 이용하여 합성한 결과 22k 개의 로직 게이트로 구현되었다. 또한, 동작 주파수는 150MHz에서 UHD급 8K 해상도인 $7680{\times}4320@60fps$ 처리가 가능하고 최대 동작 주파수는 285MHz이다. 제안하는 하드웨어 구조의 기본 처리단위 당 사이클 수를 비교 분석한 결과, 처리율이 기존 구조 대비 32% 향상된 결과를 얻었다.

맘모그래피의 화질과 평균유선조직선량에 관한 검토 (A Study on the Image Quality of Mammography and the Average Glandular Dose)

  • 이인자;김학성;김성수;허준
    • 대한방사선기술학회지:방사선기술과학
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    • 제25권2호
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    • pp.47-55
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    • 2002
  • 유방촬영에 대한 화질과 평균유선조직선량에 대하여 실험한 결과 반가층은 장치마다 큰 차이를 나타내지 않았으며, 자동노출기구를 사용할 경우 정확성에 문제가 있으므로 확인이 필요하다. 유방촬영에 사용되는 자동현상기 또한 꼭 관리가 필요하며, 유방촬영 시 사용되는 증감지/필름에 따라서 팬톰 촬영 식별능에 많은 영향을 받고 있으므로 선택 시 신중을 기해야 한다. 유방두께 4.2 cm에 대한 평균유선조직 선량은 관전압에 따라 달라지며, ACR기준인 3.0 mGy보다 훨씬 적은 $0.26{\sim}1.39\;mGy$로 나타났다. 이상에서 알 수 있듯이 유방촬영에서는 촬영장치의 성능뿐만 아니라 HVL, AEC, 자동현상기 관리, 증감지/필름 등 모두 관리가 되어야 하며, 이로 인해 평균유선조직선량은 더 줄일 수 있을 것이다.

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전자파 위험 지형도의 상이한 구성: 지중 송전선로 위험 논쟁을 중심으로 (Constructing Topographies of EMF Risks from Underground Power Lines)

  • 김주희
    • 과학기술학연구
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    • 제19권3호
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    • pp.119-166
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    • 2019
  • 일상 공간을 가득 메우고 있는 다양한 종류의 전자파. 그중에서도 송전선에서 발생하는 전자파의 위험성은 고압 송전탑이 건설될 때마다 여러 차례 논란이 되었는데, 이때 대안으로 떠오른 것이 바로 송전선을 땅속에 묻는 송전선로 지중화(地中化)였다. 하지만 2014년 서울의 한 초등학교 과학 교사가 지중 송전선로 구간의 전자파 측정 결과를 환경보건 시민센터에 제보하면서, 송전선로 지중화에 대한 논의는 새로운 국면을 맞이하게 된다. 송전탑보다 지중 송전선로에서 발생하는 전자파가 더 세고, 따라서 더 유해할 수도 있다는 주장이 제기된 것이다. 이후 지중 송전선로 전자파의 위험성을 둘러싸고 벌어진 논쟁에서 환경보건시민센터와 국립환경과학원은 눈에 보이지 않는 전자파 위험의 지형을 서로 다르게 재현해냈다. 이에 본 논문은 양측이 전자파를 측정할 때 측정 지점, 측정기기, 측정 높이의 측면에서 어떤 차이를 보였으며, 나아가 측정값의 의미를 해석하고 그것을 지도나 표로 재현하는 과정에서 다양한 종류의 표준들(인체보호기준, 측정의 국제 가이드라인, 발암물질 그룹 분류)을 어떻게 동원했는지를 살펴본다. 서울의 지중 송전선로에서 발생하는 전자파를 두고 벌어진 이와 같은 위험 논쟁은 그동안 주목받지 못했던, 전자파 장기 노출의 비열적 영향에 대한 관심을 불러일으키는 것이었으며, 송전선로 지중화가 과연 전자파 문제의 해결책인지에 대해서도 의문을 갖게 하는 것이었다. 나아가 이는 송전선로 지중화율이 약 90%에 육박하는 서울이라는 공간이 안전하게 관리되는 일상 공간인지, 통제되지 않는 위험한 공간인지에 대해 상충되는 대답을 암시하는 것이기도 했다.

MVDC 시스템연계 디지털변전소 자동화 연구 (A Study on the Automation of MVDC System-Linked Digital Substation)

  • 장순호;구자익;문초롱
    • 정보처리학회논문지:컴퓨터 및 통신 시스템
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    • 제10권7호
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    • pp.199-204
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    • 2021
  • 디지털변전소는 전력망 지능화를 위해 감시, 계측, 제어·보호, 운전 등 변전소를 구성하는 전력설비 기능과 통신방식을 국제표준인 IEC61850 기반으로 디지털화한 변전소를 말한다. 지능화된 운영시스템을 기반으로 효율적인 전력설비의 감시제어가 가능하며, 사고 발생 시 자동 복구 기능과 원격제어가 가능해 신속한 전력 장애 복구가 가능하다. 디지털 기술의 발달과 친환경 신재생에너지 및 전기차의 도입이 확대 되면서 직류 배전시스템의 보급이 확대될 전망이다. MVDC는 기존 송전계통에 적용되는 HVDC와 수용가에서의 LVDC 사이의 전압 레벨 및 전송용량을 갖는 직류 선로를 활용한 시스템이다. 대부분의 전력설비들이 교류 중심인 기존변전소의 기존 선로를 직류 선로로 변환하면 송전 손실 감소 및 더 큰 전류 용량이 확보된다. 디지털변전소의 프로세스 버스는 베이 레벨과 프로세스 레벨의 설치된 장치 간을 연결하는 이더넷스위치 등의 통신장비로 구성된 통신네트워크이다. 기존 디지털변전소에 MVDC 연계를 위해 프로세스 레벨을 교류부와 직류부로 나누어 두 개의 버스로 구성을 하였고 감시, 제어만 아니라 진단 IED와 연계되어 종합적으로 관리할 수 있는 시스템을 제안하였다.

다항식 회귀분석을 이용한 전자저울의 비선형 특성 개선 연구 (A Study of the Nonlinear Characteristics Improvement for a Electronic Scale using Multiple Regression Analysis)

  • 채규수
    • 융합정보논문지
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    • 제9권6호
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    • pp.1-6
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    • 2019
  • 본 연구에서는 다항식 회귀분석(Polynomial regression analysis) 방법을 이용하여 비선형 특성을 갖는 전자저울의 질량 추정 모델 개발이 이루어 졌다. 전자저울에 사용되는 로드셀의 출력 단자 전압을 기준 질량 추를 사용하여 직접 측정하였고 이 데이터를 이용하여 MS Office 엑셀의 행렬식 계산과 데이터 추세선 분석 기능을 이용하여 다항식 회귀모델을 구하였다. 5kg까지 측정 가능한 로드셀 전자저울을 사용하여 100g단위로 질량을 측정하였고 다항식 회귀분석(Multiple regression analysis) 모델을 구하였으며, 단순(1차), 2차, 3차 다항식 회귀분석에 대한 오차를 구하였다. 각 모델에 대한 회귀 방정식의 적합도 분석을 위해 결정계수(Coefficient of determination)를 제시하여 추정 질량과 측정 데이터와의 상관관계를 나타내었다. 본 연구에서 제안하는 3차 다항식 모델을 이용하여 추정 값의 표준편차가 10g, 결정계수 1.0으로 상당히 정확한 모델을 얻었다. 본 연구에 사용된 선형 회귀 분석 이론을 바탕으로 최근 인공지능 분야에서 많이 사용되고 있는 로지스틱 회귀 분석(Logistic regression analysis)을 활용하여 기상예측, 신약개발, 경제지표 분석 등의 분야에 대한 다양한 연구를 수행할 수 있을 것으로 생각된다.