반도체소자의 접합특성에 따라서 분극의 특성이 달라지는 원인을 조사하였다. 반도체소자의 접합특성은 최종적인 반도체소자의 효율과 관련되기 때문에 중요한 요소이며, 효율을 높이기 위해서는 반도체접합 특성을 이해하는 것은 매우 중요하다. 다양한 성질의 접합을 얻기위하여 n형의 실리콘 위에 절연물질인 carbon doped silicon oxide (SiOC) 박막을 증착하였으며, 아르곤 (Ar) 유량에 따라서 반도체기판의 특성이 달라지는 것을 확인하였다. 전도체인 tin doped zinc oxide (ZTO) 박막을 절연체인 SiOC 위에 증착하여 소자의 전도성을 살펴보았다. SiOC 박막의 특성은 플라즈마에 의하여 이온화현상이 일어날 때 Ar 유량에 따라서 이온화되는 경향이 달라지면서 반도체 계면에서의 공핍현상이 달라졌으며, 공핍층 형성이 많이 일어나는 곳에서 쇼키접합 특성이 잘 형성되는 것을 확인하였다. 아르곤 가스의 유량이 많은 경우 이온화 반응이 많이 일어나고 따라서 접합면에서 전자 홀쌍의 재결합반응에 의하여 전하들이 없어지게 되면 절연특성이 좋아지고 공핍층의 전위장벽이 증가되며, 쇼키접합의 형성이 유리해졌다. 쇼키접합이 잘 이루어지는 SiOC 박막에서 ZTO를 증착하였을 때 SiOC와 ZTO 사이의 계면에서 전하들이 재결합되면서 전기적으로 안정된 ZTO 박막을 형성하고, ZTO의 전도성이 증가되었다. 두께가 얇은 반도체소자에서 흐르는 낮은 전류를 감지하기 위해서는 쇼키접합이 이루어져야 하며, 낮은 전류만으로도 전기신호의 품질이 우수해지고 또한 채널층인 ZTO 박막에서의 전류의 발생도 많아지는 것을 확인하였다.
RP 반응성 스펏터링으로서 P형 실리콘 웨이퍼위에 $Ta_{2}O_{5}$막을 제조하였다. 시편의 구조 및 조성은 XRD와 AES로 조사하였다. 산소의 혼합비가 10%일 때 C-V 특성으로부터 구한 $Ta_{2}O_{5}$막의 비유전률은 10-12이었다. AES와 RBS로 측정한 $Ta_{2}O_{5}$막의 Ta : O의 비는 각각 1 : 2와 1 : 2.49로 나타났으며, 산소분위기에서 $700^{\circ}C$의 열처리 온도에서 결정성장이 시작되었다. 산소분위기에서 $1000^{\circ}C$로 열처리한 $Ta_{2}O_{5}$막의 비유전률값은 20.5였으며, 질소분위기에서 열처리한 경우의 비유전률값은 23으로 나타났다. 이 때 가육방전계(pseudo hexagonal ${\delta}-Ta_{2}O_{5}$)의 결정구조를 나타내었다. 시편의 ${\Delta}V_{FB}$와 누설전류밀도는 산소의 혼합비가 증가함에 따라 감소하였다. 그리고 최대절연파괴전장은 산소가 10% 혼합되었을 때 2.4MV/cm로 나타났다. 이러한 $Ta_{2}O_{5}$막은 수소이온 감지막 및 기억용소자의 게이트 절연막 등에 응용될 수 있을 것이다.
For more than three decades, the gate dielectrics in CMOS devices are $SiO_2$ because of its blocking properties of current in insulated gate FET channels. As the dimensions of feature size have been scaled down (width and the thickness is reduced down to 50 urn and 2 urn or less), gate leakage current is increased and reliability of $SiO_2$ is reduced. Many metal oxides such as $TiO_2$, $Ta_2O_4$, $SrTiO_3$, $Al_2O_3$, $HfO_2$ and $ZrO_2$ have been challenged for memory devices. These materials posses relatively high dielectric constant, but $HfO_2$ and $Al_2O_3$ did not provide sufficient advantages over $SiO_2$ or $Si_3N_4$ because of reaction with Si substrate. Recently, $HfO_2$ have been attracted attention because Hf forms the most stable oxide with the highest heat of formation. In addition, Hf can reduce the native oxide layer by creating $HfO_2$. However, new gate oxide candidates must satisfy a standard CMOS process. In order to fabricate high density memories with small feature size, the plasma etch process should be developed by well understanding and optimizing plasma behaviors. Therefore, it is necessary that the etch behavior of $HfO_2$ and plasma parameters are systematically investigated as functions of process parameters including gas mixing ratio, rf power, pressure and temperature to determine the mechanism of plasma induced damage. However, there is few studies on the the etch mechanism and the surface reactions in $BCl_3$ based plasma to etch $HfO_2$ thin films. In this work, the samples of $HfO_2$ were prepared on Si wafer with using atomic layer deposition. In our previous work, the maximum etch rate of $BCl_3$/Ar were obtained 20% $BCl_3$/ 80% Ar. Over 20% $BCl_3$ addition, the etch rate of $HfO_2$ decreased. The etching rate of $HfO_2$ and selectivity of $HfO_2$ to Si were investigated with using in inductively coupled plasma etching system (ICP) and $BCl_3/Cl_2$/Ar plasma. The change of volume densities of radical and atoms were monitored with using optical emission spectroscopy analysis (OES). The variations of components of etched surfaces for $HfO_2$ was investigated with using x-ray photo electron spectroscopy (XPS). In order to investigate the accumulation of etch by products during etch process, the exposed surface of $HfO_2$ in $BCl_3/Cl_2$/Ar plasma was compared with surface of as-doped $HfO_2$ and all the surfaces of samples were examined with field emission scanning electron microscopy and atomic force microscope (AFM).
일반적으로 수직형 프로브는 가늘고 긴 S-자형 구조가 중복되기 때문에 신호 전달 특성이 저하되므로 이것에 대한 개선이 필요하다. 본 논문에서 제안된 프로브는 캔틸리버형보다 적은 면적을 차지하는 수직형으로 동시에 많은 메모리를 테스트하기에 적합하며, 특히 외부 압력이 가해졌을 때 분기된 스프링에 의해 폐 루프(closed loop)가 형성되어 기존의 S-자형 수직형 프로브보다 기계적 특성뿐만 아니라 전기적 신호 전달 특성이 개선된 새로운 형태의 수직형 프로브를 제안하였다. 제안된 프로브를 제작하여 측정 및 시뮬레이션을 통해 기존의 S-자형 수직형 프로브보다 오버드라이브(overdrive)는 1.2배, 컨택 포스(contact force)는 2.5배, 신호 전달특성은 $0{\sim}10$ GHz에서 최대 1.4 dB 개선되는 것을 확인하였다. 또한 프로브 카드(probe card)의 신호 전달 특성을 예측할 수 있는 시뮬레이션 모델을 개발하였다. 이를 위하여 프로브 카드를 구성하는 각 부품의 기하학적 특성에 맞도록 2.5D 또는 3D Full-wave 시뮬레이터를 사용하였으며, 계산된 결과는 측정 결과와 매우 잘 일치 하였다.
기판온도 $300^{\circ}C$에서 열증착법에 의해 p형 <100> Si 기판위에 CuPc(Copper Phthalocyanine) 결정 박막을 증착하였다. X선 회절분석으로부터 CuPc 박막은 a-축 방향으로 성장하였음을 알 수 있었다. CuPc분자들이 기판면위에 수직인 CuPc/Si박막의 광전특성을 조사하기 위하여 수직방향의 전류-전압 (I-V) 특성을 기판 Si의 특성과 비교 관찰하였다. 저항성 접촉을 위해 기판인 p형 Si위에 전극으로 Au를 증착시켰다. Au/Si 접합에 빛을 조사한 결과 전류는 증가하지만 광기전력효과는 관찰되지 않았다. p형 반도체인 CuPc 박막과 기판 p-Si의 접합은 장벽을 형성하지 않기 때문에 빛을 조사하지 않았을 때의 I-V 특성은 저항성을 나타낸다. 빛을 조사하였을 때 CuPc/Si 접합의 증가된 광전류는 Si 웨이퍼보다 현저하게 큰 것을 알 수 있다. 따라서 CuPc 층이 600 nm 파장에서의 붉은 빛을 현저하게 흡수하여 광전류에 기여하는 다량의 광캐리어를 형성함을 알 수 있다. CuPc/Si 박막은 $J_{sc}$ (short-circuit photocurrent) $4.29\;mA/cm^{2}$와 $V_{oc}$ (open circuit photovoltage) 12 mV의 광기전력 특성을 보여준다.
목적: Magnetron의 세기를 비대칭으로 한 unbalanced magnetron sputtering 장치를 설계 제작하고, 이 장치를 사용하여 sus304시편 위에 TiN을 코팅할 때 산소영향을 연구하고자 한다. 방법: 코팅막의 두께를 알기 위해 실리콘 웨이퍼 위의 코팅막을 SEM으로 단면을 관찰하였고, TiN 코팅박막표면의 성분을 분석하기 위하여 XPS를 사용하였으며, 표면안쪽의 성분을 관찰하기 위해 depth profile을 하였다. 결과: XPS depth profile 데이터로부터 티타늄과 질소 뿐만 아니라 산소가 일정한 양으로 존재하며, 산소의 양은 약 65 at.%의 큰 양이 존재한다는 것을 알 수 있었다. 두께에 따른 색상변화는 세 개의 피크가 모여서 형성이 된 Ti $ 2p_{3/2}$ 피크의 모양이 두께에 따라 약간 다르다는 것을 알 수 있었다. 결론: 코팅 중에 산소가 섞여 순수한 TiN보다는 $ TiO_2$, TiN, $ TiO_{x}N_{y}$ 세가지 조합에 의해 색이 결정되는 것을 알 수 있었다.
목적: Magnetron의 세기를 비대칭으로 한 unbalanced magnetron sputtering 장치를 설계 제작하고 sus304시편 위에 TiN박막을 증착하여 색상과 경도에 관한 연구를 하고자 한다. 방법: 증착된 박막표면의 화학조성을 양적으로 분석하기 위하여 XPS high resolution scan과 curve fitting을 수행하였으며, 박막 표면의 경도를 측정하기 위해 nano indentation 장비를 이용하였다. 결과: 박막 두께가 두꺼워지면 박막의 색상은 처음에는 연한 금색, 시간이 지남에 따라 어두운 금색, 연보라, 남색으로 바뀌었다. 두께에 따른 박막의 색상변화는 박막에$TiO_{x}N_{y}$, $TiO_2$, TiN과 같은 세가지 화합물의 조성변화에 기인함을 알 수 있었으며,$ TiO_{x}N_{y}$의 조성변화가 두께에 따른 색상변화에 가장 큰 영향을 미치는 것을 여겨졌다. 결론: TiN박막의 비커스 경도가 TiN의 일반적인 경도보다 수치가 작은 것은 박막이 TiN, $TiO_2$,$TiO_{x}N_{y}$ 세가지 물질 섞여 있기 때문이라고 여겨지며, 두께에 따른 박막의 경도가 점점 커지다가 줄어드는 것은 두께에 따른 TiN 양과 밀접한 관계가 있음을 알 수 있었다.
The tunnel oxide passivated contact (TOPCon) structure got more consideration for development of high performance solar cells by the introduction of a tunnel oxide layer between the substrate and poly-Si is best for attaining interface passivation. The quality of passivation of the tunnel oxide layer clearly depends on the bond of SiO in the tunnel oxide layer, which is affected by the subsequent annealing and the tunnel oxide layer was formed in the suboxide region (SiO, Si2O, Si2O3) at the interface with the substrate. In the suboxide region, an oxygen-rich bond is formed as a result of subsequent annealing that also improves the quality of passivation. To control the surface morphology, annealing profile, and acceleration rate, an oxide tunnel junction structure with a passivation characteristic of 700 mV or more (Voc) on a p-type wafer could achieved. The quality of passivation of samples subjected to RTP annealing at temperatures above 900℃ declined rapidly. To improve the quality of passivation of the tunnel oxide layer, the physical properties and thermal stability of the thin layer must be considered. TOPCon silicon solar cell has a boron diffused front emitter, a tunnel-SiOx/n+-poly-Si/SiNx:H structure at the rear side, and screen-printed electrodes on both sides. The saturation currents Jo of this structure on polished surface is 1.3 fA/cm2 and for textured silicon surfaces is 3.7 fA/cm2 before printing the silver contacts. After printing the Ag contacts, the Jo of this structure increases to 50.7 fA/cm2 on textured silicon surfaces, which is still manageably less for metal contacts. This structure was applied to TOPCon solar cells, resulting in a median efficiency of 23.91%, and a highest efficiency of 24.58%, independently. The conversion efficiency of interdigitated back-contact solar cells has reached up to 26% by enhancing the optoelectrical properties for both-sides-contacted of the cells.
최근 열선 화학 기상 증착법(HWCVD)은 낮은 온도에서 TFT용 Poly Si 중착을 할 수 있다는 점과 실리콘 박막을 빠른 속도로 증착할 수 있다는 점에서 각광을 받고 있다. 본 연구에서는 HWCVD를 이용하여 태양전지를 제조하고 그 특성을 평가하였다. 조건에 따른 실리콘 박막의 특성 변화를 알기 위해 corning glass 및 실리콘 wafer에 다양한 조건에서 단위 박막(intrinsic layer)을 증착하였고 이 결과를 바탕으로 p/i/n 구조의 태양전지를 제조하였다. Ta 열선 온도는 1700-2000도였고 가스 원료인 $SiH_4$와 수소의 비율을 조절하면서 그 영향을 관찰하였다. 태양전지의 경우 p충과 n충은 PECVD로 증착하였으며 단위박막 및 태양전지 i충 증착시 기판과 열선간의 거리는 7cm, 기판 온도는 $200^{\circ}C$와 $250^{\circ}C$로 고정하였고 작업압력은 30mTorr였다. 단위 박막 특성 평가를 위해 암/광 전도도, SEM, Raman Scattering, FT-IR등을 사용하였으며 태양전지 특성 평가를 위해 I-V 및 Spectral response를 측정하였다. 열선 온도가 증가함에 따라 증착속도 및 결정화 분율은 증가하였다. 특히 비정질에서 결정질로 전이되는 구간은 매우 좁았으며 여러 분석 방법에서 일치되는 결과를 보였다. $SiH_4$ 유량이 늘어날수록 비정질이 결정질로 바뀌는 열선 온도가 증가하였으며 기판 온도가 낮을 경우 또한 결정으로 바뀌는 열선 온도가 증가하였다. 태양전지의 경우 열선 온도가 증가함에 따라 $V_{oc}$ 및 W가 낮아졌으며 $J_{sc}$, 는 증가하는 경향을 보였으며 결정질 비율이 증가하는 것을 관찰할 수 있었다. 이러한 경향은 quantum efficiency 결과에서도 확인할 수 있었다.용을 반복하면서 석재 내부와 외부의 암석 및 결정에 균열과 미세열극 등이 생성되어 석재 자체의 구조적 안정성에 영향을 주고 있다. 따라서 감은사지 석탑은 지리적 환경 차이로 인해 일반적인 환경의 석조물들과는 다른 형태의 풍화양상을 보이고 있어서 풍화양상 및 풍화형태에 대한 정확한 연구와 이해를 바탕으로 보존대책이 마련되어야 한다.되었다. 이런 모든 시편들을 각 탈염방법에 따라 탈염처리한 후 XRD와 SEM-EDS으로 분석한 결과 인철광과 침철광은 어떠한 변화도 보이지 않았고, 다만 적금광으로 동정된 시편만이 잔존하지 않았다. 철기 제작별 $Cl^-$ 이온 추출량과 탈염효과에 대한 비교 실험은 이온 크로마토그래피 분석 결과와 마찬가지로 단조 철제유물이 주조 철제보다 $Cl^-$ 이온을 많이 가지고 있었으며, 탈염 처리 후에는 $Cl^-$ 이온은 전혀 발견되지 않았다. 이상의 결과 $K_2CO_3$와 Sodium 용액은 탈염처리에서 가장 적합한 탈염처리 용액으로 알수가 있었으며 특히 어떠한 탈염 용액으로 유물을 처리한다 해도 철제유물에 생성된 부식물은 제거되지 않는다는 것을 알게 되었다. 따라서 보존처리자는 유물 표면의 부식 상태만을 보고 처리하기 보다는 철기제작물로 고려하여 처리하는 것이 필요하다. 또한 금속에 부식을 야기시키는 $Cl^-$ 이온과 부식물을 완전하게 제거하여 탈염처리를 하는 것이 유물 부식을 최대한 지연시킬 수 있는 것이라 생각된다.TEX>$88\%$)였다.(P=0.063). 결론: 본 연구에서는 MTHFR C/T & T/T 유전자 다형성이 위암의 발생과 그 위치에 대해 관련이 있는 것으로 여겨지고, 흡연력, 음주력과는 관련이 없는 것으로 여겨진다.험이 커지는 경향을 보였으나, 나이 및 병기, 종양의 크기, MD-BED $Gy_{10}$ 등의 예후 인자를 보정한 다변
반도체 산업에서 회로의 고집적화와 다층구조를 형성하기 위해 화학적-기계적 연마(CMP: Chemical-Mechanical Planarization) 공정이 도입되었으며 반도체 패턴의 미세화와 다층화에 따라 화학적-기계적 연마 공정의 중요성은 더욱 강조되고 있다. 화학적-기계적 연마공정이란 화학적 반응과 기계적 힘을 동시에 이용하여 표면을 평탄화하는 공정으로, 화학적-기계적 연마 공정은 압력, 속도 등의 공정조건과, 화학적 반응을 유도하는 슬러리(Slurry), 기계적 힘을 위한 패드 등에 의해 복합적으로 영향을 받는다. 패드 컨디셔닝이란 컨디셔너가 화학적-기계적 연마 공정 중에 지속적으로 패드 표면을 연마하여 패드의 손상된 부분을 제거하고 새로운 표면을 노출시켜 패드의 상태를 일정하게 유지시키는 것을 말한다. 한편, 금속박막의 화학적-기계적 연마 공정에 사용되는 슬러리는 금속박막과 산화반응을 하기 위하여 산화제를 포함하는데, 산화제는 금속 컨디셔너 표면을 산화시켜 부식을 야기한다. 컨디셔너의 표면부식은 반도체 수율에 직접적인 영향을 줄 수 있는 스크래치(Scratch) 등을 발생시킬 뿐만 아니라, 컨디셔너의 수명도 저하시키게 되므로 이를 방지하기 위한 노력이 매우 중요하다. 본 연구에서는 컨디셔너 표면에 슬러리와 컨디셔너 표면 간에 일어나는 표면부식을 방지하기 위하여 유기박막을 표면에 증착하여 부식을 방지하고자 하였다. 컨디셔너 제작에 사용되는 금속인 니켈과 니켈 합금을 기판으로 하고, 증착된 유기박막으로는 자기조립단분자막(SAM: Self-Assembled Monolayer)과 불화탄소(FC: FluoroCarbon) 박막을 증착하였다. 자기조립단분자막은 2가지 전구체(Perfluoroctyltrichloro silane(FOTS), Dodecanethiol(DT))를 사용하여 기상 자기조립 단분자막 증착(Vapor SAM) 방법으로 증착하였고, 불화탄소막은 10 nm, 50 nm, 100 nm 두께로 PE-CVD(Plasma Enhanced-Chemical Vapor Deposition, SRN-504, Sorona, Korea) 방법으로 증착하여 표면의 부식특성을 평가하였다. 표면 부식 특성은 동전위분극법(Potentiodynamic Polarization)과 전기화학적 임피던스 측정법(Electrochemical Impedance Spectroscopy(EIS)) 등의 전기화학 분석법을 사용하여 평가되었다. 또한 측정된 임피던스 데이터를 전기적 등가회로(Electrical Equivalent Circuit) 모델에 적용하여 부식 방지 효율을 계산하였다. 동전위분극법과 EIS의 결과 분석으로부터 유기박막이 증착된 표면의 부식전류밀도가 감소하고, 임피던스가 증가하는 것을 확인하였다.
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[게시일 2004년 10월 1일]
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