• 제목/요약/키워드: loop filter

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복잡도 기반 적응적 샘플 오프셋 병렬화 (Complexity-based Sample Adaptive Offset Parallelism)

  • 유은경;조현호;서정한;심동규;김두현;송준호
    • 방송공학회논문지
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    • 제17권3호
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    • pp.503-518
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    • 2012
  • 본 논문은 High Efficiency Video Coding (HEVC)의 인-루프 필터 기술인 Sample Adaptive Offset (SAO)에 대하여 복잡도 분석기반의 병렬화 방법을 제안한다. HEVC의 SAO는 쿼드트리 기반으로 영상을 다수의 SAO영역으로 분할하고, 각 영역 단위로 에러 보정을 위한 오프셋 값을 전송함으로써 복호화된 화소의 에러를 보정한다. HEVC의 SAO는 데이터 레벨의 병렬화를 통하여 고속화할 수 있는데, SAO영역 단위의 데이터 레벨 병렬화는 영역의 크기가 일정하지 않아 멀티 코어를 사용한 병렬화시 작업량 불균형(Workload imbalance)이 발생한다. 또한, SAO는 영역 단위로 필터링 적용 여부가 결정되므로 균둥하게 SAO영역을 각 코어에 할당하더라도, 작업량 불균형이 발생할 수 있다. 본 논문에서는 SAO영역의 최소 단위인 Largest Coding Unit (LCU)를 SAO 수행의 기본단위로 하여, 각 단위에서의 SAO 파라미터 정보를 이용하여 복잡도를 미리 예측 하였다. 예측된 복잡도를 기반으로 각 코어에 균일하게 작업량이 할당될 수 있도록 영역을 코어에 적응적으로 할당하여 병렬화를 수행한 결과 순차 수행 기반 SAO에 비하여 2.38배, 영역 균등 SAO 병렬화 대비 21% 속도 향상되었다.

회전기기 진동의 Order Tracking을 위한 재합성 필터의 설계 (The Design of Reconstruction Filter for the Order Tracking of the Rotating Machinery)

  • 정승호;박영필;이상조
    • 한국소음진동공학회:학술대회논문집
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    • 한국소음진동공학회 1991년도 춘계학술대회논문집; 한국해사기술연구소, 대전; 1 Jun. 1991
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    • pp.95-98
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    • 1991
  • 회전 기기의 이상으로 인하여 발생하는 진동은 축 회전속도의 고주파 성분 (super-harmonic)이나 또는 분수조파 성분(sub-harmonic)으로 나타나는 경 우가 대부분이기 때문에 회전기기의 진동을 주파수 영역에서 해석함에 있어 파워 스펙트럼의 주파수 축을 Hz로 나타내기보다는 축 회전속도의 order로 써 나타내는 것이 매우 유용하다. 스펙트럼을 order로써 나타내기 위해서는 샘플링 시간을 축 회전속도와 동기(synchronization)시켜야 하는데 이 방법으 로는 회전축에 엔코더(encorder)를 부착하여 엔코더에서 발생하는 펄스 신호 를 이용하여 샘플링하는 방법과 order tracking 필터를 이용하는 방법이 있 다. 그러나 전자의 방법은 원하는 회전축마다 엔코더를 부착하여야 하며 경 우에 따라서는 엔코더를 부착하기가 어려운 경우도 있으며, 회전기기의 운전 개시나 종료시처럼 회전속도가 급격히 변화하는 경우에는 낮은 주파수에서 중첩(aliasig)에 의한 오차가 수반될 수도 있다. 후자의 방법은 order tracking 필터 이외에도 여러 부수장비가 필요하며 기준 주파수(즉 회전속 도)가 급격히 변화하는 경우 PLL(phase locked loop)에서 tracking 오차가 발생된다. 최근에 발표된 논문에서 일정한 시간간격으로 샘플링한 데이터들 로부터 신호를 재합성하여 회전축의 속도와 동기가 되도록 재 샘플링함으로 서 스펙트럼의 주파수를 회전속도의 order로써 나타내는 방법을 제시하였다. 그러나 위 논문에서는 신호의 재합성에 필요한 재합성 필터(reconstruction filter)의 설계 방법에 대하여 구체적인 언급이 없이 다만 결과만을 논하였다. 따라서 본 논문에서는 재합성 필터의 설계 방법에 대하여 구체적인 방법을 제시하고 또한 동기화 샘플링의 장점 및 고려 사항에 대하여 고찰하였다. 고려한 능동 소음제어 에 대해 연구하였다. 경량화 추세에 따라 지반이나 케이싱이 경량이거나 유연하여 회전축과 동적으로 연성된 경우 회전축-베어링-지반으로 이루어진 2중구조의 회전축 계 동특성을 해석할 수 있는 프로그램을 개발하므로서 회전 기계류의 진동 전반에 걸친 문제점에 대한 그 원인과 현상을 명확히 분석하여 국내의 전기 계류의 보다 신뢰성있는 설계 및 제작자료를 확보하는데 기여할 수 있게 하 였다.존의 small molecular Gd-chelate에 비해 매우 큼을 알 수 있었다. MnPC는 간세포에 흡수된 후 담도계로 배출되는 간특이성 조영제임을 확인하였다. 장비 내에서 반복 시행한 평균값의 차이는 대체적으로 유의한 차이가 없었으나, 다른 장비에서 반복 시행한 장비간의 사이에는 유의한 차이가 있는 경우가 더 많았다. 따라서 , MRS 검사를 소뇌나 뇌교의 어떤 절환에 적용하기 전에 각 장비 마다 정상 기준치를 반드시 얻은 후에 이상여부를 판 정하는 것이 필수적이라고 생각된다.EX> 이상이 적절한 진단기준으로 생각되었다. $0.4{\;}\textrm{cm}^3$ 이상의 좌우 부피차를 보이는 모든 증례에서 육안적으로도 해마위축이 뚜렷이 나타났다. 결론 : MR영상을 이용한 해마의 부피측정은 해마경화증 환자의 진단에 있어 육안적인 MR 진단이 어려운 제한된 경우에만 실제적 도움을 줄 수 있는 보조적인 방법으로 생각된다.ofile whereas relaxivity at high field is not affected by τS. On the other hand, the change in τV does not affect low field profile but strongly in fluences on both inflection fie이 and the maximum relaxivity value. The re

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심층학습 알고리즘을 이용한 보청기의 음향궤환 및 잡음 제거 (Acoustic Feedback and Noise Cancellation of Hearing Aids by Deep Learning Algorithm)

  • 이행우
    • 한국전자통신학회논문지
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    • 제14권6호
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    • pp.1249-1256
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    • 2019
  • 본 논문에서는 보청기의 음향궤환 및 잡음을 제거하기 위한 새로운 알고리즘을 제안한다. 이 알고리즘은 기존의 FIR 구조를 이용하는 대신 신경망 적응예측필터를 이용한 심층학습 알고리즘으로 궤환 및 잡음제거 성능을 향상시킨다. 먼저 궤환제거기가 마이크 신호에서 궤환신호를 제거하고, 이어서 Wiener 필터기법을 이용하여 잡음을 제거한다. 잡음 제거는 음성신호가 가진 주기적 성질에 따라 선형예측모델을 이용하여 잡음이 포함된 음성신호로부터 음성을 추정해내는 것이다. 한 루프 안에 포함된 두 적응 시스템의 안정적 수렴을 보장하기 위해 궤환제거기 및 잡음제거기의 계수 업데이트를 분리하여 실시하며 제거 후 생성된 잔차신호를 이용하여 수렴시키는 과정을 진행한다. 본 연구에서 제안한 궤환 및 잡음제거기의 성능을 검증하기 위하여 시뮬레이션 프로그램을 작성하고 모의실험을 수행하였다. 실험 결과, 제안한 심층학습 알고리즘을 사용하면 기존의 FIR 구조를 사용하는 경우보다 궤환제거기에서 약 10 dB의 SFR(: Signal to Feedback Ratio), 잡음제거기에서 약 3 dB의 SNRE(: Signal to Noise Ratio Enhancement) 개선효과를 얻을 수 있는 것으로 확인되었다.

딥 러닝 기반의 이미지와 비디오 압축 기술 분석 (A Technical Analysis on Deep Learning based Image and Video Compression)

  • 조승현;김연희;임웅;김휘용;최진수
    • 방송공학회논문지
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    • 제23권3호
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    • pp.383-394
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    • 2018
  • 본 논문에서는 최근 활발히 연구되고 있는 딥 러닝 기반의 이미지와 비디오 압축 기술에 대해 살펴본다. 딥 러닝 기반의 이미지 압축 기술은 심층 신경망에 압축 대상 이미지를 입력하고 반복적 또는 일괄적 방식으로 은닉 벡터를 추출하여 부호화한다. 이미지 압축 효율을 높이기 위해 심층 신경망은 복원 이미지의 화질은 높이면서 부호화된 은닉 벡터가 보다 적은 비트로 표현될 수 있도록 학습된다. 이러한 기술들은 특히 저 비트율에서 기존의 이미지 압축 기술에 비해 뛰어난 화질의 이미지를 생성할 수 있다. 한편, 딥 러닝 기반의 비디오 압축 기술은 압축 대상 비디오를 직접 입력하여 처리하기 보다는 기존 비디오 코덱의 압축 툴 성능을 개선하는 접근법을 취하고 있다. 본 논문에서 소개하는 심층 신경망 기술들은 최신 비디오 코덱의 인루프 필터를 대체하거나 추가적인 후처리 필터로 사용되어 복원 영상의 화질 개선을 통해 압축 효율을 향상시킨다. 마찬가지로, 화면 내 예측 및 부호화에 적용된 심층 신경망 기술들은 기존 화면 내 예측 툴과 함께 사용되어 예측 정확도를 높이거나 새로운 화면 내 부호화 과정을 추가함으로써 압축 효율을 향상 시킨다.

외란토크 추정 및 보상을 이용한 관성안정화 플랫폼의 제어 (Control of Inertially Stabilized Platform Using Disturbance Torque Estimation and Compensation)

  • 최경준;원문철
    • 대한기계학회논문집A
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    • 제40권1호
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    • pp.1-8
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    • 2016
  • 본 논문에서는 기존의 관성안정화 플랫폼에서 보편적으로 사용됐던 PID 제어에 외란관측기를 적용하는 알고리즘 제안한다. 외란관측기 알고리즘을 적용하기 위하여 직접구동 모터로 구동되는 안정화 플랫폼 축의 관성모멘트와 축 마찰 특성을 실험적으로 구하고, 시뮬레이션과 실험결과를 비교하여 정확도를 검증하였다. 또한 차수와 상대차수가 다른 여러 가지 Q-filter 적용실험을 통하여 필터 특성에 따른 시스템의 안정성을 확인하였다. 본 논문에서 제안한 알고리즘은 6 자유도 시뮬레이터를 이용하여 차량 모션 인가실험을 통해 이중 PID 제어 루프의 결과와 비교/검증하였다.

고속 저잡음 PLL 클럭 발생기 (A High Speed and Low Jitter PLL Clock generator)

  • 조정환;정정화
    • 대한전자공학회논문지TE
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    • 제39권3호
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    • pp.1-7
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    • 2002
  • 본 논문에서는 다중 PFD(Phase Frequency Detector)와 적응 전하펌프 회로를 설계하여 지터 잡음 특성과 주파수 획득 과정을 향상시킨 새로운 PLL 클럭 발생기를 제안한다. 기존의 PLL은 넓은 데드존과 듀티 사이클 특성을 갖고 있기 때문에 지터잡음을 발생하고, 긴 지연시간 때문에 고속 동작에는 부적합하다. 본 논문에서는 이러한 문제를 해결하기 위하여, TSPC(True Single Phase Clocking) 회로를 이용하여 다중 구조를 갖는 PFD를 설계하였다. 데드존 특성, 듀티 사이클의 제한조건을 개선할 수 있도록 회로를 설계하였으며, 탁월한 지터잡음 성능을 향상시킬 수 있었다. 또한 적응 전하펌프 회로를 사용하여 PLL을 설계하였으며 루프필터의 전하펌프 전류를 증가시킴으로써 주파수 획득 특성을 개선 할 수 있었다. Hspice 시뮬레이션을 수행한 결과, 제안한 PLL은 데드존이 0.01ns 미만이고, 입력신호의 듀티 사이클에 무관하며, 50ns의 빠른 획득시간을 갖는 것을 확인할 수 있었다. 따라서 제안된 회로는 고성능 마이크로프로세서 및 디지털시스템에 적용될 수 있다.

적응성 양자화 레벨을 가지는 광대역 다중-비트 연속시간 $\Sigma\Delta$ 모듈레이터 (Wideband Multi-bit Continuous-Time $\Sigma\Delta$ Modulator with Adaptive Quantization Level)

  • 이희범;신우열;이현중;김수환
    • 대한전자공학회논문지SD
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    • 제44권11호
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    • pp.1-8
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    • 2007
  • 본 논문에서는, 무선 통신 응용을 위한 광대역 연속시간 시그마-델타 모듈레이터를 130nm CMOS공정으로 구현하였다. 제안된 양자화 레벨을 효율적으로 조절할 수 있는 적응성 양자화기를 사용하여, 작은 크기의 입력에 대해서 SNR의 이득을 볼 수 있었다. 모듈레이터는 전력 소모를 줄이기 위해 2차 루프 필터로 구성되어 있고, 지터에 의한 영향을 줄이고 높은 선형성을 보장하기 위해 4 비트 양자화기, DAC를 사용하였다. 설계된 회로는 320MHz 샘플링 주파수에서 동작하며 10MHz 입력 대역에서 30mW의 전력을 소모하고 최대 SNR 51.36dB를 얻었다.

Comparative Analysis of SOC Estimation using EECM and NST in Rechargeable LiCoO2/LiFePO4/LiNiMnCoO2 Cells

  • Lee, Hyun-jun;Park, Joung-hu;Kim, Jonghoon
    • Journal of Electrical Engineering and Technology
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    • 제11권6호
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    • pp.1664-1673
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    • 2016
  • Lithium rechargeable cells are used in many industrial applications, because they have high energy density and high power density. For an effective use of these lithium cells, it is essential to build a reliable battery management system (BMS). Therefore, the state of charge (SOC) estimation is one of the most important techniques used in the BMS. An appropriate modeling of the battery characteristics and an accurate algorithm to correct the modeling errors in accordance with the simplified model are required for practical SOC estimation. In order to implement these issues, this approach presents the comparative analysis of the SOC estimation performance using equivalent electrical circuit modeling (EECM) and noise suppression technique (NST) in three representative $LiCoO_2/LiFePO_4/LiNiMnCoO_2$ cells extensively applied in electric vehicles (EVs), hybrid electric vehicles (HEVs) and energy storage system (ESS) applications. Depending on the difference between some EECMs according to the number of RC-ladders and NST, the SOC estimation performances based on the extended Kalman filter (EKF) algorithm are compared. Additionally, in order to increase the accuracy of the EECM of the $LiFePO_4$ cell, a minor loop trajectory for proper OCV parameterization is applied to the SOC estimation for the comparison of the performances among the compared to SOC estimation performance.

SAO의 성능개선을 위한 저면적 하드웨어 설계 (Area Efficient Hardware Design for Performance Improvement of SAO)

  • 최지수;류광기
    • 한국정보통신학회논문지
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    • 제17권2호
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    • pp.391-396
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    • 2013
  • 본 논문에서는 고성능 HEVC 복호기 설계를 위해 SAO(Sample Adaptive Offset)의 수행시간 단축과 연산량, 하드웨어 면적 감소를 위한 하드웨어 구조를 제안한다. 제안하는 SAO 하드웨어 구조는 $8{\times}8$ CU(Coding Unit)를 처리하는 연산기를 구성하여 하드웨어 면적을 최소화하고, 내부레지스터를 이용하여 $64{\times}64$ CU의 처리를 지원한다. 또한 기존 SAO의 top-down 블록분할 구조 대신 bottom-up 블록분할 구조로 설계하여 연산시간 및 연산량을 최소화한다. 제안한 SAO 하드웨어를 TSMC $0.18{\mu}m$ CMOS 표준 셀 라이브러리 이용해 합성한 결과 게이트 수는 30.7k개의 로직게이트로 구현되며 최대동작주파수는 250MHz이다. 제안한 SAO 하드웨어 구조는 하나의 매크로 블록을 복호화하는데 64사이클이 소요된다.

3차 혼변조 왜곡 특성이 우수한 K-band 상향변환기 설계 (The Design of K-band Up converter with the Excellent IMD3 Performance)

  • 정인기;이영철
    • 한국정보통신학회논문지
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    • 제8권5호
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    • pp.1120-1128
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    • 2004
  • 본 논문에서는 우수한 OIP3(ouput intercept point) 특성을 가지는 평형전력증폭단을 설계하고 이를 적용하여 K-band 상향변환기를 설계 및 제작하였다. 상향변환기의 구성은 전력 증폭기단, 국부발진신호 제거필터, 주파수혼합기및 IF단으로 구성하였으며 RF 경로의 동작 유무를 판단하기 위한 국부 루프 경로와 출력 전력을 감시하기 위한 감시 단자로 구성하여 소요되는 전력을 예측하였다. K-대역 MMIC를 이용하여 평형전력증폭단을 제작하였으며 전력 예측값에 의하여 상향변환기를 설계 제작하였다. 설계된 상향변환기의 이득은 $40\pm$2dB, PldB는 29dBm의 특성을 가지며, OIP3는 37.25dBm의 높은 특성이 나타내었다. 특히 전력증폭단의 MMIC를 조정하여 30dB이상의 이득을 제어하였다. 본 논문에서 제작한 상향변환기는 PTP 및 PTMP용 트랜시버에 사용할 수 있으며, QAM 및 QPSK 변조방식을 이용하는 디지털 통신 시스템 및 BWA(Broad Wireless System)에도 적용할 수 있다.