• 제목/요약/키워드: jitter accumulation

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0.11-2.5 GHz All-digital DLL for Mobile Memory Interface with Phase Sampling Window Adaptation to Reduce Jitter Accumulation

  • Chae, Joo-Hyung;Kim, Mino;Hong, Gi-Moon;Park, Jihwan;Ko, Hyeongjun;Shin, Woo-Yeol;Chi, Hankyu;Jeong, Deog-Kyoon;Kim, Suhwan
    • JSTS:Journal of Semiconductor Technology and Science
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    • 제17권3호
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    • pp.411-424
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    • 2017
  • An all-digital delay-locked loop (DLL) for a mobile memory interface, which runs at 0.11-2.5 GHz with a phase-shift capability of $180^{\circ}$, has two internal DLLs: a global DLL which uses a time-to-digital converter to assist fast locking, and shuts down after locking to save power; and a local DLL which uses a phase detector with an adaptive phase sampling window (WPD) to reduce jitter accumulation. The WPD in the local DLL adjusts the width of its sampling window adaptively to control the loop bandwidth, thus reducing jitter induced by UP/DN dithering, input clock jitter, and supply/ground noise. Implemented in a 65 nm CMOS process, the DLL operates over 0.11-2.5 GHz. It locks within 6 clock cycles at 0.11 GHz, and within 17 clock cycles at 2.5 GHz. At 2.5 GHz, the integrated jitter is $954fs_{rms}$, and the long-term jitter is $2.33ps_{rms}/23.10ps_{pp}$. The ratio of the RMS jitter at the output to that at the input is about 1.17 at 2.5 GHz, when the sampling window of the WPD is being adjusted adaptively. The DLL consumes 1.77 mW/GHz and occupies $0.075mm^2$.

디지털 중계단에서 랜덤 지터 누적의 수렴을 위한 루우프 여파기의 제한조건 (Constraint Condition of the Loop Filter for the Convergence of Random Jitter Accumulation in Digital Repeater Chain)

  • 유흥균;안수길
    • 대한전자공학회논문지
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    • 제24권4호
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    • pp.548-552
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    • 1987
  • The constraint condition of the loop filter is persented for the convergence of the random jitter accumulation fo the 2-nd order PLL (phase-locked loop) circuit used in digital regenerative repeater. This condition is confirmed under the assumption that the number of repeater chain is 5, bandwidth is 100. 0KHz, the power spectral density of white Gaussian noise is 1.0x10**-6 [W/Hz]. Also, it is shown that if the condition is satisfied, the accumulated random jitter and the alignment jitter will have the saturation characteristics.

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향상된 고성능 VCDL(Voltage Controled Delay Line) (A Improved High Performance VCDL(Voltage Controled Delay Line))

  • 이지현;최영식;류지구
    • 한국정보통신학회:학술대회논문집
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    • 한국해양정보통신학회 2003년도 추계종합학술대회
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    • pp.394-397
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    • 2003
  • 최근의 system 내에서 동작속도가 급속히 증가함에 따라 단일 chip 내에서도 각부분의 clock 동기의 필요성이 요구되고 있다. 이러한 요구를 만족시키기 위해 PLL (Phase Locked Loop) 흑은 DLL (Delay Locked Loop)과 같은 clock를 동기 시켜 주는 회로가 사용되고 있다. PLL 내에서 주파수를 발생시키는 VCO (Voltage Controled Oscillator)는 jitter의 축적과 higher order system으로 인한 unstable한 특성과 설계하기 어렵다는 단점이 있다. 반면에 DLL에서 사용되는 VCDL (Voltage Controled Delay Line)은 first order system으로 동작이 stable하고 설계하기 쉬우며, no jitter의 장점을 가지고 있다. 본 연구에서는 기존의 VCDL의 단점을 개선하여 보다 안정적인 동작을 하는 VCDL을 제안하고자 한다.

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Re-timing 기능을 생략한 광/전/광 파장변환기의 cascadability 분석 및 측정 (Analysis and measurement of the cascadability for 2R O/E/O wavelength converter)

  • 장윤선;김광준
    • 한국광학회지
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    • 제14권3호
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    • pp.215-218
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    • 2003
  • 2R 광/전/광 파장변환기는 이미 검증된 기술을 사용하여 간단히 구현할 수 있으며 데이터 전송율을 제한하지 않는다는 장점이 있다. 그러나, 이 방식은 각 파장변환기를 통과하면서 타이밍 지터 성분이 계속 누적되어 cascadability가 제한된다 본 논문에서는 통상적인 정현파 신호 모델 대신 보다 현실적인 비선형 신호 모델을 제안하여 시스템 성능에 미치는 타이밍 지터의 영향 및 2R 광/전/광 파장변환기의 cascadability를 이론적으로 분석하였으며, 40-km re-circulation loop 실험 장치에서 10 Gb/s 신호에 대한 cascadability를 측정하여 계산 결과와 비교하였다.

연속적으로 연결된 스타핑동기장치들에서 발생되는 지터에 관한 연구 (Accumulation of Jitter in a Chain of Stuffing Systems)

  • 최승국
    • 한국통신학회논문지
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    • 제19권8호
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    • pp.1558-1570
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    • 1994
  • 스타핑시스템이 한 개 또는 여러개 연속적으로 연결되었을때 발생되는 이상적인 스타핑지터에 대하여 연구하였다. 스타핑비가 두 개의 서로 나누어 떨어지지 않는 간단한 수로 이루어지는 분수값 근처의 값을 가질때 크기가 큰 지터가 발생한다. 연속적으로 여러 개 연결된 스타핑시스템에서도 각 시스템이 위와 같은 스타핑비로 동작할때 큰 크기의 축적된 지터가 발생한다. 시스템의 수에 따라 증가되는 이러한 지터의 실효치와 확률빌도함수가 계산되었으며 제작된 하드웨어 시뮬레이터를 이용하여 그 결과가 확인되었다.

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UHF대역 RFID 수신단(리더)의 지터(비트동기) 및 글리치 제거회로 설계 (Implementation of a Jitter and Glitch Removing Circuit for UHF RFID System Based on ISO/IEC 18000-6C Standard)

  • 김상훈;이용주;심재희;이용석
    • 한국통신학회논문지
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    • 제32권1A호
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    • pp.83-90
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    • 2007
  • 본 논문에서는 ISO/IEC 18000-6C 표준안을 만족하는 UHF대역 RFID 수신단(리더)의 지터(Jitter)처리와 글리치제거 알고리듬 및 설계방안을 제안하고 이를 이용한 리더를 구현하여 실제 TI(Texas instrument) Gen2 태그의 응답을 분석하였다. ISO/IEC 18000-6C표준안은 Reader에서 Tag로 데이터 전송 시 +/-1%의 오차와 Tag에서 Reader로 데이터 전송 시 최대 +/-22%의 오차를 허용하도록 정의하고 있다. 이러한 허용오차범위 내의 데이터에 대해 본 논문에서 제시한 회로는 기존의 PLL(DPLL, ADPLL)을 이용한 방식이 아닌 최대허용치(tolerance)와 허용치누적을 이용하여 일정치의 오차범위를 허용하며 디코딩 하도록 설계하였다. 또한 글리치와 지터제거 알고리듬의 기본원리를 동일하게 구성하여 글리치제거와 지터제거를 따로 구분하지 않고 하나의 기능으로 동작하게 한다. 주 클럭은 19.2MHz로 설정하였으며 LF는 국내 전파법에 맞도록 40kHz로 설정하였다 시뮬레이션결과 15%이하의 위상지터를 가진 입력데이터에 대해 판독에러율은 0이었으며 $15%{\sim}22%$ 위상지터를 가진 입력데이터에 대해서 는 0.000589였다. 그러나 동적LF생성회로를 사용한 결과 $15%{\sim}22%$ 위상변화를 가진 입력데이터에 대해 판독에러율은 0이었으며 표준안에 정의된 최대 +/-22%오차 범위내의 지터 발생에 대해서 판독에러율은 0이었다.

디지틀 전송에서 시스템/랜덤 지터 누적 (Systematic and Random Jitter Accumulation in Digital Transmission)

  • 유홍균;안수길
    • 한국음향학회지
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    • 제5권2호
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    • pp.13-18
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    • 1986
  • 디지틀 데이터 전송시 수신기에서 또는 중계기에서 송신 데이터를 구하기 위해서는 타이밍 클럭 을 복원해야 한다. 대개의 실장된 경우에서는 PLL을 이용하는데, 이때 시스템/랜덤 지터가 발생되고 또 중계기가 늘어남에 따라서 생성된 지터가 누적되는데 이것을 해석하였다. 90 Mbps 광통신 시스템에 적 용하여 테이블 1,2,3,4와 같은 결과를 얻었으며, 시스템 지터가 랜덤 지터보다 더 급격히 누적됨을 알았 고, 또한 댐핑팩터가 커짐에 따라 지터 누적이 양화됨을 알았다.

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음성신호 처리 기술을 적용한 탄산음료와 유칼립투스 발향이 발음에 미치는 영향 분석 (Pronunciation Influence Analysis of Carbonate Drink and Eucalyptus Fragrance by Applying Speech Signal Processing Techniques)

  • 김봉현;조동욱
    • 한국통신학회논문지
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    • 제37권5C호
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    • pp.420-428
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    • 2012
  • 현대와 같은 스마트사회에서 NQ라 불리우는 대인관계의 효율을 극대화 시키는 것은 대단히 중요한 요소가 되고 있다. 특히 대인 관계 시 목소리가 미치는 영향이 38%나 차지하고 있는 실정이므로 발음을 좋게 하기 위한 다각적 방법 마련이 사회적 요구사항이 되고 있는 실정이다. 이를 위해 본 논문에서는 일상생활에서 대화 중 흔히 섭취하는 탄산음료와 유칼립투스 발향이 발음에 미치는 영향을 음성신호 처리 기술을 적용하여 규명해 내는 방법을 제안하고자 한다. 특히 탄산음료의 경우 섭취량에 따라 그것이 발음에 어떤 영향을 미치는지를 분석해 보고자하며 기관지에 효과적인 유칼립투스의 경우도 그 발향이 발음에 미치는 영향을 새롭게 규명해 보고자 한다. 이를 위해 성대 진동의 변화율과 진폭의 규칙성을 분석하고 피치와 음성 에너지의 크기를 분석하여 탄산음료 섭취량과 유칼립투스 발향이 발음에 미치는 영향을 정량화, 객관화, 수치화를 행하고자 한다.