• 융합신호처리학회논문지
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• 제17권1호
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• pp.1-9
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• 2016

본 논문에서는 이기종 네트워크의 QoS 성능 향상을 위한 멀티 셀 스케줄링을 제안한다. 제안된 알고리즘 구현을 위하여 UE 처리량에 미치는 영향을 인식하고자 분산형 구조의 매크로-피코 배치 시나리오와 중앙 집중식 구조의 매크로-RRH 배치 시나리오를 제안하여 이기종 네트워크 시스템을 구성한다. 제안되는 시스템의 간섭완화를 위해 선택적 서브프레임을 적용하고 각 서브프레임 기간의 CQI 측정을 통하여 시스템 상황에 따른 제약조건을 측정하며, 시스템의 단순화를 위해서 동일한 ABS를 적용하여 뮤팅 패턴을 가정한다. ABS를 이용하는 것은 전송시간 구간의 일부를 매크로 셀이 전송하지 않게 설정하고 이 구간에서 피코 셀에서만 전송하도록 설정하기 위한 것이다.

• 한국음향학회지
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• 제26권2호
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• pp.87-94
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• 2007

LFM 신호를 이용한 능동소나 신호처리에서는 Split-beam을 이용한 좌우 두 빔 사이의 상호상관관계를 측정함으로써 표적의 자세각과 길이 정보를 추정할 수 있다. 그러나 탐지된 원거리 표적의 정보를 추정하기 위해서는 고분해능의 방위각 및 거리 해상도가 요구된다. 이를 위해 나이키스트(Nyquist) 샘플링 주파수보다 높은 샘플링 주파수가 필요하므로, 일반적으로 보간기법을 이용하여 과도샘플링(over-sampling) 을 해야 한다. 하지만 과도 샘플링된 좌우 빔신호를 이용하여 상호상관관계를 구할 경우, 요구되는 연산량과 메모리 용량이 일반적으로 상용 DSP 프로세서들의 처리용량과 내부 메모리 용량을 초과하게 되어 DSP를 이용한 실시간 구현이 어렵게 된다. 본 논문에서는 이러한 문제를 해결하기 위해 누적처리기법을 이용한 Split-beam처리 방법을 제안하였다. 제안한 기법의 성능을 모의실험을 통하여 검증하고, ADSP-TS101을 사용하여 실시간 시스템으로 구현하였다.

• 한국정보통신학회:학술대회논문집
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• 한국정보통신학회 2018년도 추계학술대회
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• pp.480-483
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• 2018

본 논문에서는 CMOS센서 기반 가시광 통신 시스템에서 고속전송을 위한 다중 광원의 간섭제거 및 이미지 센싱 처리기술에 대해서 연구하였다. 이미지센서를 통한 광학카메라 통신에서 전송 용량을 향상 시키려면 각 LED에서 다른 데이터를 동시에 전송해야한다. 그러나 고속전송을 위한 다수의 LED광원 환경은 인접한 LED 간 간섭을 일으킬 수 있다. 이 경우, 가시광통신시스템은 일반적으로 세기 변조를 사용하기 때문에 다수의 LED가 동시에 데이터를 전송할 경우 인접한 LED의 빛 퍼짐 간섭으로 인해 각각의 LED들의 정확한 신호 검출이 어렵다. 이러한 문제를 해결하기 위해서, 듀얼 CMOS 센서를 사용하여 다수의 광원 LED의 ON/OFF 상태를 정확히 인식하고, 각각의 LED들의 이미지 시그널 프로세싱 기법을 제안하였다. 이러한 기법을 통해 다수의 LED픽셀을 정확하게 인식하여 다중LED OCVLC 시스템의 총 평균 비트 오류율과 처리량을 향상시킬 수 있다.

• 정보처리학회논문지B
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• 제13B권6호
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• pp.579-584
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• 2006

본 연구는 카운팅 정합도라 불리는, 비선형 정합도를 척도로 하는 템플릿 정합법을 이용하여 온-오프 형태 DNA칩의 탐색자를 구분하는 방법을 제안한다. 또한, 스팟 템플릿의 다양한 위치나 크기에 따른 응답의 최대값을 찾는 최대 응답 탐색법을 제안한다. 각 스팟의 교잡반응 여부만을 분류하는 온-오프 형태의 DNA 칩의 탐색자를 구분하는 용도에 제안된 방법을 적용하였다 2390명의 환자에 대한 인유두종 바이러스 DNA 칩 검사에 적용하여, 카운팅 정합도를 기존의 정규상관도나 메디안과 비교하였다. 카운팅 정합도가 최대 응답 탐색법에 관계없이 최고의 성능을 보였다. 실험결과 위치탐색을 결합한 카운팅 정합도가 가장 적절하였다.

• 한국통신학회논문지
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• 제30권1A호
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• pp.70-75
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• 2005

이동 멀티미디어 서비스를 위한 통신 시스템에서 고속으로 데이터를 송신하고 수신함에 따라 발생하는 인접 심벌간의 간섭(Inter Symbol Interference : ISI) 왜곡을 줄이기 위한 방식으로 직교 주파수 분할 다중화(Orthogonal Frequency Division Multiplexing : OFDM) 방식에 대한 연구가 활발하게 진행되고 있다. 고속 무선 LAN이 표준방식으로 채택한 OFDM 방식이 부 반송파의 수가 많아짐에 따라 변복조부를 실제 시스템으로 구현하기가 어려운 단점이 있었다. 그러므로 본 논문에서는 파이프라인 방식을 이용해서 변복조부를 설계하여 많은 수의 버터플라이(Butterfly) 연산자를 감소시켰다. 또한 고속의 처리속도를 만족시키기 위해서 64 포인트를 처리하는 버터플라이 구조를 각각 32 포인트씩 병렬처리 하도록 구성하였다.

• 한국정보전자통신기술학회논문지
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• 제13권1호
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• pp.42-47
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• 2020

OFDM 기반 초고속 통신시스템을 위한 IFFT/FFT 프로세서는 저면적 저전력이면서 데이터 처리량이 높고 프로세싱 지연이 적어야 한다. 따라서, 파이프라인과 병렬처리를 적용한 radix-2k 알고리즘 기반 MDF(multipath delay feedback) 구조가 적합하다. 기존의 MDF 구조에서 입력신호의 워드길이에 비례하여 커지는 피드백 메모리는 면적과 전력소모가 크다. 본 논문에서는 OFDM 응용을 위한 radix-22 MDF IFFT 프로세서의 피드백 메모리 크기 감소 방법을 제안한다. MDF 구조에서 첫 두 스테이지의 피드백 메모리의 크기는 전체 피드백 메모리의 75%를 차지하므로 첫 두 스테이지의 피드백 메모리 크기 감소에 초점을 맞춘다. OFDM 전송에서 IFFT 입력신호는 변조데이터와 파일럿과 널 신호로 구성된다는 특징을 이용하여 변조데이터와 파일럿/널 신호를 각각 부호있는 정수로 매핑하여 입력신호의 워드길이를 감소시키는 방법을 제안한다. 시뮬레이션을 통해 제안한 방법이 기존 방법보다 피드백 메모리의 크기를 약 39%까지 감소시킬 수 있음을 보인다.

• 한국통신학회논문지
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• 제23권6호
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• pp.1409-1418
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• 1998

최근의 오디오 압축 알고리듬은 다양한 코딩 기법을 조합하여 사용하고 있다. 이들은 DSP 작업(DSP task), 제어 작업(controller task), 그리고 혼합 작업(mixed task)으로 나눌 수 있다. 기존의 DSP 프로세서들은 이들 중 DSP 작업만을 효율적으로 설계되어 있어 제어작업이나 혼합작업에 대해서는 자원을 효율적으로 활용하지 못하는 단점이 있다. 본 논문에서는 기존의 DSP 프로세서가 가지는 DSP 작업에 대하여 고성능을 그대로 유지하면서 제어작업과 혼합작업에서도 좋은 성능을 가지는 새로운 구조를 제안하고 구현하였다. 제안된 프로세서 YSP-3는 4개의 실행 유닛 (곱셈기, 2개의 ALU, 메모리 접근 유닛)을 병렬로 배치한 후 4-way 수퍼스칼라명령어 구조를 사용하여 각 우ㅠ닛을 독립적으로 사용할 수 있도록 하였다. 제안된 구조는 일반적인 DSP 알고리듬과 AC-3 디코딩 알고리듬을 실행하여 성능을 평가하였다. 마지막으로 VHDL을 통해 $0.6\$\mu$textrm{m}$-3ML 표준셀 기술로 합성한 후 Compass상에서 모의실험으로 통해 33MHz의 시스템 클럭에 대해 최대 지연시간 상황에서 실시간 동작을 확인하였다.

• 한국정보전자통신기술학회논문지
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• 제12권3호
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• pp.179-185
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• 2019

본 논문은 저전력 특징추출 알고리즘의 구현을 위한 블록 유형 분류 기반 영상 이진화 방법을 제안한다. 제안하는 방법은 영상 내에서 $64{\times}64$ macro block 크기로 영상을 나누고 각 블록 유형별 threshold 값을 한 번만 연산한 후 그 값을 re-use 하는 기법으로 구현될 수 있다. 알고리즘은 threshold 값이 같은 영상/블록 유형 내에서 최대 9%의 변화율만 발생하는 것을 정량적인 결과를 기반으로 검증했다. 기존 알고리즘은 $512{\times}512$ 이미지 기준으로 macro block을 $64{\times}64$로 나누었을 때 64개의 블록을 위해 threshold 값을 연산해야 하지만 제안하는 방법은 모두 같은 블록 유형이 출력되는 best case의 경우 threshold 연산을 한번만 수행하고, 나머지 63개의 블록에 대해서는 블록 유형 구분 과정만 수행하면 adaptive threshold calculation 연산을 98% 생략할 수 있다. 모든 블록 유형이 발생하는 worst case일 때 threshold calculation 연산은 다섯 번 수행되고, 나머지 59개의 블록에 대해서는 블록 유형 구분 과정만 수행할 수 있으므로 93%의 adaptive threshold calculation 연산을 생략할 수 있다.

• 한국정보전자통신기술학회논문지
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• 제10권2호
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• pp.192-197
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• 2017

본 논문은 저전력 영상 특징 추출 하드웨어 설계를 위한 공통 부분식 제거 기법 기반 이미지 필터 하드웨어 최적화 기법을 제안한다. 저전력 및 고성능 물체인식 하드웨어는 공장 자동화를 위한 산업용 로봇에 필수 모듈로 채택되고 있다. 따라서 물체인식 하드웨어의 영상 특징 추출 알고리즘에 다양하게 적용되는 Gaussian gradient 필터 하드웨어의 저면적 설계가 필수적이다. Gaussian gradient 필터의 하드웨어 복잡도를 줄이기 위해 필터에 사용되는 계수의 Symmetric한 특징과 Transposed form FIR 필터 하드웨어 구조를 이용했다. 제안된 이미지 필터의 하드웨어 구조는 알고리즘에 적용된 계수의 변형 없이 구현되었기 때문에 윤곽선 검출 알고리즘에 적용했을 때 검출 데이터의 열화 없이 구현될 수 있다. 제안된 이미지 필터 하드웨어 구조는 기존 구조와 비교했을 때 곱셈기의 수를 50% 절감할 수 있음을 확인했다.

• 한국정보전자통신기술학회논문지
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• 제9권4호
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• pp.414-418
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• 2016

본 논문은 저면적 gradient magnitude 연산을 위한 하드웨어 구조를 제안한다. 하드웨어 복잡도를 줄이기 위해 정사영 벡터의 특징 및 하드웨어 자원 공유기법을 이용했다. 제안된 하드웨어 구조는 gradient magnitude 연산 알고리즘의 변형 없이 구현되었기 때문에 gradient magnitude 데이터 품질의 열화 없이 구현될 수 있다. 제안된 저면적 gradient magnitude 연산 하드웨어는 Altera Quartus II v15.0 환경에서 Altera Cyclone VI (EP4CE115F29C7N) FPGA를 이용하여 구현되었다. 구현 결과, 기존 하드웨어 구조를 이용하여 구현한 연산기와의 비교에서 15%의 logic elements 및 38%의 embedded multiplier 절감 효과가 있음을 확인했다.